一种SERDES数据速率自适应系统及SERDES的制作方法

本申请涉及数据处理技术领域，更具体地说，涉及一种serdes数据速率自适应系统及serdes。

背景技术：

serdes，是serializer(串行器)/deserializer(并行器)的缩写，广泛应用于时分多路复用(timedivisionmultiplexing，tdm)、点对点(p2p)的串行通信技术领域。serdes在发送端将多路低速并行信号被转换成高速串行信号，经过传输媒体(光缆或铜线)传输后在接收端将高速串行信号重新转换成低速并行信号，以实现充分利用传输媒体的信道容量，减少所需的传输信道和器件引脚数目，提升信号的传输速度，从而大大降低通信成本的目的。

但是由于serdes存在数据速率下限，即不能应用于数据速率较低的场合，不能适应某些低速应用，从而降低了serdes的适用性。

技术实现要素：

为解决上述技术问题，本发明提供了一种serdes数据速率自适应系统及serdes，以实现将serdes适用于数据速率较低的场合，拓展serdes的适用性的目的。

为实现上述技术目的，本发明实施例提供了如下技术方案：

一种serdes数据速率自适应系统，包括：模式转换模块和数据采样模块；其中，

所述模式转换模块用于将输入用户数据转换为串行输入用户数据，并传输给所述数据采样模块，和用于将接收的输出数据转换为并行输出的用户数据进行输出；

所述数据采样模块用于根据所述串行输入用户数据确定第一采样频率，并根据所述第一采样频率对所述串行输入用户数据进行数据采样，获得高频数据向serdes传输，和用于根据所述serdes输出的数据确定第二采样频率，并根据所述第二采样频率对所述serdes输出的数据进行数据恢复，获得输出数据向所述模式转换模块传输；

所述第一采样频率大于奈奎斯特采样频率。

可选的，所述数据采样模块包括：相位检测单元、低通滤波单元、采样单元、周期计算单元、时钟产生单元和过采样恢复电路；其中，

所述相位检测单元用于接收所述串行输入用户数据，并检测所述串行输入用户数据的数据相位，根据所述串行输入用户数据的数据相位计算输入用户数据频率；

所述低通滤波单元用于对所述输入用户数据进行低通滤波；

所述周期计算单元用于根据所述输入用户数据频率计算输入用户数据速率，并根据所述输入用户数据速率确定第一采样频率时钟周期；

所述时钟产生单元用于根据所述第一采样频率时钟周期产生第一采样频率时钟向所述采样单元传输，和用于根据第二采样频率时钟周期产生第二采样频率时钟，并向所述过采样恢复电路传输；

所述过采样恢复电路用于对所述serdes输出的数据进行滤波整形和相位检测，确定所述第二采样频率时钟周期向所述时钟产生单元传输，并根据所述时钟产生单元传输的第二采样频率时钟对所述serdes输出的数据进行数据恢复，获得输出数据。

可选的，所述周期计算单元包括：速率计算单元和转换率计算单元；其中，

所述速率计算单元用于根据所述输入用户数据频率计算数据速率；

所述转换率计算单元用于根据所述数据速率计算确定所述第一采样频率时钟周期。

可选的，所述时钟产生单元为数控晶振。

可选的，所述模式转换模块包括：串行转并行单元和并行转串行单元，其中，

所述串行转并行单元用于将输入用户数据转换为串行输入用户数据，并传输给所述数据采样模块；

所述并行转串行单元用于将接收的输出数据转换为并行输出的用户数据进行输出。

可选的，所述串行转并行单元具体用于判断所述输入用户数据是否为串行数据，如果是，则将其作为所述串行输入用户数据传输给所述数据采样模块，如果否，则将所述输入用户数据转换为串行输入用户数据，并将其传输给所述数据采集模块。

可选的，所述并行转串行单元具体用于判断接收的输出数据是否为并行数据，如果是，则将其作为所述并行输出的用户数据进行输出，如果否，则将接收的输出数据转换为并行输出的用户数据并进行输出。

一种serdes，包括如上述任一项所述的serdes数据速率自适应系统。

从上述技术方案可以看出，本发明实施例提供了一种serdes数据速率自适应系统及serdes，其中，所述serdes数据速率自适应系统通过所述数据采样模块对所述串行输入用户数据以所述第一采样频率进行过采样，以实现数据速率的提升，使向serdes输出的高频数据能够满足serdes的数据速率的要求；并且所述数据采样模块还可以对所述serdes输出的数据利用所述第二采样频率进行过采样数据的恢复，以保证所述serdes数据速率自适应系统的输出数据的正确性。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据提供的附图获得其他的附图。

图1为本申请的一个实施例提供的一种serdes数据速率自适应系统的结构示意图；

图2为本申请的另一个实施例提供的一种serdes数据速率自适应系统的结构示意图；

图3为本申请的又一个实施例提供的一种serdes数据速率自适应系统的结构示意图。

具体实施方式

下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。

本申请实施例提供了一种serdes数据速率自适应系统，如图1所示，包括：模式转换模块100和数据采样模块200；其中，

所述模式转换模块100用于将输入用户数据转换为串行输入用户数据，并传输给所述数据采样模块200，和用于将接收的输出数据转换为并行输出的用户数据进行输出；

所述数据采样模块200用于根据所述串行输入用户数据确定第一采样频率，并根据所述第一采样频率对所述串行输入用户数据进行数据采样，获得高频数据向serdes传输，和用于根据所述serdes输出的数据确定第二采样频率，并根据所述第二采样频率对所述serdes输出的数据进行数据恢复，获得输出数据向所述模式转换模块100传输；

所述第一采样频率大于奈奎斯特采样频率。

需要说明的是，所述serdes数据速率自适应系统通过所述数据采样模块200对所述串行输入用户数据以所述第一采样频率进行过采样，以实现数据速率的提升，使向serdes输出的高频数据能够满足serdes的数据速率的要求；并且所述数据采样模块200还可以对所述serdes输出的数据利用所述第二采样频率进行过采样数据的恢复，以还原所述serdes输出的数据，保证所述serdes数据速率自适应系统的输出数据的正确性。

也可以说所述serdes数据速率自适应系统是用在用户数据接口和serdes之间作为一个速率过渡电路使用。所述serdes数据自适应系统将输入用户数据升频后发送到serdes，恢复电路从serdes接收高频的过采样数据进行恢复后传到用户数据接口的接收端。

在上述实施例的基础上，在本申请的一个实施例中，如图2所示，所述数据采样模块200包括：相位检测单元210、低通滤波单元220、采样单元250、周期计算单元230、时钟产生单元240和过采样恢复电路260；其中，

所述相位检测单元210用于接收所述串行输入用户数据，并检测所述串行输入用户数据的数据相位，根据所述串行输入用户数据的数据相位计算输入用户数据频率；

所述低通滤波单元220用于对所述输入用户数据进行低通滤波；

所述周期计算单元230用于根据所述输入用户数据频率计算输入用户数据速率，并根据所述输入用户数据速率确定第一采样频率时钟周期；

所述时钟产生单元240用于根据所述第一采样频率时钟周期产生第一采样频率时钟向所述采样单元250传输，和用于根据第二采样频率时钟周期产生第二采样频率时钟，并向所述过采样恢复电路260传输；

所述过采样恢复电路260用于对所述serdes输出的数据进行滤波整形和相位检测，确定所述第二采样频率时钟周期向所述时钟产生单元240传输，并根据所述时钟产生单元240传输的第二采样频率时钟对所述serdes输出的数据进行数据恢复，获得输出数据。

具体地，所述周期计算单元230包括：速率计算单元231和转换率计算单元232；其中，

所述速率计算单元231用于根据所述输入用户数据频率计算数据速率；

所述转换率计算单元232用于根据所述数据速率计算确定所述第一采样频率时钟周期。

在本申请的一个具体实施例中，所述时钟产生单元240为数控晶振。但本申请对所述时钟产生单元240的具体种类并不做限定，具体视实际情况而定。

在上述实施例的基础上，在本申请的又一个实施例中，如图3所示，所述模式转换模块100包括：串行转并行单元110和并行转串行单元120，其中，

所述串行转并行单元110用于将输入用户数据转换为串行输入用户数据，并传输给所述数据采样模块200；

所述并行转串行单元120用于将接收的输出数据转换为并行输出的用户数据进行输出。

在本申请的一个优选实施例中，所述串行转并行单元110具体用于判断所述输入用户数据是否为串行数据，如果是，则将其作为所述串行输入用户数据传输给所述数据采样模块200，如果否，则将所述输入用户数据转换为串行输入用户数据，并将其传输给所述数据采集模块。

在本实施例中，所述串行转并行单元110对于原本就是串行数据的输入用户数据不进行数据传输形式的转换，降低了所述serdes数据速率自适应系统的数据处理量，提高了所述serdes数据速率自适应系统的响应速度。

所述并行转串行单元120具体用于判断接收的输出数据是否为并行数据，如果是，则将其作为所述并行输出的用户数据进行输出，如果否，则将接收的输出数据转换为并行输出的用户数据并进行输出。

同样的，所述并行转串行单元120对于原本就是并行数据的输出数据不进行数据转换，降低了所述serdes数据速率自适应系统的数据处理量，提高了所述serdes数据速率自适应系统的响应速度。

相应的，本申请实施例还提供了一种serdes，包括如上述任一实施例所述的serdes数据速率自适应系统。

综上所述，本申请实施例提供了一种serdes数据速率自适应系统及serdes，其中，所述serdes数据速率自适应系统通过所述数据采样模块200对所述串行输入用户数据以所述第一采样频率进行过采样，以实现数据速率的提升，使向serdes输出的高频数据能够满足serdes的数据速率的要求；并且所述数据采样模块200还可以对所述serdes输出的数据利用所述第二采样频率进行过采样数据的恢复，以保证所述serdes数据速率自适应系统的输出数据的正确性。

本说明书中各个实施例采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似部分互相参见即可。

对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本发明。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本发明的精神或范围的情况下，在其它实施例中实现。因此，本发明将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。