一种可锁相恒定频率的多相操作电路的制作方法

本发明涉及电源管理领域，特别是涉及一种可锁相恒定频率的多相操作电路。

背景技术：

随着便携式电子产品的普及，电源管理系统越来越重要，对于电源性能的要求也越来越高，多相大电流的开关电源应运而生。对于需要大电流的输出负载，可以把多个芯片级联起来，并使它们异相操作，以在不增加输入和输出电压纹波的情况下提供更大的输出电流。

多相电源能显著地减小输入和输出电容器中的纹波电流值。rms输入纹波电流等于与采用的相位数量相除，而有效纹波频率则等于与所采用的相位数量相乘(假设输入电压高于所使用的相位数量与输出电压的乘机)。输出纹波幅度的减小与所采用的相位数之间的关系和输入纹波电流的情况是相同的。

单级设计的最坏情况rms纹波电流在输入电压为输出电压的两倍时达到峰值。对于一个两级设计而言，最坏情况rms纹波电流将产生幅度为输入电压的1/4和3/4的峰值输出。当计算rms电流时，将产生较高的有效占空比，而且只要每一级中的电流是平衡的，则峰值电流值将被等分。对于一个两相转换器，输出电流峰值减半，而频率将倍增，输入电容降低到原来的1/4。采用更多的相位将在电容器方面实现极大的节省。

技术实现要素：

本发明要解决的技术问题是提供一种多相操作电路，能够满足提供高输出电流的基础上减小电流纹波的功能。

一种可锁相恒定频率的多相操作电路特征包括以下模块：振荡器，锁相环，相位选择电路，相位差产生电路。对于多相操作电路，第一片的频率为内部振荡器产生，产生的频率输出到第二片，经锁相环锁相后，第二片与第一片频率相位都相同，这时第二片内的相位选择电路工作，产生相位差，使得第二片的内部震荡频率与第一片相同，但相位不同，从而达到异相操作的目的，以此类推，最多可达到十二相操作。原理图如图1所示。因为要保证异相操作，所以所有芯片的频率要相同，但相位各不相同。本电路可以实现180度，120度，90度的相位差，依次对应于两相，3相，4相操作，总共可以级联12相。

由于每个芯片的输出电流为7a，级联12相的话总的输出电流可以达到84a，满足了用户对大电流的要求。

因此本发明具有如下特点：(1)可产生最高可达84a的大电流，满足用户需求。(2)由于采用了异相操作模式，可以使得在获得大电流的同时，并未增加输入和输出电压纹波。(3)相位可选择电路利用反相器和d触发器的延迟，巧妙实现了相位差，简化了电路。

附图说明

图1为振荡器电路

图2为多相操作电路模型

图3为分频电路

图4为锁相环电路

图5为相位选择电路

图6为相位差产生电路

具体实施方式

为使本发明的上述特征和优点更加清晰，下面结合附图对本发明的具体实施方式做详细的说明。

图1为振荡器电路，振荡器为电流控制振荡器(ico)由

i×t＝c×v(1)

可知在电容和翻转电压不变的情况下可以通过改变电流i的大小来改变振荡周期即振荡频率。振荡器通过电流i2充电，电流i1放电，充放电电容为c1，电流i1和i2都为电流基准镜像过来的电流，大小相等，通过电流对电容的充放电作用产生9mhz的振荡频率。

图2为多相操作电路模型，包括两相操作电路，3相操作电路，4相操作电路，6相操作电路，12相操作电路，本文重点介绍两相操作，其余同理。

图3为分频电路，本电路通过级联d触发器并通过与非门与反相器等逻辑电路的作用产生分频，三个d触发器的输出都为前面电路的6分频，即此时的频率为1.5mhz,。

图4为锁相环电路，锁相环包括鉴频鉴相器、电荷泵、环路滤波器组成以及前面的振荡器组成。相位检波器为边缘敏感数字型，它在外部时钟和内部振荡器之间提供了0度相移，该相位检波器输出是一对互补电流源，用于对后面的电荷泵进行充放电。如果外部频率高于内部振荡器频率，则连续提供电流，从而将上拉plllpf引脚电压。当外部频率低于内部振荡器频率时，将连续吸收电流，从而下拉plllpf引脚电压。如果外部频率与内部频率相同但存在相位差，电流源在一个与相位差对应的时间里导通，对plllpf引脚上的电压进行调整，直到外部时钟与内部振荡器相位和频率相等为止。

电荷泵锁相环能检测输入与输出的跳变，检测相位差或频率差，故不管是频率不同还是相位不同，pfd都是通过比较两者的上升沿来工作的。外部时钟与内部时钟分别作为两个d触发器的输入，当外部时钟上升沿早于内部上升沿出现时，上面输出高电平，这时上面开关s1导通，给电荷泵充电，不断有电荷在c1上积累，使得lpf电压升高，从而使得内部振荡器vco的频率升高，当下面上升沿也出现时，这时上下同时输出高电平，通过与门使得两个d触发器复位。当内部时钟上升沿早于外部时钟出现时，下面输出高电平，这时下面开关s2导通，电荷泵放电，c1上的电荷不断减少，使得lpf电压降低，从而使得内部振荡器vco的频率下降，当上面的上升沿也出现时，这时上下同时输出高电平，通过与门使得两个d触发器复位。

因为这个锁相环包含了两个极点，不稳定，在增益交点频率下会发生震荡，为修改系统相位特性，在环路增益中引入一个零点，也就是在环路滤波电容处串连一个电阻r1。另外由于i1，i2之间的不匹配以及s1，s2的电荷注入和时钟馈通，都会引起lpf电压跳动,所导致的波纹严重干扰了vco，从而损坏了相位，为缓解这个问题，引入电容c2以抑制电压的跳动，c2大约为c1的1/5到1/10。

图5为相位选择电路，通过调整phmode引脚电平的高低电平来控制相位差产生电路中的传输门导通与否。当phmode接高电平时，m1关断，m2导通，a,b都为高电平，这时通过数字逻辑x17_q为高电平，其他为低电平；当phmode接低电平时，m1导通m2导通，a,b都为低电平，这时通过数字逻辑x15_q为高电平，其他为低电平；当phmode浮置时，m1关断m2关断，a为高电平，b为低电平，这时通过数字逻辑x16_q为高电平，其他为低电平。

图6为相位差产生电路,ck1为前面振荡器产生的时钟信号，频率为9mhz，经过三个d触发器和反相器与非门作用，实现6分频，x17_q，x15_q，x16_q频率相同，但是存在相位差。x17_q通过锁相环与外部时钟的振荡频率和相位相同，当phmode接高电平时对应控制x17_q的传输门导通，x17_q经过一个反相器输出到clkout，进而传递给下一个芯片，这时候实现了相位差180度。当phmode接低电平时对应控制x15_q的传输门导通，x15_q与x17_q相位差为120度，x15_q直接传输到clkout，所以此时两个芯片之间的相位差为120度。当phmode浮置时，对应x16_q的传输门导通，x15_q与x17_q相位差为120度，x15_q经过一个反相器后与x17_q的相位差变为60度，然后作为触发器d4的输入，d4以ck1作为时钟触发信号，ck1与ck2反向，使得d4触发器的输入d与输出q相位差为30度，所以最后clkout与前面的时钟频率相差90度。所以当两相操作时，可以使phmode接高电平，这样两个芯片相位差为180度。当三相操作时，phmode接低电平，这样三个芯片之间相位差为120度。当四相操作时，phmode浮置，这样四个芯片之间相位差为90度。以此类推，这样可以使得每一个芯片与其他所有芯片的频率相同，但相位差都不相同，从而显著地减小了输入与输出电容器中的纹波电流值。

整体电路工作原理如下，在多相操作中，第一个芯片的内部时钟由内部振荡器产生，第二个芯片首先通过锁相环实现对前一级芯片的锁相锁频，然后再phmode引脚所接高低电平的作用下，产生与前一级有相位差的时钟信号，作为本芯片的内部时钟，同时传递给下一级芯片，以此类推，最终最多可以实现12相操作，实现大电流输出。

以上所述，仅是本发明的较佳实施例而已，并非对本发明作任何形式上的限制。任何熟悉本领域的技术人员，在不脱离本发明技术方案范围情况下，都可利用上述揭示的方法和技术内容对本发明技术方案做出许多可能的变动和修饰，或修改为等同变化的等效实施例。因此，凡是未脱离本发明技术方案的内容，依据本发明的技术实质对以上实施例所做的任何简单修改、等同变化及修饰，均仍属于本发明技术方案保护的范围内。