专利名称：对模拟-数字转换器的多个输入端的可选择性实时取样触发的制作方法
对模拟-数字转换器的多个输入端的可选择性实时取样触发 技术领域(根据一实施例，本发明涉及数字系统中所使用的模拟-数字转换器(ADC)，更具 体而言，涉及对ADC的多个输入的可选择性实时取样触发。
背景技术：
在功率转换应用中，需要测量每一脉宽调制(PWM)控制回路的电压及电流。 PWM信号控制一开关(例如晶体管、功率场效晶体管等)，使所述开关能够将电感器 充电至所希望的电流。所述PWM信号导通越久，则电感器充电越久，且因此电感器 龟流在PWM信号结束时处于其最大值。常常，在PWM信号结束时，应对电流及电 压进行测量，以实现最大的精确性及正确的PWM控制回路操作。因此，希望以脉宽 调制(PWM)信号(其控制通过电源电感器的电流)为基准的规定时刻捕获电源组件 (例如电感器)的电流及电压值。发明内容电源可需要多个PWM信号来控制多个功率电路，且这些多个PWM信号可相对 于彼此在随机的时刻出现。然而，ADC可局限于在一触发事件之后取得一序列模拟输 入样本。因此，可能无法在所需要的确切时刻取得ADC的模拟输入样本。现有的ADC 是在出现一命令(例如软件命令或控制信号)时取得一模拟输入样本并进行转换，但 仅在所选"触发"事件发生之后进行。然后，ADC按照顺序将所选的模拟输入样本转 换成数字值。所述顺序性样本相对于单个触发事件的定时关系会随着序列的进行而变 "陈旧"。在电源应用中，需要可在适合于电源电路实际活动的确切且唯一的时刻处取 得每一模拟信号样本。根据本发明一具体实例性实施例，ADC所处理的每一模拟输入都具有一相关的取样及保持电路。存在多个模拟输入对(例如，四对)，每一对都与用以起始一转换过程 的唯一触发源相关联。当每对模拟输入接收其规定的触发信号时，可对这些模拟输入 对上的模拟输入信号进行取样并保持，直到ADC转换逻辑准备将所取样的模拟输入 信号转换成供数字处理器用于控制PWM控制回路的数字值为止。根据本发明的具体实例性实施例，一种用于转换多个模拟输入信号的模拟-数字转 换设备可包括多个模拟输入端，其每一者均可接收一模拟输入信号；多个取样及保 持电路，其每一者均可包括一有选择地耦合至所述多个输入端中至少一者的输入端及
一输出端； 一个或多个模拟-数字转换器(ADC)，其每一者均可包括一输入端及一输 出端；多个触发器选择电路，其每一者均可有选择地将其中一个输入端耦合至其中一 个取样及保持电路；及一个或多个模拟多路复用器，其每一者均可包括多个输入端及 一输出端，所述多个输入端有选择性地耦合至所述取样及保持电路输出端中的一者或 多者，所述输出端则耦合至所述一个或多个模拟-数字转换器中的一者。
根据本发明另一具体实例性实施例， 一种用于监控多个模拟输入信号的脉宽调制 (PWM)控制系统可包括多个各自用来接收一模拟输入信号的模拟输入端；多个取 样及保持电路，其每一者可包括一有选择地耦合至所述多个输入端中至少一者的输入 端及一输出端； 一个或多个模拟-数字转换器(ADC)，每一 ADC均可包括一输入端及 一输出端；多个触发器选择电路，其每一者均可有选择地将其中一个输入端耦合至所 述取样及保持电路中的一者；及一个或多个模拟多路复用器，每一模拟多路复用器可 包括多个输入端及一输出端，所述多个输入端有选择地耦合至所述取样及保持电路输 出端中的一者或多者，所述输出端则耦合至所述一个或多个模拟-数字转换器中的一 者。
根据未发明再一具体实例性实施例， 一种用于将多个模拟输入信号转换成数字输出信号的方法可包括使所述模拟输入信号的每一者与一个或多个触发器信号相关联； 检测与所述模拟输入相关联的所述一个或多个触发器信号中的一者是否现用，且当与所述至少一个模拟输入中的一者相关联的所述一个或多个触发器信号中的一者现用 时将一取样请求信号发送至一取样请求锁存器；如果与所述模拟输入信号相关联的 取样及保持电路可用，则将所述模拟输入切换至与所述模拟输入信号相关联的取样及 保持电路，以对与所述至少一个触发器信号相关联的模拟输入进行取样及保持；将一 取样就绪信号发送至一转换请求选择电路；如果模拟-数字转换器可用且与所述取样模 拟输入信号相关联的取样及保持电路为最高优先级请求方，则将所取样的模拟输入信 号发送至所述模拟-数字转换器；将所取样及保持的模拟输入信号转换成数字值；且将 所述数字值存储在一结果寄存器中。
通过结合附图参看下文说明可获得对本发明的更全面理解，附图中 图1是根据本发明一具体实例性实施例的具有取样及保持电路的模拟-数字转换 器(ADC)的示意方框图；图2是根据本发明一具体实例性实施例的触发器选择逻辑的示意方框图；图3是根据本发明一具体实例性实施例的转换请求选择逻辑的示意图；图4是根据本发明一具体实例性实施例的ADC控制逻辑的示意方框图；及图5是根据本发明一具体实例性实施例的转换请求清除逻辑的示意方框图。
尽管本发明易于作出各种修改及替代形式，但在图式中是显示并在本文中详细说明其具体实例性实施例。然而，应了解，本文对具体实例性实施例的说明并非打算将 本发明限定于本文所揭示的具体形式，而是相反，本发明打算涵盖随附权利要求书所 界定的所有修改及等效形式。例如，尽管本发明设备、系统及方法可用于功率控制应 用中，但其还可用于其他ADC应用，例如包括数据获取或控制系统。
具体实施方式
现在参考图式，图中对实例性实施例的细节进行示意性图解说明。图式中的相同 元件将由相同的编号来表示，且相似的元件将由带有不同小写字母后缀的相同编号来 表示。参看图1，其中绘示一模拟-数字转换系统(其总体上以100显示)的示意方框图。 所述模拟-数字控制系统可用于监控一个或多个脉宽调制(PWM)控制回路。模拟-数 字转换系统100包括N+l个模拟输入端102。^及M+l个取样及保持电路104。，每一 取样及保持电路104a.M均包括用来接收输入的输入端及输出端。取样控制逻辑106可 控制每一模拟输入端.1020..N与相关联的一个取样及保持电路104Q..M的牵接。在某些实例性实施方案中，可存在一个专用于每一模拟输入端1020..n的取样及保 持电路104。在其他实施方案中，取样及保持电路104Q..M的数量可小于模拟输入端 102a,n的数量。例如，在一实施方案中，可将输入端102Q..N分组成若干个对且每对输 入端102()..m中的一个成员可专用一个取样及保持电路104。在此一实施方案中，每对 输入端102Q..M中不具有专用取样及保持电路104的成员可共享一个或多个其他取样及 保持电路1040..M。在再一些实施方案中，所述模拟输入端102()..m中的至少一者可不与任何取样及保 持电路104()卫选择性地连接，而是，模拟输入端102a.m中的至少一者可直接地连接至 一个或多个模拟多路复用器110。..q的一个输入端。在一实例性实施方案中， 一对模拟输入端中的交替成员(例如模拟输入端1020 及102。可分别用来测量电源中的电流及电压。由于电流可比电压具有更大的易失性， 故与所测量电流相关联的模拟输入端(即模拟输入端1020)可具有一专用的取样及保 持电路，而与所测量电压相关联的模拟输入端(即模拟输入端102i)可与其他模拟输 入端共享取样及保持电路104。..M中的一者或多者。一般而言，取样控制逻辑106可控制将模拟输入端102a.n中的哪些连接至取样及 保持电路104()..m中的一者或多者。取样控制逻辑106还可控制一个或多个模拟多路复 用器110a.s，以使取样及保持电路104()..m的输出与一个或多个模拟-数字转换器1120..s 的输入端相连接。在某些其中模拟输入端102aw中的一者或多者并非有选择地连接至 取样及保持电路104。..m的任一者的实施方案中，模拟多路复用器llOo..s可将这些模拟 输入端102c^直接连接至一个或多个ADC 1120..s。ADC 112。..s的每一者可包括接收模拟信号的输入端及提供模拟信号的数字形式
的输出端。ADC 112Q..S的每一者可进一步包括一个或多个用来控制ADC 112操作的控 制输入端。施加至ADC112a.s每一者的输入端的模拟信号可由S+l个模拟多路复用器 llOo..s中对应的一个模拟多路复用器来进行控制c模拟多路复用器llOo..s的每一者均可 具有Q+I个模拟输入端(在图1中显示为ASO-ASQ)、 一控制输入端及一输出端。在 所述模拟输入端的每一者都具有至少一个相关联取样及保持电路104的模拟-数字转 换系统100的实施方案中，Q可等于M。在模拟输入端102a.n中的一者或多者并非与 取样及保持电路104a.M的任一者相关联或唯一相关联的其他实施方案中，Q可大于M， 以虑及任何不具有相关联取样及保持电路104的模拟输入端102a.N。模拟多路复用器 llOa.s的每一者的控制输入端可接收来自取样控制逻辑106的控制信号。ADC 112。..s 的每一者的控制输入端可接收来自转换控制逻辑114的信号。一旦ADC 112Q..S己转换所接收的模拟信号，其便可将各自的数字值输出至数据格 式化电路116，数据格式化电路116又可将经格式化的值存储至一个或多个结果寄存 器118。模拟-数字转换系统100可通过总线接口 120与其他组件耦合在一起。模拟-数字 转换系统100可通过总线接口 i20接收控制消息。在一实例性实施方案中，取样控制 逻辑106及转换控制逻辑114中的一者或两者可通过总线接口 120接收控制消息。模 拟-数字转换系统100还可通过总线接口 120输出例如来自结果寄存器118的结果。参看图2，其绘示根据本发明一具体实例性实施例的触发器选择逻辑电路的示意 方框图。所述触发器选择逻辑可包含在取样控制逻辑106中。图2中所示的触发器选 择逻辑经配置以使模拟输入端102o与取样及保持电路1040有选择地耦合。 一般而言， 所述触发器选择逻辑有选择地使所述N+1个模拟输入端102a,n中的一者或多者耦合至 M+l个取样及保持电路中的一者。在根据本发明的某些实施例中，可为每一取样及保 持电路104。..m提供一个触发器选择逻辑。所述触发器选择逻辑可将一个或多个触发器信号接收至触发器选择多路复用器 202内。可基于存储于触发器选择控制寄存器204中的值来选择触发器选择信号108l,p 的一者。基于所述系统的需要，存储在触发器选择控制寄存器204中的值可为静态或 动态的。在某些实施方案中，触发器选择控制寄存器204可使触发器信号108L.p中的 一者与模拟输入端102。..w中的一者相关联。在其中在多个模拟输入端1020』之间切换 取样及保持电路104()..M中的单独一者的另一实例性实施方案中，触发器选择控制寄存 器204中的值可基于应接纳哪一个模拟输入端102。..n而改变。所述触发器选择多路复用器的输出端可耦合至一边缘检测器206。当所选触发器 信号得到确定时，边缘检测器206可提供一信号。边缘检测器206的输出端可耦合至 取样请求锁存器208，此使得通过在取样请求锁存器208的Q输出端上提供信号而使 相关联的取样及保持电路104。对相关联的模拟输入端102。进行取样。取样请求锁存器 208可包括一用来使取样请求锁存器208复位的清除输入端(Clear i叩ut)。取样请求锁存器208的Q输出端还可耦合至取样时间延迟210。取样时间延迟210
可进一步包括输出端，所述输出端耦合至取样请求锁存器208的清除输入端。 一般而 言，在取样时间延迟210自取样请求锁存器的Q输出端接收到输入信号之后，取样时 间延迟210会使所述取样请求锁存器在某一时刻进行清除。取样时间延迟210可通过 向取样请求锁存器208的清除输入端提供一信号来清除取样请求锁存器208。取样时 间延迟210的输出端可进一步耦合至转换请求锁存器212的设定输入端(Setinput)。 转换请求锁存器212进一步包括一 Q输出端及一清除输入端。当所述锁存器被激活(例 如，在设定输入端上接收到信号)时，所述转换请求锁存器可发送一指示取样及保持 电路104o准备好进行模拟-数字转换的信号。转换请求锁存器214的清除输入端可经配置以在取样及保持电路104o的模拟-数 字转换完成时接收信号。在某些具有多个模拟-数字转换器112。.,s的实例性实施方案中， 转换请求锁存器212可经配置以接收转换完成信号，以指示其中一个模拟-数字转换器 1120..3已完成取样及保持电路104。的转换。例如，图2中所示的转换请求锁存器212 的清除输入端耦合至"或"门的输出端。所述"或"门的输入端经配置以接收指示相关联的模拟-数字转换器已完成对取样及保持电路104o的转换的信号。参看图3，其中绘示根据本发明一具'体实例性实施例的转换请求选择逻辑电路的 示意方框图。某些实例性实施方案可每一模拟-数字转换器1120..3包括一个转换请求逻 辑电路。所述一个或多个转换请求选择逻辑元件可包含在取样控制逻辑106中。转换请求逻辑可包括M+l个取样就绪多路复用器302a.M。每一取样就绪多路复用 器302。.m可接收M+1个输入。大体而言，每一取样就绪多路复用器3020.^接收来自每 一所述触发器选择逻辑电路的输入。每一取样就绪多路复用器3020..m可包括稱合至其 中一个M+l个取样选择控制寄存器304Q..M的控制输入端。存储于每一取样选择控制寄 存器304a.M内的地址指明拟选定的样本的地址。存储于取样就绪多路复用器304a.M内 的地址还可输入至地址选择多路复用器310。每一取样就绪多路复用器302a,w可包括 耦合至优先级编码器306中M+1个输入端的输出端。 一般而言，优先级编码器306可 选择与转换请求逻辑电路相关联的其中一个模拟-数字转换器112()..5将转换哪些准备转 换的样本。可基于所述系统的需要来调节优先级编码器306的行为，以为某些样本提 供高于其他样本的优先级。优先级编码器306可包括当已选定至少一个样本进行转换 时现用的"任一现用(Any Active)"输出端。优先级编码器306可包括"所选输入端 的ID (ID ofl叩ut Selected)"输出端，以输出被选定进行转换的样本的地址。"所选输 入端的ID"输出端可输入至锁存器308的D输入端内。锁存器308可进一步包括用来 输出存储于锁存器中的值(若存在)的Q输出端及用于清除所述锁存器的LE输入端。 地址选择多路复用器310可包括一控制输入端，用来控制输出来自取样选择控制 寄存器304Q..M的哪些输入。地址选择多路复用器310的控制输入端可耦合至锁存器308 的Q输出端。在一具有此种布置的实例性实施例中，所述地址选择多路复用器可输出 由优先级编码器306选定进行转换的样本的地址。地址选择多路复用器310的输出端 可耦合至所述一个或多个模拟多路复用器110Q..S，从而使其将其中一个取样及保持电 路104a.M的输出选择为与模拟多路复用器110相关联的ADC 112的输入。参看图4，图中绘示根据本发明一具体实例性实施例的ADC控制逻辑的示意方框 图。在某些实施方案中，为每一ADC 112()..s提供一个与其相关联的ADC控制逻辑电 路402。 ADC控制逻辑电路402包括一 "转换请求"输入端及一用于接收所要转换的 模拟输入的地址的地址输入端。"转换请求"输入端可耦合至其中一个转换请求逻辑电 路的优先级编码器306的"转换请求"输出端。同样地，所述地址输入端可耦合至其 中一个转换请求逻辑电路的地址选择多路复用器310的输出端。一般而言，ADC控制逻辑402使其中一个ADC 112a.s从在地址输入端上所规定 的地址接收模拟输入并将一数字结果输出至所述一个或多个结果寄存器118中的地 址。ADC控制逻辑402可包括一可耦合至锁存器308的LE输入的"转换器不忙" (Converter Not Busy)输出。在操作中，"转换器不忙"输出可使锁存器308复位。 ADC控制逻辑402可包括"转换完成"(Conversion Done)输出。参看图5，图中绘示根据本发明一具体实例性实施例的转换请求清除逻辑的示意 方k图。 一般而言，在与转换请求锁存器中的地址相关联的信号经过其中一个ADC 112()..s转换之后，所述转换请求清除逻辑可清除锁存器308。转换请求清除逻辑502可 包括一具有启用(Enable)输入端、选择(Select)输入端及Q+1个输出端的解多路复 用器。所述启用输入端可耦合至ADC控制逻辑402，以接收"转换完成"信号。所述 选择输入端可耦合至所述一个或多个转换请求选择逻辑电路中的一者，以自地址选择 多路复用器310的输出端接收被选定进行转换的样本的地址。虽然已参看本发明的实例性实施例来绘示、阐述及界定本发明各实施例，但这种 参看并不暗示对本发明的限定，且不应推断出存在此种限定。可在形式及功能上对本 发明的标的物作出大量的修改、替代及等效形式，所属技术领域的技术人员根据本揭 示内容将会想出这些修改、替代及等效形式。所示及所述的本发明各实施例仅作为实 例，而并非对本发明范围的穷尽性说明。
权利要求
1、一种用于转换多个模拟输入信号的模拟-数字转换设备，其包括多个模拟输入端，每一者均用于接收模拟输入信号；多个取样及保持电路，每一者均包括有选择地耦合至所述多个输入端中至少一者的输入端及输出端；至少一个模拟-数字转换器(ADC)，每一者均包括输入端及输出端；多个触发器选择电路，其用于有选择地将所述多个模拟输入端中所选定的模拟输入端耦合至所述取样及保持电路中相应的一者；及至少一个模拟多路复用器，其包括多个输入端，每一者均用于有选择地耦合至所述取样及保持电路输出端中的至少一者；及输出端，其耦合至所述至少一个模拟-数字转换器中的一者。
2、 如权利要求1所述的模拟-数字转换设备，其中所述触发器选择电路中的每一者包括触发器多路复用器，其包括多个每一者均接收触发器信号的触发器输入端、接收触发器选择信号的控制输入端、及输出端；触发器选择控制寄存器，其耦合至所述触发器多路复用器控制输入端，其中所述 寄存器可操作以存储一值，以控制所述触发器多路复用器选择所述多个触发器信号中的哪一者；边缘检测器，其包括耦合至所述触发器多路复用器输出端的输入端及输出端，其 中当来自所述触发器多路复用器的信号得到确定时，所述边缘检测器产生信号；及取样请求锁存器，其包括设定输入端，其耦合至所述边缘检测器输出端；输出 端，其使所述多个取样及保持电路中的一者自所述多个输入端中的一者接收模拟输入 信号；及清除输入端。
3、 如权利要求2所述的模拟-数字转换设备，其中每一触发器选择电路进一步包括取样延迟电路，其包括耦合至所述样本请求锁存器Q输出端的输入端及耦合至所 述取样请求锁存器清除输入端的输出端，其中在所述取样请求锁存器Q输出端现用之 后一预定时间，所述取样延迟电路使所述取样请求锁存器被清除。
4、 如权利要求2所述的模拟-数字转换设备，其中每一触发器选择电路进一步包括转换请求锁存器，其包括设定输入端，其耦合至所述请求锁存器清除输入端；Q输出端，其用于发出与所述触发器选择电路相关联的取样及保持寄存器准备好进行 转换的信号；及清除输入端，其用于清除所述转换请求锁存器。
5、 如权利要求1所述的模拟-数字转换设备，其中所述多个输入端中的每一者均与一个取样及保持电路相关联。
6、 如权利要求1所述的模拟-数字转换设备，其中所述多个输入端被分组成多个 对，且其中每对输入端与一个取样及保持电路相关联。
7、 如权利要求1所述的模拟-数字转换设备，其进一步包括至少一个转换请求选择电路，每一者均自所述多个触发器选择逻辑电路接收取样 就绪信号并控制所述模拟多路复用器中的至少一者。
8、 如权利要求7所述的模拟-数字转换设备，其中所述转换请求选择电路中的至 少一者包括两个或更多个取样就绪多路复用器，每一者均包括至少一个耦合至所述至少一个 取样及保持电路中的一者的输入端、控制输入端、及输出端；优先级编码器，其包括多个输入端，其耦合至所述至少一个取样就绪多路复用 器输出端；地址输出端；及转换请求输出端；转换请求锁存器，其包括多路复用器ID输入端、多路复用器ID输出端及清除输 入端，其中所述转换请求锁存器可操作以存储待转换样本的多路复用器ID;及地址选择多路复用器，其用于将所述请求转换锁存器的多路复用器ID输出端转 换成所述待转换样本的地址。
9、 如权利要求1所述的模拟-数字转换设备，其进一步包括 一个或多个用于存 储转换结果的寄存器。
10、 一种用于监控多个模拟输入信号的脉宽调制(PWM)控制系统，其包括 多个模拟输入端，每一者均用于接收模拟输入信号；多个取样及保持电路，每一者均包括有选择地耦合至所述多个输入端中的至少一者的输入端及输出端；至少一个模拟-数字转换器(ADC),其包括输入端及输出端； 多个触发器选择电路，其用于有选择地将所述多个模拟输入端中所选定的一者耦合至所述多个取样及保持电路中对应的一者；及至少一个模拟多路复用器，其包括多个输入端，其有选择地耦合至所述取样及保持电路输出端中的一者或多者；及输出端，其耦合至所述一个或多个ADC中的一者。
11、 如权利要求10所述的PWM控制系统，其中所述多个输入端中的每一者与一 个取样及保持电路相关联。
12、 如权利要求10所述的PWM控制系统，其中所述多个输入端被分组成多个 对，且其中每对输入端与一个取样及保持电路相关联。
13、 如权利要求10所述的PWM控制系统，其进一步包括 至少一个转换请求选择电路，其用于自所述多个触发器选择逻辑电路接收取样就绪信号且用于控制所述模拟多路复用器中的一者或多者。
14、 如权利要求10所述的PWM控制系统，其进一步包括一个或多个用于存储转换结果的寄存器。
15、 一种用于将多个模拟输入信号转换成数字输出信号的方法，其包括-使所述多个模拟输入信号中的每一者与至少一个触发器信号相关联； 检测与所述模拟输入中的一者相关联的至少一个触发器信号是否现用，且如果现用，贝IJ:将取样请求信号发送至取样请求锁存器；如果与所述模拟输入信号相关联的取样及保持电路可用，则将所述模拟输入 切换至与所述模拟输入信号相关联的所述取样及保持电路，以对与所述一个或多个触 发器信号相关联的模拟输入进行取样及保持；将取样就绪信号发送至转换请求选择电路；如果模拟-数字转换器可用，且与所述所取样的模拟输入信号相关联的所述 取样及保持电路为最高优先级请求方，则将所述所取样的模拟输入信号发送至所述模 拟-数字转换器；将所述所取样及保持的模拟输入信号转换成数字值；及将所述数字值存储在结果寄存器中。
16、 如权利要求15所述的方法，其中将取样就绪信号发送至转换请求选择电路包括发送所述所取样的模拟输入信号的地址。
17、 如权利要求15所述的方法，其进一步包括在将所述所取样的模拟输入信号转换成所述数字值的同时，存储所述所取样的模 拟输入信号的地址，；及在将所述所取样的模拟输入信号转换成所述数字值之后，清除所述所取样的模拟 输入信号的地址。
18、 如权利要求15所述的方法，其进一步包括在将所述所取样的模拟输入信号发送至所述模拟-数字转换器之后，清除所述取样 及保持电路。
19、 如权利要求15所述的方法，其进一步包括 将所述数字值输出至串行总线。
全文摘要
本发明揭示一种用于转换多个模拟输入信号的模拟-数字转换设备，其可包括多个模拟输入端、多个取样及保持电路、一个或多个模拟-数字转换器(ADC)、多个触发器选择电路及一个或多个模拟多路复用器。所述模拟输入端可接收模拟输入信号。所述取样及保持电路可包括有选择地耦合至所述多个输入端中至少一者的输入端及输出端。所述模拟-数字转换器(ADC)可包括输入端及输出端。所述触发器选择电路可有选择地将所述输入端中的一者耦合至所述取样及保持电路中的一者。所述模拟多路复用器可包括多个输入端，其有选择地耦合至所述取样及保持电路输出端中的一者或多者；输出端，其耦合至所述一个或多个模拟-数字转换器中的一者。
文档编号H03M1/12GK101160724SQ200680012836
公开日2008年4月9日 申请日期2006年9月26日 优先权日2005年9月27日
发明者布赖恩·克里斯 申请人:密克罗奇普技术公司