SAR模数转换器选择性同步的制作方法

本发明通常而非限制性涉及集中电路，更特别地涉及逐次逼近路由(sar)模数转换器(adc)电路及其选择性同步。

背景技术：

模数转换器(adc)电路可以用于将模拟信号转换成数字信号，然后可以在数字域中进一步处理或使用数字信号。逐次逼近路由(sar)adc电路可以执行位试验以将模拟信号的部分与参考电压进行比较，以确定表示模拟信号的特定采样的数字字的数字位值。saradc可以使用数模转换器(dac)的电容器阵列来执行位试验以确定数字字的相应数字位值。位试验可以涉及一定量的时间，例如dac信号可能需要从瞬态值稳定到稳定的值，用于前置放大器以将dac信号的增益放大提供到特定水平，并且对于锁存电路重新产生前置放大器的输出，给出一个位试验结果。然而，高速位试验需要获得adc的高速信号转换。

多通道adc集成电路(ic)可包括多个通道，个人通道包括可以共享公共精密参考电压的单独adc，用于执行位测试，例如可以提供、稳定并存储在大的片外电容器上。

技术实现要素：

本发明人尤其认识到，adc之间的共享参考电压可能会在adc之间产生串扰，特别是当adc被允许异步工作时，可能需要增加、优化或最大化各个adc的转换速度。当选择dac的电容器连接到位试验的参考电压节点时，将所选择的电容器充电到参考电压将从参考电压节点绘出电流。即使参考电压节点被放大器主动地稳定并保持在大的芯片外存储电容器上，也可以扰乱参考电压。

尽管将各种adc的每个位试验同步到其他adc的相应位试验可以为转换提供“安静”的时间，在此期间可以避免串扰，但这种同步可能会减慢转换过程。

本公开提供了解决这个问题的另一种方法，其可以只是同步所有(或跨越至少2个的选择子集中的至少一个、但少于n个)至少一个但不到n个的仔细选择子集同一个ic芯片上的adc。该选择子集与位于同一个ic中的所有或其他adc的选择子集的位试验中的至少一个但少于n个可以包含位置试验对应于预定义的关键事件，例如因为特别期望稳定参考电压节点的事件。这可以帮助获得良好的速度和鲁棒性。

本概述旨在提供本专利申请的主题的概述。本发明不是提供专门的或详尽的解释。包括详细描述以提供有关本专利申请的进一步信息。

附图说明

在不一定按比例绘制的附图中，相同的数字可以在不同的视图中描述相似的部件。具有不同字母后缀的相似的数字可以表示相似组件的不同实例。附图通过举例而不是限制的方式说明本文件中讨论的各种实施例。

图1是示出给定模数转换器(adc)电路中模数转换的连续位试验之间的定时变化的时序图。

图2示出了多通道模数转换器ic中的流水线adc的一个通道的示例。

图3a示出了多通道adc的部分的框图。

图3b示出了用于在图3a的示例中在同一ic上的不同通道的adc同步的伴随时序图。

图4是计算机模拟瞬态分析结果，显示两个不同adc之间共享的参考电压的变化，用于同步和非同步情况。

具体实施方式

本文件尤其描述了可用于仅在同一ic芯片上的至少两个adc的跨越所有或一个选择子集的至少一个但少于n的位试验的仔细选择子集的同步技术。位试验中至少一个但少于n个该选择子集与位于同一个ic中的其他adc的所有或一个选择子集同步，可以包括对应于预定义的关键事件的位试验，例如特别期望稳定的参考电压节点的那些事件。这可以帮助获得良好的速度和鲁棒性。

图1是示出给定模数转换器(adc)电路中模数转换的连续位试验之间的定时变化的时序图。图1显示了一个例子，其中n^th试验比第(n-1)^th位试验更长，即使当它们各自的数模(dac)转换时间和前置放大器增益时间相同时。在位试验结束时，位试验结果可以由再生锁存电路锁存。锁定位试验结果所涉及的再生可引入时间变异性，例如可以依赖于信号，并可能在再生锁存中涉及一定程度的亚稳态，如图1所示。再生锁存电路可以异步运行，锁存电路输出端的逻辑指示锁存完成时间，因此该adc电路的位试验完成。在位试验期间的再生锁存时间变异性或其他时间变异性可以减慢经历长位试验的adc的模数转换。不同通道异步运行的adc可以提高转换时间，但是可以增加对来自其他异步操作的adc的参考电压扰动的敏感性，这可能会在特定adc最需要参考电压在其位试验期间采样稳定的时间内干扰参考电压。如果在单个集成电路管芯的不同通道上有多个adc异步工作，即使每个adc都被修剪到给定的转换时间，所有adc的组合的总体组合转换时间也可以变化，例如由于修整分辨率，或者由于在锁存电路中出现亚稳态而导致特别长的位试验。在转换敏感的采样事件期间，可能没有任何“安静的时间”。共享电压参考节点上的容性负载变得更加不可预测。

解决这个问题的一个方法是完全同步ic上的所有adc，使得每个adc的n位试验(i＝1、2、...n)的每个第i位试验，在完成特定的第i位试验后，在继续进行第(i+1)位试验之前，每个adc等待ic上所有其他adc的相应第i位试验完成。一个adc中的慢位试验(由于更长的再生时间或不同的dac稳定/比较器增益时间)将使所有其他adc减慢。

解决这个问题的另一种方法是同步仅在同一ic芯片上的至少2个adc的跨越所有或一个选择子集的至少一个但少于n个位试验的仔细的选择子集。至少一个但少于n个位试验的选择子集与位于同一个ic中的其他adc的所有或一个选择子集同步，其可以包含对应于预定义的关键事件的位试验，例如因为特别期望稳定参考电压节点的事件。可以包括(或可以限制)的被同步的这种预定义的关键事件的示例：(1)流水线或其他阶段adc的第一阶段的残留放大器的采样；(2)从参考电压节点中选出一个或多个位试验，如最高有效位(msb)位试验，其可以将dac的最大选定电容值放在参考电压节点上；或者(1)和(2)两者。

图2示出了流水线多通道模数转换器ic的一个通道200的示例。在图2的示例中，通道200可以包括可以包括第一阶段adc1202a、第二级adc2202b和辅助“微型adc203”的adc202。采样的模拟输入信号(待转换为n位数字字)，例如vip和vin之间的差分信号，可以提供给微型adc203和第一段adc1202a。微型adc203可以被配置为比第一阶段adc1202a更快地解析由第一阶段adc1202a解析的m个比特的第一(例如，最高有效)k比特，其中k<m。这可以使用不同的迷你adc类型(例如，闪存adc203和saradc202a)来实现，或者通过在sar微型adc203中使用较小的电容器来实现，因为它不需要具有来自第一级adc1202a的所需的全分辨率，或使用其他技术。微型adc203可以提供其转换为第一级adc1202a的k位的转换结果。这可以由第一阶段adc1202a用于转换剩余的m-k位，例如通过使用sar位试验。

残留放大器(ra)204可以接收由第一级adc1202a从第一m位的转换剩下的残留。ra204可以放大残差并将该放大后的残留输出到第二级adc2202b的输入端，用于将残差转换成剩余的p＝n-k位。在一个示例中，在第一m位被转换之后，并且在由第二adc2202b转换第(m+1)位之前，由ra204提供的残留物对第二级adc2202b的采样构成在同一ic上的adc的一个或多个或所有其他通道同步的预定义的关键事件，在这些其他adc中的任何一个执行其位试验以转换其各自的(m+1)位之前。在一个例子中，另一个位试验不需要在同一个ic上的其他adc之间同步。在一个例子中，只有一些(对应于预定义的关键事件的那些)，而不是所有的其他位试验都可以在同一个ic上的其他adc之间同步。

在另一个例子中，将最大dac电容阵列电容值放置在参考电压上的第i位试验可以在同一ic上的其他通道的其他adc之间同步，因为这最有可能扰乱参考电压，因此，当参考电压更可能稳定时，可以期望采样时间。在某些例子中，将最大的dac电容阵列电容值放在参考电压上的第i位试验是最高有效位(msb)位试验，这是同一ic上的adc同步的msb位试验，而不是所有位试验。在其他示例中，例如在流水线式saradc中，当微型adc的位试验结果加载到第一阶段adc1时，最大的电容器被切换到参考电压。在这样的示例中，该事件可以在同一个ic上的所有adc中同步。

如上所述，同步ic的不同通道上的adc同步一些但不是全部的n位试验可以允许使用在同一ic的不同通道上共享的参考电压节点进行准确的操作，同时允许通过允许另一个或多个位试验在同一ic上的不同通道的adc之间保持不同步来允许更高速度的转换。

图3a示出了多通道adc302的部分的框图，图3b示出了用于在同一ic上跨不同通道的adc同步的伴随时序图304。虽然图3a示出了两个adc306a、b的部分，但这是为了便于说明；图3a旨在表示任何数量的通道和任何相应数量的adc。每个adc通道可以包括同步逻辑308、逐次逼近路由(sar)逻辑310和位试验结果锁存器312。如上所述，如果第i位试验(n位试验)是一个关键事件，那么可以期望从同一个ic的各个通道上的所有adc的开始同步。首先，将第(i-1)位试验的adc位测验结果的传播门限为sar逻辑。然后，只有在相同ic的各种通道上的每个adc的(i-1)位验证结果之后才将第(i-1)位试验的结果释放到sar逻辑310变得可用。

时序图304示出了其示例。在时序图304中，第(i-1)位试验的结果在两个不同时间变得可用，由res_latch1信号所示，比从低到高的res_latch2信号从低到高转换。只有当两个结果(或更全面的情况下所有adc的全部第(i-1)位验证结果)都可用时，同步逻辑308产生将第(i-1)位试验的结果释放到sar逻辑310的门结果信号，例如由允许第一adc306a进行其第i位试验的res_sync1信号和允许第二adc306b进行其第i位试验的同步res_sync2信号所指示的。这确保了第i位试验的开始在两个或多个不同的adc中同步。

图4是计算机模拟瞬态分析结果，显示两个不同adc之间共享的参考电压的变化，用于同步和非同步情况，例如允许在其间进行比较。在图4中，最顶层的信号迹线显示了两个不同步adc的残留放大器(ra)采样事件的边沿跳变。第二个从顶部的信号轨迹显示参考电压节点的扰动，其发生在不同的时间，并且由于两个adc的异步操作，导致第二adc在仍然从第一adc的扰动恢复时对参考电压进行采样，这可能导致同步的第i位试验的转换不准确。第三个来自顶部的信号跟踪显示边缘转换，指示两个同步adc的ra采样事件。底部信号迹线在两个同步的adc的ra采样期间显示相应的未受干扰的参考电压，这将提高同步的第i位试验的转换的准确性。

如本文所解释的，本方法可以包括同步仅在相同的ic芯片上的至少两个adc的跨越所有或一个选择子集的位试验的至少一个但少于n个的仔细选择子集。该选择子集至少一个但少于n个的位试验将与同一ic上的其他adc的所有或一个选择子集同步，其可包括对应于预定义的关键事件的位试验，例如特别期望稳定的参考电压节点的那些事件。这可以帮助优化速度和鲁棒性之间的权衡。预定义的关键事件的例子如上所述。确定哪些事件被预先定义为关键事件的一种方法是将其作为关键决策点，由于缺乏同步，只有那些决定点其中dac比较器建立错误就在sar位置试验决定之前高于错误预算，如模数转换的冗余预算。例如，adc1在流水线sar中的第一个位试验，如图2所示，与任何其他位置试验相比，将从参考节点获取最大电流，并可能引起长时间的稳定瞬变。如果该位试验不同步，则可能会导致其他adc的错误大于其可用冗余。然而，这个相同的标准也可以应用于一个或多个其他位试验，以确定它们是否应被视为和预定义为应该在使用共享参考电压的多通道adcic的各种选定adc(或所有adc)之间同步的关键决策点，同时留下位试验的一个或多个其他同步以提高转换速度。

各种注释

以上描述包括对作为详细描述的一部分的附图的参考。附图通过说明的方式示出了可以实施本发明的具体实施例。这些实施例在本文中也被称为“示例”。除了所示出或描述的之外，这些示例可以包括元件。然而，本发明人还考虑了例子，其中仅提供了显示或描述的那些元件。此外，本发明人还考虑了关于特定实施例(或其一个或多个方面)或相对于其它实施例使用所示或描述的那些元件(或其一个或多个方面)的任何组合或排列的示例(或其一个或多个方面)。

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