静电放电电路、阵列基板和显示装置的制造方法
【专利摘要】本公开涉及一种静电放电电路、阵列基板和显示装置。该静电放电电路包括第一信号线、第二信号线和第一TFT，第一TFT包括多个第一子TFT。每个第一子TFT包括第一源极和第一漏极，多个第一子TFT依次排布，相邻的第一子TFT之间共用一个第一源极或第一漏极每个第一子薄膜晶体管包括第一源极和第一漏极，多个第一子薄膜晶体管依次排布，相邻的第一子薄膜晶体管之间共用一个第一源极或第一漏极；第一信号线和第二信号线之一与每个第一子薄膜晶体管的第一漏极电连接，另一个与每个第一子薄膜晶体管的第一源极电连接。该静电放电电路，可提高第一TFT的宽长比，提高放电时的电流负载能力。
【专利说明】
静电放电电路、阵列基板和显示装置
技术领域
[0001]本实用新型至少一实施例涉及一种静电放电电路、阵列基板和显示装置。
【背景技术】
[0002]薄膜晶体管液晶显不器(ThinFilm Transistor liquid crystal display,TFT-LCD)的结构设计中，阵列基板周边电路包括静电放电电路、栅极扫描线、数据线、公共电极线、修复线和测试线等。高端显示面板一般具有高分辨率和窄边框的特点，在周边电路区具有较多的的周边电路，易形成较大的寄生电容负载，易导致各种信号延迟和显示不良。同时较大的电路面积亦不利于窄边框面板的实现。
【实用新型内容】
[0003]本实用新型的至少一实施例涉及一种静电放电电路、阵列基板和显示装置，以提高第一TFT的宽长比，提高放电时的电流负载能力。
[0004]本实用新型至少一实施例提供一种静电放电电路，该静电放电电路包括第一信号线、第二信号线和第一薄膜晶体管，所述第一薄膜晶体管包括多个第一子薄膜晶体管;每个所述第一子薄膜晶体管包括第一源极和第一漏极，所述多个第一子薄膜晶体管依次排布，相邻的所述第一子薄膜晶体管之间共用一个所述第一源极或第一漏极;所述第一信号线和所述第二信号线之一与每个所述第一子薄膜晶体管的所述第一漏极电连接，另一个与每个所述第一子薄膜晶体管的所述第一源极电连接。
[0005]本实用新型至少一实施例还提供一种阵列基板，包括本实用新型实施例所述的任一静电放电电路。
[0006]本实用新型至少一实施例还提供一种显示装置，包括本实用新型实施例所述的任一阵列基板。
【附图说明】
[0007]为了更清楚地说明本实用新型实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本实用新型的一些实施例，而非对本实用新型的限制。
[0008]图1a为本实用新型一实施例提供的一种静电放电电路的平面示意图；
[0009]图1b为本实用新型一实施例提供的静电放电电路中形成第一信号线、各第一子TFT的第一栅极、各第二子TFT的第二栅极的图形的第一薄膜示意图；
[0010]图1c为本实用新型一实施例提供的静电放电电路中第一信号线、各第一子TFT的第一栅极、各第二子TFT的第二栅极的图形的示意图；
[0011]图1d为本实用新型一实施例提供的静电放电电路中形成各第一子TFT的第一源极和第一漏极、各第二子TFT的第二源极和第二漏极、第二信号线和第三信号线的图形的第二薄膜示意图；
[0012]图1e为本实用新型一实施例提供的静电放电电路中形成的各第一子TFT的第一源极和第一漏极、各第二子TFT的第二源极和第二漏极、第二信号线和第三信号线的图形的示意图；
[0013]图1f为本实用新型一实施例提供的另一种静电放电电路的平面示意图；
[0014]图1g为本实用新型一实施例提供的静电放电电路的电路结构示意图(等效电路图)；
[0015]图2为本实用新型另一实施例提供的一种静电放电电路的平面示意图；
[0016]图3为本实用新型另一实施例提供的一种静电放电电路的平面示意图；
[0017]图4为本实用新型另一实施例提供的一种静电放电电路的平面示意图。
[0018]附图标记:
[0019]10-第一信号线；20_第二信号线；30_第三信号线;40-第一 TFT ； 50-第二 TFT ； 04-第一子TFT; 05-第二子TFT; 041-第一源极；042-第一漏极;043-第一栅极；044-第一有源层；051-第二源极;052-第二漏极;053-第二栅极;054-第二有源层；100-第一薄膜;200-第二薄膜；201-第二信号线的分支；301-第三信号线的分支；0412、0411、0421、0422、0423、0511、0521、0523_ 过孔。
【具体实施方式】
[0020]为使本实用新型实施例的目的、技术方案和优点更加清楚，下面将结合本实用新型实施例的附图，对本实用新型实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本实用新型的一部分实施例，而不是全部的实施例。基于所描述的本实用新型的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本实用新型保护的范围。
[0021]除非另外定义，本公开使用的技术术语或者科学术语应当为本实用新型所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
[0022]本公开中，薄膜晶体管(Thin Film Transistor，TFT)简写为TFT。相应的，第一薄膜晶体管简写为第一 TFT，第二薄膜晶体管简写为第二 TFT。并且，本公开中，源极和漏极相对而言，可相互替换。例如，将源极替换为漏极的情况下，漏极亦替换为源极。各附图中，“S”表示源极，“D”表示漏极。
[0023]本实用新型至少一实施例提供一种静电放电电路，包括第一信号线、第二信号线、和第一 TFT，第一 TFT包括多个第一子TFT。多个第一子TFT并联设置。
[0024]每个第一子TFT包括第一源极和第一漏极，多个第一子TFT依次排布，相邻的第一子TFT之间共用一个第一源极或第一漏极;第一信号线和第二信号线之一与每个第一子TFT的第一漏极电连接，另一个与每个第一子TFT的第一源极电连接。
[0025]例如，本实用新型至少一实施例提供的静电放电电路还包括第三信号线和第二TFT，第二 TFT包括多个第二子TFT。多个第二子TFT并联设置。每个第二子TFT包括第二源极和第二漏极，多个第二子TFT依次排布，相邻的第二子TFT之间共用一个第二源极或第二漏极;第一信号线和第三信号线之一与每个第二子TFT的第二源极电连接，另一个与每个第二子TFT的第二漏极电连接。例如，本公开的实施例中，“依次排布”是指在同一平面内按顺序排列，进一步例如，在同一平面内排列成一条线，但不限于此。
[0026]需要说明的是，第二TFT可以采用上述多个第二子TFT并联的结构，也可以采用其他任意结构，本公开的实施例对此不作限定。并且，除了第一 TFT和第二 TFT外，亦可包括其他TFT，本公开的实施例对此不作限定。
[0027]本实用新型至少一实施例提供的静电放电电路，可提高第一TFT和/或第二 TFT的宽长比，提高放电时的电流负载能力。通常电流正比于TFT的宽长比(W/L)。例如，当第一TFT设置四个第一子TFT或第二 TFT设置四个第二子TFT时，与只设置一个第一子TFT或第二子TFT相比，可使得第一TFT或第二TFT的电流负载能力提高四倍，相应的，宽长比也提高四倍。从而，在不增加周边电路面积和信号线的电容负载的前提下，实现提供大电流的高宽长比的TFT和静电放电电路。同时，还可以降低形成较大宽度(W)图案的不均匀性。
[0028]需要说明的是，本公开中，对电连接的方式不作限定。例如可直接电连接，或者一体形成，也可通过过孔电连接，只要是能实现电连接即可。
[0029]第一信号线上可积累正的静电荷或负的静电荷。第一信号线上的静电荷通过第一TFT释放给第二信号线或通过第二TFT释放给第三信号线。例如，第一信号线上积累的正的静电荷通过第一 TFT和第二信号线释放，第一信号线上积累的负的静电荷通过第二 TFT和第三信号线释放，或者，第一信号线上积累的负的静电荷通过第一 TFT和第二信号线释放，第一信号线上积累的正的静电荷通过第二 TFT和第三信号线释放。例如，第一信号线可为阵列基板中的数据线、栅线、时钟信号线等，在此不作限定。阵列基板例如为构成液晶显示面板或有机发光二极管显示面板的一个基板，在此不作限定，只要是其中包含待释放静电的信号线即可。例如，第二信号线和/或第三信号线还可与公共电极电连接，以更好的释放静电荷，但不限于此。例如，第二信号线和第三信号线可为两条不同的信号线，还可以电连接，本公开的实施例对此不作限定。
[0030]例如，本实用新型一实施例提供的静电放电电路中，第一TFT和第二TFT串联。例如，第三信号线与第二 TFT的多个第二漏极电连接，第二 TFT中的各第二子TFT的第二源极经第一 TFT中的至少一个第一子TFT的至少一个第一漏极或第一源极与第一信号线电连接;或者，第三信号线与第二 TFT的多个第二源极电连接，第二TFT中的各第二子TFT的第二漏极经第一 TFT中的至少一个第一子TFT的至少一个第一漏极或第一源极与第一信号线电连接。如此设置，可使得第一 TFT中的至少一个第一子TFT的至少一个第一漏极或第一源极可同时作为连接线，可减小整个静电放电电路的占用面积。
[0031]例如，本实用新型一实施例提供的静电放电电路中，第二信号线和第三信号线之一为高电平信号线；另一个为低电平信号线，但不限于此。例如，本公开中，第一信号线上积累的正的静电荷通过高电平信号线释放，第一信号线上积累的负的静电荷通过低电平信号线释放。例如，静电荷释放时通过一个TFT，例如第一TFT或第二TFT将电荷导出。例如，静电荷通过第一 TFT释放给第二信号线，或者通过第二 TFT释放给第三信号线。当然，第二信号线和第三信号线也可为等电平信号线，本公开的实施例对此不作限定。例如第二信号线和第三信号线上电势为O。本公开的实施例对此不作限定。
[0032]例如，本实用新型一实施例提供的静电放电电路中，各第一子TFT包括第一栅极，第一栅极与第一漏极电连接;各第二子TFT包括第二栅极，第二栅极与第二漏极电连接。如此设置，可使得第一子TFT和第二子TFT形成二极管，相应的，第一TFT和第二TFT分别形成二极管。从而可简化电路布图设计。当然，亦可第一栅极与第一源极电连接，第二栅极与第二源极电连接，在此不作限定。
[0033]例如，本实用新型一实施例提供的静电放电电路中，第一TFT中的多个第一子TFT的多个第一栅极电连接;第二 TFT的多个第二子TFT的多个第二栅极电连接。如此设置，可易于栅极信号的传送。
[0034]例如，本实用新型一实施例提供的静电放电电路中，第一子TFT为双栅极TFT，第二子TFT为双栅极TFT。设置双栅极TFT，有利于降低正常工作状态时的TFT的漏电流，从而减弱信号串扰所导致的显示不良。当然，亦可不采用双栅极TFT，在此不作限定。
[0035]例如，本实用新型一实施例提供的静电放电电路中，第一信号线、各第一子TFT的第一栅极、各第二子TFT的第二栅极由第一薄膜形成。如此设置，可简化制作工艺。需要说明的是，本实用新型实施例并不限于此。例如，第一薄膜可采用溅射法形成，但不限于此。
[0036]例如，本实用新型一实施例提供的静电放电电路中，各第一子TFT的第一源极和第一漏极、各第二子TFT的第二源极和第二漏极、第二信号线和第三信号线由第二薄膜形成。如此设置，可简化制作工艺。需要说明的是，本实用新型实施例并不限于此。例如，第二薄膜可采用溅射法形成，但不限于此。
[0037]例如，本实用新型一实施例提供的静电放电电路中，第二信号线包括多个分支，第二信号线的多个分支作为(构成)第一 TFT的多个第一源极或多个第一漏极，第三信号线包括多个分支，第三信号线的多个分支作为(构成)第二 TFT的多个第二漏极或多个第二源极。如此设置，可以使得第二信号线和第一 TFT的多个第一源极或多个第一漏极一体形成，第三信号线和第二 TFT的多个第二漏极或多个第二源极一体形成，可以简化制作工艺，减小静电放电电路占用面积。需要说明的是，第二信号线与第一 TFT的多个第一源极或多个第一漏极、第三信号线与第二 TFT的多个第二漏极或多个第二源极亦可不一体形成，而是通过其他方式例如通过过孔相连，对此不作限定。
[0038]例如，本实用新型一实施例提供的静电放电电路中，第一TFT包括第一有源层，第一 TFT的多个第一子TFT分用第一 TFT的第一有源层的不同部分;第二 TFT包括第二有源层，第二 TFT的多个第二子TFT分用第二 TFT的第二有源层的不同部分。例如，第一子TFT的第一源极和第一漏极分别通过过孔与第一 TFT的第一有源层连接;第二子TFT的第二源极和第二漏极分别通过过孔与第二 TFT的第二有源层连接。
[0039]例如，本实用新型一实施例提供的静电放电电路中，第一TFT为N型TFT或P型TFT，第二 TFT为N型TFT或P型TFT。例如，第一 TFT和第二 TFT可均为N型TFT或P型TFT，亦可其中一个为N型TFT，另一个为P型TFT，在此不作限定。
[0040]例如，本实用新型一实施例提供的静电放电电路中，第一TFT中第一子TFT和第二TFT中第二子TFT的个数均大于或等于4个。例如，第一 TFT中第一子TFT和第二 TFT中第二子TFT的个数均大于或等于4个并且小于或等于8个，如此设置，可以兼顾面积开销和产品性能。但本实用新型并不限于此。
[0041 ]下面通过几个具体的实施例来进行说明。
[0042]以下各实施例中，第一TFT和第二TFT均采用多个子TFT，第一TFT中第一子TFT的个数为4个，第二 TFT中第二子TFT的个数为4个，并且，第一信号线、各第一子TFT的第一栅极、各第二子TFT的第二栅极由第一薄膜形成，各第一子TFT的第一源极和第一漏极、各第二子TFT的第二源极和第二漏极、第二信号线和第三信号线由第二薄膜形成，第二信号线的多个分支作为(形成)第一 TFT的多个第一源极或多个第一漏极，第三信号线的多个分支作为(形成)第二TFT的多个第二漏极或多个第二源极，本实用新型实施例以其为例进行说明，但并不限于此。
[0043]需要说明的是，以下各实施例中，N型TFT中，源极为低电平，漏极为高电平，正的栅压(栅源压差大于O)可打开N型TFT J型TFT中，源极为高电平，漏极为低电平，负的栅压(栅源压差小于O)可打开P型TFT。栅极与漏极电连接构成二极管。
[0044]实施例一
[0045]本实施例提供一种静电放电电路，如图1a所不。该静电放电电路包括第一信号线10、第二信号线20、第三信号线30、第一 TFT40和第二 TFT50，第一 TFT40包括多个第一子TFT04，第二 TFT50包括多个第二子TFT05。多个第一子TFT04并联设置，多个第二子TFT05并联设置。
[0046]每个第一子TFT04包括第一源极041和第一漏极042，多个第一子TFT04依次排布，相邻的第一子TFT04之间共用一个第一源极041或第一漏极042;第一信号线10与第一 TFT40中每个第一子TFT04的第一漏极042电连接，第二信号线20与第一 TFT40中每个第一子TFT04的第一源极041电连接。
[0047]每个第二子TFT05包括第二源极051和第二漏极052，多个第二子TFT05依次排布，相邻的第二子TFT05之间共用一个第二源极051或第二漏极052;第一信号线10与第二 TFT50中每个第二子TFT05的第二源极051电连接，第三信号线30与第二 TFT50中每个第二子TFT05的第二漏极052电连接。
[0048]例如，如图1a所示，各第一子TFT04包括第一栅极043，第一栅极043与第一漏极042电连接;各第二子TFT05包括第二栅极053，第二栅极053与第二漏极052电连接。例如，第一TFT40中的多个第一子TFT04的多个第一栅极043电连接;第二 TFT50的多个第二子TFT05的多个第二栅极053电连接。
[0049]例如，如图1a所示，第一 TFT40和第二 TFT50串联。例如，第三信号线30与第二 TFT50的多个第二漏极052电连接，第二TFT50中的各第二子TFT05的第二源极051分别经第一TFT40中的一个第一子TFT04的第一漏极042与第一信号线10电连接。从而，使得第二 TFT50中的各第二子TFT05的第二源极051与第一信号线10电连接。
[ΟΟδΟ]例如，如图lb、Ic所不，第一信号线10、各第一子TFT04的第一栅极043、各第二子TFT05的第二栅极053由第一薄膜100形成。例如，先形成如图1b所示的第一薄膜100，再采用构图工艺形成如图1c所示的图形，该图形包括第一信号线10、各第一子TFT04的第一栅极043、各第二子TFT05的第二栅极053。
[0051 ] 例如，如图ld、Ie所示，各第一子TFT04的第一源极041和第一漏极042、各第二子TFT05的第二源极051和第二漏极052、第二信号线20和第三信号线30由第二薄膜200形成。例如，先形成如图1d所示的第二薄膜200，再采用构图工艺形成如图1e所示的图形，该图形包括各第一子TFT04的第一源极041和第一漏极042、各第二子TFT05的第二源极051和第二漏极052、第二信号线20和第三信号线30。
[0052]例如，如图la、le所示，第二信号线20包括多个分支201，第二信号线20的多个分支201作为(形成)第一 TFT40的多个第一源极041，第三信号线30包括多个分支301，第三信号线30的多个分支301作为(形成)第二 TFT50的多个第二漏极052。如此设置，可简化制作工
-H-
O
[0053]例如，不同层的薄膜形成的图形之间可设置有绝缘层，不同层的薄膜形成的图形之间可通过绝缘层过孔电连接。例如，第一漏极042经过孔0422与第一信号线10相连。例如，第一栅极043通过过孔0423与第一漏极042电连接，第二栅极053通过过孔0523与第二漏极052电连接。
[0054]例如，如图1a所示，第一 TFT40包括第一有源层044，第一 TFT40的多个第一子TFT04分用第一 TFT40的第一有源层044的不同部分;第二 TFT50包括第二有源层054，第二 TFT50的多个第二子TFT05分用第二 TFT50的第二有源层054的不同部分。例如，第一子TFT04的第一源极041和第一漏极042分别通过过孔0411、0421与第一 TFT40的第一有源层044连接；第二子TFT05的第二源极051和第二漏极052分别通过过孔0511、0521与第二了?了50的第二有源层054连接。
[0055]例如，如图1a所示，各第一子TFT04为双栅极TFT，各第二子TFT05为双栅极TFT。当然，亦可如图1f所示，各第一子TFT04和各第二子TFT05亦可不采用双栅极结构，在此不作限定。
[0056]例如，本实施例一示例提供的静电放电电路中，第一TFT40中第一子TFT04和第二TFT50中第二子TFT05的个数均大于或等于4个。
[0057]例如，第一TFT40为N型TFT，第二TFT50为N型TFT，第二信号线20为高电平信号线，第三信号线30为低电平信号线。正的静电荷通过高电平信号线释放，负的静电荷通过低电平信号线释放。例如，本实施例一示例提供的静电放电电路中，第二信号线20上可施加持续的高电平信号线，第三信号线30上可施加持续的低电平信号线，但不限于此。例如，第二信号线20和第三信号线30上亦可以不施加信号，本公开的实施例对此不作限定。
[0058]例如，本实施例一示例提供的静电放电电路的电路结构图可如图1g所示。
[0059]例如，本实施例一示例还提供一种静电放电电路的制备方法，该方法可包括如下步骤。
[0060](I)在衬底基板上形成缓冲层；
[0061](2)在缓冲层上形成半导体层，该半导体层包括第一有源层和第二有源层的图形；
[0062](3)在半导体层上形成栅极绝缘层；
[0063](4)在栅极绝缘层上形成第一栅极、第二栅极、第一信号线的图形；
[0064](5)在第一栅极、第二栅极、第一信号线的图形上形成层间绝缘层；
[0065](6)形成层间绝缘层过孔；
[0066](7)在形成了过孔的层间绝缘层上形成各第一子TFT的第一源极和第一漏极、各第二子TFT的第二源极和第二漏极、第二信号线和第三信号线的图形。
[0067]例如，本实施例一示例提供的另一静电放电电路的制备方法中，第一栅极、第二栅极先于半导体层形成。
[0068]例如，缓冲层包括氮化硅、氧化硅、或者氧化硅和氮化硅的双层薄膜。
[0069]例如，半导体层材质包括非晶硅(a-Si)、多晶硅(p-Si)、金属氧化物半导体材料等，P-Si包括低温多晶硅，金属氧化物半导体包括ZnO、IGO、IGZO等。
[0070]例如，栅极绝缘层包括氮化硅和氧化硅，可以是单层结构，也可以是多层结构，例如氧化硅\氮化硅。
[0071]例如，层间绝缘层可以采用无机物如氮化硅，也可以采用有机物如树脂。
[0072]例如，第一栅极、第二栅极、第一源极、第一漏极、第二源极、第二漏极、第二信号线、第三信号线均可以采用Cu、Al、Mo、T1、Cr、W等金属材料制备，也可以采用这些材料的合金制备;可以是单层结构，也可以采用多层结构，Mo\Al\Mo，Ti\Al\Ti，Ti\Cu\Ti，Mo\Cu\Ti等。
[0073]例如，缓冲层、栅极绝缘层可采用等离子体增强化学气相沉积法(PlasmaEnhanced Chemical Vapor Deposit1n，PECVD)方法形成。
[0074]需要说明的是，上述对于静电放电电路中各元件/部件的材质的说明只是例举，并非限定，亦可采用其他适合的材质，在此不作限定。本公开的静电放电电路的制备方法也不限于上述给出的方法。
[0075]实施例二
[0076]本实施例提供的静电放电电路，与实施例一不同的是，第二信号线20为低电平信号线，第三信号线30为高电平信号线，第一 TFT40为P型TFT，第二 TFT50为P型TFT。其余可参照实施例一的描述。
[0077]实施例三
[0078]本实施例提供的静电放电电路，如图2所示。与实施例一大体有以下几点不同。
[0079](I)第一 TFT40 为P 型 TFT，第二 TFT50 为P 型 TFT。
[0080](2)第二信号线20的多个分支201作为(形成)第一 TFT40的多个第一漏极042，第一信号线与第一TFT的多个第一源极电连接。即，实施例一中的第一源极为本实施例的第一漏极042，相应的，实施例一中的第一漏极为本实施例的第一源极041。
[0081 ] (3)第一源极041经过孔0412与第一信号线10相连。
[0082](4)第三信号线30的多个分支301作为(形成)第二 TFT50的多个第二源极051，即，实施例一中的第二漏极为本实施例的第二源极051。相应的，实施例一中的第二源极为本实施例的第二漏极052。
[0083](5)第二 TFT50中的各第二子TFT05的第二漏极052分别经第一 TFT40中的一个第一子TFT04的第一源极041与第一信号线10电连接。从而，使得第二 TFT50中的各第二子TFT05的第二漏极052与第一信号线10电连接。
[0084]其余可参照实施例一的描述。需要说明的是，各第一子TFT中，第一栅极还是与第一漏极电连接，各第二子TFT中，第二栅极还是与第二漏极电连接。第二信号线20还是为高电平信号线，第三信号线30还是为低电平信号线。
[0085]实施例四
[0086]本实施例提供的静电放电电路，与实施例三不同的是，第二信号线20为低电平信号线，第三信号线30为高电平信号线，第一 TFT40为N型TFT，第二 TFT50为N型TFT。其余可参照实施例三的描述。
[0087]实施例五
[0088]本实施例提供一种静电放电电路，如图3所示，与实施例一有以下几点不同。
[0089](I)第二 TFT50 为P 型 TFT。
[0090](2)第三信号线30的多个分支301作为(形成)第二 TFT50的多个第二源极051，即，实施例一中的第二漏极为本实施例的第二源极051。相应的，实施例一中的第二源极为本实施例的第二漏极052。
[0091](3)第二 TFT50中的各第二子TFT05的第二漏极052分别经第一 TFT40中的一个第一子TFT04的第一漏极042与第一信号线10电连接。从而，使得第二 TFT50中的各第二子TFT05的第二漏极052与第一信号线10电连接。
[0092]其余可参照实施例一的描述。需要说明的是，第一TFT40还是为N型TFT。各第一子TFT中，第一栅极还是与第一漏极电连接，各第二子TFT中，第二栅极还是与第二漏极电连接。第二信号线20还是为高电平信号线，第三信号线30还是为低电平信号线。
[0093]实施例六
[0094]本实施例提供的静电放电电路，如图3所示，与实施例五不同的是，第二信号线20为低电平信号线，第三信号线30为高电平信号线，第一TFT40为P型TFT，第二TFT50为N型TFT。其余可参照实施例五的描述。
[0095]实施例七
[0096]本实施例提供的静电放电电路，如图4所示，与实施例一有以下几点不同。
[0097](I)第一 TFT40 为P 型 TFT。
[0098](2)第二信号线20的多个分支201作为(形成)第一TFT40的多个第一漏极042，第一信号线与第一 TFT的多个第一源极电连接。即，实施例一中的第一源极为本实施例的第一漏极042。相应的，实施例一中的第一漏极为本实施例的第一源极041。
[0099](3)第一源极041经过孔0412与第一信号线10相连。
[0100](4)第二 TFT50中的各第二子TFT05的第二源极051分别经第一 TFT40中的一个第一子TFT04的第一源极041与第一信号线10电连接。从而，使得第二 TFT50中的各第二子TFT05的第二源极051与第一信号线10电连接。
[0101]其余可参照实施例一的描述。需要说明的是，各第一子TFT中，第一栅极还是与第一漏极电连接，各第二子TFT中，第二栅极还是与第二漏极电连接。第二TFT50还是N型TFT。第二信号线20还是为高电平信号线，第三信号线30还是为低电平信号线。
[0102]实施例八
[0103]本实施例提供的静电放电电路，如图4所示，与实施例七不同的是，第二信号线20为低电平信号线，第三信号线30为高电平信号线，第一TFT40为N型TFT，第二TFT50为P型TFT。其余可参照实施例七的描述。
[0104]实施例九
[0105]本实施例提供一种阵列基板，包括上述任一实施例所述的任一静电放电电路。
[0106]例如，本实施例的一个示例中，阵列基板包括显示区和位于显示区外的周边区域，静电放电电路可设置在周边区域中。例如，周边区域可位于显示区的至少一侧，或者周边区域可围绕显示区设置。例如，显示区内还可设置有TFT和与TFT漏极电连接的像素电极等，在此不再详述。
[0107]例如，本实施例的一个示例中，阵列基板上还可包括驱动芯片，用以提供驱动信号给第二信号线和/或第三信号线，以进行静电放电。
[0108]实施例十
[0109]本实施例提供一种显示装置，包括实施例九所述的任一阵列基板。
[0110]有以下几点需要说明:
[0111](I)本公开中，光刻工艺是指包括成膜、曝光、显影等工艺过程，利用光刻胶、掩模板、曝光机等形成图形。形成图形的构图或构图工艺可只包括光刻工艺，或包括光刻工艺以及刻蚀步骤，或者可以包括打印、喷墨等其他用于形成预定图形的工艺，在此不作限定。
[0112](2)本实用新型实施例附图中，只涉及到与本实用新型实施例涉及到的结构，其他结构可参考通常设计。
[0113](3)为了清晰起见，在用于描述本实用新型的实施例的附图中，层或区域的厚度被放大。可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
[0114](4)在不冲突的情况下，本实用新型的不同实施例及同一实施例中的不同特征可以相互组合。
[0115](5)说明书以及附图中，除非另作定义，同一附图标记表示同一元件/部件。
[0116]以上所述，仅为本实用新型的【具体实施方式】，但本实用新型的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本实用新型揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本实用新型的保护范围之内。因此，本实用新型的保护范围应以所述权利要求的保护范围为准。
【主权项】
1.一种静电放电电路，其特征在于，包括第一信号线、第二信号线、和第一薄膜晶体管，所述第一薄膜晶体管包括多个第一子薄膜晶体管； 每个所述第一子薄膜晶体管包括第一源极和第一漏极，所述多个第一子薄膜晶体管依次排布，相邻的所述第一子薄膜晶体管之间共用一个所述第一源极或第一漏极;所述第一信号线和所述第二信号线之一与每个所述第一子薄膜晶体管的所述第一漏极电连接，另一个与每个所述第一子薄膜晶体管的所述第一源极电连接。2.根据权利要求1所述的静电放电电路，其特征在于，还包括第三信号线和第二薄膜晶体管，所述第二薄膜晶体管包括多个第二子薄膜晶体管，每个所述第二子薄膜晶体管包括第二源极和第二漏极，所述多个第二子薄膜晶体管依次排布，相邻的所述第二子薄膜晶体管之间共用一个所述第二源极或第二漏极;所述第一信号线和所述第三信号线之一与每个所述第二子薄膜晶体管的所述第二源极电连接，另一个与每个所述第二子薄膜晶体管的所述第二漏极电连接。3.根据权利要求2所述的静电放电电路，其特征在于，所述第一薄膜晶体管和所述第二薄膜晶体管串联。4.根据权利要求3所述的静电放电电路，其特征在于，所述第三信号线与所述第二薄膜晶体管的所述多个第二漏极电连接，所述第二薄膜晶体管中的各所述第二子薄膜晶体管的所述第二源极经所述第一薄膜晶体管中的至少一个所述第一子薄膜晶体管的至少一个所述第一漏极或所述第一源极与所述第一信号线电连接;或者， 所述第三信号线与所述第二薄膜晶体管的所述多个第二源极电连接，所述第二薄膜晶体管中的各所述第二子薄膜晶体管的所述第二漏极经所述第一薄膜晶体管中的至少一个所述第一子薄膜晶体管的至少一个所述第一漏极或所述第一源极与所述第一信号线电连接。5.根据权利要求2所述的静电放电电路，其特征在于，所述第二信号线和所述第三信号线之一为高电平信号线，另一个为低电平信号线；或者所述第二信号线和所述第三信号线为等电平信号线。6.根据权利要求2所述的静电放电电路，其特征在于，所述第一信号线上积累的正的静电荷通过所述第一薄膜晶体管和所述第二信号线释放，所述第一信号线上积累的负的静电荷通过所述第二薄膜晶体管和所述第三信号线释放，或者，所述第一信号线上积累的负的静电荷通过所述第一薄膜晶体管和所述第二信号线释放，所述第一信号线上积累的正的静电荷通过所述第二薄膜晶体管和所述第三信号线释放。7.根据权利要求2-6任一项所述的静电放电电路，其特征在于，各所述第一子薄膜晶体管包括第一栅极，所述第一栅极与所述第一漏极或所述第一源极电连接;各所述第二子薄膜晶体管包括第二栅极，所述第二栅极与所述第二漏极或所述第二源极电连接。8.根据权利要求7所述的静电放电电路，其特征在于，所述第一薄膜晶体管中的所述多个第一子薄膜晶体管的所述多个第一栅极电连接;所述第二薄膜晶体管的所述多个第二子薄膜晶体管的所述多个第二栅极电连接。9.根据权利要求2-6任一项所述的静电放电电路，其特征在于，所述第一子薄膜晶体管为双栅极薄膜晶体管，所述第二子薄膜晶体管为双栅极薄膜晶体管。10.根据权利要求7所述的静电放电电路，其特征在于，所述第一信号线、各所述第一子薄膜晶体管的所述第一栅极、各所述第二子薄膜晶体管的所述第二栅极由第一薄膜形成。11.根据权利要求2-6任一项所述的静电放电电路，其特征在于，各所述第一子薄膜晶体管的所述第一源极和所述第一漏极、各所述第二子薄膜晶体管的所述第二源极和所述第二漏极、所述第二信号线和所述第三信号线由第二薄膜形成。12.根据权利要求2-6任一项所述的静电放电电路，其特征在于，所述第二信号线包括多个分支，所述第二信号线的多个分支作为所述第一薄膜晶体管的所述多个第一源极或所述多个第一漏极，所述第三信号线包括多个分支，所述第三信号线的多个分支作为所述第二薄膜晶体管的所述多个第二漏极或所述多个第二源极。13.根据权利要求2-6任一项所述的静电放电电路，其特征在于，所述第一薄膜晶体管包括第一有源层，所述第一薄膜晶体管的所述多个第一子薄膜晶体管分用所述第一薄膜晶体管的所述第一有源层的不同部分;所述第二薄膜晶体管包括第二有源层，所述第二薄膜晶体管的所述多个第二子薄膜晶体管分用所述第二薄膜晶体管的所述第二有源层的不同部分。14.根据权利要求13所述的静电放电电路，其特征在于，所述第一子薄膜晶体管的所述第一源极和所述第一漏极分别通过过孔与所述第一薄膜晶体管的所述第一有源层连接;所述第二子薄膜晶体管的所述第二源极和所述第二漏极分别通过过孔与所述第二薄膜晶体管的所述第二有源层连接。15.根据权利要求2-6任一项所述的静电放电电路，其特征在于，所述第一薄膜晶体管为N型薄膜晶体管或P型薄膜晶体管，所述第二薄膜晶体管为N型薄膜晶体管或P型薄膜晶体管。16.根据权利要求2-6任一项所述的静电放电电路，其特征在于，所述第一薄膜晶体管中所述第一子薄膜晶体管和所述第二薄膜晶体管中所述第二子薄膜晶体管的个数均大于或等于4个。17.—种阵列基板，包括权利要求1-16任一项所述的静电放电电路。18.—种显示装置，包括权利要求17所述的阵列基板。
【文档编号】G09G3/36GK205621414SQ201620363192
【公开日】2016年10月5日
【申请日】2016年4月26日
【发明人】龙春平, 先建波
【申请人】京东方科技集团股份有限公司