存储器系统及其操作方法与流程

相关申请的交叉引用

本申请要求于2018年7月25日提交的申请号为10-2018-0086791的韩国专利申请的优先权，其通过引用整体并入本文。

本发明的各种实施例涉及一种存储器系统。更特别地，实施例涉及一种基于非易失性存储器的存储器系统以及操作该存储器系统的方法。

背景技术：

近年来，计算机环境范例已经转变成允许计算机系统被随时随地使用的普适计算。因此，诸如移动电话、数码相机以及笔记本/膝上型计算机的便携式电子装置的使用已经迅速增加。通常，这些便携式电子装置使用利用存储器装置的存储器系统，即数据存储装置。数据存储装置用作便携式电子装置的主存储器装置或辅助存储器装置。

由于这种使用存储器装置的数据存储装置不具有机械驱动部件，因此它们提供诸如优良的稳定性和耐用性、高信息访问速度以及低功耗的优点。具有这些优点的数据存储装置包括通用串行总线(usb)存储器装置、具有各种接口的存储卡以及固态硬盘(ssd)。

技术实现要素：

本发明的实施例涉及一种可以减少在非易失性存储器的多层单元(mlc)区域和单层单元(slc)区域之间的数据迁移的存储器系统、一种能够通过将存储在mlc区域中的多个数据之中的可能被读出的数据迁移至slc区域中来在读取操作期间快速处理数据的存储器系统以及操作存储器系统的方法。

根据本发明的实施例，一种存储器系统包括：非易失性存储器，包括主区域和第一高速缓存区域；以及控制器，适于控制非易失性存储器并且包括第二高速缓存区域，其中控制器包括读取管理器，适于执行基于列表来将存储在主区域中的数据移动至第一高速缓存区域中的迁移操作，列表基于读取数据访问模式而存储多个逻辑块地址(lba)。

列表可以存储基于执行读操作的频率(数据读取计数)而布置的多个lba，并在设定时间更新数据读取计数。

lba的数量可以基于存储在第一高速缓存区域或第二高速缓存区域中的页面的数量。

数据可以被存储在主区域中的多层单元中，并且数据可以被存储在第一高速缓存区域中的单层单元中。

读取管理器当检测到空闲时间时或者周期性地来执行迁移操作，该迁移操作通过检查列表来将存储在主区域中的数据移动到第一高速缓存区域中。

在执行迁移操作之后，读取管理器可以删除存储在主区域中的数据。

读取管理器可以进一步包括：基于根据读取数据访问模式的列表，读取并复制存储在主区域中的数据并将数据存储在第二高速缓存区域中，或者读取并复制存储在第一高速缓存区域中的数据并将数据存储在第二高速缓存区域中。

读取管理器可以检测第二高速缓存区域的数据存储空间的数量，然后从列表中读取与第二高速缓存区域的数据存储空间的检测数量对应的一个或多个lba、从主区域读取并复制与lba对应的数据以及将数据存储在第二高速缓存区域中。

读取管理器可以检测第二高速缓存区域的数据存储空间的数量，然后从列表中读取与第二高速缓存区域的数据存储空间的检测数量对应的一个或多个lba，并且从第一高速缓存区域读取并复制与lba对应的数据，并且将数据存储在第二高速缓存区域中。

根据本发明的实施例，一种操作存储器系统的方法，存储器系统包括非易失性存储器和控制器，非易失性存储器具有主区域和第一高速缓存区域；以及控制器控制非易失性存储器并且包括第二高速缓存区域，该方法可以包括：读取列表，列表基于读取数据访问模式存储多个逻辑块地址(lba)；以及执行迁移操作，该迁移操作基于列表来将存储在主区域中的数据移动至第一高速缓存区域中或基于列表来将存储在主区域中的数据存储在第二高速缓存区域中。

列表可以存储基于执行读操作的频率(数据读取计数)而布置的多个lba，并在设定时间更新数据读取计数。

lba的数量可以基于存储在第一高速缓存区域或第二高速缓存区域中的页面的数量。

数据可以被存储在主区域中的多层单元中，并且数据可以被存储在第一高速缓存区域中的单层单元中。

执行基于列表来将存储在主区域中的数据移动到第一高速缓存区域中的迁移操作可以包括：检测空闲时间或在预定时间段，检测在空闲时间或预定时段期间的第一高速缓存区域的数据存储空间的数量，从列表读取与第一高速缓存区域的数据存储空间的检测数量对应的一个或多个lba，并且将存储在主区域中的与lba对应的数据迁移至第一高速缓存区域中。

基于列表来将存储在主区域中的数据存储在第二高速缓存区域中可以包括：检测空闲时间或在预定时段，检测在空闲时间或预定时段期间的第二高速缓存区域的数据存储空间的数量，从列表读取与第二高速缓存区域的数据存储空间的检测数量对应的一个或多个lba，从主区域读取与lba对应的数据并且将所读取的数据存储在第二高速缓存区域中。

基于所读取的列表将存储在第一高速缓存区域中的数据存储到第二高速缓存区域中可以包括：检测空闲时间或在预定时间段，检测在空闲时间或预定时段期间的第二高速缓存区域的数据存储空间的数量，从列表读取与第二高速缓存区域的数据存储空间的检测数量对应的一个或多个lba，从第一高速缓存区域读取与lba对应的数据，并且将所读取的数据存储在第二高速缓存区域中。

根据本发明的实施例，一种存储器系统包括：非易失性存储器，包括主区域以及第一高速缓存区域，第一高速缓存区域具有比主区域的数据访问速率更快的数据访问速率；以及控制器，包括第二高速缓存区域，第二高速缓存区域具有比主区域的数据访问速率更快的数据访问速率，控制器被配置成：控制非易失性存储器，保持列表，该列表表示特定时间段中的数据项目中的每个被访问的次数，以及基于列表来将存储在主区域中的数据项目移动到第一高速缓存区域或第二高速缓存区域中。

根据本发明的实施例，一种存储器系统包括：非易失性存储器，包括第一访问区域和第二访问区域，第二访问区域具有比第一访问区域的数据访问速率更快的数据访问速率；以及控制器，包括高速缓存区域，控制器被配置成：保持列表，该列表表示数据项目被访问的相对频率，以及基于列表来将数据项目从第一访问区域移动至第二访问区域或者从第一访问区域移动至高速缓存区域。

附图说明

图1是示出包括根据本发明的实施例的存储器系统的数据处理系统的框图。

图2是示出根据本发明的实施例的存储器系统中的存储器装置的示图。

图3是示出根据本发明的实施例的存储器装置中的存储块的存储器单元阵列电路的示图。

图4是示出根据本发明的实施例的存储器系统中的存储器装置的示图。

图5是示出根据本发明的实施例的存储器系统的框图。

图6示出根据本发明的实施例的包括在读取管理器中的示例性列表。

图7示出根据本发明的实施例的读取管理器的操作。

图8示出根据本发明的实施例的包括读取管理器中的示例性列表。

图9至图11示出根据本发明的实施例的读取管理器的操作。

图12至20是是示出根据本发明的实施例的存储器系统的示例性应用的示图。

具体实施方式

以下将参照附图更详细地描述本发明的各个实施例。然而，本发明可以不同形式实施，且不应被解释为限于本文阐述的实施例。相反，提供这些实施例使得本公开全面并将本发明的范围充分地传达给本领域技术人员。在整个本公开中，相同的附图标记在本发明的各个附图和实施例中表示相同的部件。而且，在整个说明书中，对“实施例”，“另一实施例”等的参考不一定仅是一个实施例，并且对任何这种短语的不同参考不一定是相同的实施例。

图1是示出根据实施例的包括存储器系统的数据处理系统100的框图。

参照图1，数据处理系统100可以包括主机102和存储器系统110。

主机102包括例如下列的各种电子装置中的任意一种：诸如移动电话、mp3播放器和膝上型计算机的便携式电子装置或诸如台式计算机、游戏机、电视机(tv)和投影仪的电子装置，即有线和无线电子装置。

主机102包括至少一个操作系统(os)。操作系统通常管理并控制主机102的功能和操作，并且在主机102和使用数据处理系统100或存储器系统110的用户之间提供交互操作性。操作系统支持与主机102的使用和应用对应的各种功能和操作。例如，根据主机102的移动性，操作系统可以是一般操作系统或移动操作系统。根据使用环境，一般操作系统可以是个人操作系统或企业操作系统。例如，配置成支持一般用户的服务提供功能的个人操作系统可以包括windows和chrome，配置成确保并支持高性能的企业操作系统可以包括windowsserver、linux和unix。配置成支持用户的移动服务提供功能和系统节电功能的移动操作系统可以包括android、ios、windowsmobile等。主机102可以包括多个操作系统，并且运行操作系统以利用存储器系统110执行与用户请求对应的操作。主机102将与用户请求对应的多个命令传送至存储器系统110，并且因此，存储器系统110执行与命令对应的操作，即，与用户请求对应的操作。

存储器系统110响应于主机102的请求进行操作，并且特别地，存储待由主机102访问的数据。换言之，存储器系统110可以用作主机102的主存储器装置或辅助存储器装置。根据与主机102联接的主机接口协议，存储器系统110可以实施为各种存储装置中的任何一种。例如，存储器系统110可以被实施为固态硬盘(ssd)、多媒体卡(例如，mmc、嵌入式mmc(emmc)、减小尺寸的mmc(rs-mmc)和微型-mmc)、安全数字卡(例如，sd、迷你-sd和微型-sd)、通用串行总线(usb)存储装置、通用闪存(ufs)装置、标准闪存(cf)卡、智能媒体卡和记忆棒中的任何一种。

实施存储器系统110的存储装置可以是诸如动态随机存取存储器(dram)和/或静态随机存取存储器(sram)的易失性存储器装置或者诸如以下的非易失性存储器装置：只读存储器(rom)、掩膜rom(mrom)、可编程rom(prom)、可擦除可编程rom(eprom)、电可擦除可编程rom(eeprom)、铁电随机存取存储器(fram)、相变ram(pram)、磁性ram(mram)和/或电阻式ram(rram)。

存储器系统110包括存储待由主机102访问的数据的存储器装置150和控制存储器装置150中的数据存储的控制器130。

控制器130和存储器装置150可以集成至一个半导体装置中。例如，控制器130和存储器装置150可以集成至一个半导体装置中以形成固态硬盘(ssd)。在存储器系统110用作ssd的情况下，联接至存储器系统110的主机102的运行速度可以得到提高。控制器130和存储器装置150可以集成至一个半导体装置中以形成诸如以下的存储卡：个人计算机存储卡国际协会(pcmcia)卡、标准闪存(cf)卡、智能媒体卡(例如，sm和smc)、记忆棒、多媒体卡(例如，mmc、rs-mmc和微型mmc)、安全数字卡(例如，sd、迷你-sd、微型-sd和sdhc)和/或通用闪存(ufs)装置。

在另一实施例中，存储器系统110可以设置在计算机、超移动pc(umpc)、工作站、上网本、个人数字助理(pda)、便携式计算机、网络平板、平板电脑、无线电话、移动电话、智能电话、电子书、便携式多媒体播放器(pmp)、便携式游戏机、导航装置、黑盒、数码相机、数字多媒体广播(dmb)播放器、三维电视、智能电视、数字音频记录器、数字音频播放器、数字图片记录器、数字图片播放器、数字视频记录器、数字视频播放器、配置数据中心的存储装置、能够在无线环境下传送和接收信息的装置、配置家庭网络的各种电子装置中的一种、配置计算机网络的各种电子装置中的一种、配置远程信息处理网络的各种电子装置中的一种、无线射频识别(rfid)装置、或者配置计算系统的各种组成元件中的一种中。

实施为非易失性存储器装置时，即使不供应电力，存储器装置150也可以保留存储的数据。特别地，存储器装置150通过写入操作存储从主机102提供的数据，并且通过读取操作将存储的数据提供至主机102。存储器装置150包括多个存储块152、154和156，每个存储块包括多个页面。页面中的每一个包括联接至多个字线(wl)的多个存储器单元。而且，存储器装置150包括多个平面，平面中的每一个包括多个存储块，例如块152、154和156。特别地，存储器装置150可以包括多个存储器管芯，存储器管芯中的每一个包括多个平面。存储器装置150可以是非易失性存储器装置，例如闪速存储器。闪速存储器可以具有三维(3d)堆叠结构。

在下文参照图2至图4给出包括3d堆叠结构的存储器装置150的结构的详细说明。

控制器130响应于来自主机102的请求控制存储器装置150。例如，控制器130将从存储器装置150读取的数据提供至主机102，并且将从主机102提供的数据存储在存储器装置150中。为此，控制器130控制存储器装置150的操作，诸如读取操作、写入操作、编程操作和擦除操作。

控制器130可以包括主机接口(i/f)132、处理器134、错误校正码(ecc)组件138、电源管理单元(pmu)140、存储器接口(i/f)142以及存储器144。

主机接口132处理主机102的命令和数据，并且可以配置成通过诸如以下的各种接口协议中的至少一种与主机102通信：通用串行总线(usb)、多媒体卡(mmc)、高速外围组件互连(pci-e或pcie)、串列scsi(sas)、串行高级技术附件(sata)、并行高级技术附件(pata)、小型计算机系统接口(scsi)、增强型小型磁盘接口(esdi)、电子集成驱动器(ide)以及移动工业处理器接口(mipi)。主机接口32可以通过被称为主机接口层(hil)的固件驱动，主机接口层为与主机102交换数据的区域。

ecc组件138校正存储器装置150中处理的数据的错误位，并且可以包括ecc编码器和ecc解码器。ecc编码器可以对待编程至存储器装置150中的数据进行编码，并且生成添加有奇偶校验位的数据。添加有奇偶校验位的数据可以存储在存储器装置150中。在读取存储在存储器装置150中的数据的情况下，ecc解码器检测并校正从存储器装置150读取的数据中包括的错误。也就是说，在对从存储器装置150读取的数据执行错误校正解码之后，ecc组件138可以确定错误校正解码是否已经成功，输出表示确定结果的指示信号，例如，错误校正成功/失败信号、并且通过使用ecc编码进程中生成的奇偶校验位来校正读取数据的错误位。当错误位的数量超过可校正错误位极限时，ecc组件138不能校正错误位，在这种情况下ecc组件138可以输出指示不能校正错误位的错误校正失败信号。

ecc组件138可以通过使用但不限于以下来执行错误校正：低密度奇偶校验(ldpc)码、博斯-查德胡里-霍昆格姆(bose-chaudhuri-hocquenghem，bch)码、turbo码、里德-所罗门(reed-solomon，rs)码、卷积码、递归系统码(rsc)、网格编码调制(tcm)或分组编码调制(bcm)等。ecc组件138可以包括用于错误校正的电路、模块、系统或装置。

pmu140提供和管理用于控制器130的电源，即，用于控制器130中包括的组成元件的电源。

存储器接口142用作执行控制器130和存储器装置150之间的接口连接的存储器和存储接口以允许控制器130响应于来自主机102的请求来控制存储器装置150。在存储器装置150是闪速存储器的情况下，特别是在存储器装置150是nand闪速存储器的情况下，存储器接口142根据作为nand闪存控制器(nfc)的处理器134的控制来生成用于存储器装置150的控制信号并处理数据。存储器接口142可以支持处理在控制器130和存储器装置150之间交换的命令和数据或更一般地数据的接口，例如nand闪存接口的操作。存储器接口142可以通过被称为闪存接口层(fil)的固件驱动，闪存接口层为与存储器装置150交换数据的区域。

作为存储器系统110和控制器130的工作存储器的存储器144存储用于驱动存储器系统110和控制器130的数据。例如，当控制器130响应于来自主机102的请求控制存储器装置150时，控制器130可以将从存储器装置150读取的数据提供至主机102，和/或将从主机102提供的数据存储在存储器装置150中。为此，当控制器130控制存储器装置150的诸如读取操作、写入操作、编程操作和擦除操作的操作时，存储器144存储允许存储器系统110，即控制器130和存储器装置150之间执行这些操作所需的数据。

存储器144可以由诸如静态随机存取存储器(sram)或动态随机存取存储器(dram)的易失性存储器来实现。此外，存储器144可以被设置在如图1所示的控制器130内。可选地，存储器144可以在控制器130外部，并且在一点上，存储器144可以实现为通过存储器接口与控制器130通信的独立的外部易失性存储器。

如上所述，存储器144存储在主机102和存储器装置150之间执行数据读取操作和写入操作所需的数据以及当执行数据读取操作和写入操作时的数据。对于这种数据存储，存储器144包括程序存储器、数据存储器、写入缓冲器/高速缓存、读取缓冲器/高速缓存、数据缓冲器/高速缓存、映射缓冲器/高速缓存等。

处理器134控制存储器系统110的操作，特别地，响应于来自主机102的写入请求或读取请求控制对存储器装置150的编程操作或读取操作。处理器134驱动被称为闪存转换层(ftl)的固件，以控制存储器系统110的一般操作。处理器134可以由微处理器或中央处理单元(cpu)实现。

例如，控制器130通过处理器134来在存储器装置150中执行主机102请求的操作，即利用存储器装置150执行与从主机102接收的命令对应的命令操作。控制器130可以执行前台操作，该前台操作为与从主机102接收的命令对应的命令操作，例如，与写入命令对应的编程操作、与读取命令对应的读取操作、与擦除命令对应的擦除操作、或与作为设置命令的设置参数命令或设置特征命令对应的参数设置操作。

控制器130还可以通过处理器134执行对存储器装置150的后台操作。对存储器装置150的后台操作包括将存储器装置150的存储块152、154和156中的一个存储块中存储的数据复制到另一存储块中的操作。这种后台操作可以是：垃圾收集(gc)操作；交换存储块152、154和156或存储块152、154和156中存储的数据的操作，例如损耗均衡(wl)操作；将存储在控制器130中的映射数据存储在存储块152、154和156中的操作，例如映射清除操作；或者对存储器装置150执行坏块管理的操作，例如识别并处理存储器装置150中的存储块152、154和156中的坏块的操作。

用于对存储器装置150执行坏块管理的管理单元(未示出)可以包括在控制器130的处理器134中。管理单元识别存储器装置150中的多个存储块152、154和156中的坏块，然后执行可以处理坏块并将坏块标记为坏的坏块管理。在存储器装置150是例如nand闪速存储器的闪速存储器的情况下，当在执行数据写入，例如数据编程时，由于nand闪速存储器的特性而发生编程失败时，可执行坏块管理。处理已经发生编程失败的存储块并将该存储块标记为坏块，并且将编程失败的数据写入，即编程在新的存储块中。此外，在存储器装置150具有如上所述的3d堆叠结构的情况下，如果相应块根据编程失败而被处理为坏块，则因为存储器装置150的使用效率和存储器系统110的可靠性可能突然劣化，因此需要可靠地执行坏块管理。下面将参照图2至图4详细描述根据本公开的实施例的存储器系统中的存储器装置。

图2是示出存储器系统中的存储器装置的示图，图3是示出存储器装置中的存储块的存储器单元阵列电路的示图，并且图4是示出3d非易失性存储器装置的结构的示图。

参照图2，存储器装置150可以包括多个存储块，例如152、154以及156。块152、154以及156中的每一个包括多个页面，例如2^m页面或m页面。每个页面包括连接至多个字线(wl)的多个存储器单元。

根据一个存储器单元中存储或表达的位的数量，存储器装置150可以包括单层单元(slc)存储块和/或多层单元(mlc)存储块。slc存储块包括由每一个存储1位数据的存储器单元实现的多个页面。mlc存储块可以包括由每一个存储多位(例如，两位或更多位)数据的存储器单元实现的多个页面，并且具有比slc存储块大的数据存储空间，即mlc存储块能够被高度集成。特别地，存储器装置150可以包括：包括由每一个能够存储两位数据的存储器单元实现的多个页面的mlc存储块，包括由每一个能够存储三位数据的存储器单元实现的多个页面的三层单元(tlc)存储块，包括由每一个能够存储四位数据的存储器单元实现的多个页面的四层单元(qlc)存储块，或者包括由每一个能够存储五位或更多位数据的存储器单元实现的多页面的多层单元存储块，作为mlc存储块。

尽管作为示例描述了存储器装置150由诸如闪速存储器，例如nand闪速存储器的非易失性存储器实现，但应注意的是，存储器装置150可以作为诸如以下的多种类型的存储器中的任一种实施：相变存储器(即，相变随机存取存储器(pcram))、电阻式存储器(即，电阻式随机存取存储器(rram或reram))、铁电存储器(即，铁电随机存取存储器(fram))和自旋转移力矩磁性存储器(即，自旋转移力矩磁性随机存取存储器(stt-ram或stt-mram))。

存储块152、154以及156中的每一个通过写入操作存储从图1的主机102提供的数据，并且通过读取操作将存储的数据提供至主机102。

参照图3，存储块330表示存储器系统110的存储器装置150中的存储块152、154和156中的任意一个。每个存储块330可以包括实现为存储器单元阵列并且分别连接到位线bl0至blm-1的多个单元串340。每个列的单元串340可以包括至少一个漏极选择晶体管dst和至少一个源极选择晶体管sst。多个存储器单元或存储器单元晶体管mc0至mcn-1可以串联地连接在选择晶体管sst和dst之间。各存储器单元mc0至mcn-1可以由每一个存储多位数据或信息的多层单元(mlc)构成。单元串340可以分别电连接到相应的位线bl0至blm-1。

虽然图3作为示例示出每个存储块330由nand闪速存储器单元构成，但注意的是，存储块器装置150不限于nand闪速存储器，相反可以由nor闪速存储器、组合至少两种存储器单元的混合闪速存储器或控制器内置在存储器芯片中的1-nand闪速存储器实现。存储器装置150不仅可以实现为电荷存储层由导电浮栅构成的闪速存储器装置，而且可以实现为电荷存储层由介电层构成的电荷撷取闪存(ctf)存储器装置。

存储器装置150的电压供给电路310可以根据操作模式提供待供给到各字线的字线电压(例如，编程电压、读取电压和通过电压)，以及待供给至由存储器单元形成的体材料(bulk)(例如，阱区)的电压。电压供给电路310的电压生成操作可以通过控制电路(未示出)的控制执行。电压供给单元310可以生成多个可变读取电压以生成多个读取数据，响应于控制电路的控制选择存储器单元阵列的存储块(或扇区)中的一个，选择所选择的存储块的字线中的一个，并且将字线电压提供至所选择的字线和未选择的字线。

存储器装置150的读取/写入电路320由控制电路(未示出)控制，并且可以根据操作模式用作读出放大器或写入驱动器。在验证/正常读取操作期间，读取/写入电路320可以用作用于从存储器单元阵列读取数据的读出放大器。在编程操作期间，读取/写入电路320可以用作根据待被存储在存储器单元阵列中的数据驱动位线的写入驱动器。在编程操作期间，读取/写入电路320可以从缓冲器(未示出)接收待写入到存储器单元阵列中的数据并且可以根据输入的数据来驱动位线。为此，读取/写入电路320可以包括分别对应于列(或位线)或列对(或位线对)的多个页面缓冲器(pb)322、324和326，并且页面缓冲器322、324和326中的每一个可以包括多个锁存器(未示出)。

存储器装置150可以被实现为二维(2d)或三维(3d)存储器装置。具体地，如图4所示，存储器装置150可以被实现为具有3d堆叠结构的非易失性存储器装置。在这种情况下，存储器装置150可以包括多个存储块blk0至blkn-1。图4示出了图1所示的存储器装置150的存储块152、154和156。如图4中所示，存储块152、154和156中的每一个可以被实现为3d结构(或垂直结构)，该3d结构在第一方向至第三方向，例如，x轴方向、y轴方向和z轴方向上延伸。

每个存储块330可以包括在第二方向上延伸的多个nand串ns。多个nand串ns可以在第一方向和第三方向上提供。每个nand串ns可以连接至位线bl、至少一个串选择线ssl、至少一个接地选择线gsl、多个字线wl、至少一个虚设字线dwl和共源线csl，并且可以包括多个晶体管结构ts。

每个存储块330可以连接至多个位线bl、多个串选择线ssl、多个接地选择线gsl、多个字线wl、多个虚设字线dwl和多个共源线csl，因此每个存储块330可以包括多个nand串ns。并且，在每个存储块330中，多个nand串ns可以连接至一个位线bl，多个晶体管可以实现在一个nand串ns中。每个nand串ns的串选择晶体管sst可以连接至对应的位线bl，并且每个nand串ns的接地选择晶体管gst可以连接至共源线csl。存储器单元mc可以设置在每个nand串ns的串选择晶体管sst和接地选择晶体管gst之间。即，多个存储器单元可以实现在每个存储块330中。

图5是示出根据本发明的实施例的包括存储器系统110的数据处理系统100的框图。

参照图5，存储器系统110可以包括存储器装置150和控制器130。

存储器装置150可以包括非易失性存储器151，并且可以由控制器130控制，并且可以执行与控制器130的请求对应的操作(例如，读取操作和写入操作)。非易失性存储器151可以包括主区域和高速缓存区域。主区域可以包括多层单元(mlc)区域151a，并且高速缓存区域可以包括单层单元(slc)区域151b。mlc区域151a和slc区域151b可以如图5的实施例中所示被实现在一个存储器装置中或分别被实现在单独的存储器装置中。适合于低速率操作的映射方案可以应用于mlc区域151a，并且适合于高速率操作的映射方案可以应用于slc区域151b。例如，可以基于块映射方案来管理mlc区域151a，并且可以基于页面映射方案来管理slc区域151b。因为页面映射方案不需要导致操作性能劣化的合并操作，所以slc区域151b能够以高速操作。另一方面，由于块映射方案需要这样的合并操作，因此mlc区域151a可能以相对低速操作。

mlc区域151a可以在每个单元中存储2位数据，并且slc区域151b可以在每个单元中存储1位数据。

控制器130可以响应于来自主机的请求来控制对存储器装置的读取操作或写入操作。控制器130可以包括主机接口132、处理器134、ecc138、pmu140、存储器接口142、存储器144和读取管理器146。由于以上参照图1描述了主机接口132、处理器134、ecc138、pmu140、存储器接口142和存储器144，因此此处省略对它们的描述。读取管理器146可以管理以下操作：将存储在存储器装置150的mlc区域151a中的数据迁移至slc区域151b或存储器144中的缓冲器。此外，读取管理器146可以管理以下操作：将存储在slc区域151b中的数据迁移至存储器144中的缓冲器。将参照图6至图11详细描述读取管理器146的操作。

图6示出根据本发明的实施例的包括在读取管理器146中的示例性列表。

参照图6，列表可以是根据数据的访问模式来存储逻辑块地址(lba)的列表。通常，当分析数据的访问模式时，经常读取的数据和/或最近读取的数据很大可能被再次读取。在本发明的该实施例中，如图6所示，根据数据读取计数来布置lba。

列表可以存储最近读取最多的数据的lba。也就是说，列表可以包括多个逻辑块地址(lba)，该多个逻辑块地址根据对关联数据执行数据读取操作的频率来被顺序地布置，其中对关联数据执行数据读取操作的频率有时被称为数据读取计数。可以通过在设定时段或预定时段检查数据读取计数来更新列表，其中设定时段或预定时段可重复出现。在这种布置中，与读取最多的数据对应的lba可以位于列表的第一区域中。存储在列表中的lba的数量可以基于在slc区域中可以存储的页面数量。例如，可以基于以下假设来描述本发明的实施例：可以存储在列表中的lba的数量等于可以存储在slc区域中的页面的数量。例如，列表可以存储分别与第一至第五索引对应的lba，其中第一至第五索引用于a至e数据。基于数据读取计数，列表可按照a→d→e→c→b数据的次序来顺序地存储与a至e数据对应的lba。

图7示出根据本发明的实施例的读取管理器的操作。

参照图7，读取管理器146可以执行基于列表将存储在mlc区域151a中的数据移动至slc区域151b的迁移操作。可以通过各种方法来执行将数据从mlc区域151a迁移至slc区域151b的操作。例如，每当检测到空闲时间时，读取管理器146可以通过检查列表来执行将存储在mlc区域151a中的数据迁移至slc区域151b的操作。可选地，可以周期性地，例如在重复出现的设定时间执行将存储在mlc区域151a中的数据迁移至slc区域151b的操作。例如，读取管理器146可以在每个空闲时间检查列表并将存储在mlc区域151a中的数据迁移至slc区域151b中。更具体地，读取管理器146可以检查存储在列表中的、与a至e数据对应的lba，并且将存储在mlc区域151a中的所有数据之中的a至e数据迁移至slc区域151b中。由于mlc区域151a和slc区域151b处于非易失性存储器装置中，因此mlc区域151a中的数据不被复制到slc区域151b中并且被重复存储；相反，存储在mlc区域151a中的数据被迁移至slc区域151b中。因此，存储在mlc区域151a中的a数据到e数据是无效数据。

图8示出根据本发明的实施例的包括在读取管理器146中的示例性列表。

参照图8，列表可以根据数据的访问模式存储lba。通常，当分析数据的访问模式时，具有高数据读取计数的数据或最近读取的数据很大可能被再次读取。将基于包括根据数据读取计数布置的lba的列表来描述本发明的该实施例。

列表可以是存储最近读取最多的数据的lba的列表。也就是说，列表可以包括多个逻辑块地址(lba)，该多个逻辑块地址(lba)根据数据读取计数而被顺序地布置。可以通过在设定或预定时段检查数据读取计数来更新列表。与最频繁或最常读取的数据对应的lba可以位于列表的第一区域中。存储在列表中的lba的数量可以基于通过合并slc区域的大小和存储器144中的高速缓存区域的大小而获得的大小。例如，可以基于以下假设来描述本发明：可被存储在列表中的lba的数量等于通过合并slc区域的大小和包括在存储器144中的高速缓存区域的大小而获得的大小。例如，列表可以存储a至j数据的lba。基于数据读取计数，列表可按照e→d→c→g→f→j→i→h→b→a数据的次序来顺序地存储与a至j数据对应的lba。

图9至图11示出根据本发明的实施例的读取管理器146的操作。图9至图11的读取管理器146可以基于列表来将存储在mlc区域151a中的数据复制到高速缓存区域144中，或者当数据未被复制到高速缓存区域144中时，读取管理器146可以将存储在mlc区域151a中的数据迁移至slc区域151b中，或者当数据未被复制至高速缓存区域144或未被迁移至slc区域151b时，读取管理器146可以指定并操作mlc区域151a的一部分作为slc区域151b。

参照图9，读取管理器146可以基于列表来将存储在mlc区域151a中的数据复制到高速缓存区域144中。

首先，读取管理器146可以检测高速缓存区域144中的数据存储空间的数量，并且基于存储在列表的第一部分中的lba来顺序地执行多个读取操作，直达达到高速缓存区域144的数据存储空间的检测数量。读取管理器146可以从mlc区域151a读取与lba对应的数据，并将数据存储在高速缓存区域144中。例如，当在高速缓存区域144中存在三个数据存储空间时，读取管理器146可以从列表的第一部分顺序地读取e-lba，d-lba和c-lba。换言之，如图9中所示，读取管理器146可以基于在列表的第一部分中存储和读取的e-lba、d-lba和c-lba，从mlc区域151a读取与e-lba、d-lba和c-lba对应的数据，并将它们存储在高速缓存区域144中。当在mlc区域151a中没有与读取的lba对应的数据时，读取管理器146可以从slc区域151b读取与lba对应的数据，并将数据存储在高速缓存区域144中。

参照图10，读取管理器146可以执行基于列表将存储在mlc区域151a中的数据移动至slc区域151b中的迁移操作。

首先，读取管理器146可以检测slc区域151b中的可以存储数据的数据存储空间的数量，并且顺序地执行与检测到的slc区域151b的数据存储空间一样多的读取操作。读取管理器146可以基于读取的lba来从mlc区域151a读取与lba对应的数据，并将数据迁移至slc区域151b。例如，当假设在slc区域151b中存在五个数据存储空间时，读取管理器146可以从列表读取lba之中的除第一部分之外的g-lba、f-lba、j-lba、i-lba和h-lba。读取管理器146可以基于读取的g-lba、f-lba、j-lba、i-lba和h-lba，将与g-lba、f-lba、j-lba、i-lba和h-lba对应的数据从mlc区域151a读取到slc区域151b中。因此，存储在mlc区域151a中的、与g-lba、f-lba、j-lba、i-lba和h-lba对应的数据可以是无效数据。

参照图11，当读取管理器146不执行基于列表将存储在mlc区域151a中的数据迁移至slc区域151b中或者将存储在mlc区域151a中的数据复制到高速缓存区域中的操作时，读取管理器146可以指定mlc区域151a的一部分并且将数据迁移至mlc区域151a的一部分中。

首先，读取管理器146可以在高速缓存区域144和slc区域151b中检测可以存储数据的空间。当高速缓存区域144和slc区域151b中的存储空间不足时，与除了列表的第一和第二部分之外的、mlc区域151a的剩余lba对应的数据，即与第三部分中的lba对应的数据可以不被复制到高速缓存区域144中或者迁移至slc区域151b中。此处，可以在mlc区域151a中指定部分151c，并且与包括在第三部分中的lba对应的数据可以被迁移至指定部分151c中。例如，当高速缓存区域144和slc区域151b中的存储空间不足时，读取管理器146可以从列表中读取第三部分中的b-lba和a-lba。读取管理器146可以基于读取的b-lba和a-lba来在mlc区域151a中指定部分151c，并将与b-lba和a-lba对应的数据迁移至mlc区域151a的部分151c中。

参照图12至图20，描述根据实施例的可以应用上述包括存储器装置150和控制器130的存储器系统100的数据处理系统和电子设备。

图12是示出包括根据实施例的存储器系统的数据处理系统的示图。图12示出应用存储器系统的存储卡系统6100。

参照图12，存储卡系统6100包括连接器6110、存储器控制器6120和存储器装置6130。

存储器控制器6120与实施为非易失性存储器(nvm)的存储器装置6130连接，以访问存储器装置6130。例如，存储器控制器6120控制存储器装置6130的读取操作、写入操作、擦除操作和后台操作。存储器控制器6120提供存储器装置6130和主机(未示出)之间的接口并驱动用于控制存储器装置6130的固件。也就是说，存储器控制器6120可对应于上面参照图1描述的存储器系统110中的控制器130，并且存储器装置6130可对应于上面参照图1描述的存储器系统110中的存储器装置150。

因此，存储器控制器6120可包括诸如随机存取存储器(ram)、处理器、主机接口、存储器接口和错误校正组件的组件。

存储器控制器6120可通过连接器6110与例如上面参照图1描述的主机102的外部装置通信。例如，如上面参照图1所述的，存储器控制器6120可被配置为通过诸如以下的各种通信协议中的至少一种与外部装置通信：通用串行总线(usb)、多媒体卡(mmc)、嵌入式mmc(emmc)、外围组件互连(pci)、高速pci(pcie)、高级技术附件(ata)、串行ata、并行ata、小型计算机系统接口(scsi)、增强型小型磁盘接口(edsi)、电子集成驱动器(ide)、火线、通用闪存(ufs)、wifi或wi-fi以及蓝牙。因此，根据实施例的存储器系统和数据处理系统可应用于有线和/或无线电子设备，特别是移动电子设备。

存储器装置6130可通过诸如以下的非易失性存储器来实施：电可擦除可编程rom(eprom)、nand闪速存储器、nor闪速存储器、相变ram(pram)、电阻式ram(reram)、铁电ram(fram)和/或自旋转移力矩磁性ram(stt-mram)。

存储器控制器6120和存储器装置6130可集成到一个半导体装置中，以形成固态硬盘(ssd)、或诸如以下的存储卡：pc卡(个人计算机存储卡国际协会(pcmcia))、标准闪存(cf)卡、智能媒体卡(例如，sm和smc)、记忆棒、多媒体卡(例如，mmc、rs-mmc、微型mmc和emmc)、安全数字(sd)卡(例如，sd、迷你sd、微型sd和sdhc)或通用闪存(ufs)。

图13是示出包括根据实施例的存储器系统的数据处理系统6200的示图。

参照图13，数据处理系统6200包括通过至少一个非易失性存储器(nvm)实施的存储器装置6230和控制存储器装置6230的存储器控制器6220。数据处理系统6200可以是诸如存储卡(例如，cf、sd和微型sd)的存储介质。存储器装置6230可对应于上面参照图1描述的存储器系统110中的存储器装置150，并且存储器控制器6220可对应于上面参照图1描述的存储器系统110中的控制器130。

存储器控制器6220可响应于来自主机6210的请求来控制对存储器装置6230的读取操作、写入操作和擦除操作。存储器控制器6220包括至少一个cpu6221、诸如ram6222的缓冲存储器、ecc电路6223、主机接口6224以及诸如nvm接口6225的存储器接口。

cpu6221可控制对存储器装置6230的一般操作，例如读取、写入、文件系统管理和坏页面管理等。ram6222可根据cpu6221的控制来操作且可以用作工作存储器、缓冲存储器或高速缓存存储器等。在ram6222用作工作存储器的情况下，通过cpu6221处理的数据可被临时存储在ram6222中。在ram6222用作缓冲存储器的情况下，ram6222用于缓冲从主机6210传送到存储器装置6230的数据或从存储器装置6230传送到主机6210的数据。在ram6222用作高速缓存存储器的情况下，ram6222可用来使低速存储器装置6230能够以高速操作。

ecc电路6223对应于上面参照图1描述的控制器130的ecc组件138。如上面参照图1所述，ecc电路6223生成用于校正从存储器装置6230接收的数据中的失效位或错误位的错误校正码(ecc)。并且，ecc电路6223可对将提供至存储器装置6230的数据执行错误校正编码，并生成添加有奇偶校验位的数据。奇偶校验位可被存储在存储器装置6230中。ecc电路6223可对从存储器装置6230输出的数据执行错误校正解码。ecc电路6223可通过使用奇偶校验位来校正错误。例如，如上面参照图1所述，ecc电路6223可通过使用诸如ldpc码、bch码、turbo码、里德-所罗门)码、卷积码、rsc、tcm和bcm的各种编码调制来校正错误。

存储器控制器6220可通过主机接口6224向主机6210传送数据以及从主机6210接收数据，并通过nvm接口6225向存储器装置6230传送数据以及从存储器装置6230接收数据。主机接口6224可通过pata总线、sata总线、scsi、usb、pcie或nand接口与主机6210连接。此外，由于实施了诸如wifi或长期演进(lte)的无线通信功能或移动通信协议，存储器控制器6220可通过与外部装置，例如主机6210或另一外部装置连接来传送和接收数据。具体地，由于存储器控制器6220被配置为通过各种通信协议中的至少一种与外部装置进行通信，因此根据实施例的存储器系统和数据处理系统可应用于有线和/或无线电子设备，特别是移动电子设备。

图14是示出包括根据实施例的存储器系统的数据处理系统的示图。图14示出应用存储器系统的固态硬盘(ssd)6300。

参照图14，ssd6300包括控制器6320和包括多个非易失性存储器(nvm)的存储器装置6340。控制器6320可对应于上面参照图1描述的存储器系统110中的控制器130，并且存储器装置6340可对应于上面参照图1描述的存储器系统110中的存储器装置150。

控制器6320通过多个信道ch1、ch2、ch3、……和chi与存储器装置6340连接。控制器6320包括至少一个处理器6321、ecc电路6322、主机接口6324、缓冲存储器6325以及例如非易失性存储器接口6326的存储器接口。

缓冲存储器6325临时存储从主机6310接收的数据或从存储器装置6340中包括的多个闪速存储器nvm接收的数据，或者临时存储多个闪速存储器nvm的元数据，例如，包括映射表的映射数据。缓冲存储器6325可通过诸如但不限于dram、sdram、ddrsdram、lpddrsdram和gram的易失性存储器或诸如但不限于fram、reram、stt-mram和pram的非易失性存储器来实现。尽管图13示出了缓冲存储器6325设置在控制器6320内部，然而缓冲存储器6325可设置在控制器6320外部。

ecc电路6322可在编程操作期间计算待被编程到存储器装置6340中的数据的错误校正编码值。在读取操作期间，ecc电路6322基于错误校正编码值对从存储器装置6340读取的数据执行错误校正操作。在失效数据的恢复操作期间，ecc电路6322对从存储器装置6340恢复的数据执行错误校正操作。

主机接口6324提供与诸如主机6310的外部装置的接口功能，并且非易失性存储器接口6326提供与通过多个信道ch1、ch2、ch3、……和chi连接的存储器装置6340的接口功能。

由于使用了每一个均应用了上面参照图1描述的存储器系统110的多个ssd6300，因此可实现数据处理系统，例如，独立磁盘冗余阵列(raid)系统。在raid系统中，可包括多个ssd6300和用于控制多个ssd6300的raid控制器。在通过从主机6310接收写入命令而执行编程操作的情况下，raid控制器可对应于接收的写入命令的raid级别信息在多个raid级别，即多个ssd6300中选择至少一个存储器系统，即，至少一个ssd6300，并可将与写入命令对应的数据输出到选择的ssd6300。并且，在通过从主机6310接收读取命令而执行读取操作的情况下，raid控制器可对应于接收的读取命令的raid级别信息在多个raid级别，即多个ssd6300中选择至少一个存储器系统，即，至少一个ssd6300，并可将从选择的ssd6300输出的数据提供给主机6310。

图15是示出包括根据实施例的存储器系统的数据处理系统的示图。图15示出应用存储器系统的嵌入式多媒体卡(emmc)6400。

参照图15，emmc6400包括控制器6430和通过至少一个nand闪速存储器实施的存储器装置6440。控制器6430可对应于上面参照图1描述的存储器系统110中的控制器130，并且存储器装置6440可对应于上面参照图1描述的存储器系统110中的存储器装置150。

控制器6430通过多个信道与存储器装置6440连接。控制器6430包括至少一个内核6432、主机接口(i/f)6431和存储器接口，即nand接口(i/f)6433。

内核6432控制emmc6400的一般操作。主机接口6431提供控制器6430和主机6410之间的接口功能。nand接口6433提供存储器装置6440和控制器6430之间的接口功能。例如，主机接口6431可以是并行接口，例如上面参照图1所描述的mmc接口，并且主机接口6431可以是串行接口，例如超高速(uhs)-i/uhs-ii接口和/或ufs接口。

图16至图19是示出包括根据实施例的存储器系统的数据处理系统的示例的示图。图16至图19中的每一个示出应用存储器系统的通用闪存(ufs)。

参照图16至图19，各ufs系统6500、6600、6700和6800可分别包括主机6510、6610、6710和6810，ufs装置6520、6620、6720和6820以及ufs卡6530、6630、6730和6830。各主机6510、6610、6710和6810可以是有线和/或无线电子设备，特别是移动电子设备等的应用处理器，各ufs装置6520、6620、6720和6820可以是嵌入式ufs装置。各ufs卡6530、6630、6730和6830可以是外部嵌入式ufs装置或可移除ufs卡。

在各ufs系统6500、6600、6700和6800中，主机6510、6610、6710和6810，ufs装置6520、6620、6720和6820以及ufs卡6530、6630、6730和6830可通过ufs协议与例如有线和/或无线电子设备，特别是移动电子设备等的外部装置通信。ufs装置6520、6620、6720和6820以及ufs卡6530、6630、6730和6830可被实施为上面参照图1描述的存储器系统110。例如，在各ufs系统6500、6600、6700和6800中，ufs装置6520、6620、6720和6820可以参照图13至图15描述的数据处理系统6200、ssd6300或emmc6400的形式来实施，并且ufs卡6530、6630、6730和6830可以参照图12描述的存储卡系统6100的形式来实施。

在各ufs系统6500、6600、6700和6800中，主机6510、6610、6710和6810，ufs装置6520、6620、6720和6820以及ufs卡6530、6630、6730和6830可通过通用闪存(ufs)接口，例如，移动工业处理器接口(mipi)中的mipim-phy和mipi统一协议(unipro)来执行通信。ufs装置6520、6620、6720和6820与ufs卡6530、6630、6730和6830可通过除ufs协议之外的另一协议，例如，诸如通用存储总线(usb)、闪存驱动器(ufd)、多媒体卡(mmc)、安全数字(sd)、迷你sd和微型sd的各种卡协议中的任意一种来执行通信。

在图16所示的ufs系统6500中，主机6510、ufs装置6520以及ufs卡6530中的每一个可包括unipro。主机6510执行交换操作，以便与ufs装置6520和ufs卡6530中的每一个通信。特别地，主机6510通过例如l3交换的unipro中的链路层交换与ufs装置6520或ufs卡6530来执行通信。ufs装置6520和ufs卡6530可通过主机6510的unipro中的链路层交换来执行通信。尽管作为示例描述了一个ufs装置6520和一个ufs卡6530连接到主机6510，然而要注意的是，多个ufs装置和多个ufs卡可以并联布置或星型布置连接到主机6510。并且，多个ufs卡可以并联式布置、星型式布置、串联式布置或链型式布置连接到ufs装置6520。

在图17所示的ufs系统6600中，主机6610、ufs装置6620和ufs卡6630中的每一个可包括unipro。主机6610通过执行交换操作的交换模块6640，例如，执行例如l3交换操作的unipro中的链路层交换的交换模块6640，来与ufs装置6620或ufs卡6630通信。ufs装置6620和ufs卡6630可通过在交换模块6640的unipro中的链路层交换来执行通信。尽管作为示例描述了一个ufs装置6620和一个ufs卡6630连接到交换模块6640，然而要注意的是，多个ufs装置和多个ufs卡可以并联式布置或星型式布置连接到交换模块6640。并且，多个ufs卡可以并联式布置、星型式布置、串联式布置或链型式布置连接到ufs装置6620。

在图18所示的ufs系统6700中，主机6710、ufs装置6720和ufs卡6730中的每一个中可包括unipro。主机6710通过执行交换操作的交换模块6740，特别地，执行例如l3交换操作的unipro中的链路层交换的交换模块6740，来与ufs装置6720或ufs卡6730通信。ufs装置6720和ufs卡6730可通过交换模块6740的unipro中的链路层交换来执行通信。交换模块6740可在ufs装置6720内部或外部与ufs装置6720实施为一个模块。尽管作为示例描述了一个ufs装置6720和一个ufs卡6730连接到交换模块6740，然而要注意的是，交换模块6740和ufs装置6720分别被实施在其中的多个模块可以并联式布置或星型式布置连接到主机6710。并且，各模块可以串联式布置或以链型式布置连接，或者多个ufs卡可以并联式布置或星型式布置连接到交换模块6740。

在图19所示的ufs系统6800中，主机6810、ufs装置6820和ufs卡6830中的每一个中存在m-phy和unipro。ufs装置6820执行交换操作以便与主机6810和ufs卡6830通信。特别地，ufs装置6820通过用于与主机6810通信的m-phy和unipro模块之间的交换和用于与ufs卡6830通信的m-phy和unipro模块之间的交换，例如目标标识符(id)交换，来与主机6810或ufs卡6830通信。主机6810和ufs卡6830可通过ufs装置6820的m-phy和unipro模块之间的目标id交换来执行通信。尽管作为示例描述了一个ufs装置6820连接到主机6810并且一个ufs卡6830连接到ufs装置6820，然而要注意的是，多个ufs装置可以并联式布置或星型式布置连接到主机6810。并且，多个ufs卡可以并联式布置、星型式布置、串联式布置或链型式布置中的任一种连接到ufs装置6820。

图20是示出包括根据实施例的存储器系统的数据处理系统的示图。图20示出应用存储器系统的用户系统6900。

参照图20，用户系统6900包括用户接口6910、存储器模块6920、应用处理器6930、网络模块6940和存储模块6950。

应用处理器6930驱动用户系统6900中包括的组件和操作系统(os)。例如，应用处理器6930可以包括控制用户系统6900中包括的组件的控制器、接口和图形引擎以及其它组件。应用处理器6930可被设置为片上系统(soc)。

存储器模块6920可用作用户系统6900的主存储器、工作存储器、缓冲存储器或高速缓存存储器。存储器模块6920可包括诸如dram、sdram、ddrsdram、ddr2sdram、ddr3sdram、lpddrsdarm、lpddr2sdram和lpddr3sdram的易失性随机存取存储器，或诸如pram、reram、mram和fram的非易失性随机存取存储器。例如，应用处理器6930和存储器模块6920可作为堆叠封装(pop)来安装。

网络模块6940可与外部装置通信。例如，网络模块6940不仅可支持有线通信，而且可支持各种无线通信，诸如码分多址(cdma)、全球移动通信系统(gsm)、宽带cdma(wcdma)、cdma-2000、时分多址(tdma)、长期演进(lte)、全球微波接入互操作性(wimax)、无线局域网(wlan)、超宽带(uwb)、蓝牙、无线显示(wi-di)等，因此可与有线和/或无线电子设备，特别是移动电子设备通信。因此，存储器系统和数据处理系统可应用于有线和/或无线电子设备。网络模块6940可包括在应用处理器6930中。

存储模块6950可存储数据，例如从应用处理器6930接收的数据，并且可将存储在其中的数据传送到应用处理器6930。存储模块6950可通过诸如相变ram(pram)、磁性ram(mram)、电阻式ram(reram)、nand闪速存储器、nor闪速存储器和三维nand闪速存储器的非易失性存储器中的任意一种来实施。并且，存储模块6950可被提供为诸如用户系统6900的存储卡或外部驱动器的可移除存储介质。也就是说，存储模块6950可对应于上面参照图1描述的存储器系统110，并且可被实施为上面参照图14至图19描述的ssd、emmc和ufs。

用户接口6910可包括用于向应用处理器6930输入数据或命令或者用于将数据输出到外部装置的接口。例如，用户接口6910可包括诸如键盘、小键盘、按钮、触摸面板、触摸屏、触摸板、触摸球、摄像机、麦克风、陀螺仪传感器、振动传感器和压电元件的用户输入接口，以及诸如液晶显示器(lcd)、有机发光二极管(oled)显示装置、有源矩阵oled(amoled)显示装置、led、扬声器和监视器的用户输出接口。

在上面参照图1描述的存储器系统110被应用于根据实施例的用户系统6900的移动电子设备的情况下，如上所述，应用处理器6930控制移动电子设备的一般操作，并且作为通信模块的网络模块6940控制与外部装置的有线和/或无线通信。作为移动电子设备的显示和触摸模块的用户接口6910显示应用处理器6930处理的数据，或支持来自触摸面板的数据输入。

根据本发明的实施例，存储器系统和操作该存储器系统的方法可以通过将存储在非易失性存储器的mlc区域中的多个数据之中的可能被读出的数据复制或迁移至高速缓存区域或slc区域中，来在读取操作期间快速地处理数据。

虽然已经针对特定实施例示出并描述了本发明，但是根据本公开，本领域技术人员将显而易见的是，在不脱离如所附权利要求中限定的本发明的精神和范围的情况下，可以进行各种改变和修改。