专利名称：：存储器宏及电路布局产生方法
技术领域：
：本发明涉及一种集成电路设计，特别是涉及一种具有不规则边缘单元的存储器宏。
背景技术：
：由于现今电子电路的复杂度越来越高，迫使电子电路设计者必须依赖计算机程序来帮助或自动化设计制造工艺中大部分的步骤。一个典型的电路设计包含有十万或百万个单一的部分或"叶单元"(leafcell)或"单元"(cell)。这样的设计对于电路设计者，甚至设计团队而言过于庞大以至于无法手动管理。因此，通常会使用存储器编译器来帮助存储器设计。一个典型的存储器编译器是一组具有多个且已参数化的产生器，其可以帮助设计者规划(layout)存储器宏，如动态随机存取存储器(dynamicrandomaccessmemory,DRAM)宏或静态随机存取存储器(stadcrandomaccessmemory,SRAM)宏。传统上，所有存储器布置图中的单元是完全相同的。然而，在一个典型的存储器装置中，在存储模块边缘单元的电子特性通常会比他们的内部副本弱。其中一个造成边缘单元的电子特性较弱的原因为负载效应(loadingeffect):其是一种因蚀刻率随晶片变化而改变，导致覆盖在晶片表面的图案密度(patterndensity)变化的现象。这些边缘单元相较于内部单元，具有较小的存储电容及驱动电流。在某些情况下，电子特性较弱的边缘单元会对于存储器装置的合格率造成不利的影响。因此，需要一种存储器装置，其具有修改过的边缘单元，以改进整体的性能及合格率。
发明内容鉴于上述现有技术不足，提出本发明。本发明提供一种电路布局产生方法，适用于使用存储器编译器产生电路布局，包括产生第一组单元，设置于该电路布局的第一区域;以及产生第二组单元，设置于该第一区域的边缘，该第二组单元为可操作的且与该第一组单元具有不同的物理尺寸，由此强化依据此电路布局所制造出的装置。如上所述的电路布局产生方法，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长5%。如上所述的电路布局产生方法，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长出的尺寸在5%至30%的范围内。本发明还提供一种电路布局产生方法，适用于使用存储器编译器产生路布局，包括产生第一组单元，设置于该电路布局的第一区域;以及产生第二组单元，设置于该第一区域的边缘，该第二组单元为不动作的且与该第一组单元具有不同的物理尺寸，由此强化依据此电路布局所制造出的装置。如上所述的电路布局产生方法，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长5%。如上所述的电路布局产生方法，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长出的尺寸在5%至30%的范围内。如上所述的电路布局产生方法，其中该第二组单元省略使得该第二组单元能够操作的至少一个关键层。如上所述的电路布局产生方法，其中该第二组单元省略使得该第二组单元能够操作的至少一个关键电子元件。本发明还提出一种具有不规则边缘单元的存储器宏。在本发明实施例中，存储器宏包含设置在存储模块中第一区域的第一组单元，以及为了改进存储模块中边缘单元的坚固性(robustness),设置在第一个区域边缘且具有与第一组单元不同的物理尺寸(physicaldimension)的第二组单元。如上所述的存储器宏，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长5%。如上所述的存储器宏，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长处的尺寸在5%至30%的范围内。如上所述的存储器宏为静态随机存取存储器、动态随机存取存储器、非易失性存储器、以及磁性电阻随机存取存储器之一。如上所述的存储器宏，其中该第二组单元操作在独立于该第一组单元的至少一个条件下。如上所述的存储器宏，其中该第二组单元相对于该第一组单元，并未完整的被制造。本发明还提供一种存储器宏，包括至少一个存储器子模块，设置于存储模块的边缘；第一感测放大器，设置于邻近该存储器子模块远离该存储模块的边缘的一边；第二感测放大器，设置于邻近该存储器子模块与该存储模块的边缘重叠的另一边；以及其中该第二感测放大器包括至少一个电子元件，与该第一感测放大器的电子元件具有不同的物理尺寸。如上所述的存储器宏为动态随机存取存储器。如上所述的存储器宏，其中该第二感测放大器操作在至少一个独立于该第一感测放大器的条件下。如上所述的存储器宏，其中该第二感测放大器的晶体管通道长度或宽度至少比该第一感测放大器的晶体管长5%。如上所述的存储器宏，其中该第二感测放大器的晶体管通道长度或宽度比该第一感测放大器的晶体管长出的尺寸在5%至30。/。的范围内。如上所述的存储器宏，其中该第二感测放大器是不动作的。本发明可以改善位于存储模块的边缘单元的坚固性，从而改善电子装置的性能及合格率。图1为部分显示传统存储器宏。图2为部分显示根据本发明实施例所述的存储器宏200。图3为依照本发明另一实施例所述的存储器宏300的布局图。图4为依照本发明另一实施例所述的动态随机存取存储器(DRAM)宏400的布局图。图5为感测放大器尺寸与感测能力的关系图。图6为单元电容与感测能力的关系图。其中，附图标记说明如下100传统存储器宏102、202、408、410感测放大器104、204~列译码器105、205、402存储模块106、206内部单元108、208边缘单元200、300存储器宏302第一区域304第二区域400动态随机存取存储器(DRAM)宏406规则存储单元BL位线的方向具体实施例方式为使本发明的制造、操作方法、目标和优点能更明显易懂，下文特举几个优选实施例，并配合附图，作详细说明如下实施例图1部分显示传统存储器宏IOO,其包含存储模块105，在列与行的交点具有存储单元。第一组存储单元106(以下称之为内部单元)设置于存储模块105的内部区域。第二组存储单元108(以下称之为边缘单元)设置于存储模块105的至少一个边缘。行译码器与感测放大器102以及列译码器104设置于行与列的一端，用以选择存储单元以执行读、写或清除操作。如图所示，标号BL代表位线的方向。在设计阶段，所有的存储单元，包含内部及边缘单元106与108，是完全相同的。然而，边缘单元108与内部单元106的尺寸可能因为存储器装置100经历不同的处理程序而有所不同。例如负载效应会改变边缘单元108的尺寸。这些被改变的尺寸会造成边缘单元的运作与内部单元106不同。例如，在动态随机存取存储器(DRAM)装置中，边缘单元的电容可能较内部单元低。又例如在静态随机存取存储器(SRAM)装置中，边缘单元产生的驱动电流可能会较内部单元低。这些电子特性较弱的边缘单元可能会降低存储器装置的合格率。图2部分显示根据本发明实施例所述的存储器宏200。此存储器宏200包含一个在列与行的交点具有存储单元的存储模块205。此存储器宏200可以是一个静态随机存取存储器(SRAM)、动态随机存取存储器(DRAM)、非易失性存储器(non-volatilememory)或磁性随机存取存储器(magneticrandomaccessmemory,MRAM)。第一组存储单元206(以下称之为内部单元)设置于存储模块205内部区域。第二组存储单元208(以下称之为边缘单元)设置于存储模块205的至少一个边缘。行译码器与感测放大器202以及列译码器204设置于行与列的一端，用以选择存储单元以执行读、写或清除操作。在此提出的本发明实施例还允许存储器宏200承受制造工艺中发生的变化，例如在制造工艺阶段的等离子体蚀刻或化学机械研磨。内部存储单元206被设计成固定的单元，亦即它们具有相同的物理尺寸、构建规则以及操作条件。边缘存储单元208被设计成不规则的单元，亦即它们在物理尺寸、建构规则以及操作条件上与内部存储单元206不同。因此这些不规则的边缘单元206允许在存储模块205边缘的图案与内部区域的单元不同。这样一来，在边缘的蚀刻率可通过仔细设计边缘单元208的物理尺寸来调整。值得注意的是，图2显示在存储模块205的右上方设置了一列与一行的边缘单元208，这些边缘单元的列与行数目是可以分别地改变。例如本发明的精神是只要满足设计的需求可以只设置一列或一行的边缘单元208。同样地，当设计者需要时，也可以使用两个或两个以上的列与行的边缘单元208。边缘单元208可被设计为可操作或不动作的单元。当边缘单元208被设计成可操作时，可以縮小芯片尺寸。若边缘单元被设计为可操作，它可以操作在至少一个独立于内部单元206的条件下，例如井区偏压(wdlbias)、井区拾取偏压(wdlpick-upbias)以及接地节点偏压(ground-nodebias)。边缘单元208可以用较宽松的标准设计，因此边缘单元208的电子元件比内部单元206的电子元件坚固。例如在边缘单元208中的晶体管通道长度或宽度可以比内部单元206中的晶体管大5%。在一些由90mn半导体制造技术所制造的存储器装置，在边缘单元208中的晶体管通道长度或宽度会比内部单元206中的晶体管大5%到30%，以补偿制造过程中产生的变化。在一些由65nm半导制造工艺技术所制造的存储器装置，在边缘单元208中的晶体管通道长度或宽度会比内部单元206中的晶体管大15%到60%，以补偿制造过程中产生的变化。边缘单元208可以提供较大的节点储存电容及更强的驱动电流。边缘单元208可被设计为不动作的元件。有一些让边缘单元208成为不动作的冗余单元的方法。一个方法是故意让边缘单元208不完整。例如边缘单元208可被设计成至少省略一个必须存在才能让单元可操作的关键层，如氧化定义(oxidedefined,OD)层与多晶硅层。又例如边缘单元208可被设计成至少省略一个必须存在才能让单元可操作的关键电子元件，如传输闸晶体管(passgatetransistor)、下拉装置(pull-downdevice)与上拉装置(pull-updevice)。另一个方法是使用制造正常单元的方式制造边缘单元208，但让它们没有能力实行它们的功能。在所有的情形中，不规则边缘单元208都加强了存储模块205在边缘的坚固性。图3显示依照本发明另一实施例所述的存储器宏300的布局图。此布局可利用自动化工具产生，例如存储器编译器。存储器宏300包含第一区域302与位于边缘的第二区域304。此存储器编译器可以分别地铺砌规则与不规则单元至第一及第二区域。不规则单元如上述讨论可以是可操作或不动作的单元。就其本身而论，根据此布局做出的存储器宏更能承受制造工艺的变化以及改进性能。图4显示依照本发明另一实施例所述的动态随机存取存储器(DRAM)宏400的布局图。动态随机存取存储器(DRAM)宏400包括存储模块402，其有多个子模块，而子模块包含规则存储单元406以及由规则存储单元旁的规则电子元件所组成的感测放大器408。动态随机存取存储器(DRAM)宏400还包括感测放大器410，由位于存储模块402边缘的不规则电子元件所组成的。不规则单元如上述讨论可以是可操作或不动作的单元。就其本身而论，根据此布局做出的存储器宏还能承受制造工艺的变化以及改进性能。以下的例子说明具有边缘存储单元的存储模块与使用4列边缘单元的256K-bit存储器装置之间读取能力改进的关系表一<table>tableseeoriginaldocumentpage9</column></row><table>边<table>tableseeoriginaldocumentpage10</column></row><table>图5显示感测放大器尺寸与感测能力的关系图。当感测放大器尺寸加大时，不协调会随之变小，导致如图中所示的更好的感测能力。图6显示单元电容与感测能力的关系图。当单元尺寸变大时，单元电容会增加，而导致如图中所示的更好的感测能力。使用不同的技术节点(Technologynode)所制造的边缘单元会有不同的物理尺寸。内部存储单元与边缘存储单元之间经过多种不同的技术节点(Technologynode)制造所产生在闸长与闸宽的变化的估计呈现于下表中。这些估计包括250nm、180nm、130nm、90nm以及65nm的技术。在表中，关键尺寸变化为模块边缘的最终通道长或宽以及模块中央的最终通道长或宽的差异，除以画在掩模上的通道长或宽而得。根据这些结果，建议对于不同技术节点(Technologynode)使用边缘单元来补偿通道长或宽。表二<table>tableseeoriginaldocumentpage10</column></row><table>上述说明提供了本发明许多不同的实施例或用来执行不同功能的实施例。特定实施例的元件以及程序的公开是用来帮助阐明本发明。当然，仅为实施例，不可用以限制本发明权利要求所定义的范围。本发明虽以优选实施例公开如上，然其并非用以限制本发明的范围，任何所属领域技术人员，在不脱离本发明的精神和范围内，当可做些许的变更与修饰，因此本发明的保护范围当视后附的权利要求所界定的范围为准。权利要求1.一种电路布局产生方法，适用于使用存储器编译器产生电路布局，包括产生第一组单元，设置于该电路布局的第一区域；以及产生第二组单元，设置于该第一区域的边缘，该第二组单元为可操作的且与该第一组单元具有不同的物理尺寸，由此强化依据此电路布局所制造出的装置。10.如权利要求9所述的存储器宏，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长5%。11.如权利要求9所述的存储器宏，其中该第二组单元的晶体管通道长度或宽度至少比该第一组单元的晶体管通道长度或宽度长出的尺寸在5%至30%的范围内。12.如权利要求9所述的存储器宏为静态随机存取存储器、动态随机存取存储器、非易失性存储器、以及磁性电阻随机存取存储器之一。13.如权利要求9所述的存储器宏，其中该第二组单元操作在独立于该第一组单元的至少一个条件下。14.如权利要求9所述的存储器宏，其中该第二组单元相对于该第一组单元，并未完整的被制造。15.—种存储器宏，包括至少一个存储器子模块，设置于存储模块的边缘；第一感测放大器，设置于邻近该存储器子模块远离该存储模块的边缘的一边；第二感测放大器，设置于邻近该存储器子模块与该存储模块的边缘重叠的另一边；以及其中该第二感测放大器包括至少一个电子元件，与该第一感测放大器的电子元件具有不同的物理尺寸。16.如权利要求15所述的存储器宏为动态随机存取存储器。17.如权利要求15所述的存储器宏，其中该第二感测放大器操作在至少一个独立于该第一感测放大器的条件下。18.如权利要求15所述的存储器宏，其中该第二感测放大器的晶体管通道长度或宽度至少比该第一感测放大器的晶体管长5%。19.如权利要求15所述的存储器宏，其中该第二感测放大器的晶体管通道长度或宽度比该第一感测放大器的晶体管长出的尺寸在5%至30%的范围内。20.如权利要求15所述的存储器宏，其中该第二感测放大器是不动作的。全文摘要本发明提供一种存储器宏及电路布局产生方法。其中该电路布局产生方法，适用于使用存储器编译器产生电路布局，包括产生第一组单元，设置于该电路布局的第一区域；以及产生第二组单元，设置于该第一区域的边缘，该第二组单元为可操作的且与该第一组单元具有不同的物理尺寸，由此强化依据此电路布局所制造出的装置。该存储器宏，包括第一组单元，设置于存储模块的第一区域，以及第二组单元，设置于第一区域的边缘，第二组单元为可操作的且与第一组单元具有不同的物理尺寸，由此改善位于存储模块的边缘单元的坚固性。本发明可以改善电子装置的性能及合格率。文档编号H01L27/108GK101114643SQ20061016047公开日2008年1月30日申请日期2006年11月28日优先权日2006年7月26日发明者李政宏,邹宗成申请人:台湾积体电路制造股份有限公司