专利名称：低功耗源极驱动器的方法及其装置的制作方法
技术领域：
本发明是提供一种低功耗源极驱动器的方法及其装置，尤指一种利用参考电压源对源极驱动器的负载端进行充放电至参考电压的方法及其装置。
背景技术：
近年来，在消费市场上蓬勃发展的是体积小和提供高显示品质的平面显示器(Flat Panel Display，FPD)。平面显示器的种类主要有等离子体显示器(Plasma Display Panel，PDP)、液晶显示器(Liquid Crystal Display，LCD)，和背投影显示器(Rear Projection Display)等。这些平面显示器具有体积小和高显示品质等共通优点，已逐渐取代传统的阴极射线管显示器(CathodeRay Tube Display，CRT)，因而被广泛地应用在笔记本型计算机(NotebookComputer)、个人数字助理(Personal Digital Assistant，PDA)、平面电视，或移动电话等信息产品上。
请参考图1。图1为先前技术使用电荷分享的源极驱动器芯片10的示意图。源极驱动器芯片10共包含N组通道，且为Dot Inversion，因此相邻的运算放大器其极性是相反的，比如说第1组运算放大器OP+为正极性，第2组运算放大器OP-为负极性。其中，Vref[R:1]为提供给数字模拟转换器DAC的R组参考电压，数字模拟转换器DAC会依据这些参考电压再细分出更多的电压值给运算放大器使用。而Code[B:1]是欲显示于平面显示器的灰阶数字数据，是由时序控制器产生并传送给源极驱动器暂存及使用。请参考第1组与第2组通道，假设所有的运算放大器都是不断地在供应电压AVDD与接地电压GNDA的电位做切换，则于电荷分享时(Charge Sharing)，先将相邻的源极驱动器芯片外部负载Load1、Load2做短路连接的操作，此时第一开关Φ1为导通状态，则源极驱动器芯片外部负载Load1、Load2上的电荷会重新平均分配，平衡后的电压值大约为供应电压AVDD的二分之一。此时再将第一开关Φ1开路，并将运算放大器的输出级连接至相对应的源极驱动器芯片外部负载(第1组运算放大器OP+连接至源极驱动器芯片外部负载Load1，第2组运算放大器OP-连接至源极驱动器芯片外部负载Load2)，此时第二开关Φ2为导通状态。则运算放大器会将源极驱动器芯片外部负载提升或压低至目标电位(此为供应电压AVDD/接地电压GNDA)，以完成一次完整的驱动操作。
请参考图2。图2为图1中的源极驱动器的输出时序图。使用电荷共享方式与1-Line Dot Inversion。其中，POL代表运算放大器OP的极性信号，LD代表运算放大器OP的输出起始信号。OUT则为源极驱动器芯片外部负载的电压。决定运算放大器OP输出极性的方式是在LD的上升缘(Rising Edge)暂存POL的值，如图2所示，在LD的上升缘暂存到的POL为1，则运算放大器OP输出极性为正极性，若在LD的上升缘暂存到的POL为0，则运算放大器OP输出极性为负极性。于第一开关Φ1导通期间，可通过电荷共享的方式，先将源极驱动器芯片外部负载的电压提升或压低至0.5*AVDD，但于第二开关Φ2导通期间，改由运算放大器OP接替输出，仍有将近0.5*AVDD的电位需要驱动。
请参考图3。图3为图1中的源极驱动器的另一输出时序图。使用电荷共享方式与2-Line Dot Inversion。与图2不同的是，运算放大器OP极性变换的频率为原本的二分之一。则于第一次第一开关Φ1导通期间，可通过电荷共享的方式，先将源极驱动器芯片外部负载的电压提升或压低至0.5*AVDD，于第二开关Φ2导通期间，改由运算放大器OP驱动剩余的0.5*AVDD电位，于第二次的第一开关Φ1导通则不做切换，直到第三次的第一开关Φ1导通再做切换。
现有的平面显示器所使用的源极驱动器(Source Driver)架构中，为了节省功率损耗，往往采用电荷分享(Charge Sharing)的做法，先将相邻且极性相反的输出端点以短路方式连接，等到电荷平均分配后，再将源极驱动器的输出级连接至输出端点对负载进行充放电的操作。此种方法的缺点在于电荷平均分配后，负载端距离目标电压仍有一段不小的距离，导致源极驱动器的输出端要继续队负载端进行充放电时，仍需耗费许多的功率。
发明内容
本发明的目的在于提供一种可减少源极驱动器的功率损耗的方法及其装置，以解决已知技术中的问题。
本发明是提供一种可减少源极驱动器的功率损耗的方法，包含有参考电压源对源极驱动器的负载端进行充放电至与目标电压极性相同且电压值接近的参考电压；以及该源极驱动器的输出级对该负载端进行充放电至该目标电压。
本发明是提供一种可减少源极驱动器的功率损耗的方法，包含有第一参考电压源对源极驱动器的负载端进行充电至与第一目标电压极性相同且电压值接近的第一参考电压；该源极驱动器的输出级对该负载端进行充放电至该第一目标电压；第二参考电压源对该源极驱动器的负载端进行放电至与第二目标电压极性相同且电压值接近的第二参考电压；以及该源极驱动器的输出级对该负载端进行放电至该第二目标电压。
本发明是提供一种可减少源极驱动器的功率损耗的方法，包含有依据起始信号于时序上延迟第一参考电压以产生多个第一电压信号；依据该起始信号于时序上延迟第二参考电压以产生多个第二电压信号；依据该多个第一电压信号对多个相对应的源极驱动器的负载端进行充电至与第一目标电压极性相同且电压值接近的该第一参考电压；该多个相对应的源极驱动器的输出级对该多个相对应的负载端进行充放电至该第一目标电压；依据该多个第二电压信号对该多个相对应的源极驱动器的负载端进行放电至与第二目标电压极性相同且电压值接近的该第二参考电压；以及该多个相对应的源极驱动器的输出级对该负载端进行放电至该第二目标电压。
本发明是提供一种低功耗的源极驱动器，包含有第一脚位，用来输入第一参考电压；第二脚位，用来输入第二参考电压；第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第一开关，耦接于该第一脚位与该输出端之间，用来控制该输出端是否电性连接至该第一脚位；第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；以及第三开关，耦接于该第二脚位与该输出端之间，用来控制该输出端是否电性连接至该第二脚位。
本发明是提供一种低功耗的源极驱动器，包含有第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第一开关，耦接于该第一数字模拟转换器与该输出端之间，用来控制该输出端是否电性连接至该第一数字模拟转换器；以及第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；其中，该第一数字模拟转换器是根据极性信号与灰阶数字数据由多组参考电压中选取一组参考电压输出。
本发明是提供一种低功耗的源极驱动器，包含有第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第二数字模拟转换器，其包含第一输出端及第二输出端；第一开关，耦接于该第二数字模拟转换器的该第一输出端与该输出端之间，用来控制该输出端是否电性连接至该第二数字模拟转换器的该第一输出端；第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；以及第三开关，耦接于该第二数字模拟转换器的该第二输出端与该输出端之间，用来控制该输出端是否电性连接至该第二数字模拟转换器的该第二输出端；其中，该第一数字模拟转换器是根据极性信号与灰阶数字数据由多组参考电压中选取一组参考电压输出；其中，该第二数字模拟转换器是根据该极性信号以及一灰阶数字数据由多组转换器参考电压中选取一组转换器参考电压并于该第一输出端输出第一参考电压；其中，该第二数字模拟转换器是根据该极性信号以及一灰阶数字数据由该多组转换器参考电压中选取另一组转换器参考电压并于该第二输出端输出第二参考电压。
本发明是提供一种低功耗的源极驱动器集成电路，包含有时序控制器，用来依据起始信号于时序上延迟第一参考电压以产生多个第一电压信号，且依据该起始信号于时序上延迟第二参考电压以产生多个第二电压信号；以及多个通道群组，每一个通道群组包含第一输入端，用来接收相对应的第一电压信号；第二输入端，用来接收相对应的第二电压信号；第三输入端，用来接收该起始信号；及多个源极驱动器，每一个源极驱动器包含数字模拟转换器；运算放大器，耦接于该数字模拟转换器；输出端；第一开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；第二开关，耦接于该第二输入端与该输出端之间，用来控制该输出端是否电性连接至该第二输入端；以及第三开关，耦接于该第一输入端与该输出端之间，用来控制该输出端是否电性连接至该第一输入端。
图1为先前技术使用电荷分享的源极驱动器芯片的示意图。
图2为图1中的源极驱动器的输出时序图。
图3为图1中的源极驱动器的另一输出时序图。
图4为本发明一实施例说明源极驱动器的示意图。
图5为图4中的源极驱动器的输出时序图。
图6为本发明另一实施例说明源极驱动器的示意图。
图7为图6的控制信号与输出电压对应方式的示意图。
图8为图6中的源极驱动器的输出时序图。
图9为本发明另一实施例说明源极驱动器芯片的示意图。
图10为本发明另一实施例说明源极驱动器芯片的示意图。
图11为图9与图10的控制信号与参考电压对应方式的示意图。
图12为图9与图10的控制信号与参考电压对应方式的另一示意图。
图13为图9与图10的控制信号与参考电压对应方式的另一示意图。
图14为图9与图10中的源极驱动器的输出时序图。
图15为本发明一实施例说明源极驱动器芯片内部的信道群组的示意图。
图16为本发明一源极驱动器芯片的示意图。
图17为图16中时序控制器的架构的示意图。
图18为图15的源极驱动器的输出时序图。
图19为图15的源极驱动器的另一输出时序图。
图20为图17的时序控制器的输出时序图。
图21为图17的时序控制器的另一输出时序图。
图22为图17的时序控制器的另一输出时序图。
图23为图16中同一个通道群组的第1信道与第2信道的输出时序图。
图24为图16中第1组通道群组与第2组通道群组的输出时序图。
图25为图16中第1组通道群组与第2组通道群组的另一输出时序图。
10、40、60源极驱动器芯片62 时序控制器DAC、DAC1-DACk数字模拟转换器OP+、OP-、OP1-OPK运算放大器AVDD供应电压 GNDA接地电压Vref[R:1]、Vref2[V:1] 参考电压Code[B:1]、Code[C:1]、Code2[D:1] 灰阶数字数据POL 极性信号
LD 起始信号OUT负载电压Φ1、SW1、SW11-SWK1第一开关Φ2、SW2、SW12-SWK2第二开关SW3、SW13-SWK3第三开关SWC1-SWCM第一电压控制开关SWD1-SWDM第二电压控制开关VT1第一目标电压 VT2第二目标电压V1第一参考电压 V2第二参考电压V1-VN参考电压 VT 目标电压Load1-LoadN、Load1-LoadK、Load1-LoadM源极驱动器芯片外部负载DAC1第一数字模拟转换器DAC2第二数字模拟转换器Input1、622 第一输入端Input2、624 第二输入端Input3、626 第三输入端628 第一输出端629 第二输出端CG1-CGM通道群组72 相位控制单元P1-PM第一电压信号N1-NM第二电压信号C1-CM、D1-DM相位控制信号T1-TM、t1-tM、T12-TM2、t12-tM2时间L1-LM、W1-WM宽度具体实施方式
请参考图4。图4为本发明一实施例说明源极驱动器芯片40的示意图。于集成电路外部先产生第一参考电压V1及第二参考电压V2，并将第一参考电压V1及第二参考电压V2通过源极驱动器芯片40的第一脚位及第二脚位连接至集成电路内部。根据源极驱动器输出级的极性，将源极驱动器芯片外部负载Load1连接至第一参考电压V1或第二参考电压V2，然后再将源极驱动器芯片外部负载Load1连接至运算放大器OP1进行充放电至第一目标电压VT1或第二目标电压VT2。假设第一目标电压VT1大于第二目标电压VT2，欲将源极驱动器芯片外部负载Load1充电至第一目标电压VT1，则先将源极驱动器芯片外部负载Load1连接至第一参考电压V1，此时第一开关SW1为导通状态；再将源极驱动器芯片外部负载Load1连接至运算放大器OP1继续充电至第一目标电压VT1，此时第二开关SW2为导通状态。同样地，欲将源极驱动器芯片外部负载Load1放电至第二目标电压VT2，则先将源极驱动器芯片外部负载Load1连接至第二参考电压V2，此时第三开关SW3为导通状态；再将源极驱动器芯片外部负载Load1连接至运算放大器OP1继续放电至第二目标电压VT2，此时第二开关SW2为导通状态。通过第一开关SW1、第二开关SW2及第三开关SW3的导通与否，用来选择源极驱动器芯片外部负载Load1电性连接至第一参考电压V1、第二参考电压V2或运算放大器OP1。
请参考图5。图5为图4中的源极驱动器的输出时序图。当LD上升时，依据POL信号来决定是否要将源极驱动器芯片外部负载Load1电性连接至第一参考电压V1或第二参考电压V2，直至LD下降后，才将源极驱动器芯片外部负载Load1连接至运算放大器OP1进行充放电。于第一开关SW1导通期间，先将源极驱动器芯片外部负载Load1的电压提升或压低至第一参考电压V1，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load的电压至第一目标电压VT1。于第三开关SW3导通期间，先将源极驱动器芯片外部负载Load1的电压提升或降低至第二参考电压V2，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load1的电压至第二目标电压VT2。若第一参考电压V1接近第一目标电压VT1且第二参考电压V2接近第二目标电压VT2，则运算放大器OP1只需要供应少许电荷便可驱动至目标电压，可大幅降低源极驱动器的功率损耗。
请参考图6。图6为本发明另一实施例说明源极驱动器芯片的示意图。由集成电路内部的数字模拟转换器DAC，根据极性信号POL与灰阶数字数据Code[C:1]由多组参考电压V1-VN中选取一组参考电压输出，而Code[C:1]是欲显示于平面显示器的灰阶数字数据，是由时序控制器产生并传送给源极驱动器暂存及使用。POL代表输出极性，VT代表目标电压。根据源极驱动器输出级的极性，先将源极驱动器芯片外部负载Load1连接并充放电至上述所选取的参考电压V1-VN的其中一组，然后再将源极驱动器芯片外部负载Load1连接至运算放大器OP1进行充放电至目标电压VT。即先将源极驱动器芯片外部负载Load1连接至数字模拟转换器DAC的输出端，充电至所选取的某一组参考电压，此时第一开关SW1为导通状态；再将源极驱动器芯片外部负载Load1连接至运算放大器OP1继续充电至目标电压VT，此时第二开关SW2为导通状态。
请参考图7、图8与图6。图7为图6的控制信号与输出电压对应方式的示意图。以Code[C:1]为二个位为例Code[2:1]，则依据POL信号与Code[2:1]的排列组合，会产生8组目标电压V1-V8，而V1’-V8’分别代表接近目标电压V1-V8的电压(请参考图8)。如图7所示，当POL信号为0且Code为00时，目标电压VT为V1，以此类推。
请参考图8。图8为图6中的源极驱动器的输出时序图。如图8所示，当POL信号为1且Code为00时，对应到的目标电压为V5，则导通第一开关SW1，先将源极驱动器芯片外部负载Load1连接至数字模拟转换器DAC的输出端，充电至电压V5’，然后再导通第二开关SW2，将源极驱动器芯片外部负载Load1连接至运算放大器OP1继续充电至目标电压V5，以此类推。
请参考图9。图9为本发明另一实施例说明一源极驱动器芯片的示意图。Code[C:1]代表欲显示于平面显示器的灰阶数字数据，Vref[R:1]代表R组参考电压，Vref2[V:1]是Vref[R:1]的部分集合或完全集合中的V组参考电压(V≤R)，Code2[D:1]是Code[C:1]的部分集合或完全集合中的D个位(D≤C)，VT1、VT2代表正负极性下的目标电压。由集成电路内部的第二数字模拟转换器DAC2，根据极性信号POL与灰阶数字数据Code2[D:1]由多组参考电压Vref2[V:1]中选取一组参考电压输出(输出第一参考电压V1或第二参考电压V2)，根据源极驱动器输出级的极性，将源极驱动器芯片外部负载Load1连接至第一参考电压V1或第二参考电压V2，然后再将源极驱动器芯片外部负载Load1连接至运算放大器OP1进行充放电至目标电压VT1或VT2。于第一开关SW1导通期间，先将源极驱动器芯片外部负载Load1的电压提升或压低至第一参考电压V1，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load1的电压至第一目标电压VT1。于第三开关SW3导通期间，先将源极驱动器芯片外部负载Load1的电压降低至第二参考电压V2，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load1的电压至第二目标电压VT2。由于第一参考电压V1接近第一目标电压VT1且第二参考电压V2接近第二目标电压VT2，则运算放大器OP1只需要供应少许电便可驱动至目标电压，可大幅降低源极驱动器的功率损耗。
请参考图10。图10为本发明另一实施例说明一源极驱动器芯片的示意图。与图9不同的是第二数字模拟转换器DAC2所使用的参考电压Vref2[V:1]与第一数字模拟转换器DAC1所使用的参考电压Vref[R:1]互为独立。仍由第二数字模拟转换器DAC2输出第一参考电压V1及第二参考电压V2，第一开关SW1、第二开关SW2及第三开关SW3的导通与否，用来选择源极驱动器芯片外部负载Load1连接至第一参考电压V1、第二参考电压V2或运算放大器OP1。
请参考图11。图11为图9与图10的控制信号与参考电压对应方式的示意图。令V等于16，D等于3，此种对应方式表示数值不同的Code2[3:1]会选择到不同的Vref2值。
请参考图12。图12为图9与图10的控制信号与参考电压对应方式的另一示意图。令V等于16，D等于3，此种对应方式表示数值不同的Code2[3:1]可以选择到相同的Vref2值。
请参考图13。图13为图9与图10的控制信号与参考电压对应方式的另一示意图。令V等于16，D等于3，此种对应方式表示V1、V2的值可以与Code2[3:1]无关，直接固定为特定的Vref2值，此处为Vref2[1]及Vref2[16]。
请参考图14。图14为图9与图10中的源极驱动器的输出时序图。此处的控制信号与参考电压对应方式采用图11的对照方式，并举Code2[3:1]为000、001、010及011为例说明。则V1-V4分别代表Code2[3:1]为000-011在正极性下的目标电压，V9-V12分别代表Code2[3:1]为000-011在负极性下的目标电压。于第一开关SW1导通期间，先将源极驱动器芯片外部负载Load1的电压提升至参考电压V1，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load1的电压至目标电压VT1。于第三开关SW3导通期间，先将源极驱动器芯片外部负载Load1的电压降低至参考电压V9，于第二开关SW2导通期间，改由运算放大器OP1驱动源极驱动器芯片外部负载Load1的电压至目标电压VT9，以此类推。
请参考图15。图15为本发明一实施例说明源极驱动器芯片内部的信道群组的示意图。令源极驱动器芯片内的总输出信道数目为N，并将该N个信道分成M个信道群组(Channel Group)，每一个通道群组包含第一输入端Input1、第二输入端Input2及第三输入端Input3；其中，第一输入端Input1用来接收相对应的第一电压信号P1-PM，第二输入端Input2用来接收相对应的第二电压信号N1-NM，第三输入端Input3用来接收起始信号LD(请参考图16)。每一个通道群组包含K个源极驱动器，每一个源极驱动器分别包含一个数字模拟转换器DAC1-DACK，一个运算放大器OP1-OPK，一第一开关SW11-SWK1、一第二开关SW12-SWK2以及一第三开关SW13-SWK3。其中，第一开关SW11-SWK1是耦接于源极驱动器芯片外部负载Load1-Loadk跟运算放大器OP1-OPK之间，根据第三输入端Input3所接收的起始信号LD控制其开启或关闭，用来决定运算放大器OP1-OPK是否可以对源极驱动器芯片外部负载Load1-LoadK进行充放电。第二开关W12-SWK2是耦接于源极驱动器芯片外部负载Load1-Loadk跟第二输入端Input2之间，用来决定是否将第二输入端Input2所接收的第二电压信号N1-NM连接至源极驱动器芯片外部负载Load1-LoadK。而电压控制开关SW13-SWK3是耦接于源极驱动器芯片外部负载Load1-Loadk跟第一输入端Input1之间，用来决定是否将第一输入端Input1所接收的第一电压信号P1-PM连接至源极驱动器芯片外部负载Load1-LoadK。
请参考图16与图17。图16为本发明一实施例说明源极驱动器芯片60的示意图。源极驱动器芯片60包含时序控制器62及M个通道群组CG1-CGM，其中每一个通道群组CG1-CGM包含K个源极驱动器，则该源极驱动器芯片总共包含M×K个源极驱动器，其包含M×K个源极驱动器芯片外部负载Load1-LoadM×K。时序控制器62包含第一输入端622，用来接收第一参考电压V1，第二输入端624，用来接收第二参考电压V2，控制端626，用来接收起始信号LD，M个第一输出端628，用来根据起始信号LD于时序上延迟第一参考电压V1以产生M个第一电压信号P1-PM，M个第二输出端629，用来根据起始信号LD于时序上延迟第二参考电压V2以产生M个第二电压信号N1-NM。每一个通道群组CG1-CGM包含第一输入端Input1、第二输入端Input2以及第三输入端Input3，分别用来接收相对应的第一控制信号P1-PM、相对应的第二控制信号N1-NM以及起始信号LD。
请参考图17与图16。图17为图16中时序控制器62的架构的示意图。时序控制器62包含相位控制单元72、M个第一电压控制开关SWC1-SWCM以及M个第二电压控制开关SWD1-SWDM。相位控制单元72包含输入端、多个第一相位控制信号输出端以及多个第二相位控制信号输出端。该输入端用来接收起始信号LD。该多个第一相位控制信号输出端用来根据起始信号LD输出多个第一相位控制信号C1-CM，其用来控制相对应的多个第一电压控制开关SWC1-SWCM的开启及关闭。该多个第二相位控制信号输出端用来根据起始信号LD输出多个第二相位控制信号D1-DM，其是用来控制相对应的多个第二电压控制开关SWD1-SWDM的开启及关闭。其中，多个第一电压控制开关SWC1-SWCM的每一个第一电压控制开关是耦接于第一输入端622与相对应的第一输出端628之间(第一参考电压V1与第一电压信号P1-PM之间)。多个第二电压控制开关SWD1-SWDM的每一个第二电压控制开关是耦接于第二输入端624与相对应的第一输出端629之间(第二参考电压V2与第二电压信号N1-NM之间)。
请参考图18。图18为图15的源极驱动器的输出时序图。假设为1-LineDot Inversion的方式，信道群组CG1包含四个源极驱动器。由于是DotInversion，相邻的通道极性是相反的，因此，当POL为1时，电压控制开关SW13、SW22、SW33、SW42会同时导通，当POL为0时，电压控制开关SW12、SW23、SW32、SW43会同时导通，以此类推。而电压控制开关SW11、SW21、SW31、SW41则是在起始信号LD为0时同时导通(耦接至运算放大器OP1-OP4)。
请参考图19。图19为图15的源极驱动器的另一输出时序图。假设为1-Line Row Inversion的方式，信道群组CG1包含四个源极驱动器。由于是Row Inversion，相邻的通道极性是相同的，因此，当POL为1时，电压控制开关SW13、SW23、SW33、SW43会同时导通，当POL为0时，电压控制开关SW12、SW22、SW32、SW42会同时导通，以此类推。而电压控制开关SW11、SW21、SW31、SW41则是在起始信号LD为0时同时导通(耦接至运算放大器OP1-OP4)。
请参考图20。图20为图17的时序控制器的输出时序图。其中，T1-TM为第一相位控制信号C1-CM上升缘距离起始信号LD上升缘的时间，t1-tM为第二相位控制信号D1-DM上升缘距离起始信号LD上升缘的时间，且T1-TM与t1-tM为互相独立的实数。第一相位控制信号C1-CM与第二相位控制信号D1-DM会在起始信号LD上升后依序上升，并在起始信号LD下降缘同时下降。当第一相位控制信号C1-CM为高电平时，则第一电压控制开关SWC1-SWCM呈导通状态，当第二相位控制信号D1-DM为高电平时，则第二电压控制开关SWD1-SWDM呈导通状态。
请参考图21。图21为图17的时序控制器的另一输出时序图。此时T1-TM与t1-tM皆等于0，则第一相位控制信号C1-CM与第二相位控制信号D1-DM的时序关系图如图21所示。当第一相位控制信号C1-CM为高电平时，则第一电压控制开关SWC1-SWCM呈导通状态，当第二相位控制信号D1-DM为高电平时，则第二电压控制开关SWD1-SWDM呈导通状态。
请参考图22。图22为图17的时序控制器的另一输出时序图。其中，T1-TM为第一相位控制信号C1-CM上升缘距离起始信号LD上升缘的时间，T12-TM2为第一相位控制信号C1-CM下降缘距离起始信号LD下降缘的时间，t1-tM为第二相位控制信号D1-DM上升缘距离起始信号LD上升缘的时间，t12-tM2为第二相位控制信号D1-DM下降缘距离起始信号LD下降缘的时间，且T1-TM与、T12-TM2、t1-tM与t12-tM2为互相独立的实数。通过此种时序关系，可以将第一相位控制信号C1-CM跟第二相位控制信号D1-DM的宽度调整为等长(即L1-LM等长，W1-WM等长)。当第一相位控制信号C1-CM为高电平时，则第一电压控制开关SWC1-SWCM呈导通状态，当第二相位控制信号D1-DM为高电平时，则第二电压控制开关SWD1-SWDM呈导通状态。
请参考图23。图23为图16中同一个通道群组的第1信道与第2信道的输出时序图。于1-Line Dot Inversion的方式下，第1信道与第2信道输出的极性相反。VT1和VT2分别代表不同的目标电压。其中，第一电压信号P1于起始信号LD第一次上升后由高阻抗(Hi-Z)状态转变成V1，此时电压控制开关SW13为导通状态，则源极驱动器芯片外部负载Load1会充电至V1，待起始信号LD下降后，关闭电压控制开关SW13，此时运算放大器OP1会接手将源极驱动器芯片外部负载Load1充电至目标电压VT1(导通电压控制开关SW11)。于起始信号LD第二次上升时，电压控制开关SW12为导通状态，则源极驱动器芯片外部负载Load1会放电至V2，待起始信号LD下降后，关闭电压控制开关SW12，此时运算放大器OP1会接手将源极驱动器芯片外部负载Load1放电至目标电压VT2(导通电压控制开关SW11)。由于第1信道与第2信道输出的极性相反，第一电压信号P1于起始信号LD第一次上升后由高阻抗(Hi-Z)状态转变成V1，此时电压控制开关SW22为导通状态，则源极驱动器芯片外部负载Load2会放电至V2，待起始信号LD下降后，关闭电压控制开关SW22，此时运算放大器OP2会接手将源极驱动器芯片外部负载Load2放电至目标电压VT2(导通电压控制开关SW21)。于起始信号LD第二次上升时，电压控制开关SW23为导通状态，则源极驱动器芯片外部负载Load2会充电至V1，待起始信号LD下降后，关闭电压控制开关SW23，此时运算放大器OP2会接手将源极驱动器芯片外部负载Load2充电至目标电压VT1(导通电压控制开关SW21)。
请参考图24。图24为图16中第1组通道群组与第2组通道群组的输出时序图。VT1、VT2、VT3和VT4分别代表不同的目标电压。其中，第一电压信号P1、P2由高阻抗(Hi-Z)状态转变成V1以及第二电压信号N1、N2由高阻抗(Hi-Z)状态转变成V2的时间点可以彼此错开，此种做法可避免同一时间内对所有的负载进行充放电，以防止瞬间最大电流及降低系统噪声产生的机会。
请参考图25。图25为图16中第1组通道群组与第2组通道群组的另一输出时序图。与图24不同的是，将第一电压信号P1、P2由高阻抗(Hi-Z)状态转变成V1以及第二电压信号N1、N2由高阻抗(Hi-Z)状态转变成V2的时间点调整成相同的。
以上所述的实施例仅用来说明本发明，并不局限本发明的范畴。文中所提到参考电压V1-VN并不局限于固定的电压，且参考电压V1-VN的产生方式可以由芯片外部的脚位接出，由芯片内部的数字模拟转换器所提供，但并不局限于此。且通过一个时序控制器来将先前所产生的参考电压重新产生成多组时序上互为独立的电压信号，该些信号的时序关系可以是各种的变化组合，并不局限于本发明所举的实施例。此外，第一开关SW1、SW11-SWK1、第二开关SW2、SW12-SWK2、第三开关SW3、SW13-SWK3、第一电压控制开关SWC1-SWCM以及第二电压控制开关SWD1-SWDM等元件并不限定为金属氧化物半导体晶体管或双极型结晶体管，也可以采用其它元件。
由上可知，本发明提供一种低功耗源极驱动器的方法及其装置。先将源极驱动器的负载端进行充放电至与目标电压接近的参考电压，源极驱动器内部只需使用较小的偏压电流，即能在相同时间内让源极驱动器推动相同的负载值，进而减少源极驱动器的功率损耗，这种情况在目标电压接近最高(AVDD)及最低电位(GNDA)时更加明显。随着平面显示器尺寸及分辨率不断增加，本发明所获得的功率改善更加显著。
以上所述仅为本发明的较佳实施例，凡依本发明权利要求范围所做的均等变化与修饰，皆应属本发明的涵盖范围。
权利要求
1.一种可减少源极驱动器的功率损耗的方法，包含有参考电压源对源极驱动器的负载端进行充放电至与目标电压极性相同且电压值接近的参考电压；以及该源极驱动器的输出级对该负载端进行充放电至该目标电压。
2.根据权利要求1所述的方法，其中该目标电压为系统供应电压。
3.根据权利要求2所述的方法，其中与该目标电压极性相同且电压值接近的该参考电压为该系统供应电压的四分之三。
4.根据权利要求3所述的方法，其中该目标电压为系统地电压。
5.根据权利要求4所述的方法，其中与该目标电压极性相同且电压值接近的该参考电压为该系统供应电压的四分之一。
6.根据权利要求1所述的方法，其包含通过该源极驱动器的脚位提供该参考电压给该参考电压源。
7.根据权利要求1所述的方法，其包含由该源极驱动器内部与该源极驱动器的输出级所共享的数字模拟转换器产生该参考电压给该参考电压源。
8.根据权利要求1所述的方法，其包含由该源极驱动器内部不与该源极驱动器的输出级所共享的数字模拟转换器产生该参考电压给该参考电压源。
9.一种可减少源极驱动器的功率损耗的方法，包含有第一参考电压源对源极驱动器的负载端进行充电至与第一目标电压极性相同且电压值接近的第一参考电压；该源极驱动器的输出级对该负载端进行充放电至该第一目标电压；第二参考电压源对该源极驱动器的负载端进行放电至与第二目标电压极性相同且电压值接近的第二参考电压；以及该源极驱动器的输出级对该负载端进行放电至该第二目标电压。
10.根据权利要求9所述的方法，其中该第一目标电压为系统供应电压。
11.根据权利要求10所述的方法，其中该第一参考电压为该系统供应电压的四分之三。
12.根据权利要求11所述的方法，其中该第二目标电压为系统地电压。
13.根据权利要求12所述的方法，其中该第二参考电压为该系统供应电压的四分之一。
14.根据权利要求9所述的方法，其包含通过该源极驱动器的脚位提供该第一参考电压给该第一参考电压源；以及通过该源极驱动器的脚位提供该第二参考电压给该第二参考电压源。
15.根据权利要求9所述的方法，其包含由该源极驱动器内部与该源极驱动器的输出级所共享的数字模拟转换器产生该第一参考电压给该第一参考电压源；以及由该源极驱动器内部与该源极驱动器的输出级所共享的数字模拟转换器产生该第二参考电压给该第二参考电压源。
16.根据权利要求9所述的方法，其包含由该源极驱动器内部不与该源极驱动器的输出级所共享的数字模拟转换器产生该第一参考电压给该第一参考电压源；由该源极驱动器内部不与该源极驱动器的输出级所共享的数字模拟转换器产生该第二参考电压给该第二参考电压源。
17.一种可减少源极驱动器的功率损耗的方法，包含有依据起始信号于时序上延迟第一参考电压以产生多个第一电压信号；依据该起始信号于时序上延迟第二参考电压以产生多个第二电压信号；依据该多个第一电压信号对多个相对应的源极驱动器的负载端进行充电至与第一目标电压极性相同且电压值接近的该第一参考电压；该多个相对应的源极驱动器的输出级对该多个相对应的负载端进行充放电至该第一目标电压；依据该多个第二电压信号对该多个相对应的源极驱动器的负载端进行放电至与第二目标电压极性相同且电压值接近的该第二参考电压；以及该多个相对应的源极驱动器的输出级对该负载端进行放电至该第二目标电压。
18.根据权利要求17所述的方法，其中该第一目标电压为系统供应电压。
19.根据权利要求18所述的方法，其中该第一参考电压为该系统供应电压的四分之三。
20.根据权利要求19所述的方法，其中该第二目标电压为系统地电压。
21.根据权利要求20所述的方法，其中该第二参考电压为该系统供应电压的四分之一。
22.根据权利要求17所述的方法，其还包含接收该起始信号；根据该起始信号输出多个第一相位控制信号；以及根据该起始信号输出多个第二相位控制信号；其中，该多个第一相位控制信号用来控制相对应的该多个第一电压信号于时序上的延迟，该多个第二相位控制信号用来控制相对应的该多个第二电压信号于时序上的延迟。
23.一种低功耗的源极驱动器，包含有第一脚位，用来输入第一参考电压；第二脚位，用来输入第二参考电压；第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第一开关，耦接于该第一脚位与该输出端之间，用来控制该输出端是否电性连接至该第一脚位；第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；以及第三开关，耦接于该第二脚位与该输出端之间，用来控制该输出端是否电性连接至该第二脚位。
24.一种低功耗的源极驱动器，包含有第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第一开关，耦接于该第一数字模拟转换器与该输出端之间，用来控制该输出端是否电性连接至该第一数字模拟转换器；以及第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；其中，该第一数字模拟转换器是根据极性信号与灰阶数字数据由多组参考电压中选取一组参考电压输出。
25.一种低功耗的源极驱动器，包含有第一数字模拟转换器；运算放大器，耦接于该第一数字模拟转换器；输出端；第二数字模拟转换器，其包含第一输出端及第二输出端；第一开关，耦接于该第二数字模拟转换器的该第一输出端与该输出端之间，用来控制该输出端是否电性连接至该第二数字模拟转换器的该第一输出端；第二开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；以及第三开关，耦接于该第二数字模拟转换器的该第二输出端与该输出端之间，用来控制该输出端是否电性连接至该第二数字模拟转换器的该第二输出端；其中，该第一数字模拟转换器是根据极性信号与灰阶数字数据由多组参考电压中选取一组参考电压输出；其中，该第二数字模拟转换器是根据该极性信号与一灰阶数字数据由多组转换器参考电压中选取一组转换器参考电压并于该第一输出端输出第一参考电压；其中，该第二数字模拟转换器是根据该极性信号与一灰阶数字数据由该多组转换器参考电压中选取另一组转换器参考电压并于该第二输出端输出第二参考电压。
26.根据权利要求25所述的源极驱动器，其中该多组转换器参考电压为该多组参考电压的部分集合或完全集合。
27.根据权利要求25所述的源极驱动器，其中该多组转换器参考电压与该多组参考电压为独立。
28.一种低功耗的源极驱动器集成电路，包含有时序控制器，用来依据起始信号于时序上延迟第一参考电压以产生多个第一电压信号，且依据该起始信号于时序上延迟第二参考电压以产生多个第二电压信号；以及多个信道群组，每一个通道群组包含第一输入端，用来接收相对应的第一电压信号；第二输入端，用来接收相对应的第二电压信号；第三输入端，用来接收该起始信号；及多个源极驱动器，每一个源极驱动器包含数字模拟转换器；运算放大器，耦接于该数字模拟转换器；输出端；第一开关，耦接于该运算放大器与该输出端之间，用来控制该输出端是否电性连接至该运算放大器；第二开关，耦接于该第二输入端与该输出端之间，用来控制该输出端是否电性连接至该第二输入端；以及第三开关，耦接于该第一输入端与该输出端之间，用来控制该输出端是否电性连接至该第一输入端。
29.根据权利要求28所述的源极驱动器集成电路，其中该时序控制器包含第一输入端，用来接收该第一参考电压；第二输入端，用来接收该第二参考电压；控制端，用来接收该起始信号；多个第一输出端，用来根据该起始信号于时序上延迟该第一参考电压以产生多个第一电压信号；以及多个第二输出端，用来根据该起始信号于时序上延迟第二参考电压以产生多个第二电压信号。
30.根据权利要求29所述的源极驱动器集成电路，其中该时序控制器包含多个第一电压控制开关，每一个第一电压控制开关是耦接于该第一输入端与相对应的该第一输出端之间；以及多个第二电压控制开关，每一个第二电压控制开关是耦接于该第二输入端与相对应的该第二输出端之间。
31.根据权利要求30所述的源极驱动器集成电路，其中该时序控制器还包含相位控制单元，其包含输入端，用来接收该起始信号；多个第一相位控制信号输出端，用来根据该起始信号输出多个第一相位控制信号；以及多个第二相位控制信号输出端，用来根据该起始信号输出多个第二相位控制信号；其中，该多个第一相位控制信号用来控制相对应的该多个第一电压控制开关的开启及关闭，该多个第二相位控制信号用来控制相对应的该多个第二电压控制开关的开启及关闭。
全文摘要
一种可减少源极驱动器的功率损耗的方法，包含有参考电压源对源极驱动器的负载端进行充放电至与目标电压极性相同且电压值接近的参考电压；以及该源极驱动器的输出级对该负载端进行充放电至该目标电压。
文档编号G09G3/20GK101075399SQ20071000578
公开日2007年11月21日 申请日期2007年2月13日 优先权日2006年4月3日
发明者曹文远, 陈章三, 林哲立 申请人:联詠科技股份有限公司