射频ldmos器件及其制造方法
【专利摘要】本发明公开了一种射频LDMOS器件，在多晶硅栅的顶部表面形成的第一金属硅化物层的厚度大于在源漏区表面形成的第二金属硅化物层的厚度，第一金属硅化物层和第二金属硅化物层都由形成有硅表面的钛和氮化钛经快速热退火后形成。本发明还公开了一种射频LDMOS器件的制造方法。本发明通过第一金属硅化层的加厚能降低栅极的电阻，容易保证栅极低电阻；第二金属硅化物层的厚度不会随着第一金属硅化层的厚度的增加而增加，能通过降低第二金属硅化物层的厚度来降低第二金属硅化物层对源区和漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定，从而能整体提高器件的击穿电压、提高器件的可靠性。
【专利说明】射频LDMOS器件及其制造方法
【技术领域】
[0001]本发明涉及半导体集成电路制造领域，特别是涉及一种射频LDMOS器件；本发明还涉及一种射频LDMOS器件的制造方法。
【背景技术】
[0002]射频横向场效应晶体管(RF LDM0S)是应用于射频基站和广播站的常用器件。如图1所示，是现有射频LDMOS器件的结构示意图，以N型器件为例，现有射频LDMOS器件包括:P型重掺杂即P+掺杂的硅衬底101，硅衬底101的掺杂浓度大于le20cm_3 ；P型轻掺杂的娃外延层102,娃外延层102的掺杂浓度和厚度取决于器件的漏端工作电压,漏端工作电压越高，硅外延层102掺杂越低、厚度越厚；栅介质层如栅氧化层103和多晶硅栅104 #型漂移区105，形成于硅外延层102中#型掺杂的沟道区106，沟道区105和漂移区106在横向上直接接触或通过硅外延层102连接；N型重掺杂即N+掺杂的源区107、漏区108 ;在源区107、漏区108和多晶娃栅104的表面形成有金属娃化物110 ;介质层如氧化娃层109用于定义出源区107、漏区108的形成金属硅化物110的区域。
[0003]在现有射频LDMOS工艺中，为了获得较小的栅极电阻，需要将栅极金属硅化物即多晶硅栅104上的金属硅化物110厚度做厚。由于源/漏极金属硅化物即源区107和漏区108上的金属硅化物110与栅极金属硅化物是同一步淀积形成的，导致源/漏极金属硅化物的厚度过厚，大量消耗了源区107和漏区108的N型重掺杂，从而致使射频LDMOS反向击穿时有较大的漏电流，击穿电压也不够稳定，从而导致器件可靠性的降低。
【发明内容】
[0004]本发明所要解决的技术问题是提供一种射频LDMOS器件，能保证栅极低电阻，同时又能减少源漏区的N型重掺杂的消耗，从而能提高器件的击穿电压、提高器件的可靠性。为此，本发明还提供一种射频LDMOS器件的制造方法。
[0005]为解决上述技术问题，本发明提供的射频LDMOS器件包括:
[0006]第一导电类型重掺杂的娃衬底。
[0007]第一导电类型掺杂的娃外延层，该娃外延层形成于所述娃衬底表面上。
[0008]漂移区，由形成于所述硅外延层的选定区域中的第二导电类型离子注入区组成，所述漂移区的顶部表面和所述硅外延层的顶部表面相平、所述漂移区的深度小于所述硅外延层的厚度。
[0009]沟道区，由形成于所述硅外延层的选定区域中的第一导电类型离子注入区组成，所述沟道区的顶部表面和所述硅外延层的顶部表面相平、所述沟道区的深度小于所述硅外延层的厚度；所述沟道区和所述漂移区在横向上直接接触，或者所述沟道区和所述漂移区在横向上通过所述娃外延层相连接。
[0010]多晶硅栅，形成于所述硅外延层上方，所述多晶硅栅和所述硅外延层间隔离有栅介质层，所述多晶硅栅覆盖部分所述沟道区并延伸到所述漂移区上方，被所述多晶硅栅覆盖的所述沟道区表面用于形成沟道。
[0011]源区，由形成于所述沟道区中的第二导电类型重掺杂区组成，所述源区和所述多晶硅栅的第一侧自对准。
[0012]漏区，由形成于所述漂移区中的第二导电类型重掺杂区组成，所述漏区和所述多晶硅栅的第二侧相隔一横向距离。
[0013]在所述多晶硅栅的顶部表面形成有第一金属硅化物层，在所述源区和所述漏区表面都形成有第二金属硅化物层，所述第一金属硅化物层和所述第二金属硅化物层都由形成有硅表面的钛和氮化钛经快速热退火后形成，所述第一金属硅化物层的厚度大于所述第二金属硅化物层的厚度，通过增加所述第一金属硅化物层的厚度降低所述多晶硅栅的寄生电阻；通过降低所述第二金属硅化物层的厚度来降低所述第二金属硅化物层对所述源区和所述漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。
[0014]进一步的改进是，所述第一金属硅化物层由300埃的第一钛层加300埃的第二钛和氮化钛层经快速热退火后形成；所述第二金属硅化物由300埃的第二钛和氮化钛层经快速热退火后形成。
[0015]进一步的改进是，所述射频LDMOS器件为N型器件，所述第一导电类型为P型，所述第二导电类型为N型；或者，所述射频LDMOS器件为P型器件，所述第一导电类型为N型，所述第二导电类型为P型。
[0016]为解决上述技术问题，本发明提供的射频LDMOS器件的制造方法包括如下步骤:
[0017]步骤一、在第一导电类型重掺杂的硅衬底表面上外延生长形成第一导电类型掺杂的娃外延层。
[0018]步骤二、在所述硅外延层表面依次淀积栅介质层、多晶硅，对所述多晶硅进行注入掺杂。
[0019]步骤三、采用光刻刻蚀工艺对所述多晶硅进行刻蚀形成多晶硅栅。
[0020]步骤四、在形成有所述多晶硅栅的所述硅外延层中进行全面第二导电类型离子注入，由位于所述多晶硅栅第二侧的第二导电类型离子注入区组成漂移区，所述漂移区的顶部表面和所述硅外延层的顶部表面相平、所述漂移区的深度小于所述硅外延层的厚度。
[0021]步骤五、在所述硅外延层的选定区域中的进行第一导电类型离子注入形成沟道区，形成所述沟道区的选定区域由光刻工艺定义、且所述沟道区的选定区域和所述多晶硅栅的第一侧自对准；进行快速热退火推进，快速热退火推进后所述沟道区和所述漂移区都相所述多晶硅栅底部扩散，所述沟道区和所述漂移区在横向上直接接触、或者所述沟道区和所述漂移区在横向上通过所述硅外延层相连接；所述沟道区的顶部表面和所述硅外延层的顶部表面相平、所述沟道区的深度小于所述硅外延层的厚度；被所述多晶硅栅覆盖的所述沟道区表面用于形成沟道。
[0022]步骤六、光刻定义出源区和漏区，进行第二导电类型重掺杂离子注入形成所述源区和所述漏区，所述源区和所述多晶硅栅的第一侧自对准；所述漏区和所述多晶硅栅的第二侧相隔一横向距离。
[0023]步骤七、在形成有所述源区和所述漏区的所述硅外延层正面淀积氧化硅层，所述氧化硅层覆盖所述多晶硅栅顶部、侧部表面以及所述多晶硅栅外部的所述硅外延层表面。
[0024]步骤八、采用干法刻蚀工艺将所述多晶硅栅顶部表面的所述氧化硅层去除，所述多晶硅栅侧部表面和外部的所述氧化硅层保留，所述多晶硅栅侧部表面的所述氧化硅层作为所述多晶硅栅的侧墙。
[0025]步骤九、淀积第一钛层，所述第一钛层和所述多晶硅栅的顶部表面接触并延伸到所述多晶硅栅外部的所述氧化硅层表面。
[0026]步骤十、采用光刻工艺定义出所述源区和所述漏区需要形成金属硅化物层的区域，通过干法刻蚀工艺将所述源区和所述漏区需要形成金属硅化物层的区域打开。
[0027]步骤十一、淀积第二钛和氮化钛层，在所述多晶硅栅上方所述第二钛和氮化钛层和所述第一钛层接触，在所述源区和所述漏区需要形成金属硅化物层的区域中所述第二钛和氮化钛层分别和所述源区和所述漏区接触。
[0028]步骤十二、采用快速热退火工艺进行钛和硅的合金化，合金化后在所述多晶硅栅的顶部表面形成第一金属硅化物层，在所述源区和所述漏区表面都形成第二金属硅化物层，所述第一金属硅化物层的厚度大于所述第二金属硅化物层的厚度，通过增加所述第一金属硅化物层的厚度降低所述多晶硅栅的寄生电阻；通过降低所述第二金属硅化物层的厚度来降低所述第二金属硅化物层对所述源区和所述漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。
[0029]进一步的改进是，步骤九中所述第一钛层的厚度为300埃，步骤十一中所述第二钛和氮化钛层的厚度为300埃。
[0030]进一步的改进是，步骤二中所述栅介质层的材料为氧化层，所述栅介质层的厚度为300埃，所述多晶硅的厚度为3000埃。
[0031]进一步的改进是，步骤七中所述氧化硅层的厚度为800埃。
[0032]进一步的改进是，所述射频LDMOS器件为N型器件，所述第一导电类型为P型，所述第二导电类型为N型；或者，所述射频LDMOS器件为P型器件，所述第一导电类型为N型，所述第二导电类型为P型。
[0033]本发明能够实现多晶硅栅的顶部表面形成的第一金属硅化物层和源区和漏区表面形成的第二金属硅化物层厚度不一样的设置，且第一金属硅化物层的厚度大于第二金属硅化物层的厚度，通过第一金属硅化层的加厚能降低栅极的电阻，容易保证栅极低电阻；第二金属硅化物层的厚度不会随着第一金属硅化层的厚度的增加而增加，能通过降低第二金属硅化物层的厚度来降低第二金属硅化物层对源区和漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定，从而能整体提高器件的击穿电压、提高器件的可靠性。
【专利附图】
【附图说明】
[0034]下面结合附图和【具体实施方式】对本发明作进一步详细的说明:
[0035]图1是现有射频LDMOS器件的结构示意图；
[0036]图2是本发明实施例射频LDMOS器件的结构示意图；
[0037]图3A-图31是本发明实施例方法各步骤中射频LDMOS器件的结构示意图。
【具体实施方式】
[0038]如图2所示，是本发明实施例射频LDMOS器件的结构示意图；本发明实施例射频LDMOS器件包括:
[0039]第一导电类型重掺杂的娃衬底I。娃衬底I的掺杂浓度大于le20cm 3。
[0040]第一导电类型掺杂的娃外延层2,该娃外延层2形成于所述娃衬底I表面上。所述硅外延层2的掺杂浓度和厚度取决于器件的漏端工作电压，漏端工作电压越高，硅外延层2掺杂越低、厚度越厚；较佳为，硅外延层2的掺杂浓度范围5X 114CnT3至2X 1015cm_3。
[0041]多晶娃栅4,形成于所述娃外延层2上方,所述多晶娃栅4和所述娃外延层2间隔离有栅介质层3。所述栅介质层3的材料为氧化层，厚度为300埃左右。所述多晶硅栅4的厚度为3000埃左右。
[0042]漂移区5，由形成于所述硅外延层2的选定区域中的第二导电类型离子注入区组成，所述漂移区5的顶部表面和所述硅外延层2的顶部表面相平、所述漂移区5的深度小于所述硅外延层2的厚度。
[0043]沟道区6，由形成于所述硅外延层2的选定区域中的第一导电类型离子注入区组成，所述沟道区6的顶部表面和所述硅外延层2的顶部表面相平、所述沟道区6的深度小于所述硅外延层2的厚度；所述沟道区6和所述漂移区5在横向上直接接触，或者所述沟道区6和所述漂移区5在横向上通过所述硅外延层2相连接。
[0044]所述多晶硅栅4覆盖部分所述沟道区6并延伸到所述漂移区5上方，被所述多晶硅栅4覆盖的所述沟道区6表面用于形成沟道。
[0045]源区7，由形成于所述沟道区6中的第二导电类型重掺杂区组成，所述源区7和所述多晶娃栅4的第一侧自对准。
[0046]漏区8，由形成于所述漂移区5中的第二导电类型重掺杂区组成，所述漏区8和所述多晶硅栅4的第二侧相隔一横向距离。
[0047]在所述多晶硅栅4的顶部表面形成有第一金属硅化物层10，在所述源区7和所述漏区8表面都形成有第二金属硅化物层11。氧化硅层9为金属硅化物阻挡层并用于定义出所述第一金属硅化物层10和所述第二金属硅化物层11的形成区域。所述氧化硅层9的厚度为800埃左右。
[0048]所述第一金属娃化物层10和所述第二金属娃化物层11都由形成有娃表面的钛和氮化钛经快速热退火后形成，所述第一金属硅化物层10的厚度大于所述第二金属硅化物层11的厚度，通过增加所述第一金属硅化物层10的厚度降低所述多晶硅栅4的寄生电阻；通过降低所述第二金属硅化物层11的厚度来降低所述第二金属硅化物层11对所述源区7和所述漏区8的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。较佳为，所述第一金属硅化物层10由300埃的第一钛层加300埃的第二钛和氮化钛层经快速热退火后形成；所述第二金属硅化物由300埃的第二钛和氮化钛层经快速热退火后形成。
[0049]本发明实施例射频LDMOS器件的结构既适用于N型器件，也适用于P型器件。当本发明实施例射频LDMOS器件为N型器件时，所述第一导电类型为P型，所述第二导电类型为N型；或者，当本发明实施例射频LDMOS器件为P型器件，所述第一导电类型为N型，所述第二导电类型为P型。
[0050]如图3A至图31所示，是本发明实施例方法各步骤中射频LDMOS器件的结构示意图。本发明实施例射频LDMOS器件的制造方法包括如下步骤:
[0051]步骤一、如图3A所示，在第一导电类型重掺杂的硅衬底I表面上外延生长形成第一导电类型掺杂的娃外延层2。所述娃衬底I的掺杂浓度大于le20cm_3。所述娃外延层2的掺杂浓度和厚度取决于器件的漏端工作电压，漏端工作电压越高，硅外延层2掺杂越低、厚度越厚。较佳为，硅外延层2的掺杂浓度范围5X 114CnT3至2X 1015cm_3。
[0052]步骤二、如图3A所示,在所述娃外延层2表面依次淀积栅介质层3、多晶娃4,对所述多晶硅4进行注入掺杂。所述栅介质层3的材料为氧化层，厚度为300埃左右。所述多晶硅栅4的厚度为3000埃左右。
[0053]步骤三、如图3B所示，采用光刻刻蚀工艺对所述多晶硅4进行刻蚀形成多晶硅栅4。
[0054]步骤四、如图3B所示，在形成有所述多晶硅栅4的所述硅外延层2中进行全面第二导电类型离子注入，由位于所述多晶硅栅4第二侧的第二导电类型离子注入区组成漂移区5，所述漂移区5的顶部表面和所述硅外延层2的顶部表面相平、所述漂移区5的深度小于所述硅外延层2的厚度。
[0055]步骤五、如图3C所示，在所述硅外延层2的选定区域中的进行第一导电类型离子注入形成沟道区6。
[0056]形成所述沟道区6的选定区域由光刻工艺形成的光刻胶5a图形定义、且所述沟道区6的选定区域和所述多晶硅栅4的第一侧自对准。
[0057]进行快速热退火推进，快速热退火推进后所述沟道区6和所述漂移区5都相所述多晶硅栅4底部扩散，所述沟道区6和所述漂移区5在横向上直接接触、或者所述沟道区6和所述漂移区5在横向上通过所述硅外延层2相连接；所述沟道区6的顶部表面和所述硅外延层2的顶部表面相平、所述沟道区6的深度小于所述硅外延层2的厚度；被所述多晶硅栅4覆盖的所述沟道区6表面用于形成沟道。
[0058]步骤六、如图3D所示，光刻形成光刻胶5a图形定义出源区7和漏区8，进行第二导电类型重掺杂离子注入形成所述源区7和所述漏区8，所述源区7和所述多晶硅栅4的第一侧自对准；所述漏区8和所述多晶硅栅4的第二侧相隔一横向距离。
[0059]步骤七、如图3E所示,在形成有所述源区7和所述漏区8的所述娃外延层2正面淀积氧化硅层9，所述氧化硅层9覆盖所述多晶硅栅4顶部、侧部表面以及所述多晶硅栅4外部的所述硅外延层2表面。所述氧化硅层9为金属硅化物阻挡层并用于定义出后续第一金属硅化物层10和第二金属硅化物层11的形成区域。所述氧化硅层9的厚度为800埃左右。
[0060]步骤八、如图3F所示，采用干法刻蚀工艺将所述多晶硅栅4顶部表面的所述氧化硅层9去除，所述多晶硅栅4侧部表面和外部的所述氧化硅层9保留，所述多晶硅栅4侧部表面的所述氧化硅层9作为所述多晶硅栅4的侧墙。
[0061]步骤九、如图3G所示,淀积第一钛层1a,所述第一钛层1a和所述多晶娃栅4的顶部表面接触并延伸到所述多晶硅栅4外部的所述氧化硅层9表面。所述第一钛层1a的厚度为300埃左右。
[0062]步骤十、如图3H所示，采用光刻工艺形成光刻胶5a图形定义出所述源区7和所述漏区8需要形成金属硅化物层的区域，通过干法刻蚀工艺将所述源区7和所述漏区8需要形成金属硅化物层的区域打开。
[0063]步骤十一、如图31所示，淀积第二钛和氮化钛层10b，在所述多晶硅栅4上方所述第二钛和氮化钛层1b和所述第一钛层1a接触，在所述源区7和所述漏区8需要形成金属硅化物层的区域中所述第二钛和氮化钛层1b分别和所述源区7和所述漏区8接触。所述第二钛和氮化钛层1b的厚度为300埃左右。
[0064]步骤十二、如图2所示，采用快速热退火工艺进行钛和硅的合金化，合金化后在所述多晶硅栅4的顶部表面形成第一金属硅化物层10，在所述源区7和所述漏区8表面都形成第二金属娃化物层11，所述第一金属娃化物层10的厚度大于所述第二金属娃化物层11的厚度，通过增加所述第一金属硅化物层10的厚度降低所述多晶硅栅4的寄生电阻；通过降低所述第二金属硅化物层11的厚度来降低所述第二金属硅化物层11对所述源区7和所述漏区8的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。
[0065]本发明实施例方法中，所述射频LDMOS器件能为N型器件或P型器件，当本发明实施例方法形成的射频LDMOS器件为N型器件时，所述第一导电类型为P型，所述第二导电类型为N型；此时步骤五中所述沟道区6的P型离子注入的能量为200kev左右，注入剂量为lE12cm_2?lE13cm_2 ;步骤六中所述源区7和所述漏区8的N型重掺杂离子注入的剂量为lE15cm 2 左右。
[0066]当本发明实施例一方法形成的射频LDMOS器件为P型器件时，所述第一导电类型为N型，所述第二导电类型为P型。
[0067]以上通过具体实施例对本发明进行了详细的说明，但这些并非构成对本发明的限制。在不脱离本发明原理的情况下，本领域的技术人员还可做出许多变形和改进，这些也应视为本发明的保护范围。
【权利要求】
1.一种射频LDMOS器件，其特征在于，包括: 第一导电类型重掺杂的娃衬底； 第一导电类型掺杂的娃外延层，该娃外延层形成于所述娃衬底表面上； 漂移区，由形成于所述硅外延层的选定区域中的第二导电类型离子注入区组成，所述漂移区的顶部表面和所述硅外延层的顶部表面相平、所述漂移区的深度小于所述硅外延层的厚度； 沟道区，由形成于所述硅外延层的选定区域中的第一导电类型离子注入区组成，所述沟道区的顶部表面和所述硅外延层的顶部表面相平、所述沟道区的深度小于所述硅外延层的厚度；所述沟道区和所述漂移区在横向上直接接触，或者所述沟道区和所述漂移区在横向上通过所述娃外延层相连接； 多晶硅栅，形成于所述硅外延层上方，所述多晶硅栅和所述硅外延层间隔离有栅介质层，所述多晶硅栅覆盖部分所述沟道区并延伸到所述漂移区上方，被所述多晶硅栅覆盖的所述沟道区表面用于形成沟道； 源区，由形成于所述沟道区中的第二导电类型重掺杂区组成，所述源区和所述多晶硅栅的第一侧自对准； 漏区，由形成于所述漂移区中的第二导电类型重掺杂区组成，所述漏区和所述多晶硅栅的第二侧相隔一横向距离； 在所述多晶硅栅的顶部表面形成有第一金属硅化物层，在所述源区和所述漏区表面都形成有第二金属娃化物层，所述第一金属娃化物层和所述第二金属娃化物层都由形成有娃表面的钛和氮化钛经快速热退火后形成，所述第一金属硅化物层的厚度大于所述第二金属硅化物层的厚度，通过增加所述第一金属硅化物层的厚度降低所述多晶硅栅的寄生电阻；通过降低所述第二金属硅化物层的厚度来降低所述第二金属硅化物层对所述源区和所述漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。
2.如权利要求1所述射频LDMOS器件，其特征在于:所述第一金属硅化物层由300埃的第一钛层加300埃的第二钛和氮化钛层经快速热退火后形成；所述第二金属硅化物层由300埃的第二钛和氮化钛层经快速热退火后形成。
3.如权利要求1所述射频LDMOS器件，其特征在于:所述射频LDMOS器件为N型器件，所述第一导电类型为P型，所述第二导电类型为N型；或者，所述射频LDMOS器件为P型器件，所述第一导电类型为N型，所述第二导电类型为P型。
4.一种射频LDMOS器件的制造方法，其特征在于，包括如下步骤: 步骤一、在第一导电类型重掺杂的硅衬底表面上外延生长形成第一导电类型掺杂的硅外延层； 步骤二、在所述硅外延层表面依次淀积栅介质层、多晶硅，对所述多晶硅进行注入掺杂； 步骤三、采用光刻刻蚀工艺对所述多晶硅进行刻蚀形成多晶硅栅； 步骤四、在形成有所述多晶硅栅的所述硅外延层中进行全面第二导电类型离子注入，由位于所述多晶硅栅第二侧的第二导电类型离子注入区组成漂移区，所述漂移区的顶部表面和所述硅外延层的顶部表面相平、所述漂移区的深度小于所述硅外延层的厚度； 步骤五、在所述硅外延层的选定区域中的进行第一导电类型离子注入形成沟道区，形成所述沟道区的选定区域由光刻工艺定义、且所述沟道区的选定区域和所述多晶硅栅的第一侧自对准；进行快速热退火推进，快速热退火推进后所述沟道区和所述漂移区都相所述多晶硅栅底部扩散，所述沟道区和所述漂移区在横向上直接接触、或者所述沟道区和所述漂移区在横向上通过所述硅外延层相连接；所述沟道区的顶部表面和所述硅外延层的顶部表面相平、所述沟道区的深度小于所述硅外延层的厚度；被所述多晶硅栅覆盖的所述沟道区表面用于形成沟道； 步骤六、光刻定义出源区和漏区，进行第二导电类型重掺杂离子注入形成所述源区和所述漏区，所述源区和所述多晶硅栅的第一侧自对准；所述漏区和所述多晶硅栅的第二侧相隔一横向距离； 步骤七、在形成有所述源区和所述漏区的所述硅外延层正面淀积氧化硅层，所述氧化硅层覆盖所述多晶硅栅顶部、侧部表面以及所述多晶硅栅外部的所述硅外延层表面； 步骤八、采用干法刻蚀工艺将所述多晶硅栅顶部表面的所述氧化硅层去除，所述多晶硅栅侧部表面和外部的所述氧化硅层保留，所述多晶硅栅侧部表面的所述氧化硅层作为所述多晶娃棚的侧墙； 步骤九、淀积第一钛层，所述第一钛层和所述多晶硅栅的顶部表面接触并延伸到所述多晶硅栅外部的所述氧化硅层表面； 步骤十、采用光刻工艺定义出所述源区和所述漏区需要形成金属硅化物层的区域，通过干法刻蚀工艺将所述源区和所述漏区需要形成金属硅化物层的区域打开； 步骤十一、淀积第二钛和氮化钛层，在所述多晶硅栅上方所述第二钛和氮化钛层和所述第一钛层接触，在所述源区和所述漏区需要形成金属硅化物层的区域中所述第二钛和氮化钛层分别和所述源区和所述漏区接触； 步骤十二、采用快速热退火工艺进行钛和硅的合金化，合金化后在所述多晶硅栅的顶部表面形成第一金属硅化物层，在所述源区和所述漏区表面都形成第二金属硅化物层，所述第一金属硅化物层的厚度大于所述第二金属硅化物层的厚度，通过增加所述第一金属硅化物层的厚度降低所述多晶硅栅的寄生电阻；通过降低所述第二金属硅化物层的厚度来降低所述第二金属硅化物层对所述源区和所述漏区的第二导电类型重掺杂区的消耗，使射频LDMOS器件的反向击穿电压稳定。
5.如权利要求4所述方法，其特征在于:步骤九中所述第一钛层的厚度为300埃，步骤十一中所述第二钛和氮化钛层的厚度为300埃。
6.如权利要求4所述方法，其特征在于:步骤二中所述栅介质层的材料为氧化层，所述栅介质层的厚度为300埃，所述多晶硅的厚度为3000埃。
7.如权利要求4所述方法，其特征在于:步骤七中所述氧化硅层的厚度为800埃。
8.如权利要求4所述方法，其特征在于:所述射频LDMOS器件为N型器件，所述第一导电类型为P型，所述第二导电类型为N型；或者，所述射频LDMOS器件为P型器件，所述第一导电类型为N型，所述第二导电类型为P型。
【文档编号】H01L29/78GK104425589SQ201310365073
【公开日】2015年3月18日 申请日期:2013年8月20日 优先权日:2013年8月20日
【发明者】遇寒, 蔡莹, 周正良, 李 昊 申请人:上海华虹宏力半导体制造有限公司