专利名称：时钟生成装置的制作方法
技术领域：
本发明涉及根据在数字广播中所使用的MPEG2(运动图象专家组2)传输包等比特流中包含的基准信息来生成基准时钟的时钟生成装置。
背景技术：
在数字广播中，以比特流来多路传输与多个节目相关的图象、声音等各种信号。为了对其进行接收，需要在接收侧生成作为基准时钟的系统时钟。因此，在现有技术中，把用于生成系统时钟的基准信息以适当的间隔插入到比特流内，在接收侧对其进行检出，使用所检出的接收侧振荡器的基准信息和被相位锁定的锁相环电路(PLL电路)来得到系统时钟。
当使用MPEG2传输流来作为比特流时，传输作为下述那样的基准信息的程序时钟基准(PCRProgram Clock Reference，以下称为「PCR」)信号，以其为基准在接收侧生成27MHz的系统时钟。图3是表示MPEG2的传输流的构造的图，在188字节的传输包中，开头的4字节(32位)是首部。通过首部内的修正字节控制字节F7来表示修正字节F9的有无。当表示为没有修正字节F9时，在首部之后紧接着有效负荷F10。在该有效负荷F10中插入视频和音频等数据来进行传输。当表示为修正字节F9存在时，在首部之后接着修正字节F9，其余的部分为有效负荷F10。在接在修正字节F9之后的有效负荷F10中可以放入视频等数据，而在与其他不同的长度的有效负荷中放入数据，会使处理变得复杂，为了避免其，可以在该有效负荷中插入「填充数据」(用于填塞空间而放入的数据，在内容上没有意义的数据)。
修正字节F9的构造为图3(c)、(d)所示的那样，在其中定义了包含PCR信号的字节F11。PCR信号的实数据是42位的数据，在每个节目中以0.1秒以下的周期来传输包含其的传输包。PCR信号中预定位置(例如最后字节的开头)被规定为时刻的标准位置，在接收机侧，在该位置到达的时刻，按照PCR信号表示的值来修正时钟。
下面使用图4来描述接收MPEG2传输流的数字广播的接收机中的系统时钟生成PLL电路的构成。首先，由接收的数字信号通过PCR检出器102而从该节目的包抽出PCR信号。在由PCR检出器102所检出的PCR信号的时刻标准位置上，通过在PCR检出器102内所发生的闩锁脉冲，来闩锁对电压控制振荡器(以下称为「VCO」)106的输出进行计数的计数器107的计数值。PCR信号的数据由PCR检出器102进行解码，并提供给比较电路103的一输入端。计数器107的被闩锁的输出被提供给比较电路103的另一输入端，把两者进行比较。比较结果被变换为例如PWM信号(脉宽调制信号)，由低通滤波器104进行平滑，经过开关105而提供给VCO106。其中，当PCR信号被输入时，开关105的可动接触片被保持在B侧。VCO106的输出作为系统时钟通过输出端子108提供给例如MPEG2传输流的记录重放装置。
当接收数字广播时，接收数字信号被提供给输入端子101，如上述那样，开关105的可动接触片被保持在B侧，系统时钟生成PLL电路把控制电压VPLL提供给VCO106，以使该输出信号被PCR信号进行锁相，而得到27MHz的系统时钟。另一方面，在来自数字广播的PCR信号的非接收时，例如在数字广播接收机一体型记录重放装置中的重放时，开关105的可动接触片被切换到A侧，由恒压电路109给VCO106提供恒定的电压VCST。在此情况下，当从重放切换到广播接收时，由于PLL电路立即进行锁相，希望非接收时的VCO106的控制电压VCST接近于锁定时的控制电压VPLL。
但是，由于在包含VCO106的PLL电路中存在制造上的偏差，就需要分别调整VCO控制电压的偏置，而存在制造成本上升的问题。
鉴于上述问题，本发明的目的是提供一种时钟生成装置，即使不进行偏置调整，也能迅速地进行用于生成基准时钟的基准信息的输入开始时的PLL电路的锁相动作。
在数字广播接收机一体型记录重放装置中，当从数字广播的接收切换为由记录重放部所进行的记录媒体的重放时，当直接切换系统时钟时，在信号处理LSI(大规模集成电路)的输入时钟等中产生不连续，由于必须复位LSI，而存在例如重放信号的输出开始滞后的问题。
发明内容
鉴于上述问题，本发明的目的是提供一种时钟生成装置，当从对在PCR信号这样的输入信号中包含的基准信息进行锁相的状态而切换为不使用基准信息的状态时或者进行相反切换时，输出的基准时钟不会成为不连续的。
为了实现上述目的，根据本发明的一个方面，提供了一种时钟信号生成装置，其特征在于时钟信号生成装置具有接收装置，接收包括基准信息在内的广播信号；记录重放装置，记录、重放用上述接收装置接收到的上述广播信号；抽出装置，从用上述接收装置接收的上述广播信号中抽出上述基准信息；第一振荡器，生成具有和控制信号相对应的频率的基准时钟；第二振荡器，生成具有和上述基准信息无关的内部基准信号；第一比较部，比较上述第一振荡器生成的上述基准时钟和上述抽出装置抽出的上述基准信息，输出第一比较信息；第二比较部，比较上述第一振荡器生成的上述基准时钟和上述第二振荡器生成的上述基准信号，输出第二比较信息；在上述接收装置接收上述广播信号时，将上述第一比较部输出的上述第一比较信息作为上述控制信号反馈到上述第一振荡器，另一方面，在通过上述记录重放装置重放上述广播信号时，将上述第二比较部输出的上述第二比较信息作为上述控制信号反馈到上述第一振荡器。
根据本发明的又一个方面，上述时钟信号生成装置，其特征在于，上述第一比较部输出的上述第一比较信息和上述第二比较部输出的上述第二比较信息，通过单一的低通滤波器，作为上述控制信号反馈到上述第一振荡器。
本发明的这些和其他的目的、优点及特征将通过结合附图对本发明的实施例的描述而得到进一步说明。在这些附图中图1是表示本发明的一个实施例所涉及的数字广播接收机一体型记录重放装置的构成的方框图；图2是表示图1的装置的时钟生成部的构成的第一实施例的方框图；图3是用于说明MPEG2传输流的构成的图；图4是表示现有的时钟生成装置的图；
图5是表示本发明的第二实施例的时钟生成装置的构成的图。
下面参照附图来说明本发明的实施例。
具体实施例方式
图1是表示本发明的一个实施例所涉及的数字广播接收机一体型记录重放装置的构成的方框图，该装置包括接收处理电路121，输入来自天线的信号，进行变频、纠错等预定的处理并输出基带信号(数字广播接收信号)；开关114；记录重放部123，进行数字广播接收信号的记录重放；MPEG解码器122，对MPEG传输流进行解码而输出视频信号和音频信号；时钟生成部100，给记录重放部123和MPEG解码器122提供27MHz系统时钟。记录重放部123由例如符合D-VHS(注册商标)方式的VTR(磁带录象机)所构成，使用由时钟生成部100所提供的系统时钟来进行记录重放时的信号处理。记录重放部123的输出通过外部数字信号输入端子113而输入给开关114。
在数字广播接收时，开关114的可动接触片如图所示的那样被保持在A侧，数字广播接收信号被提供给时钟生成部100、MPEG解码器122和记录重放部123。另一方面，当记录重放部123的重放时，开关114的可动接触片被保持在B侧，重放数字信号被提供给时钟生成部100和MPEG解码器122。图2是表示时钟生成部100的构成的方框图，在该图中，对与图4相同的部分使用相同的标号。
即，时钟生成部100包括PCR检出器102，从接收的数字信号中的该节目的包抽出PCR信号；VCO106；计数器107，对VCO106的输出进行计数，在由PCR检出器102所检出的PCR信号的时刻标准位置上，通过在PCR检出器102内所发生的闩锁脉冲来锁定计数值；比较电路103，把由PCR检出器102所解码的PCR信号的数据与计数器107的闩锁输出进行比较，把其比较结果变换为例如PWM信号(脉宽调制信号)并输出；低通滤波器104，对比较电路103的输出信号进行平滑；A/D变换器110，把低通滤波器104的输出信号变换为数字信号；存储器111，存储A/D变换器110输出的数字信号；D/A变换器112，把从存储器111读出的数字信号变换为模拟信号；开关105。即，时钟生成部100是在图4的现有装置中追加了A/D变换器110、存储器111和D/A变换器112的构成。
在数字广播接收时，给PCR检出器102按上述那样输入数字广播接收信号。此时，开关105的可动接触片被保持在B侧，PLL电路与图4的装置相同地动作。接着，PLL电路进行锁相的状态被检出时，低通滤波器104输出的控制电压VPLL经过A/D变换器110存储在存储器111中。进行锁相的状态的检出是通过下述这样的方法进行例如通过微型计算机来监视A/D变换器110输出的数字值，当其变动变得少于预定量时，判定为进行了锁相。
另一方面，当记录重放部123进行重放时，如果在使开关105的可动接触片处于B侧的状态下PLL电路进行锁相，开关105保持为原状，VCO106被LPF104的输出信号进行控制。但是，即使在此情况下，由于所重放的PCR信号的精度不够，控制电压VPLL的经过A/D变换器110向存储器111的写入不能进行。当在使开关105的可动接触片处于B侧的状态下PLL电路未进行锁相时，开关105的可动接触片被切换到A侧，当接收数字广播时，在存储器111中所存储的电压值的学习被进行D/A变换，而成为模拟电压VPLLM，提供给VCO106。
由此，当从重放状态向数字广播接收状态转换时，即，在PCR信号输入开始时，就能迅速地进行PLL电路的锁相。
上述动作可以是这样的在作为数字广播的接收信号并进行了变频、纠错等预定处理的信号经过输入端子101而输入的情况下，经过外部数字信号输入端子113通过数字接口而外部提供(数字广播接收信号之外的)数字信号，而不是记录重放部123的重放信号。在此情况下，即使PCR信号进入到数字信号中，也需要考虑PCR信号的精度不够的问题。因此，当假设为这样时，开关114的可动接触片被连接到B侧，当接收到来自外部输入的数字信号时，开关105的可动接触片被切换到B侧，PLL电路动作以便于对进入输入信号中的PCR信号进行锁相，但是，不能进行经过A/D变换器110的向存储器111的写入。由此，仅对足够可靠性的某个广播接收信号进行控制电压VPLL的存储，当从重放状态向广播接收状态切换时，能够实现迅速的引入动作。
本发明并不仅限于上述实施例，可以进行各种变形。例如，VCO106的控制信息的存储并不仅限于上述例子那样存储低通滤波器104的输出的方法，可以对输入比较电路103的两个输入使用存储广播接收时的典型的值，在非接收时把与这些值相对应的信号连续提供给比较电路103的方法，以及，对比较电路103输出的PWM信号等使用存储脉宽等参数的信息等方法。
下面，参照附图来对本发明的第二实施例进行说明。
图5是表示本发明的第二实施例所涉及的时钟生成装置的构成方框图。在该图中，对与图2相同的部分使用相同的标号。
图5的装置包括PCR检出器102，从接收的数字信号中的该节目的包抽出PCR信号；VCO106；计数器107，对VCO106的输出进行计数，在由PCR检出器102所检出的PCR信号的时刻标准位置上，通过在PCR检出器102内所发生的闩锁脉冲来锁定计数值；比较电路103，把由PCR检出器102所解码的PCR信号的数据与计数器107的闩锁输出进行比较，把其比较结果变换为例如PWM信号(脉宽调制信号)并输出；开关130；低通滤波器104，对开关130的输出信号进行平滑；石英振荡器131，发生作为内部基准信号的频率27MHz的基准信号；相位比较器132。接着，VCO106的输出，除了计数器107之外，被输入相位比较器132一方的比较输入。相位比较器132的另一方的比较输入连接在石英振荡器131上。
该装置在数字广播接收时从输入端子101输入包含PCR信号的数字信号，使开关130的可动接触片保持在B侧，与图2所示的第一实施例的装置相同地动作。
另一方面，例如，当图5的装置安装在数字广播接收机一体型记录重放装置中时，在该记录重放装置重放时，把开关130的可动接触片切换到A侧。因此，当记录重放装置重放时，由VCO106、相位比较器132和低通滤波器104所形成的环路来构成PLL电路，使用石英振荡器131的输出来作为其基准信号。由此，同样使用VCO106的输出来作为系统时钟，因此，即使在从数字广播接收向重放的切换等方式切换时，不会产生系统时钟的不连续，可以不需要信号处理用LSI等的复位动作。
在开关130的切换时，在其输出中会发生切换噪声，但是，在本实施例中，由于把开关130配置在低通滤波器104的前段，则上述切换噪声由低通滤波器104进行平滑，VCO106的输出就不会引入切换噪声而大幅度摆动，就能连续地生成系统时钟。
如上述详细说明的那样，根据本发明的第一个方面，当基准时钟被从数字广播接收信号所抽出的基准信息进行锁相时，振荡装置的控制信号被进行存储，当输入信号不是数字广播接收信号时，根据上述存储的控制信号来控制振荡装置，因此，即使不进行偏置调整，也能迅速地进行用于输出基准时钟的基准信息的输入开始时的振荡装置的锁相动作。
根据本发明的另一个方面，当基准信息的精度较低时，不进行上述控制信号的存储，因此，就能防止因不正确的基准信息而导致偏置偏移。
根据本发明的再一个方面，生成与在输入数字信号中包含的基准信息相对应的内部基准信息，当使用基准信息时，控制振荡装置以便于输出对上述基准信息进行锁相的基准时钟，另一方面，当不使用上述基准信息时，控制振荡装置以便于上述基准时钟对上述内部基准信息进行锁相，因此，当从对在输入信号中包含的基准信息进行锁相的状态向不使用基准信息的状态切换时，或者进行相反切换时，能够保持输出的基准时钟的连续性。其结果，不需要对使用基准时钟的LSI等进行复位，能够提高记录重放输入数字信号的记录重放装置的重放动作的开始性能。
权利要求
1.一种时钟信号生成装置，其特征在于时钟信号生成装置具有接收装置，接收包括基准信息在内的广播信号；记录重放装置，记录、重放用上述接收装置接收到的上述广播信号；抽出装置，从用上述接收装置接收的上述广播信号中抽出上述基准信息；第一振荡器，生成具有和控制信号相对应的频率的基准时钟；第二振荡器，生成具有和上述基准信息无关的内部基准信号；第一比较部，比较上述第一振荡器生成的上述基准时钟和上述抽出装置抽出的上述基准信息，输出第一比较信息；第二比较部，比较上述第一振荡器生成的上述基准时钟和上述第二振荡器生成的上述基准信号，输出第二比较信息；在上述接收装置接收上述广播信号时，将上述第一比较部输出的上述第一比较信息作为上述控制信号反馈到上述第一振荡器，另一方面，在通过上述记录重放装置重放上述广播信号时，将上述第二比较部输出的上述第二比较信息作为上述控制信号反馈到上述第一振荡器。
2.根据权利要求1中的时钟信号生成装置，其特征在于，上述第一比较部输出的上述第一比较信息和上述第二比较部输出的上述第二比较信息，通过单一的低通滤波器，作为上述控制信号反馈到上述第一振荡器。
全文摘要
本发明提供一种时钟生成装置，即使不进行偏置调整，也能迅速地进行用于生成基准时钟的基准信息的输入开始时的PLL(锁相环)电路的锁相动作。所述时钟信号生成装置具有接收装置、记录重放装置、抽出装置、第一振荡器、第二振荡器、第一比较部、和第二比较部。在上述接收装置接收广播信号时，将第一比较部输出的第一比较信息作为控制信号反馈到第一振荡器；另一方面，在通过记录重放装置重放广播信号时，将第二比较部输出的第二比较信息作为控制信号反馈到第一振荡器。
文档编号H03L7/095GK1574888SQ200410055890
公开日2005年2月2日 申请日期1998年10月27日 优先权日1997年10月29日
发明者大石刚士 申请人:日本胜利株式会社