专利名称：多层结构的制造工艺的制作方法
技术领域：
本发明涉及一种由半导体材料构成的多层结构的制造工艺，所述结构包括由第一半导体材料形成的衬底和由第二半导体材料形成的表面薄层，两种半导体材料具有差异很大的晶格参数。
已经知道这种类型的工艺。
因此生产包括由例如硅的材料构成的衬底，和由例如锗硅(SiGe)、乃至锗(Ge)的材料构成的表面薄层的结构是公知的。
申请人名下的专利申请FR0208600涉及一种从包括晶格参数适配层的晶片开始制造包括半导体材料的薄层的结构的工艺，该晶格参数适配层包括由具有第一晶格参数的半导体材料构成的上层，特征在于它包括如下步骤(a)在适配层的上层上生长具有基本上不同于第一晶格参数的第二额定晶格参数的半导体材料膜，其具有足够小的厚度，以保持下面适配层的上层的第一晶格常数并因此变形，(b)在该膜上生长具有基本上与第一晶格参数相同的额定晶格参数的半导体材料的松散层，(c)相对于松散层除去适配层一侧上的至少部分晶片，包括以下操作●相对于松散层形成适配层一侧的脆裂区域，●在脆裂区域上供能以从晶片分离包括松散层的结构。
因此该专利申请的工艺使用层迁移技术(特别是SMARTCUT_型或ELTRAN_型)以组成希望的晶片。
该工艺的起始元件是包括晶格参数适配层的晶片，晶格参数适配层对应于出现在其表面上的一层基本上的松散层晶片的区域，没有大量的结构缺陷，例如位错。
可以理解，松散层指的是具有非应变晶体结构的半导体材料的任意层，即，具有与组成该层的材料的额定晶格参数基本相同的晶格参数的层。
相反，将应变层称为其晶体结构应变的半导体材料的任意层，在晶体生长过程中以牵引方式或以压缩方式使晶体结构应变，例如外延生长，至少迫使晶格参数基本不同于该材料的额定晶格参数。
专利申请FR0208600的工艺构成一个有利的解决方案以构成如本文开始时提到的结构。
本发明的目的是为本专利申请的学说提供一种补充。
为了获得该目的，本发明提出了由半导体材料构成的多层结构的制造工艺，所述的结构包括由第一半导体材料构成的衬底和由第二半导体材料构成的表面薄层，两种半导体材料具有基本上不同的晶格参数，特征在于该工艺包括如下步骤●在支撑衬底上产生包括所述表面薄层的层，●在由所述支撑衬底和所述沉积层形成的整体中生成脆性区域，●将所述的整体与目标衬底键合，●在脆性区域的层面进行分离，●处理最终结构的表面。
其它方面，参照附图，本发明的如下说明使本发明的目标和优点更加清楚地浮现，其中
图1a至1e说明执行本发明实施例的主要步骤。
首先参照图1a，显示了支撑衬底100，其上已沉积了层105(阴影所示)。
支撑衬底100由具有第一晶格参数的半导体材料形成。例如，它由硅构成。
层105是由具有不同于上文提到的第一晶格参数的第二晶格参数的材料形成的层。
因此，层105可由SiGe、乃至Ge构成。
通过下面的技术来沉积层105●沉积预定厚度的材料，该材料的晶格参数基本上不同于其上被沉积的支撑衬底的晶格参数，●同时构成实质上免除位错型缺陷的上述沉积的表面层。
例如，文献WO 00/15885讲授了允许在硅上沉积SiGe或Ge的工艺。
因此，例如可以根据其中通过实施下列步骤在单晶硅的支撑衬底上沉积单晶Ge的第一模式执行上述的沉积工艺●单晶硅衬底的温度稳定在400℃至500℃的预定稳定温度，优选430℃至460℃。
●在所述的第一预定温度下进行Ge的化学汽相淀积(CVD)，直到在支撑衬底上获得比最终期望的厚度小的预定厚度的Ge的基层。
●将Ge的化学汽相淀积的温度从第一预定温度上升到范围从750℃至850℃，优选从800℃至850℃的第二预定温度，以及●在第二预定温度下继续进行Ge的化学汽相淀积，直到单晶Ge层获得最终期望的厚度。
也可以根据例如文献WO 00/15885公开的变量执行上述沉积工艺。
直接在由硅形成的支撑衬底上获得松散SiGe或松散Ge的薄层的其它方法也是可行的。
也可以参照出版物“Strain relaxation of pseudomorphic Sil-xGex/Si(100)heterostructures after hydrogen or helium ion implantation for virtualsubstrate fabrication”，B.Holl_nde等人，Nuclear Instrument and Methodsin Physics Research B175-177(2001)357-367”，其内容引入本文。
在上述工艺中，通过形成应变层和通过松散该层来制造层110。
也可以通过下面文献公开的技术来获得松散的SiGe薄层，当他们公开用于获得为本发明而执行的上述层的方法时，下面的文献公开以引用的形式并入本文——″Development of a new type of SiGe thin strained relaxedbuffer based on the incorporation of carbon containing layer″，presented inthe first SiGe Technology and Device Meeting(ISTDM，Nagoya，Japan，January 15-17，2003)，——″Thin SiGe Buffers with High Ge content for n-Mosfets″(Lyutovich等人Material Science & Engineering，B89(2002)，341-345)，——″Relaxed SiGe buffers with thickness below 0.1μm″(Bauer等人-Thin Solid Films 369(2000)，152-156).
回到本发明的工艺，在所有情况下，在支撑衬底100上生成包括待制造的结构的表面薄层的层110。
因而形成包括支撑衬底100上的SiGe(具有理想的Si/Ge比率)或者Ge的层110的中间晶片10。
为了允许随后工艺中的中间层的键合，可以抛光层100的自由面。
为了上述键合，中间晶片10的表面粗糙度实际上只有几埃。
因此，界面105定义在层110和支撑100之间。
可以确定，通过使用这种类型的沉积工艺，位错型缺陷已限制在层110的邻近界面105的区域。
可以理解限定指的是大多数位错型缺陷位于所述区域中。层110的剩余部分没有完全免除缺陷，但它们的浓度与微电子应用不矛盾。
因此，其中限定位错型缺陷的层110的这个区域构成晶格参数适配层，其位于由硅构成的支撑衬底100与层110的表面区之间，其本身构成了由Ge或松散SiGe构成的晶片10的一层。
在工艺开始时进行的沉积之后，Ge或松散的SiGe层具有希望的厚度。该希望的厚度特别是大约0.5至1微米。
现在参照图1b，在晶片10的厚度中生成脆性区120。
该脆性区特别是通过经层110的物质注入而形成。
注入的物质是一种或几种原子或分子物质，例如，氢或氦离子或分子。
注入也可以是不同物质的共同注入，例如，氢或氦。可以确定在本文中“注入”也涵盖至少两种物质的共同注入。
当通过注入形成脆性区时，定义注入参数以便脆性区位于支撑衬底100中，如图1b所示。
也能够限定这些参数以便脆性区位于层110自身中(优选在邻近界面层105的区域中)。
可以确定，也可以通过在沉积层110之前在支撑衬底100中生成多孔区来形成脆性区。
接着回到包括脆性区的晶片，将该晶片键合到目标衬底20。
目标衬底20由硅形成。
粘在目标衬底的晶片10的表面是对应于层110的松散表面的表面。
为了执行该键合，在接触放置之前清洗该表面并在这些表面之间随意地插入键合层。
同样，电绝缘层(例如氧化物)可以插在晶片和目标衬底之间。
上述氧化物源自目标衬底20的表面的氧化。
如果它由SiGe形成，它同样源自层110的表面的氧化。
如果层110由Ge或SiGe形成，那么也可能在键合之前通过氧化物沉积使氧化层与它结合。
因此可以在键合之前，将晶片和/或目标衬底结合到绝缘层。
如果需要，为了将这些衬底的表面粗糙度降到适合键合的值(即，不大于几埃rms)，可以处理衬底的一个或两个待键合的表面。
上述的表面处理可以是抛光步骤。
在键合之后，为了固定键合界面能够继续进行典型的热处理。
接着通过热和/或机械供能在脆性界面的位置进行分离。
结果得到结构30，如图1d所示，其包括●目标衬底20，●层110●支撑衬底100的任意剩余。
在该结构中，层110本身包括●晶格参数适配层(邻近支撑衬底100的残留物的层110的一部分)，和●希望厚度的松散层。
通过在层110的该厚度的“晶格参数适配层”中注入构成脆性区的情况下，最终结构30不包括支撑衬底的残留物，在分离过程中晶格参数适配层的一部分与结构30分离。
在这种情况下，处理最终结构的表面(图1e)以改善层110的表面状态。
这种表面处理包括抛光、以及其他类型的处理。
也可以执行注入，以致在被松散的层110的一部分中获得脆性区。
在上述情况下，转移层不包括例如位错的缺陷(或仅仅非常少)，分离之后的最终结构呈现不需要任何额外处理的表面层(其来自层110的松散部分)。
在支撑衬底100的厚度中构成脆性区的情况下(通过注入或通过事先生成多孔区)，下一步骤是选择地腐蚀支撑衬底的残留物。
这种选择性腐蚀可以是选择性化学蚀刻，其仅腐蚀支撑衬底的材料。
通过湿法(选择适合的蚀刻溶液)、或通过干法(经能量等离子体、或者喷射的选择性蚀刻)进行上述蚀刻。
可以通过抛光进行上述蚀刻。
在选择性蚀刻的开始时，对应于其中限定位错型缺陷的层110的一部分，处理层110的自由表面以除去晶格参数适配层。
上文描述具有用于执行本发明的两个主要变量(分别在支撑衬底中和在层110中生成脆性区)。
在这两种情况下，最终结构的有源层对应于层110的松散部分。
根据第三个主要变量，实际上通过不同的水平面(或层)构成层110，并按如下生成层110●例如通过例如由文献WO 00/15885或上面提到的B.Holl_nder等人的参考文献的技术，或通常通过用于制造松散薄层的其它公知技术来沉积第一层，●沉积第二层，构成为化学腐蚀的阻挡层，●沉积对应于松散层的第三层以构成最终结构的有源层。进行上述沉积使有源层具有希望的厚度。
第一层对应于晶格参数适配层。它由SiGe或Ge形成。
同时第二层必须●相对于第三层具有优良的选择性，vis-à-vis化学腐蚀(在该方面，对于第二和第三层必须使用不同的材料)，以及●围绕它的两层在晶格参数方面不会引起太大的差异(在该方面，第一、第二和第三层的材料没有太大的差异)。
例如，可以生成下面的结合
第一层和第三层优选由相同性质的材料形成，以便插入在这两层之间的第二层在它的两个面上收到相似的约束力。
在这种情况下，优选使用下面的材料
在第三变量中，接下来是用于生成脆性区的相同步骤，键合并分离结构30。
因此，这里脆性区再次位于层110中。在这种情况下，它优选位于第一层的厚度中(其中通过注入生成)。
为了获得最终结构，执行两次选择性腐蚀●用于消除第一层的残留物而进行的第一选择腐蚀。该腐蚀具体是化学腐蚀，因而对应于阻挡层来调整层的插入，●用于消除阻挡层本身的第二选择腐蚀。
也可以仅用两层来构成层110，关于如上所述的第一层和类似于上述层2和3的第二层。
在这种情况下，第二层例如由应变硅形成，而第一层由SiGe或Ge形成。
因而第二层构成了最终结构的有源层，而第一层仍构成晶格参数适配层。
仍在这种情况下，能够使用下面的材料(通过非限制例子给出该表格，如前面的一种)
在所有情况下，在制造图1e的结构之后，接着是传统的表面处理测量。
因此本发明能够制造包括例如硅衬底上的Ge或SiGe层的多层结构。
应当注意在本发明的情况下，层110的适配层在其厚度中不存在浓度梯度(例如锗中的浓度梯度，如果适配层位于Si支撑衬底与具有给定Ge浓度的Ge或SiGe中的松散层之间)。
常规的适配层经常存在浓度梯度，其对应于适配层中的晶格参数的梯度。
但上述具有浓度的梯度的适配层不必相对较厚(适配层两侧上的晶格参数中的差异越大，适配层就越厚)。
WO 02/15244公开了上述具有浓度梯度的适配层的实例。
相反，在本发明中，适配层非常薄。
应当注意将缺陷(例如位错)限定在层110的邻近于支撑衬底100的界面105的区域。
本发明的这一特殊方面具有优势(与公知技术相比，例如WO02/15244中公开的)。
关于该方面的优点的说明是，上述薄适配层使它能够通过在支撑衬底100中注入，通过使注入物质的横穿适配层而生成脆性区。
在分离和消除支撑衬底100的残留材料(Si或其它)之后，允许最终结构获得非常高质量的表面，而不需要用于处理分离表面的繁重处理，分离表面例如通过在位于适配层自身内的脆性区中分离而获得的一个表面(是具有梯度的适配层本身的情况，适配层太厚而不能通过注入横穿)。
也应当注意由本发明获得的结构是位错型缺陷的实例，甚至在埋入区域中。
接着可以使用最终结构以具有，在SiGe或Ge的层上通过外延生长的补充层，例如应变硅。
在第二层由应变Si形成的情况下，为了在硅衬底上保存由应变硅-SiGe的双层构成的最终结构而仅仅进行单选择性腐蚀是有利的。
在这种情况下，最终结构保持阻挡层。
最后，也能够在将该结构键合到目标衬底阶段之前在第三层上沉积应变硅层，以便最终在硅衬底上制造包括应变硅层的结构。
权利要求
1.一种由半导体材料形成的多层结构的制造工艺，所述结构包括由第一半导体材料构成的衬底(20)和由第二半导体材料构成的表面薄层，两种半导体材料具有完全不同的晶格参数，其特征在于该工艺包括下列步骤在支撑衬底(100)上制造包括表面薄层的层(110)，在由所述支撑衬底和沉积层形成的整体中生成脆性区，将所述的整体与目标衬底(20)键合，在脆性区的层面分离，处理最终结构的表面。
2.如前面权利要求中所述的工艺，特征在于所述的制造层的步骤是通过外延生长进行的。
3.如前面权利要求中所要求的工艺，特征在于使用下面步骤进行所述外延生长将支撑衬底的温度稳定在第一预定稳定温度下，对于包括表面薄层的所述层(110)，在所述的第一预定温度下进行化学汽相沉积，直到在支撑衬底上获得比最终期望的厚度小的预定厚度的Ge的基层，将化学淀积的温度从第一预定温度上升到第二预定温度，以及在第二预定温度下继续进行化学淀积，直到该层获得最终期望的厚度。
4.如前面权利要求中所述的工艺，特征在于第一预定温度是大约400℃至500℃，第二预定温度是大约750℃至850℃。
5.如前面权利要求中所述的工艺，特征在于第一预定温度是大约430℃至460℃，第二预定温度是大约800℃至850℃。
6.如权利要求1所述的工艺，特征在于通过生成应变层并松散该层来制造所述的层。
7.如前面权利要求的任意一个所述的工艺，特征在于通过注入执行脆性区的所述制造。
8.如前面权利要求中所述的工艺，特征在于注入为至少两种物质的共同注入。
9.如两个前述权利要求中的一个所述的工艺，特征在于在制造阶段和键合阶段之间执行所述注入。
10.如前述权利要求所述的工艺，特征在于执行注入以便将脆性区限定在支撑衬底的厚度中。
11.如权利要求9所述的工艺，特征在于执行注入以便将脆性区限定在层(110)的对应于晶格参数适配层生成的区域中。
12.如权利要求9所述的工艺，特征在于执行注入以便将脆性区限定在层(110)的对应于松散层生成的区域中。
13.如前述权利要求的任意一个中所述的工艺，特征在于在键合之前，电绝缘层插在由支撑衬底和沉积层形成的所述整体(10)与目标衬底(20)之间。
14.如前述权利要求所述的工艺，特征在于在键合之前，电绝缘层形成在由支撑衬底和沉积层形成的所述整体(10)的表面上。
15.如两个前述权利要求的任意一个所述的工艺，特征在于在键合之前，电绝缘层形成在目标衬底上。
16.如三个前述权利要求的任意一个所述的工艺，特征在于所述电绝缘层是氧化物层。
17.如前述权利要求的任意一个所述的工艺，特征在于多层结构的衬底(20)由硅形成。
18.如前述权利要求的任意一个所述的工艺，特征在于支撑衬底(100)由硅形成。
19.如前述权利要求的任意一个所述的工艺，特征在于层(110)由SiGe或Ge形成。
20.如前述权利要求的任意一个所述的工艺，特征在于当形成层时，生成对应于在表面处理阶段用于化学腐蚀的阻挡层的层。
21.如前述权利要求所述的工艺，特征在于当形成层时，形成对应于下面层1晶格参数适配层、层2阻挡层、层3待获得结构的有源层的三层。
22.如前述权利要求所述的工艺，特征在于对应于所述三层的层的材料由下面组合之一构成
23.如前述权利要求所述的工艺，特征在于对应于所述三层的层的材料由下面组合之一构成
24.如四个前述权利要求的任意一个所述的工艺，特征在于在最终结构中保留阻挡层。
25.如权利要求19所述的工艺，特征在于当形成层时，形成分别对应于层1晶格参数适配层、层2待获得的结构的有源层的两层。
26.如前述权利要求所述的工艺，特征在于对应于所述三层的层的材料由下面组合之一构成
全文摘要
本发明涉及一种由半导体材料形成的多层结构的制造工艺，所述结构包括由第一半导体材料构成的衬底(20)和由第二半导体材料构成的表面薄层，两种半导体材料具有基本不同的晶格参数，其特征在于该工艺包括下列步骤在支撑衬底(100)上制造包括表面薄层的层(110)，在由所述支撑衬底和所述沉积层形成的整体(10)中生成脆性区，将所述的整体与目标衬底(20)键合，在脆性区的层面分离，处理最终结构的表面。
文档编号H01L21/762GK1720605SQ200380105249
公开日2006年1月11日 申请日期2003年12月5日 优先权日2002年12月6日
发明者C·马聚尔 申请人:S.O.I.Tec绝缘体上硅技术公司