用于形成存储器鳍片图案的方法和系统与流程

本申请要求于2016年1月29日提交的题为“METHOD AND SYSTEM FOR FORMING MEMORY FIN PATTERNS”的美国临时专利申请第62/288,846号的权益，该临时专利申请通过引用整体并入本文。

背景技术：

本公开内容涉及基板处理，并且更具体地，涉及用于使包括图案化半导体晶片的基板图案化的技术。

在光刻工艺中收缩线宽的方法历史上涉及使用更大NA光学器件(数值孔径)、更短曝光波长或除空气之外的界面介质(例如，水浸)。随着常规光刻工艺的分辨率接近理论极限，制造商已开始转向双图案化(DP)方法以克服光学限制。

在材料加工方法(例如，光刻)中，创建图案化层包括向基板的上表面施加辐射敏感材料例如光致抗蚀剂的薄层。该辐射敏感材料被转换成可以用作蚀刻掩模的浮雕(relief)图案，以将图案转移至基板上的下层中。辐射敏感材料的图案化通常涉及使用例如光刻系统通过光化辐射穿过分划板(和相关联的光学器件)曝光至辐射敏感材料上。然后可以在该曝光之后使用显影溶剂去除辐射敏感材料的照射区域(如在正性光致抗蚀剂的情况下)或非照射区域(如在负性抗蚀剂的情况下)。该掩模层可以包括多个子层。

用于将辐射或光图案曝光在基板上的常规光刻技术具有各种挑战，这些挑战限制了所曝光的特征部的尺寸，并限制了所曝光的特征部之间的间距或间隔。减轻曝光限制的一种常规技术是使用双图案化方法以允许以比常规光刻技术当前可用的间距更小的间距来图案化更小的特征部。

技术实现要素：

半导体技术不断发展到包括14纳米、7纳米、5纳米及以下的特征部尺寸的更小的特征部尺寸。制造各种元件的所用的特征部的尺寸的不断减小对用于形成特征部的技术提出了越来越高的要求。“间距”的概念可用于描述这些特征部的尺寸。间距是两个相邻重复特征部中两个相同点之间的距离。半间距则是阵列的相同特征部之间距离的一半。

作为由“间距加倍”等例示的通常有些误差但一般称为“间距倍增”的间距减小技术可以将光刻能力扩展至超出特征部尺寸限制(光学分辨率限制)。也就是说，常规的间距倍增(更准确地，间距减小或间距密度倍增)某个因数涉及将目标间距减小特定因数。与193nm浸没式光刻一起使用的双图案化技术通常被认为是对22nm节点和更小节点进行图案化的最有前途的技术之一。值得注意的是，自对准双图案化(SADP)已经被建立为间距密度加倍工艺，并且已经适用于NAND闪存器件的大批量制造。此外，可以获得超精细分辨率以重复SADP步骤，这得到了四倍间距。

尽管存在用于增加图案密度或间距密度的若干图案化技术，但是常规的图案化技术经受不良分辨率或经蚀刻的特征部的粗糙表面。因此，常规技术不能提供针对非常小尺寸(20nm和更小)所期望的均匀度和保真度水平。可靠的光刻技术可以产生间距为约80nm的特征部。然而，常规和新兴的设计规范期望制造具有小于约20nm或10nm的关键尺寸的特征部。此外，利用间距密度加倍和四倍技术，可以创建亚分辨率线，但是在这些线之间进行切割或连接具有挑战性，尤其是因为这样的切割所需的间距和尺寸远低于常规光刻系统的能力。

本文中公开的技术提供了一种用于间距减小(增加间距/特征部密度)的方法，该方法用于创建高分辨率特征部并且还用于在亚分辨率特征部的间距上进行切割例如以创建例如存储器阵列的结构。本文中的技术包括形成具有不同抗蚀刻性的材料的多线层。可以首先使用蚀刻掩模组合来制作切口，然后创建鳍片、线段或其他结构。在切口和鳍片由多种不同的材料类型限定而非仅由光掩模限定的情况下，切口可以与鳍片自对准以创建与常规的制作鳍片的常规技术相比具有更好的工艺裕度的鳍片阵列或其他结构阵列。

一个实施方式包括用于使基板图案化例如以制造用于存储器阵列的鳍片的方法。在基板上的记忆层上方形成多线层。多线层包括具有三种材料的交替线图案的区域，所述三种材料由于相对于彼此具有不同的抗蚀刻性而彼此化学上不同。所述三种不同的材料包括材料A、材料B和材料C。所述三种材料的交替线图案包括A-B-C-B-A-B-C-B的重复序列，其中，所述材料在平行于基板的工作表面的方向上交替。每条材料线从多线层的顶表面延伸至多线层的底表面。

在多线层上方形成第一蚀刻掩模。第一蚀刻掩模限定显露多线层的第一部分的第一沟槽，使得所限定的第一沟槽与交替线图案中的多条线在高度上交叉。利用第一蚀刻掩模来蚀刻穿过材料A的显露部分和记忆层的位于材料A的显露部分正下方的部分。在多线层上方形成第二蚀刻掩模。第二蚀刻掩模限定显露多线层的第二部分的第二沟槽，使得所限定的第二沟槽与交替线图案中的多条线在高度上交叉。然后利用第二蚀刻掩模来蚀刻穿过材料C的显露部分和记忆层的位于材料C的显露部分正下方的部分。在多线层被显露的同时蚀刻穿过材料B和记忆层的位于材料B正下方的部分。

因此，可以利用自对准且不依赖于准确的光刻对准的切割来创建鳍片。代替依赖于光刻对准，切割布置可以基于沉积的材料厚度和不同的抗蚀刻性。

当然，为了清楚起见，已经呈现了如本文所述的不同步骤的讨论顺序。通常，这些步骤可以以任何合适的顺序进行。另外，尽管本文中的不同特征部、技术、配置等中的每一个可以在本公开的不同位置中讨论，但是旨在每个构思可以彼此独立地执行或者彼此组合地执行。因此，可以以许多不同方式实施和查看本发明。

注意，该发明内容部分未指定本公开或要求保护的发明的每一个实施方式和/或递增的新颖方面。相反，本发明内容仅提供了相对于常规技术的不同实施方式和相应的新颖点的初步讨论。对于本发明和实施方式的其他细节和/或可能的观点，读者可以参考下面进一步讨论的本公开内容的具体实施方式部分和对应的附图。

附图说明

参考结合附图考虑的以下详细描述，对于本发明的各种实施方式及其许多伴随的优点的更完整的理解将变得明显。附图不一定按比例，而是将重点放在示出特征部、原理和构思上。

图1A至图10A是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的截面示意图。

图1B至图10B是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的示意性顶视图。

图3C和图6C是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的截面顶视图。

图10C是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的示例性透视图。

图11A至图20A是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的截面示意图。

图11B至图20B是示出了根据本文中公开的实施方式的工艺流程的示例性基板区段的示意性顶视图。

具体实施方式

本文中公开的技术提供了用于准确地增加特征部密度以创建高分辨率特征部并且还在亚分辨率特征部的间距上进行切割的方法和制造结构。技术包括使用具有不同蚀刻特性的多种材料来选择性地蚀刻特征部并在指定的位置创建切口或块。通常，多线层由提供不同蚀刻特性的三种或更多种不同材料形成。然后可以使用包括交织蚀刻掩模的蚀刻掩模来选择性地蚀刻选定的被曝光材料内的切口。然后可以对各种结构进行切割和形成。可以在记忆层中记录形成结构和切口，记忆层(在部件图案已经被记录的情况下)可以用作用于形成下层中的结构的蚀刻掩模。

存在可以使用本文中的技术形成的各种类型的结构。为了便于描述实施方式，重点将主要在于描述形成存储器鳍片图案或鳍片阵列。例如，本文中的技术可以使得能够创建具有更好的工艺裕度的DRAM(动态随机存取存储器)鳍片图案。在DRAM鳍片图案化中，线切割极具挑战性。例如，随着特征部缩放或尺寸减小的进行，例如通过使用自对准四图案化技术形成芯轴和线来以亚分辨率尺寸形成这样的鳍片图案的线。在常规的鳍片制造流程中，在记忆层例如硬掩模层中形成鳍片或线。然后使用一种或更多种材料来平坦化该硬掩模层，然后通过光刻图案化技术在顶部上形成蚀刻掩模。在对切口的曝光于光掩模的光致抗蚀剂层进行显影之后，得到光致抗蚀剂层看起来像相对小的孔的阵列。这些孔被设计成在亚分辨率形成的线的正上方对准，以随着图案被转移(蚀刻)穿过若干层而在这些线中进行切割，以切割硬掩模层中指定位置处的掩埋线。挑战在于，在叠加(overlay)或光刻未对准的情况下，如果切割落在两个相邻线之间，则线可以仅被部分切割或者根本不被切割，这导致或造成器件故障。对于亚分辨率切割，可能存在两种不同的切割掩模以切割期望位置处的掩埋线。

因此，本文中的实施方式可以用于使基板图案化。这可以包括制作用于转移亚分辨率图案例如鳍片阵列的复合蚀刻掩模。现在参照图1A和图1B，在基板上的记忆层140上方形成多线层150。可以在记忆层140下方设置下层135。注意，该基板堆叠体可以包括附加的中间层或膜以辅助制造。图1A示出了示例性基板区段的侧截面图，而图1B示出了相应基板区段的顶视图。注意，该附图标记重复用于此后的附图，其中，具有字母“A”的图号表示侧视图，而具有字母“B”的图号表示顶视图。多线层150包括具有三种或更多种材料的交替线图案的区域，这些材料通过具有相对于彼此不同的抗蚀刻性而彼此化学上不同。三种不同的材料包括材料A、材料B和材料C。多线层的一条或更多条线可以通过自对准双图案化或自对准四图案化或其他间距倍增技术形成。

三种材料的交替线图案包括A-B-C-B-A-B-C-B的重复序列，其中，各材料在平行于基板的工作表面的方向上交替。换句话说，假设基板的工作表面水平地取向，则三种材料的交替线图案在整个基板上水平地交替。括号151示出了示例性重复序列。在一个实施方式中，重复图案的最短区段是A-B-C-B，该区段然后重复。图1A和图1B示出了每条线或材料类型上方的字母A、B和C。每条材料线从多线层的顶表面延伸至多线层的底表面。换句话说，每条材料线可以从上方对于蚀刻剂是可利用的，并且可以被完全蚀刻穿过多线层150以到达记忆层140和任何中间膜。

如本文所用，具有彼此不同的抗蚀刻性意味着存在相比于其他材料以更大的速率蚀刻给定的一种材料的至少一种蚀刻剂(或蚀刻剂组合)。注意，可以存在以相同速率蚀刻两种或更多种给定材料的特定蚀刻剂，但是存在相对于其他材料更快地蚀刻所包含的材料的至少一种蚀刻剂。相对于另一种材料而蚀刻一种材料可以包括蚀刻一种材料而基本上不蚀刻另一种材料，或者与其他材料相比以基本上更大的速率蚀刻一种材料，例如具有3：1、4：1、10：1等的蚀刻速率比。对于具有不同抗蚀刻性的两种材料，这通常意味着两种材料例如因所包括的特定原子元素而在化学上彼此不同。除了两种材料中的一种包括掺杂剂之外大致相同的两种材料仍然可以具有不同的抗蚀刻性，。此外，具有相同原子元素但具有不同分子或晶体结构的材料也可以提供抗蚀刻性差异。

现在参考图2A和2B，在多线层150上方形成有第一蚀刻掩模161。第一蚀刻掩模限定显露多线层的第一部分的第一沟槽，使得所限定的第一沟槽与交替线图案中的多条线在高度上交叉。换句话说，例如从定向蚀刻或正交于基板的工作表面的角度，由第一蚀刻掩模161限定的沟槽与交替线的下图案交叉。在图2B中，可以看到(在限定的沟槽之间看)线段和重复图案。注意，线的交叉或相交不需要是垂直的，而是也可以以锐角/斜角相交。注意，为了便于说明，第一蚀刻掩模161示出为位于多线层150正上的单层。可以通过常规光刻技术形成第一蚀刻掩模161，常规光刻技术可以包括首先在基板上沉积平坦化层，然后沉积抗反射涂层，然后沉积辐射敏感材料例如光致抗蚀剂的层，然后曝光，并对可溶或已经变成可溶的部分进行显影。在替选实施方式中，可以在沉积平坦化层之前在多线层150上沉积硬掩模层，或者可以在平坦化层上沉积硬掩模层。在一些工艺流程中，可以有益的是使硬掩模层沉积在多线层150上方和第一蚀刻掩模161下方。

现在参考图3A和图3B，执行蚀刻操作：利用第一蚀刻掩模161蚀刻穿过材料A的显露部分，然后蚀刻穿过记忆层140的在材料A的显露部分正下方的显露部分。如果已经在多线层150上沉积硬掩模，则硬掩模与第一蚀刻掩模161对应地被蚀刻穿过。在图3B中，材料A通过沟槽不再可见，而下层135的一部分现在可见。为了更好地理解，图3C示出了如果从记忆层140去除叠加的层则在该过程中的该阶段处记忆层140所看上去的顶视图。

现在参考图4A和图4B，然后使用特定材料填充多线层150和记忆层140中的空间。例如，可以在基板上沉积材料C以填充开口。如图4B所示，这样的填充可以最初导致材料C的覆盖层(overburden)，然后可以再次对基板进行平坦化至多线层150的顶部。在这样的填充之前，可以去除第一蚀刻掩模161和附加层。如果在多线层150的顶部上并入有硬掩模层，则该硬掩模层可以保留在基板上。还要注意，不需要再次平坦化至多线层150的顶表面。相反，一种选择是使用材料C(或其他材料)的填充层作为用于沉积后续蚀刻掩模的平坦化层。

现在参考图5A和图5B，在多线层150上方形成有第二蚀刻掩模162。第二蚀刻掩模限定显露多线层的第二部分的第二沟槽，使得所限定的第二沟槽与交替线图案中的多条线在高度上交叉。在图5B中，在限定的第二沟槽之间，可以看到线段和重复图案。可以通过常规的光刻技术形成第二蚀刻掩模162，常规的光刻技术可以包括首先在基板上沉积平坦化层，然后沉积抗反射涂层，然后沉积光致抗蚀剂层。注意，第二蚀刻掩模162类似于第一蚀刻掩模161，不同之处在于沟槽位置被移位以位于第一蚀刻掩模161的沟槽位置之间。

现在参考图6A和图6B，执行蚀刻操作：利用第二蚀刻掩模162蚀刻穿过材料C的显露部分，然后蚀刻穿过记忆层140的位于材料C的显露部分正下方的显露部分。如果在多线层150上方使用硬掩模层，则硬掩模层与第二蚀刻掩模162对应地被蚀刻穿过。在图6B中，材料C在沟槽之间不再可见，而下层135的一部分现在是可见的。为了更好的可见，图6C示出了如果从记忆层140去除叠加的层则在该过程中的该阶段的记忆层140所看上去的顶视图。

此时，可以去除第二蚀刻掩模162(和相关层)。现在参考图7A和图7B，然后用特定材料填充多线层150和记忆层140中的空间。例如，可以在基板上沉积材料C以填充这些开口。这样的填充可以最初产生材料C的覆盖层。随着基板被再次平坦化至多线层150的顶部，该覆盖层可以被去除，如图7B所示。如果在多线层150的顶部上可选地并入硬掩模层，则在填充空间以及向下平坦化至多线层150的顶表面之前或之后去除该硬掩模层，使得全部材料B(材料B的线)被显露。

现在参考图8A和图8B，执行蚀刻操作：蚀刻穿过材料B的显露部分，然后蚀刻穿过记忆层140的位于材料B的显露部分正下方的显露部分。注意，蚀刻材料B不需要单独的蚀刻掩模。相反，与材料B相比，材料A和材料C(以及用于填充空间的材料)用作对于特定蚀刻剂具有不同抗蚀刻性的蚀刻掩模。在图8B中，材料B不再可见，并且沟槽已被蚀刻到记忆层140中，使得下层135的一部分现在是可见的。

现在参考图9A和图9B，在完成基于蚀刻穿过材料A、材料B和材料C的蚀刻转移之后，可以去除记忆层上方的剩余材料。记忆层产生具有平行线段阵列的浮雕图案。在一些实施方式中，线段阵列的平行线段的间距小于40纳米。例如，相邻的材料B的线之间的间距小于40纳米，相邻的材料A的线和材料C的线之间的间距小于40纳米。如图10A和图10B所示，然后可以将记忆层140(其可以由例如钛氮化物的硬掩模材料构成)用作蚀刻掩模，以将线段图案转移至下层135中以创建鳍片阵列。图10C是示出了具有仍然在基板上的记忆层140的所制造的线段的基板区段的透视图。附加处理可以包括去除记忆层140和/或还可以包括进行阻挡、切割、掺杂等。

注意，在该实施方式中，在创建要被切割的线之前创建切口。例如，蚀刻穿过材料B发生在蚀刻穿过材料A和蚀刻穿过材料C之后。因此，可以在要被切割的记忆层140中创建线之前创建记忆层140中的切口(被去除的材料)。然而，在其他实施方式中，蚀刻穿过材料B可以发生在蚀刻穿过材料A和蚀刻穿过材料C之前。

图11至图20示出了使用用于形成蚀刻掩模的双层芯轴以到达多线层的另一示例性工艺流程。图11A和图11B类似于图1A和图1B，不同之处在于基板区段已旋转90度以更好地描绘多线层150上方的掩模层的截面。

现在参考12A和图12B，形成第一蚀刻掩模161包括形成具有上部材料166和下部材料167的双层芯轴165。与下部材料167相比，上部材料166具有不同的抗蚀刻性。在双层芯轴上形成有侧壁间隔物171。图12A示出了处于形成状态的侧壁间隔物171，而形成可以包括在双层芯轴上方沉积保形膜，然后执行间隔物开口蚀刻以去除双层芯轴上方以及侧壁间隔物171之间的多线层150上方的保形材料。第一蚀刻掩模161包括多个双层芯轴165和侧壁间隔物171，该侧壁间隔物171限定了位于相邻侧壁间隔物的露出侧壁之间的沟槽。

图13A和图13B类似于图3A和图3B。执行蚀刻操作：利用第一蚀刻掩模161蚀刻穿过材料C的显露部分，然后蚀刻穿过记忆层140的位于材料C的显露部分正下方的显露部分。在该蚀刻操作之后，如图14A和图14B所示，在基板上沉积填充层168。这包括填充限定在第一蚀刻掩模的相邻侧壁间隔物之间的的沟槽。填充层168可以是与上部材料166相同的材料。然后对基板向下平坦化至双层芯轴165的下部材料167的上表面。因此，双层芯轴165的下部可以用作例如具有化学机械抛光的平坦化停止材料。在图15A和图15B中示出了这种平坦化步骤的结果。

如图16A所示，在双层芯轴165的下部材料167露出的情况下，双层芯轴165可以被完全去除以产生第二蚀刻掩模162。第二蚀刻掩模限定显露多线层的第二部分的第二沟槽，使得所限定的第二沟槽与交替线图案中的多条线在高度上交叉。执行蚀刻操作：利用第二蚀刻掩模162蚀刻穿过材料A的显露部分，然后蚀刻穿过记忆层140的位于材料A的显露部分正下方的显露部分。在图16A和图16B中示出了这样的蚀刻转移的结果，现在可以从图16B中的顶视图看到下层135。

可以去除第二蚀刻掩模162(和相关联的膜)。现在参考图17A和图17B，可以使用特定材料填充多线层150和记忆层140中的空间。例如，可以在基板上沉积材料C以填充开口。如图17B所示，这样的填充可以最初导致材料C的覆盖层，然后可以再次对基板进行平坦化至多线层150的顶部。如果在多线层150的顶部上并入硬掩模层，则可以在填充空间以及向下平坦化至多线层150的顶表面之前或之后去除该硬掩模层，使得所有材料B(材料B的线)被显露。

现在参考图18A和图18B，执行蚀刻操作：蚀刻穿过材料B的显露部分，然后蚀刻穿过记忆层140的位于材料B的显露部分正下方的显露部分。注意，蚀刻材料B不需要单独的蚀刻掩模。相反，与材料B相比，材料A和材料C以及填料材料用作对于特定蚀刻剂具有不同抗蚀刻性的蚀刻掩模。在图18B中，材料B不再可见，并且沟槽已被蚀刻到记忆层140中，使得下层135的一部分现在是可见的。

现在参考图19A和图19B，在完成基于蚀刻穿过材料A、材料B和材料C的蚀刻转移之后，可以去除记忆层140上方的剩余材料，记忆层产生具有平行线段阵列的浮雕图案。如图20A和图20B所示，然后可以将记忆层140(其可以由硬掩模材料或金属硬掩模材料构成)用作蚀刻掩模，以将线段的图案转移至下层135中以创建鳍片阵列。附加处理可以包括去除记忆层140，还可以包括进行阻挡、切割、掺杂等。

可以用各种技术形成多线层150。一种技术类似于如何形成图15A的第二蚀刻掩模162。例如，形成多线层可以包括使用材料A形成芯轴。芯轴可以是自对准四图案化或其他间距倍增图案化的结果。然后使用材料B在芯轴的侧壁上形成侧壁间隔物。然后使用材料C形成填充结构，其中，填充结构填充相邻间隔物之间的沟槽。因此，创建了不同材料的交替线图案，其中，可以选择性地利用每种材料以相对于其他材料进行蚀刻。

在另一实施方式中，一种使掩模图案化的方法包括在基板上的记忆层上方形成多线层。多线层包括具有三种材料的交替线图案的区域，这三种材料由于相对于彼此具有不同的抗蚀刻性而彼此化学上不同。注意，不要求整个多线层具有交替线图案，而是至少一部分具有即可。交替线包括芯轴、侧壁间隔物和填充结构。三种材料的交替线图案包括交替的芯轴线和填充结构线，其中，侧壁间隔物位于芯轴线与填充结构线之间，每条材料线从多线层的顶表面延伸至多线层的底表面。

在多线层上方形成有第一蚀刻掩模。第一蚀刻掩模限定显露多线层的第一部分的第一沟槽，使得所限定的第一沟槽与交替线图案中的多条线在高度上交叉(相交)。执行蚀刻操作：利用第一蚀刻掩模蚀刻穿过芯轴的显露部分和记忆层的位于芯轴的显露部分正下方的部分。

在多线层上方形成有第二蚀刻掩模。第二蚀刻掩模限定显露多线层的第二部分的第二沟槽，使得所限定的第二沟槽与交替线图案中的多条线在高度上交叉。执行另一蚀刻操作：利用第二蚀刻掩模蚀刻穿过填充结构的显露部分和记忆层的位于填充结构的显露部分正下方的部分。然后使多线层被显露，并且蚀刻掉侧壁间隔物以及记忆层的位于侧壁间隔物正下方的部分，以将该图案转移至记忆层中，从而在记忆层中产生自对准的线段阵列。

在前面的描述中，已经阐述了具体细节，例如处理系统的特定几何形状以及其中所使用的各种部件和过程的描述。然而，应该理解，本文中的技术可以在脱离这些具体细节的其他实施方式中实施，并且这些细节是出于解释而非限制的目的。已经参考附图描述了本文中公开的实施方式。类似地，出于解释的目的，已经阐述了具体的数字、材料和配置以提供透彻的理解。然而，可以在没有这样的具体细节的情况下实践实施方式。具有基本相同的功能构造的部件由相同的附图标记表示，因此可以省略任何多余的描述。

已经将各种技术描述为多个离散操作以帮助理解各种实施方式。描述的顺序不应被解释为暗示这些操作必须依赖于顺序。实际上，这些操作不需要按照呈现的顺序执行。所描述的操作可以以与所描述的实施方式不同的顺序执行。在另外的实施方式中，可以执行各种附加操作和/或可以省略所描述的操作。

本文使用的“基板”或“目标基板”通常是指根据本发明加工的物体。基板可以包括器件特别是半导体器件或其他电子器件的任何材料部分或结构，并且可以是例如基底基板结构例如半导体晶片、分划板、或在基底基板结构上或叠加在基底基板结构上的层例如薄膜。因此，基板不限于任何特定的基底结构、下层或叠加层、图案化或未图案化，而相反，预计包括任何这样的层或基底结构，以及层和/或基底结构的任何组合。该描述可以参考特定类型的基板，但这仅用于说明目的。

本领域技术人员还将理解，在仍可实现本发明的相同目的的情况下可以对上述技术的操作进行许多变化。这样的变化旨在由本公开内容的范围所涵盖。因此，本发明的实施方式的前述描述不旨在是限制性的。相反，对本发明的实施方式的任何限制呈现在所附权利要求中。