一种电极引出结构、阵列基板以及显示装置制造方法
【专利摘要】本发明属于显示【技术领域】，具体涉及一种电极引出结构、阵列基板以及显示装置。一种电极引出结构，包括衬底电极、隔离层和引出电极，所述隔离层位于所述衬底电极上方，所述引出电极位于所述隔离层上方，所述隔离层中开设有隔离层过孔或者所述隔离层部分覆盖所述衬底电极，所述引出电极覆盖所述隔离层过孔的孔壁和孔底，并沿所述隔离层过孔的上缘向远离所述隔离层过孔的方向与所述隔离层交叠。本发明的阵列基板由于采用了具有交叠结构的电极结构，使得水和氧的浓度梯度由外向内逐渐变小，可以有效地阻止外界的H2O和O2对金属氧化物的影响，使得采用金属氧化物半导体形成有源层的TFT的性能更稳定、信赖性更高，也同时增加了阵列基板的稳定性。
【专利说明】—种电极引出结构、阵列基板以及显示装置
【技术领域】
[0001]本发明属于显示【技术领域】，具体涉及一种电极引出结构、阵列基板以及显示装置。【背景技术】
[0002]随着科学技术的发展，平板显示装置已日益深入人们的日常生活中。目前，常用的平板显示装置包括IXD (Liquid Crystal Display:液晶显示装置)和OLED (OrganicLight-Emitting Diode:有机发光二极管)显示装置。尤其是IXD平板显示装置，由于其具有体积小、重量轻、厚度薄、功耗低、无辐射等特点，近年来得到了迅速地发展，在当前的平板显示装置市场中占据了主导地位。
[0003]其中，IXD和OLED显示装置中均设置有薄膜晶体管(Thin Film Transistor，简称TFT), TFT作为驱动元件，在IXD和OLED显示装置中发挥着至关重要的作用。近年来平板显示技术获得了飞速的发展，其尺寸和分辨率不断地提高，大尺寸、高分辨率的显示装置成为主流方向。为了适应不断增大的尺寸和不断提高的分辨率，必须采用更高频率的驱动电路，以避免控制信号和图像信号的延迟。目前，信号延迟已成为制约大尺寸、高分辨率平板显示效果的关键因素之一。
[0004]为提高驱动电路的频率，针对制备TFT的材料做了多次改进。经研究发现，现有最常采用的非晶硅制备形成的薄膜晶体管的迁移率已经很难满足驱动需求，例如:非晶硅薄膜晶体管的迁移率一般为0.5cm2/v.s左右，而尺寸超过80英寸、驱动频率为120Hz的IXD，需要lcm2/v.s以上的迁移率。而对于多晶硅薄膜晶体管，尽管研究比较早，但是多晶硅薄膜晶体管的均一性差，制作工艺复杂。相比之下，金属氧化物半导体是新兴的TFT制备材料，金属氧化物TFT迁移率高、均一性好、制作工艺简单、成本低、适合大面积成膜，非常适合大尺寸平板显示技术，可以更好地满足IXD和OLED显示装置大尺寸、高刷新频率的需求。
[0005]目前研究最多的金属氧化物半导体是铟镓锌氧化物(IGZ0)半导体，IGZO一般为非晶结构，很容易被酸溶液刻蚀掉。而在TFT结构中，一般采用Mo、Al等金属形成电极，在电极制备过程中，使用酸溶液进行刻蚀以形成相应的层结构图形。因而，电极形成过程中不可避免地会对金属氧化物半导体造成腐蚀，因此需要在金属半导体层与电极之间增加刻蚀阻挡层来保护金属氧化物半导体不被形成电极图形的刻蚀液腐蚀。
[0006]而且，金属氧化物半导体对外界的水和氧(H2O和O2)非常敏感，外界的水和氧扩散到金属氧化物半导体TFT中，将使得TFT的电学性能发生改变，直接影响金属氧化物半导体的稳定性和信赖性，导致TFT的性能急剧恶化，影响到显示装置的显示效果。
[0007]目前，形成有TFT矩阵的阵列基板(Array)中，为保证TFT沟道的正常形成，需在刻蚀阻挡层中开设过孔使得电极与金属氧化物半导体接触，过孔的开设，使得水和氧有可能沿着过孔孔间隙渗入TFT内部对金属氧化物半导体造成影响；同时，为便于显示信号的接入和测试信号的接入，还在非显示区设置有源极数据信号接入端(如图1所示)和源极连接板SD PAD (作为源极数据信号与源极驱动电路之间的桥接，如图2所示)、栅极扫描信号接入端(如图3所示)和栅极连接板Gate PAD (作为栅极扫描信号与栅极驱动电路之间的桥接，如图4所示)。在上述信号接入端和PAD结构中，均包括底部的电极和设置于电极上方的绝缘层，电极仅简单的引出到绝缘层的表面，由于电极在通过绝缘层中的过孔进行电连接时，仍有部分面积裸露在空气中，外界的水和氧容易通过孔间隙渗入到TFT的内部，扩散到金属氧化物半导体层，对金属氧化物半导体TFT的稳定性造成影响。
【发明内容】
[0008]本发明所要解决的技术问题是针对现有技术中存在的上述步骤，提供一种电极引出结构、阵列基板以及显示装置，该电极引出结构采用了交叠结构，对处于隔离层下方的结构层起到良好的保持密封的作用。
[0009]解决本发明技术问题所采用的技术方案是该电极引出结构，包括衬底电极、隔离层和引出电极，所述隔离层位于所述衬底电极上方，所述弓I出电极位于所述隔离层上方，所述隔离层中开设有隔离层过孔或者所述隔离层部分覆盖所述衬底电极，其中:所述引出电极覆盖所述隔离层过孔的孔壁和孔底，并沿所述隔离层过孔的上缘向远离所述隔离层过孔的方向与所述隔离层交叠；或者，所述引出电极覆盖所述隔离层的层壁，并沿所述隔离层层壁上缘向远离所述层壁的方向与所述隔离层的表面交叠，以及沿所述隔离层层壁下缘向远离所述层壁的方向与未被所述隔离层覆盖的所述衬底电极交叠。
[0010]优选的是，所述引出电极沿所述隔离层过孔的上缘向远离所述隔离层过孔的方向与所述隔离层交叠的半径范围为0.2-200 Pm;或者，所述引出电极沿所述隔离层层壁上缘向远离所述层壁的方向与所述隔离层的表面交叠的半径范围为0.2-200 u m0
[0011]一种阵列基板，包括基板以及设置于所述基板上的电极引出结构，所述阵列基板包括显示区和非显示区，所述电极引出结构采用上述的电极引出结构，所述电极引出结构设置于所述阵列基板的显示区和/或非显示区。
[0012]一种优选方案是，所述显示区内设置有多个像素单元，所述像素单元包括栅极、栅绝缘层、有源层、刻蚀阻挡层、源极和漏极，所述衬底电极包括所述有源层，所述引出电极包括所述源极与所述漏极，所述隔离层包括所述刻蚀阻挡层，所述刻蚀阻挡层中开设有第一刻蚀阻挡层过孔和第二刻蚀阻挡层过孔，所述源极覆盖所述第一刻蚀阻挡层过孔的孔壁和孔底并与所述有源层接触，所述漏极覆盖所述第二刻蚀阻挡层过孔的孔壁和孔底并与所述有源层接触；同时，所述源极沿所述第一刻蚀阻挡层过孔的上缘向远离所述第一刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠，和/或，所述漏极沿所述第二刻蚀阻挡层过孔的上缘向远离所述第二刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠。
[0013]优选的是，所述源极沿所述第一刻蚀阻挡层过孔的上缘向远离所述第一刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠的半径范围为0.2-Siim ;和/或，所述漏极沿所述第二刻蚀阻挡层过孔的上缘向远离所述第二刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠的半径范围为0.2-8 u m。
[0014]优选的是，所述像素单元还包括设置于所述源极和所述漏极上方的钝化层和像素电极，所述引出电极还包括像素电极，所述隔离层还包括钝化层，所述钝化层在对应着所述漏极的区域开设有钝化层过孔，所述像素电极覆盖所述钝化层过孔的孔壁和孔底并与所述漏极接触，所述像素电极沿所述钝化层过孔的上缘向远离所述钝化层过孔的方向与所述钝
化层交叠。[0015]优选的是，所述像素电极沿所述钝化层过孔的上缘向远离所述钝化层过孔的方向与所述钝化层交叠的半径范围为2-200 u m。
[0016]一种优选方案是，所述非显示区设置有电极连接板，所述电极连接板包括走线电极以及设置于所述走线电极上方的电极保护层和信号引出电极，所述衬底电极包括所述走线电极，所述引出电极包括所述信号引出电极，所述隔离层包括所述电极保护层，所述电极保护层部分覆盖所述走线电极，所述信号引出电极包覆所述电极保护层的层壁，并沿所述电极保护层层壁的上缘向远离所述层壁的方向与所述电极保护层的表面交叠，以及沿所述电极保护层层壁的下缘向远离所述层壁的方向与未被所述电极保护层覆盖的所述走线电极交叠；或者，所述电极保护层完全覆盖所述走线电极，所述电极保护层中开设有电极保护层过孔，所述信号引出电极覆盖所述电极保护层过孔的孔壁和孔底且与所述走线电极接触，并沿所述电极保护层过孔的上缘向远离所述电极保护层过孔的方向与所述电极保护层交叠。
[0017]优选的是，所述信号引出电极沿所述电极保护层层壁的上缘向远离所述层壁的方向与所述电极保护层的表面交叠，以及沿所述电极保护层层壁的下缘向远离所述层壁的方向与未被所述电极保护层覆盖的走线电极交叠的半径范围为2-200i!m;或者，所述信号引出电极沿所述电极保护层过孔的上缘向远离所述电极保护层过孔的方向与所述电极保护层交叠的半径范围为2-200 u m。
[0018]优选的是，所述走线电极与所述漏极采用相同的材料、且在同一构图工艺中形成，所述信号引出电极与所述像素电极采用相同的材料、且在同一构图工艺中形成；所述电极保护层与所述钝化层采用相同的材料、且在同一构图工艺中形成。
[0019]优选的是，所述电极保护层包括第一电极保护层和第二电极保护层，所述信号引出电极包括第一信号引出电极和第二信号引出电极，所述第一电极保护层部分覆盖所述走线电极，所述第一信号引出电极设置于所述第一电极保护层的上方并包覆所述第一电极保护层的层壁，并沿所述第一电极保护层层壁的上缘向远离所述层壁的方向与所述第一电极保护层的表面交叠，以及沿所述第一电极保护层层壁的下缘向远离所述层壁的方向与未被所述第一电极保护层覆盖的走线电极交叠；同时，所述第二信号引出电极设置于所述第二电极保护层的上方并包覆所述第二电极保护层的层壁，并沿所述第二电极保护层层壁的上缘向远离所述层壁的方向与所述第二电极保护层的表面交叠，以及沿所述第一电极保护层层壁的下缘向远离所述层壁与未被所述第二电极保护层覆盖的所述第一信号引出电极交叠；或者，所述第一电极保护层完全覆盖所述走线电极，所述第一电极保护层中开设有第一电极保护层过孔，所述第一信号引出电极覆盖所述第一电极保护层过孔的孔壁和孔底并沿所述第一电极保护层过孔的上缘向远离所述第一电极保护层过孔的方向与所述第一电极保护层交叠；所述第二电极保护层完全覆盖所述第一信号引出电极，所述第二电极保护层中开设有第二电极保护层过孔，所述第二信号引出电极覆盖所述第二电极保护层过孔的孔壁和孔底并沿所述第二电极保护层过孔的上缘向远离所述第二电极保护层过孔的方向与所述第二电极保护层交叠，所述第二信号引出电极与所述第一引出电极接触。
[0020]优选的是，所述第一信号引出电极沿所述第一电极保护层层壁的上缘向远离所述层壁的方向与所述第一电极保护层的表面交叠的半径范围，以及沿所述第一电极保护层层壁的下缘向远离所述层壁的方向与未被所述第一电极保护层覆盖的走线电极交叠的半径范围均为2-200 ym;所述第二信号引出电极沿所述第二电极保护层层壁的上缘向远离所述层壁的方向与所述第二电极保护层的表面交叠的半径范围，以及沿所述第二电极保护层层壁的下缘向远离所述层壁的方向与未被所述第二电极保护层覆盖的所述第一信号引出电极交叠的半径范围均为2-200 y m ;或者，所述第一信号引出电极沿所述第一电极保护层过孔的上缘向远离所述第一电极保护层过孔的方向与所述第一电极保护层交叠的半径范围为2-200 ym;所述第二信号引出电极沿所述第二电极保护层过孔的上缘向远离所述第二电极保护层过孔的方向与所述第二电极保护层交叠的半径范围为2-200 iim。
[0021]优选的是，所述走线电极与所述栅极采用相同的材料、且在同一构图工艺中形成，所述第一信号引出电极与所述漏极采用相同的材料、且在同一构图工艺中形成；所述第二信号引出电极与所述像素电极采用相同的材料、且在同一构图工艺中形成；所述第一电极保护层与所述栅绝缘层采用相同的材料、且在同一构图工艺中形成；所述第二电极保护层与所述钝化层采用相同的材料、且在同一构图工艺中形成。
[0022]其中，所述有源层采用金属氧化物半导体材料形成；所述栅绝缘层、所述刻蚀阻挡层或所述钝化层为一层或多层结构，且采用富硅材料形成，所述富硅材料包括氧化硅、氮化硅或氮氧化硅。
[0023]一种显示装置，包括上述的阵列基板。
[0024]本发明的有益效果是:本发明的阵列基板由于采用了具有交叠结构的电极引出结构，该交叠结构使得水和氧的浓度梯度由外向内逐渐变小，可以有效地阻止外界的水和氧渗入阵列基板内部对金属氧化物产生影响，使得采用金属氧化物半导体形成有源层的TFT(Oxide TFT)的性能更稳定、信赖性更高，也同时增加了阵列基板的稳定性。尤其适合使用于大尺寸、高分辨率液晶显示装置和AM-OLED显示装置中。同时，也使得采用了该阵列基板的显示装置的性能更稳定性，显示效果更好。
【专利附图】
【附图说明】
[0025]图1为现有技术非显示区SD区域过孔搭接的剖视图；
[0026]图2为现有技术非显示区SD PAD区域的剖视图；
[0027]图3为现有技术非显示区Gate区域过孔搭接的剖视图；
[0028]图4为现有技术非显示区Gate PAD区域的剖视图；
[0029]图5为本发明实施例2中阵列基板显示区的剖视图；
[0030]图6为本发明实施例3中阵列基板显示区的剖视图；
[0031]图7为本发明实施例4中阵列基板非显示区SD区域过孔搭接的剖视图；
[0032]图8A和图8B为本发明实施例4中阵列基板非显示区SD PAD区域的剖视图；
[0033]图9A和图9B为本发明实施例5中阵列基板非显示区Gate区域过孔搭接的剖视图；
[0034]图10为本发明实施例5中阵列基板非显示区Gate PAD区域后的剖视图；
[0035]图中:1 一基板；2 —栅极；3 —栅绝缘层；4 一有源层；5 —刻蚀阻挡层；51_第一刻蚀阻挡层过孔；52_第二刻蚀阻挡层过孔；6 —源极；7 —漏极；8 —钝化层；81 —钝化层过孔；9 一像素电极；10-保护层；11_公共电极；15-走线电极；16_电极保护层；160-电极保护层过孔；161_第一电极保护层；1610_第一电极保护层过孔；162_第二电极保护层；1620-第二电极保护层过孔；17_信号引出电极；171-第一信号引出电极；172_第二信号引出电极。
【具体实施方式】
[0036]为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和【具体实施方式】对本发明电极引出结构、阵列基板以及显示装置作进一步详细描述。
[0037]本发明中，光刻工艺，是指包括曝光、显影、刻蚀等工艺过程的利用光刻胶、掩模板、曝光机等进行刻蚀形成图形的工艺；构图工艺，包括光刻工艺，还包括打印、喷墨等其他用于形成预定图形的工艺。
[0038]实施例1:
[0039]一种电极引出结构，包括衬底电极、隔离层和引出电极，隔离层位于衬底电极上方，引出电极位于隔离层上方，隔离层中开设有隔离层过孔或者隔离层部分覆盖衬底电极，其中，引出电极覆盖隔离层过孔的孔壁和孔底，并沿隔离层过孔的上缘向远离隔离层过孔的方向与隔离层交叠；或者，引出电极覆盖隔离层的层壁，并沿隔离层层壁上缘向远离层壁的方向与隔离层的表面交叠，以及沿隔离层层壁下缘向远离层壁的方向与未被隔离层覆盖的衬底电极交叠。也即，引出电极与隔离层为交叠结构。[0040]根据应用场合的不同，衬底电极可以为采用金属材料形成的栅极、源极或漏极，还可以为采用金属氧化物半导体材料形成的有源层，还可以进一步为引入扫描信号或引入数据信号的走线电极；引出电极可以为采用金属材料形成的栅极、源极或漏极，还可以为采用金属氧化物形成的像素电极，还可以进一步为引出扫描信号或引出数据信号的引出电极；隔离层可以为刻蚀阻挡层、钝化层或保护层。在电极引出电极的制备工艺中，可以灵活应用于对水和氧有隔绝需求的层间，这里不做限定。
[0041]其中，引出电极沿隔离层过孔的上缘向远离隔离层过孔的方向与隔离层交叠的半径范围为0.2-200 ym;或者，引出电极沿隔离层层壁上缘向远离层壁的方向与隔离层的表面交叠的半径范围为0.2-200i!m。这里，由于过孔通常为圆形，半径范围可以理解为引出电极与隔离层过孔的边缘至交叠面积的边缘的距离；或者，交叠面积通常为圆形，半径范围可以理解为隔离层层壁上缘至交叠面积的边缘的距离。
[0042]在本实施例中，采用交叠结构的电极引出结构，可以利用处于上方的引出电极与隔离层的交叠结构，对隔离层过孔区域的孔间隙形成良好的阻隔作用，从而对处于隔离层下方的结构层起到良好的保持密封的作用，避免由于在隔离层中形成接触过孔而造成的水和氧渗入其内部结构的缺陷。
[0043]实施例2:
[0044]本实施例提供一种阵列基板，该阵列基板包括基板以及设置于基板上的实施例1所示例的电极引出结构。
[0045]一般的，阵列基板包括显示区和非显示区，本实施例所示例的电极引出电极设置在显示区中。显示区内设置有多个像素单元，如图5所示，像素单元包括设置于基板I上方的栅极2、栅绝缘层3、有源层4、刻蚀阻挡层5、源极6和漏极7。其中，有源层4采用金属氧化物半导体材料形成。
[0046]根据上述的电极引出结构，衬底电极包括有源层4，引出电极包括源极6与漏极7，隔离层包括刻蚀阻挡层5，刻蚀阻挡层5中开设有第一刻蚀阻挡层过孔51和第二刻蚀阻挡层过孔52 (图5所示的第一刻蚀阻挡层过孔51填充有源极6、第二刻蚀阻挡层过孔52中填充有漏极7，以下各过孔与此类同)，源极6覆盖第一刻蚀阻挡层过孔51的孔壁和孔底并与有源层4接触，漏极7覆盖第二刻蚀阻挡层过孔52的孔壁和孔底并与有源层4接触；同时，源极6沿第一刻蚀阻挡层过孔51的上缘向远离第一刻蚀阻挡层过孔51的方向与刻蚀阻挡层5交叠，和/或，漏极7沿第二刻蚀阻挡层过孔52的上缘向远离第二刻蚀阻挡层过孔52的方向与刻蚀阻挡层5交叠。S卩，源极6和漏极7与有源层4接触方式，可以将源极6和漏极7均采用上述的电极引出结构，也可以仅将源极6和漏极7任一个采用上述的电极引出结构。
[0047]其中，源极6沿第一刻蚀阻挡层过孔51的上缘向远离第一刻蚀阻挡层过孔51的方向与刻蚀阻挡层5交叠的半径范围为0.2-8 u m ;和/或，漏极7沿第二刻蚀阻挡层过孔52的上缘向远离第二刻蚀阻挡层过孔52的方向与刻蚀阻挡层5交叠的半径范围为0.2-8 ym。当然，根据TFT的结构，上述交叠的半径范围可以仅适用源极6和漏极7相邻的单边，而源极6和漏极7的另一边可按现有的源极6和漏极7图形进行设计。
[0048]在本实施例中，像素单元还包括设置于源极6和漏极7上方的钝化层8和像素电极9，引出电极还包括像素电极9，隔离层还包括钝化层8，钝化层8在对应着漏极7的区域开设有钝化层过孔81，像素电极9覆盖钝化层过孔81的孔壁和孔底并与漏极7接触，像素电极9沿钝化层过孔81的上缘向远离钝化层过孔81的方向与钝化层8交叠。
[0049]其中，像素电极9沿钝化层过孔81的上缘向远离钝化层过孔81的方向与钝化层8交叠的半径范围为2-200 u m。
[0050]同样，钝化层8为一层或多层结构，采用富硅材料形成，富硅材料包括氧化硅、氮化硅或氮氧化硅。其中，氧化硅、氮化硅或氮氧化硅与N2O, SiH4; N2O, SiH4, NH3, N2; SiH4, NH3, N2或SiH2Cl2, NH3, N2反应形成，其中，N2O与SiH4的气体反应比范围为100:1-50:1。
[0051]采用上述的交叠结构的电极引出结构以及交叠半径范围，既能有效地阻隔水和氧的渗入，又不会对TFT的结构造成较大的影响；在制备方法中，不需对制备方法进行改动，而仅需对形成源极6、漏极7和像素电极9的掩模板的曝光尺寸进行相应的修改即可。
[0052]相应的，本实施例中阵列基板的制备方法具体包括如下步骤:
[0053]步骤1、首先在透明的基板或者石英上，采用溅射或热蒸发的方法依次沉积厚度范围为2 000-5 OOOA的栅金属膜，通过一次构图工艺形成包括栅极2和栅线(图5中未示出)的图形。栅极2可以采用Cr、W、T1、Ta、Mo等金属和合金形成，可以为单层也可以为多层结构。
[0054]步骤2、在完成步骤I的基板上通过PECVD方法连续沉积厚度范围为
2000-5000 A的栅绝缘层膜以形成栅绝缘层3，栅绝缘层膜可以为一层或多层结构，
采用富硅材料形成，富硅材料包括氧化硅、氮化硅或氮氧化硅。具体的，栅绝缘层3可以为氧化硅的单层结构，或者氮化硅与氧化硅的复合结构，或者氮化硅/氮氧化硅/氧化硅的三层结构。氧化硅、氮氧化硅、氮化硅对应的反应气体可以为N2O, SiH4;N2O, SiH4, NH3,N2; SiH4, NH3, N2或SiH2Cl2, NH3, N2。本实施例所采用的氧化硅薄膜为富硅结构，含有较多的Si的悬挂键，主要通过调整气体的反应比形成，富硅结构的氧化硅N2O与SiH4的比例大于50:1，同时考虑到氧化硅薄膜的性能，其比例小于100:1，即N2O与SiH4的气体反应比范围为 100:1-50:1。
[0055]然后，通过溅射方法连续沉积厚度范围为50-1 000 A金属氧化物半导体层，金属氧化物半导体可以是IGZO、非晶IGZO、HIZO、IZO、a-1nZnO、非晶a-1nZnO、ZnO:F、In2O3:Sn> In2O3:Mo> Cd2SnO4> ZnO:Al> TiO2:Nb> Cd-Sn-O 或其他金属氧化物。通过一次构图工艺形成包括有源层4的图形。
[0056]步骤3、在完成步骤2的基板上通过PECVD方法沉积厚度范围为500-3000 A的
刻蚀阻挡层膜以形成钝化层8，刻蚀阻挡层膜可以为一层或多层结构，采用富硅材料形成，富硅材料包括氧化硅、氮化硅或氮氧化硅。具体的，刻蚀阻挡层膜可以为氧化硅的单层结构，或者氮化硅与氧化硅的复合结构，或者氮化硅/氮氧化硅/氧化硅的三层结构。氧化硅、氮氧化硅、氮化硅对应的反应气体可以为N2O, SiH4; N2O, SiH4, NH3, N2; SiH4, NH3, N2或SiH2Cl2,NH3jN20本实施例所采用的氧化硅薄膜为富硅结构，含有较多的Si的悬挂键，主要通过调整气体的反应比形成，富硅结构的氧化硅N2O与SiH4的比例大于50:1，同时考虑到氧化硅薄膜的性能，其比例小于100:1,即N2O与SiH4的气体反应比范围为100:1-50:1。通过一次构图工艺形成包括刻蚀阻挡层5以及刻蚀阻挡层过孔的图形，刻蚀阻挡层过孔包括第一刻蚀阻挡层过孔51 (用于使有源层4与源极6连接)和第二刻蚀阻挡层过孔52 (用于使有源层4与漏极7连接)。
[0057]当然，刻蚀阻挡层5可以采用Al2O3形成的单层结构，也可以采用Si0x/SiN0或者SiOJSiNx或者Al203/SiNx的双层的复合结构。
[0058]步骤4、在完成步骤3的基板上通过溅射或热蒸发沉积源漏金属层，源漏金属层可以选用Cr、W、T1、Ta、Mo等金属或合金,可以为单层或多层结构。通过一次构图工艺形成包括源极6、漏极7以及数据线(图5中未示出)的图形。
[0059]步骤5、在完成步骤4的玻璃基板上通过PECVD方法沉积厚度范围为
2000-10000 A的钝化膜，钝化膜可以为一层或多层结构，采用富硅材料形成，富硅材料
包括氧化硅、氮化硅或氮氧化硅。具体的，钝化膜可以为氧化硅的单层结构，或者氮化硅与氧化硅的复合结构，或者氮化硅/氮氧化硅/氧化硅的三层结构。氧化硅、氮氧化硅、氮化硅对应的反应气体可以为 N2O, SiH4; N2O, SiH4, NH3, N2; SiH4, NH3, N2 或 SiH2Cl2, NH3, N20 本实施例所采用的氧化硅薄膜为富硅结构，含有较多的Si的悬挂键，主要通过调整气体的反应比形成，富硅结构的氧化硅N2O与SiH4的比例大于50:1，同时考虑到氧化硅薄膜的性能，其比例小于100:1，即N2O与SiH4的气体反应比范围为100:1-50:1。通过一次构图工艺形成包括钝化层8以及钝化层过孔81的图形。
[0060]步骤6、在完成步骤5的基板上通过溅射或热蒸发的方法沉积厚度范围为300-1500 A的透明导电层，透明导电层可以为ITO或者IZ0，或者其他的透明金属氧化
物。通过一次构图工艺形成包括像素电极9的图形，本实施例中的像素电极9为板状。
[0061]本实施例的阵列基板适用于TN (Twisted Nematic,扭曲向列)模式、VA (VerticalAlignment，垂直取向)模式的液晶显示装置。或者，将像素电极9作为OLED的阳极或阴极，从而形成OLED显示装置。
[0062]本实施例的阵列基板中，可以采用多个实施例1的电极引出结构，逐层阻挡水和氧的渗入，从而能够对形成有源层4的金属氧化物半导体起到良好的保持密封的作用，保证TFT的稳定性。
[0063]实施例3:
[0064]本实施例提供一种阵列基板，该阵列基板在实施例1的基板上，还包括设置于基板上的公共电极。
[0065]如图6所示，本实施例中的阵列基板在像素电极9的上方还设置有保护层10，在保护层10的上方设置有公共电极11。公共电极11为狭缝状，在正投影方向上与像素电极9至少部分重叠。
[0066]其中，保护层10—般采用透明材料(硅氧化物、硅氮化物、铪氧化物、硅氮氧化物或铝氧化物)形成，公共电极11 一般采用透明的ITO或者IZ0，或者其他的透明金属氧化物形成。形成公共电极11时，通过溅射或热蒸发的方法沉积厚度范围为I UU-2 000 A透明导电层，然后通过一次构图工艺形成包括公共电极11的图形。
[0067]本实施例中的阵列基板适用于ADS模式的液晶显示装置。其中，ADS为平面电场宽视角核心技术-高级超维场转换技术(Advanced Super Dimension Switch,简称ADSDS或ADS)，其核心技术特性描述为:通过同一平面内狭缝电极边缘所产生的电场以及狭缝电极层与板状电极层间产生的电场形成多维电场，使液晶盒内狭缝电极间、电极正上方所有取向液晶分子都能够产生旋转，从而提高了液晶工作效率并增大了透光效率。高级超维场转换技术可以提高TFT-1XD产品的画面品质，具有高分辨率、高透过率、低功耗、宽视角、高开口率、低色差、无挤压水波纹(push Mura)等优点。针对不同应用，ADS技术的改进技术有高透过率1-ADS技术、高开口率H-ADS和高分辨率S-ADS技术等。
[0068]实施例4:
[0069]本实施例提供的阵列基板，在显示区可以采用实施例2或实施例3中的电极引出结构，在非显示区还可以同时包括实施例1所示例的电极引出结构，该电极引出结构为源极连接板SD PAD或SD区域过孔搭接。
[0070]如图7、图8A和图8B所示，阵列基板非显示区设置有电极连接板，电极连接板包括设置于基板I上方的走线电极15以及设置于走线电极15上方的电极保护层16和信号引出电极17。根据实施例1所示例的电极引出电极的结构，衬底电极包括走线电极15，引出电极包括信号引出电极17，隔离层包括电极保护层16。
[0071]如图7所示，电极保护层16完全覆盖走线电极15，电极保护层16中开设有电极保护层过孔160，信号引出电极17覆盖电极保护层过孔160的孔壁和孔底且与走线电极15接触，并沿电极保护层过孔160的上缘向远离电极保护层过孔160的方向与电极保护层16交叠。其中，信号引出电极17沿电极保护层过孔160的上缘向远离电极保护层过孔160的方向与电极保护层16交叠的半径范围为2-200 ym。这里，“完全覆盖”即指电极保护层16覆盖除电极保护层过孔160之外的走线电极15的全部裸露区域。
[0072]图7所示的电极连接板的结构即通称的SD区域过孔搭接，相比图2，该SD区域过孔搭接具有更好的阻挡水和氧的渗入的作用，从而，从非显示区就杜绝了水和氧从孔间隙渗入的可能，进一步提闻了阵列基板中TFT的稳定性。
[0073]当然，也可以如图8A和图8B所示，电极保护层16部分覆盖走线电极15，信号引出电极17包覆电极保护层16的层壁，并沿电极保护层层壁的上缘向远离层壁的方向与电极保护层16的表面交叠，以及沿电极保护层层壁的下缘向远离层壁的方向与未被电极保护层16覆盖的走线电极15交叠。其中，图8A所示的交叠结构未延伸到走线电极15的边缘，而图8B所示的交叠结构延伸到走线电极15的边缘。其中，信号引出电极17沿电极保护层层壁的上缘向远离层壁的方向与电极保护层16的表面交叠，以及沿电极保护层层壁的下缘向远离层壁的方向与未被电极保护层16覆盖的走线电极15交叠的半径范围为2-200 iim。
[0074]图8A和图8B所示的电极连接板的结构即通称的源极连接板SD PAD，相比图3，图8A和图SB任一种SD PAD结构具有更好的阻挡水和氧的渗入的作用，从而，从非显示区就杜绝了水和氧从孔间隙渗入的可能，进一步提高了阵列基板的显示区中TFT的稳定性。
[0075]在本实施例中，走线电极15与显示区中的漏极7采用相同的材料、且在同一构图工艺中形成，信号引出电极17与像素电极9采用相同的材料、且在同一构图工艺中形成；电极保护层16与钝化层8采用相同的材料、且在同一构图工艺中形成。因为透明的像素电极9 一般比较薄，其厚度范围一般为300-1 000A，与电极连接板之间不会因形成断差而造成新的不良出现。
[0076]在阵列基板的制备过程中，形成图7所示的电极连接板的结构即通称的SD区域过孔搭接时:在形成漏极7的同时在非显示区采用相同的材料、且在同一构图工艺中形成走线电极15，在形成钝化层8时将其延伸至非显示区形成电极保护层16，电极保护层16在对应着走线电极15的上方形成电极保护层过孔160 ;然后，在形成像素电极9的同时在非显示区形成搭接电极保护层过孔160的透明的信号引出电极17，该信号引出电极17与电极保护层16有一定的交叠半径,例如2 u m-200 u m (单边)。
[0077]根据上述的SD区域过孔搭接的形成过程，以及现有的构图工艺知识，可推知图8A和图8B所示的SD PAD的制备，区别在于该SD PAD为了配合外接电路的连接，设计为单边交叠(可视为半径无穷大的过孔，或者相当于单边的过孔)，且根据电路设计要求使其位于SD PAD区域。
[0078]在本实施例中，通过改进非显示区SD区域过孔搭接部分和SD PAD区域的结构，可以有效地解决外界的水和氧对金属氧化物半导体TFT的影响。
[0079]实施例5:
[0080]本实施例提供的阵列基板，在显示区可以采用实施例2或实施例3中的电极引出结构，在非显示区还可以同时包括实施例1所示例的电极引出结构，该电极引出结构为栅极连接板Gate PAD或Gate区域过孔搭接部分。
[0081]如图9A和图9B所示，阵列基板非显示区设置有电极连接板，电极连接板包括设置于基板I上方的走线电极15以及设置于走线电极15上方的第一电极保护层161和第二电极保护层162、第一信号引出电极171和第二信号引出电极172。根据实施例1所不例的电极引出结构，引出电极还包括第一信号引出电极171和第二信号引出电极172，隔离层还包括第一电极保护层161和第二电极保护层162。
[0082]如图9A所示，第一电极保护层161完全覆盖走线电极15，第一电极保护层161中开设有第一电极保护层过孔1610，第一信号引出电极171覆盖第一电极保护层过孔1610的孔壁和孔底并沿第一电极保护层过孔1610的上缘向远离第一电极保护层过孔的方向与第一电极保护层161交叠；第二电极保护层162完全覆盖第一信号引出电极171,第二电极保护层162中开设有第二电极保护层过孔1620，第二信号引出电极172覆盖第二电极保护层过孔1620的孔壁和孔底并沿第二电极保护层过孔1620的上缘向远离第二电极保护层过孔的方向与第二电极保护层162交叠，第二信号引出电极172与第一引出电极171接触。这里，“完全覆盖”即指第一电极保护层161覆盖除第一电极保护层过孔1610之外的走线电极15的全部裸露区域，第二电极保护层162覆盖除第二电极保护层过孔1620之外的第一信号引出电极171的全部裸露区域。
[0083]其中，第一信号引出电极171沿第一电极保护层过孔1610的上缘向远离第一电极保护层过孔1610的方向与第一电极保护层161交叠的半径范围为2-200 ii m ;第二信号引出电172极沿第二电极保护层过孔1620的上缘向远离第二电极保护层过孔1620的方向与第二电极保护层162交叠的半径范围为2-200 iim。
[0084]当然，也可以如图9B所示，略去图9A中的第一信号引出电极。即，第一电极保护层161完全覆盖走线电极15，第二电极保护层162完全覆盖第一电极保护层161，第一电极保护层161和第二电极保护层162在相应的位置分别开设有第一电极保护层过孔1610和第二电极保护层过孔1620，信号引出电极17覆盖第二电极保护层过孔1620并与第二电极保护层162交叠，第二信号引出电极172与走线电极15接触。
[0085]图9A和图9B所示的电极连接板的结构即通称的Gate区域过孔搭接部分，相比图3，图9A和图9B任一种结构均具有更好的阻挡水和氧的渗入的作用，从而，从非显示区就杜绝了水和氧从孔间隙渗入的可能，进一步提高了阵列基板中TFT的稳定性。根据阵列基板设计的需要，可以采用其中的一种方式或者两种方式的组合进行保护，以便更好地达到对外界水和氧的阻挡效果。
[0086]如图10所示，第一电极保护层161部分覆盖走线电极15，第一信号引出电极171设置于第一电极保护层161的上方并包覆第一电极保护层161的层壁,并沿第一电极保护层层壁的上缘向远离层壁的方向与第一电极保护层161的表面交叠，以及沿第一电极保护层层壁的下缘向远离层壁的方向与未被第一电极保护161层覆盖的走线电极15交叠；同时，第二信号引出电极172设置于第二电极保护层162的上方并包覆第二电极保护层162的层壁，并沿第二电极保护层层壁的上缘向远离层壁的方向与第二电极保护层162的表面交叠，以及沿第一电极保护层层壁的下缘向远离层壁与未被第二电极保护层162覆盖的走线电极15交叠。
[0087]其中，第一信号引出电极171沿第一电极保护层层壁的上缘向远离层壁的方向与第一电极保护层161的表面交叠的半径范围，和/或，第一信号引出电极171沿第一电极保护层层壁的下缘向远离层壁的方向与未被第一电极保护层161覆盖的走线电极15交叠的半径范围为2-200 u m ;第二信号引出电极172沿第二电极保护层层壁的上缘向远离层壁的方向与第二电极保护层162的表面交叠的半径范围，和/或第二信号引出电极172沿第二电极保护层层壁的下缘向远离层壁的方向与未被第二电极保护层162覆盖的走线电极15交叠的半径范围为2-200 u m。
[0088]图10所示的电极连接板的结构即通称的Gate PAD区域，相比图2，该结构具有更好的阻挡水和氧的渗入的作用，从而，从非显示区就杜绝了水和氧从孔间隙渗入的可能，进一步提高了阵列基板中TFT的稳定性。
[0089]在本实施例中，走线电极15与栅极2采用相同的材料、且在同一构图工艺中形成，第一信号引出电极171与漏极7采用相同的材料、且在同一构图工艺中形成；第二信号引出电极172与像素电极9采用相同的材料、且在同一构图工艺中形成；第一电极保护层161与栅绝缘层3采用相同的材料、且在同一构图工艺中形成；第二电极保护层162与钝化层8采用相同的材料、且在同一构图工艺中形成。
[0090]在阵列基板的制备过程中，形成图9A所示的电极连接板的结构即通称的Gate区域过孔搭接时:在形成栅极2的同时在非显示区采用相同的材料、且在同一构图工艺中形成走线电极15，在形成栅绝缘层3时将其延伸至非显示区形成第一电极保护层161，第一电极保护层161在走线电极15的上部形成第一电极保护层过孔1610，第一电极保护层161与走线电极15有一定的交叠半径，例如2 ii m-200 iim (单边)；接着，在形成漏极7的同时在非显示区采用相同的材料、且在同一构图工艺中形成第一信号引出电极171，在形成钝化层8时将其延伸至非显示区形成第二电极保护层162，第二电极保护层162在第一信号引出电极171的上部形成第二电极保护层过孔1620，第二电极保护层162与第一信号引出电极171有一定的交叠半径，例如2 V- m-200 u m (单边)；然后，在形成像素电极9的同时在非显示区形成搭接第二电极保护层过孔1620的透明的第二信号引出电极172，该第二信号引出电极172与第二电极保护层162有一定的交叠半径，例如2 ii m-200 iim (单边)。
[0091]根据上述的Gate区域过孔搭接的形成过程，以及现有的构图工艺知识，可推知图9B的电极连接板的结构的制备，区别在于图9B相对图9A的制备过程可略去第一信号引出电极171的形成，即在形成漏极7时在非显示区无需形成第一信号引出电极171 ;也容易推知图10所示的电极连接板的结构即通称的栅极连接板Gate PAD的制备，区别在于该GatePAD区域为了配合外接电路的连接，设计为单边交叠(可视为半径无穷大的过孔，或者相当于单边的过孔)，且根据电路设计要求使其位于Gate PAD区域。
[0092]在本实施例中，通过改进非显示区Gate区域过孔搭接部分和Gate PAD的结构，可以有效地解决外界的水和氧对金属氧化物半导体TFT的影响。
[0093]实施例2-实施例5中的阵列基板，由于采用了具有交叠结构的电极引出结构，该交叠结构使得水和氧的浓度梯度由外向内逐渐变小，可以有效地阻止外界的水和氧渗入阵列基板内部对金属氧化物产生影响，使得采用金属氧化物半导体形成有源层的TFT (OxideTFT)的性能更稳定、信赖性更高，也同时增加了阵列基板的稳定性。尤其适合使用于大尺寸、高分辨率液晶显示装置和AM-OLED显示装置中。
[0094]实施例6:
[0095]—种显不装置,包括实施例2_5任一种所不例的阵列基板。
[0096]其中，本实施例中的显示装置可以广泛应用于各种大中小尺寸的产品上，可以涵盖当今信息社会的主要电子产品，如液晶电视、电脑、手机、PDA、GPS、车载显示、投影显示、摄像机、数码相机、电子手表、计算器、电子仪器、仪表、公共显示和虚幻显示等多个领域。
[0097]本实施例的显示装置，由于采用了具有交叠结构的电极结构的阵列基板，因此性能更稳定性，显示效果更好。
[0098]可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。
【权利要求】
1.一种电极引出结构，包括衬底电极、隔离层和引出电极，所述隔离层位于所述衬底电极上方，所述引出电极位于所述隔离层上方，所述隔离层中开设有隔离层过孔或者所述隔离层部分覆盖所述衬底电极，其特征在于， 所述引出电极覆盖所述隔离层过孔的孔壁和孔底，并沿所述隔离层过孔的上缘向远离所述隔离层过孔的方向与所述隔离层交叠；或者， 所述引出电极覆盖所述隔离层的层壁，并沿所述隔离层层壁上缘向远离所述层壁的方向与所述隔离层的表面交叠，以及沿所述隔离层层壁下缘向远离所述层壁的方向与未被所述隔离层覆盖的所述衬底电极交叠。
2.根据权利要求1所述的电极引出结构，其特征在于，所述引出电极沿所述隔离层过孔的上缘向远离所述隔离层过孔的方向与所述隔离层交叠的半径范围为0.2-200 μ m;或者，所述引出电极沿所述隔离层层壁上缘向远离所述层壁的方向与所述隔离层的表面交叠的半径范围为0.2-200 μ m，和/或，所述引出电极沿所述隔离层层壁下缘向远离所述层壁的方向与未被所述隔离层覆盖的所述衬底电极交叠。
3.一种阵列基板，包括基板以及设置于所述基板上的电极引出结构，所述阵列基板包括显示区和非显示区，其特征在于，所述电极引出结构采用权利要求1-2任一项所述的电极引出结构，所述电极引出结构设置于所述阵列基板的显示区和/或非显示区。
4.根据权利要求3所述的阵列基板，其特征在于，所述显示区内设置有多个像素单元，所述像素单元包括栅极、栅绝缘层、有源层、刻蚀阻挡层、源极和漏极，所述衬底电极包括所述有源层，所述引出电极包括所述源极与所述漏极，所述隔离层包括所述刻蚀阻挡层，所述刻蚀阻挡层中开设有第一刻蚀阻挡层过孔和第二刻蚀阻挡层过孔，所述源极覆盖所述第一刻蚀阻挡层过孔的孔壁和孔底并与所述有源层接触，所述漏极覆盖所述第二刻蚀阻挡层过孔的孔壁和孔底并与所述有源层接触；同时，所述源极沿所述第一刻蚀阻挡层过孔的上缘向远离所述第一刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠，和/或，所述漏极沿所述第二刻蚀阻挡层过孔的上缘向远离所述第二刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠。`
5.根据权利要求4所述的阵列基板，其特征在于，所述源极沿所述第一刻蚀阻挡层过孔的上缘向远离所述第一刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠的半径范围为0.2-8μπι;和/或，所述漏极沿所述第二刻蚀阻挡层过孔的上缘向远离所述第二刻蚀阻挡层过孔的方向与所述刻蚀阻挡层交叠的半径范围为0.2-8 μ m。
6.根据权利要求4所述的阵列基板，其特征在于，所述像素单元还包括设置于所述源极和所述漏极上方的钝化层和像素电极，所述引出电极还包括像素电极，所述隔离层还包括钝化层，所述钝化层在对应着所述漏极的区域开设有钝化层过孔，所述像素电极覆盖所述钝化层过孔的孔壁和孔底并与所述漏极接触，所述像素电极沿所述钝化层过孔的上缘向远离所述钝化层过孔的方向与所述钝化层交叠。
7.根据权利要求6所述的阵列基板，其特征在于，所述像素电极沿所述钝化层过孔的上缘向远离所述钝化层过孔的方向与所述钝化层交叠的半径范围为2-200 μ m。
8.根据权利要求3所述的阵列基板，其特征在于，所述非显示区设置有电极连接板，所述电极连接板包括走线电极以及设置于所述走线电极上方的电极保护层和信号引出电极，所述衬底电极包括所述走线电极，所述引出电极包括所述信号引出电极，所述隔离层包括所述电极保护层，所述电极保护层部分覆盖所述走线电极，所述信号引出电极包覆所述电极保护层的层壁，并沿所述电极保护层层壁的上缘向远离所述层壁的方向与所述电极保护层的表面交叠，以及沿所述电极保护层层壁的下缘向远离所述层壁的方向与未被所述电极保护层覆盖的所述走线电极交叠； 或者，所述电极保护层完全覆盖所述走线电极，所述电极保护层中开设有电极保护层过孔，所述信号引出电极覆盖所述电极保护层过孔的孔壁和孔底且与所述走线电极接触，并沿所述电极保护层过孔的上缘向远离所述电极保护层过孔的方向与所述电极保护层交叠。
9.根据权利要求8所述的阵列基板，其特征在于，所述信号引出电极沿所述电极保护层层壁的上缘向远离所述层壁的方向与所述电极保护层的表面交叠，以及沿所述电极保护层层壁的下缘向远离所述层壁的方向与未被所述电极保护层覆盖的走线电极交叠的半径范围为2-200 μ m ； 或者，所述信号引出电极沿所述电极保护层过孔的上缘向远离所述电极保护层过孔的方向与所述电极保护层交叠的半径范围为2-200 μ m。
10.根据权利要求8所述的阵列基板，其特征在于，所述走线电极与所述漏极采用相同的材料、且在同一构图工艺中形成，所述信号引出电极与所述像素电极采用相同的材料、且在同一构图工艺中形成；所述电极保护层与所述钝化层采用相同的材料、且在同一构图工艺中形成。
11.根据权利要求8所述的阵列基板，其特征在于，所述电极保护层包括第一电极保护层和第二电极保护层， 所述信号引出电极包括第一信号引出电极和第二信号引出电极，所述第一电极保护层部分覆盖所述走线电极，所述第一信号引出电极设置于所述第一电极保护层的上方并包覆所述第一电极保护层的层壁，并沿所述第一电极保护层层壁的上缘向远离所述层壁的方向与所述第一电极保护层的表面交叠，以及沿所述第一电极保护层层壁的下缘向远离所述层壁的方向与未被所述第一电极保护层覆盖的走线电极交叠；同时，所述第二信号引出电极设置于所述第二电极保护层的上方并包覆所述第二电极保护层的层壁，并沿所述第二电极保护层层壁的上缘向远离所述层壁的方向与所述第二电极保护层的表面交叠，以及沿所述第一电极保护层层壁的下缘向远离所述层壁与未被所述第二电极保护层覆盖的所述第一信号引出电极交叠； 或者，所述第一电极保护层完全覆盖所述走线电极，所述第一电极保护层中开设有第一电极保护层过孔，所述第一信号引出电极覆盖所述第一电极保护层过孔的孔壁和孔底并沿所述第一电极保护层过孔的上缘向远离所述第一电极保护层过孔的方向与所述第一电极保护层交叠；所述第二电极保护层完全覆盖所述第一信号引出电极，所述第二电极保护层中开设有第二电极保护层过孔，所述第二信号引出电极覆盖所述第二电极保护层过孔的孔壁和孔底并沿所述第二电极保护层过孔的上缘向远离所述第二电极保护层过孔的方向与所述第二电极保护层交叠，所述第二信号引出电极与所述第一引出电极接触。
12.根据权利要求11所述的阵列基板，其特征在于，所述第一信号引出电极沿所述第一电极保护层层壁的上缘向远离所述层壁的方向与所述第一电极保护层的表面交叠的半径范围，以及沿所述第一电极保护层层壁的下缘向远离所述层壁的方向与未被所述第一电极保护层覆盖的走线电极交叠的半径范围均为2-200 μ m ;所述第二信号引出电极沿所述第二电极保护层层壁的上缘向远离所述层壁的方向与所述第二电极保护层的表面交叠的半径范围，以及沿所述第二电极保护层层壁的下缘向远离所述层壁的方向与未被所述第二电极保护层覆盖的所述第一信号引出电极交叠的半径范围均为2-200μπι; 或者，所述第一信号引出电极沿所述第一电极保护层过孔的上缘向远离所述第一电极保护层过孔的方向与所述第一电极保护层交叠的半径范围为2-200 μ m;所述第二信号引出电极沿所述第二电极保护层过孔的上缘向远离所述第二电极保护层过孔的方向与所述第二电极保护层交叠的半径范围为2-200 μ m。
13.根据权利要求12所述的阵列基板，其特征在于，所述走线电极与所述栅极采用相同的材料、且在同一构图工艺中形成，所述第一信号引出电极与所述漏极采用相同的材料、且在同一构图工艺中形成；所述第二信号引出电极与所述像素电极采用相同的材料、且在同一构图工艺中形成；所述第一电极保护层与所述栅绝缘层采用相同的材料、且在同一构图工艺中形成；所述第二电极保护层与所述钝化层采用相同的材料、且在同一构图工艺中形成。
14.根据权利要求4-13任一项所述的阵列基板，其特征在于，所述有源层采用金属氧化物半导体材料形成；所述栅绝缘层、所述刻蚀阻挡层或所述钝化层为一层或多层结构，且采用富硅材料形成，所述富硅材料包括氧化硅、氮化硅或氮氧化硅。
15.一种显示装置，包括权利`要求3-14任一项所述的阵列基板。
【文档编号】H01L29/786GK103681696SQ201310722613
【公开日】2014年3月26日 申请日期:2013年12月24日 优先权日:2013年12月24日
【发明者】刘翔 申请人:京东方科技集团股份有限公司