专利名称：锁相频率合成器及自适应频率校准电路和校准方法
技术领域：
本发明涉及锁相频率合成器，具体涉及锁相频率合成器及自适应频率校准电路和校准方法。
背景技术：
锁相频率合成器是采用锁相环(PLL)进行频率合成的一种频率合成器，它是目前频率合成器主流。锁相式整数频率合成器由鉴频鉴相器(PFD)、电荷泵(CP)、可变计数器(/N)、环路滤波器(LPF)、压控振荡器(VCO)等部分组成。锁相频率合成器是一个相位误差控制系统，它比较输入信号和压控振荡器输出信号之间的相位差，从而产生误差控制电压来调整压控振荡器的频率，以达到与输入信号同频。在环路开始工作时，如果输入参考时钟频率与VCO时钟频率不同，则由于两信号之间存在固有的频率差，它们之间的相位差势必一直在变化，结果鉴频鉴相器输出的误差电压就在一定范围内变化。在这种误差电压的控制下，压控振荡器的频率也在变化。并且，压控振荡器的工作频率对工艺非常敏感，特别是压控振荡器的振荡频率在1000MHz以上，不同批次芯片及工艺本身所造成的工艺偏差会影响VCO频率的一致性。增加VCO的压控频率增益可以增加VCO的频率覆盖范围，在一定程度上抵消工艺偏差对VCO频率的影响，但增加VCO的压控增益会增加VCO的相位噪声。AFC(Adaptive Frequency Calibration自适应频率校准)其功能是在锁频锁相初期，由基准电路产生某一固定电压作为VCO的压控电压，通过一定的算法对参考时钟与VCO分频后的时钟频率进行比较,从而调整压控振荡器的振荡频率。
发明内容
本发明所要解决的技术问题之一在于提供具有自适应频率校准电路的锁相频率合成器。本发明所要解决的技术问题之二在于提供分段式压控振荡器自适应频率校准电路。本发明所要解决的技术问题之三在于提供分段式压控振荡器自适应频率校准方法。为了解决上述技术问题，本发明的第一个技术方案是，具有自适应频率校准电路的锁相频率合成器，包括鉴频鉴相器、电荷泵、环路滤波器、可变计数器、压控振荡器、自适应频率校准电路和控制开关，其特征在于:自适应频率校准电路包括计数器、比较器以及状态机；压控振荡器通过控制开关接收基准电压信号，产生频率信号输出到可变计数器；可变计数器将收到的信号进行分频处理后输出压控振荡器的分频时钟信号到计数器和鉴频鉴相器；计数器同时接收参考时钟信号和压控振荡器的分频时钟信号进行计数，当其中一个时钟信号计数结束时，计数器产生一个脉冲信号输出到比较器；比较器收到计数器输出的脉冲信号后进行比较，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机；状态机受比较器输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器，以调整压控振荡器的时钟信号频率；当压控振荡器的分频时钟信号频率等于参考时钟信号频率，状态机输出开关控制信号，使控制开关与基准电压信号断开并与环路滤波器接通，压控振荡器通过控制开关接收环路滤波器输出的控制电压信号。本发明采用将压控振荡器分成若干频段，以增加压控振荡器的频率范围，压控振荡器的每一频段都具有较小的压控频率增益，而多个频段完全可以覆盖所需的频率范围并保留一定余量；与采用鉴频鉴相器的传统PLL环路相比，压控振荡器输出频率首先由自适应频率校准电路输出的数字信号进行控制，自动寻找最适合目标频率的频段，使压控振荡器的分频时钟信号频率能够调整到与参考时钟信号频率相近，并保持工作在这个频段；再由环路滤波器输出的控制电压进一步调整压控振荡器的频率，达到稳定后，参考时钟信号和压控振荡器分频时钟信号之间的频差为零，相差不再随时间变化，误差电压为一固定值，这时环路就进入“锁定”状态。采用频率分段结构及自适应频率校准电路，能避免VCO频率受到工艺偏差的影响，即使工艺不一致造成压控振荡器的频率变化，在设定范围内总会使压控振荡器满足所需频率要求，保证芯片一致性，提高产品成品率；并且整个校准工作由芯片内部自动完成，无需外部控制，既满足了压控振荡器频率的一致性问题，同时简化了应用方案。所述状态机包括逻辑电路、寄存器组一和寄存器组二 ；寄存器组一和寄存器组二均受比较器输出的状态机时钟信号的控制；寄存器组一作为存储加/减数的寄存器；逻辑电路接收寄存器组一输出的数据，并同时接收比较器输出的指示信号，进行逻辑运算后输出到寄存器组二，寄存器组二产生控制信号输出到压控振荡器，以调整压控振荡器的时钟信号频率。 所述寄存器组一由第η寄存器、第η-1寄存器、第n_2寄存器……第一寄存器、第零寄存器组成；寄存器组二由第m寄存器、第m-Ι寄存器……第I寄存器组成；逻辑电路由η个逻辑电路单元和第零或门构成，其中:n ^ 2的自然数;m=n ;每个逻辑电路单元均包括一个与门、一个或门和一个异或门；第η寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器采用串行环形连接；第η与门的I个输入端连接第η-1寄存器的输出端Q，第η与门的另I个输入端连接比较器的比较指示信号输出端;第η与门的输出端连接第η或门的一个输入端，第η或门的另一个输入端连接第η寄存器的输出端Q,第η或门的输出端连接第η异或门的一个输入端,第η异或门的另一个输入端连接第m寄存器的输出端Q,第η异或门的输出端连接第m寄存器的输入端D ;依次类推，第一与门的I个输入端连接第零寄存器的输出端Q，第一与门的另I个输入端连接比较器的比较指示信号输出端；第一与门的输出端连接第一或门的一个输入端，第一或门的另一个输入端连接第一寄存器的输出端Q，第一或门的输出端连接第一异或门的一个输入端，第一异或门的另一个输入端连接第I寄存器的输出端Q，第一异或门的输出端连接第I寄存器的输入端D ;第m寄存器、第m-1寄存器……第I寄存器的输出端Q共输出η位控制信号到压控振荡器；第η寄存器、第n-1寄存器、第η-2寄存器……第一寄存器、第零寄存器的时钟信号输入端以及第m寄存器、第m-1寄存器……第I寄存器的时钟信号输入端均连接比较器的状态机时钟信号输出端；第η寄存器、第η-2寄存器……第一寄存器、第零寄存器的复位端CLR、第η_1寄存器的置位端SET以及第m-Ι寄存器……第I寄存器的复位端CLR和第m寄存器的置位端SET均连接复位信号，该复位信号由外部输入，比较器的相同指示信号输出端连接第零或门的一个输入端，第零或门的另一个输入端连接第η寄存器的输出端Q，第零或门的输出端输出开关控制信号到控制开关，控制控制开关与基准电压信号连接或与可变计数器连接。本发明的第二个技术方案是，分段式压控振荡器自适应频率校准电路，包括比较器、计数器以及状态机，其特点是:参考时钟信号和压控振荡器的分频时钟信号同时输入计数器进行计数，当其中一个时钟信号计数结束时，计数器产生一个脉冲信号输出到比较器；表示其中一个时钟信号计数完成；比较器收到计数器输出的脉冲信号后进行比较，以确定参考时钟信号和压控振荡器的分频时钟信号中是哪一个时钟先计数结束或是同时计数结束，即比较参考时钟信号和压控振荡器的分频时钟信号的频率大小，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机；状态机受比较器输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器，以调整压控振荡器的时钟信号频率。本发明的第三个技术方案是，分段式压控振荡器自适应频率校准方法，其特点是:包括如下步骤:将一个标准电压输入 压控振荡器作为压控振荡器的压控电压；将参考时钟信号和压控振荡器输出的频率信号经分频处理后得到的分频时钟信号同时输入计数器进行计数；当参考时钟信号和压控振荡器的分频时钟信号中的其中一个时钟信号计数结束时，计数器产生一个脉冲信号输出到比较器；比较器收到计数器输出的脉冲信号后，判断压控振荡器的分频时钟信号频率与参考时钟信号频率的大小，判断结束后，产生指示信号并同时产生状态机时钟信号一并输出给状态机；状态机根据指示信号和状态机时钟信号，如果压控振荡器的分频时钟信号频率不等于参考时钟信号频率，则增加或减少控制信号的控制码值，并将控制信号输出到压控振荡器，如果压控振荡器的分频时钟信号频率等于参考时钟信号频率，则校准结束；校准结束，使压控振荡器的压控电压从标准电压切换为环路滤波器产生的控制电压。根据本发明所述的分段式压控振荡器自适应频率校准方法的一种优选方案，如果压控振荡器的分频时钟信号频率不等于参考时钟信号频率，则增加或减少控制信号的控制码的值，具体为:如果压控振荡器的分频时钟信号频率大于参考时钟信号频率，减小控制信号的控制码的值；如果压控振荡器的分频时钟信号频率小于参考时钟信号频率，增大控制信号的控制码的值。根据本发明所述的分段式压控振荡器自适应频率校准方法的一种优选方案，状态机的具体工作步骤为:第一步:初始化，设N=2n_S δη=2η_2 ;其中N为状态机输出的控制信号的控制码值，δη为状态机输出的控制信号的控制码值的调整数；第二步:接收比较器输出的信号；第三步:判断压控振荡器的分频时钟信号频率fva)是否等于参考时钟信号频率fKEF，如果相等，进入第七步；如果不相等，判断调整数S η是否为2°，如果调整数为2°，进入第六步；如果调整数S η不为2°，进入第四步；第四步:判断压控振荡器的分频时钟信号频率fva)是否小于参考时钟信号频率fKEF，如果是小于，调整N=N+ δ η,进入第五步；如果fVCM大于fKEF,调整N=N- δ η,进入第五步；第五步:设δ η= δ η/2,返回第二步；第六步:判断压控振荡器的分频时钟信号频率fva)是否小于参考时钟信号频率fKEF，如果是小于，调整Ν=Ν+1,进入第七步；如果fVCO大于fKEF，调整N=N-1,进入第七步；第七步:校准结束，使压控振荡器的压控电压从标准电压切换为环路滤波器产生的控制电压。发明所述的锁相频率合成器及自适应频率校准电路和校准方法的有益效果是:本发明与采用鉴频鉴相器的传统PLL环路相比，压控振荡器输出频率首先由自适应频率校准电路输出的数字信号进行控制，使压控振荡器的分频时钟信号频率能够调整到与参考时钟信号频率相近，并保持工作在这个频段。再由环路滤波器输出的控制电压进一步调整压控振荡器的频率，直至环路“锁定”;采用频率分段结构及自适应频率校准电路，能避免压控振荡器频率受到工艺偏差的影响，保证芯片一致性，提高产品成品率；并且整个校准工作由芯片内部自动完成，无需外部控制，既满足了压控振荡器频率的一致性问题，同时简化了应用方案；本发明结构简单，成本低、性能优，具有良好的应用前景。
图1是本发明所述的分段式压控振荡器自适应频率校准电路的原理框图。图2是本发明所述的状态机的原理图。图3是本发明所述的具有自适应频率校准电路的锁相频率合成器的原理框图。图4分段式压控振荡器的频率与压控电压曲线图。图5是状态机控制流程图。
具体实施例方式参见图1至图3，具有自适应频率校准电路的锁相频率合成器，包括鉴频鉴相器14、电荷泵15、环路滤波器16、可变计数器17、压控振荡器18、自适应频率校准电路10和控制开关19，其中:自适应频率校准电路10包括计数器11、比较器12以及状态机13 ；压控振荡器18通过控制开关19接收基准电压信号，产生频率信号输出到可变计数器17;可变计数器17将收到的信号进行分频处理后输出压控振荡器的分频时钟信号到计数器11和鉴频鉴相器14;计数器11同时接收参考时钟信号和压控振荡器的分频时钟信号进行计数，当其中一个时钟信号计数结束时，计数器11产生一个脉冲信号输出到比较器12 ；比较器12收到计数器11输出的脉冲信号后进行比较，以确定参考时钟信号和压控振荡器的分频时钟信号中是哪一个时钟先计数结束或是同时计数结束，即将两个时钟信号的频率进行比较，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机13 ；状态机13受比较器12输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器18，以调整压控振荡器18的时钟信号频率；当压控振荡器的分频时钟信号频率大于参考时钟信号频率，减小控制信号的控制码值；当压控振荡器的分频时钟信号频率小于参考时钟信号频率，增大控制信号的控制码值；当压控振荡器的分频时钟信号频率等于参考时钟信号频率，状态机13输出开关控制信号，使控制开关19与基准电压信号断开并与环路滤波器16接通，压控振荡器18通过控制开关19接收环路滤波器16输出的控制电压信号。在具体实施例中，状态机13包括逻辑电路33、寄存器组一 31和寄存器组二 32 ;寄存器组一 31和寄存器组二 32均受比较器12输出的状态机时钟信号的控制；寄存器组一 31作为存储加/减数的寄存器；逻辑电路33接收寄存器组一 31输出的数据，并同时接收比较器12输出的指示信号，进行逻辑运算后输出到寄存器组二 32，寄存器组二 32产生控制信号输出到压控振荡器18，以调整压控振荡器18的时钟信号频率。所述寄存器组一 31由第η寄存器DSn、第η-1寄存器DSn_l、第n_2寄存器DSn-2……第一寄存器DSl、第零寄 存器DSO组成；寄存器组二 32由第m寄存器DOn、第m_l寄存器DOn-1……第I寄存器DOl组成；逻辑电路由η个逻辑电路单元和第零或门OR构成；其中:η > 2的自然数;m=n ;每个逻辑电路单元均包括一个与门、一个或门和一个异或门；第η寄存器DSn、第η-1寄存器DSn-Ι、第n_2寄存器DSn_2……第一寄存器DS1、第零寄存器DSO采用串行环形连接；第η与门ANDn的I个输入端连接第η_1寄存器DSn-1的输出端Q，第η与门ANDn的另I个输入端连接比较器12的比较指示信号输出端；比较指示信号输出“I”表示压控振荡器的分频时钟信号频率高于参考时钟信号频率；输出“O”表示压控振荡器的分频时钟信号频率低于参考时钟信号频率；第11与门ANDn的输出端连接第η或门ORn的一个输入端,第η或门ORn的另一个输入端连接第η寄存器DSn的输出端Q,第η或门ORn的输出端连接第η异或门XORn的一个输入端,第η异或门XORn的另一个输入端连接第m寄存器DOn的输出端Q，第η异或门XORn的输出端连接第m寄存器DOn的输入端D ；依次类推，第一与门ANDl的I个输入端连接第零寄存器DSO的输出端Q，第一与门ANDl的另I个输入端连接比较器12的比较指示信号输出端；第一与门ANDl的输出端连接第一或门ORl的一个输入端,第一或门ORl的另一个输入端连接第一寄存器DSl的输出端Q，第一或门ORl的输出端连接第一异或门XORl的一个输入端,第一异或门XORl的另一个输入端连接第I寄存器DOl的输出端Q，第一异或门XORl的输出端连接第I寄存器DOl的输入端D ;第m寄存器DOn、第m_l寄存器DOn-1……第I寄存器DOl的输出端Q共输出η位控制信号到压控振荡器；第η寄存器DSn、第η-1寄存器DSn-Ι、第n_2寄存器DSn_2……第一寄存器DS1、第零寄存器DSO的时钟信号输入端以及第m寄存器DOn、第m_l寄存器DOn-1……第I寄存器DOl的时钟信号输入端均连接比较器12的状态机时钟信号输出端；第η寄存器DSn、第η-2寄存器DSn_2……第一寄存器DSl、第零寄存器DSO的复位端CLR、第n_l寄存器DSn-1的置位端SET以及第m-1寄存器DOn-1……第I寄存器DOl的复位端CLR和第m寄存器DOn的置位端SET均连接复位信号，该复位信号由外部提供，每次自动选段功能启动前该信号开始对状态机进行复位，复位完成后状态机开始重新工作；比较器12的相同指示信号输出端连接第零或门OR的一个输入端，第零或门OR的另一个输入端连接第η寄存器DSn的输出端Q，第零或门的输出端输出开关控制信号到控制开关19，控制控制开关19与基准电压信号连接或与可变计数器17连接，输出“I”表示状态机工作完成；控制控制开关19与基准电压信号断开，与可变计数器17连接。参见图1，锁相频率合成器分段式压控振荡器自适应频率校准电路，包括计数器
11、比较器12以及状态机13，其中:参考时钟信号和压控振荡器的分频时钟信号同时输入计数器11进行计数，当其中一个时钟信号计数结束时，计数器11产生一个脉冲信号输出到比较器12 ；比较器12收到计数器11输出的脉冲信号后进行比较，以确定参考时钟信号和压控振荡器的分频时钟信号中是哪一个时钟先计数结束或是同时计数结束，即将两个时钟信号的频率进行比较，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机13 ;当参考时钟信号和压控振荡器的分频时钟信号频率相等时，产生相同指示信号，具体实施时用输出“I”表示；当参考时钟信号和压控振荡器的分频时钟信号频率不相等时，产生比较指示信号，具体实施时，输出“ I”表示压控振荡器的分频时钟信号频率高于参考时钟信号频率；输出“O”表示压控振荡器的分频时钟信号频率低于参考时钟频率；状态机13受比较器12输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器18，以调整压控振荡器18的时钟信号频率。
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本发明采用将VCO分成若干频段的方案以增加VCO的频率范围，VCO的每一频段都具有较小的压控频率增益，而多个频段完全可以覆盖所需的频率范围并保留一定余量。由于VCO被分为若干段，在某一时刻只有一个VCO频段在工作，选择VCO频段的工作将通过AFC电路完成。参见图3、图4，图3是含本发明的新型锁相频率合成器总体框图，图4是分段式VCO的频率与压控电压曲线，其中X轴是压控电压V，y轴是VCO频率MHz。在具体实施例中，所述状态机13包括逻辑电路33、寄存器组一 31和寄存器组二32 ;寄存器组一 31和寄存器组二 32均受比较器12输出的状态机时钟信号的控制；寄存器组一 31作为存储加/减数的寄存器；逻辑电路33接收寄存器组一 31输出的数据，并同时接收比较器12输出的指示信号，进行逻辑运算后输出到寄存器组二 32，寄存器组二 32产生控制信号输出到压控振荡器18，以调整压控振荡器18的时钟信号频率。在具体实施时，参见图2，所述寄存器组一由第η寄存器DSn、第η-1寄存器DSn-1、第η-2寄存器DSn-2……第一寄存器DSl、第零寄存器DSO组成；寄存器组二由第m寄存器DOn、第m-Ι寄存器DOn-1……第I寄存器DOl组成；逻辑电路由η个逻辑电路单元和第零或门OR构成；其中:η彡2的自然数;m=n ;每个逻辑电路单元均包括一个与门、一个或门和一个异或门；第η寄存器DSn、第η-1寄存器DSn-Ι、第n_2寄存器DSn_2……第一寄存器DS1、第零寄存器DSO采用串行环形连接；第11与门ANDn的I个输入端连接第η-1寄存器DSn-1的输出端Q，第η与门ANDn的另I个输入端连接比较器的比较指示信号输出端；比较指示信号输出“I”表示压控振荡器的分频时钟信号频率高于参考时钟频率；输出“O”表示压控振荡器的分频时钟信号频率低于参考时钟频率；第η与门ANDn的输出端连接第η或门ORn的一个输入端,第η或门ORn的另一个输入端连接第η寄存器DSn的输出端Q,第η或门ORn的输出端连接第η异或门XORn的一个输入端,第η异或门XORn的另一个输入端连接第m寄存器DOn的输出端Q，第η异或门XORn的输出端连接第m寄存器DOn的输入端D ；依次类推，第一与门ANDl的I个输入端连接第零寄存器DSO的输出端Q，第一与门ANDl的另I个输入端连接比较器12的比较指示信号输出端；第一与门ANDl的输出端连接第一或门ORl的一个输入端,第一或门ORl的另一个输入端连接第一寄存器DSl的输出端Q,第一或门ORl的输出端连接第一异或门XORl的一个输入端,第一异或门XORl的另一个输入端连接第I寄存器DOl的输出端Q，第一异或门XORl的输出端连接第I寄存器DOl的输入端D ;第m寄存器DOn、第m_l寄存器DOn-1……第I寄存器DOl的输出端Q共输出η位控制信号到压控振荡器；第η寄存器DSn、第η-1寄存器DSn-Ι、第n_2寄存器DSn_2……第一寄存器DS1、第零寄存器DSO的时钟信号输入端以及第m寄存器DOn、第m_l寄存器DOn-1……第I寄存器DOl的时钟信号输入端均连接比较器12的状态机时钟信号输出端；第η寄存器DSn、第η-2寄存器DSn_2……第一寄存器DSl、第零寄存器DSO的复位端CLR、第n_l寄存器DSn-1的置位端SET以及第m-Ι寄存器DOn-1……第I寄存器DOl的复位端CLR和第m寄存器DOn的置位端SET均连接复位信号，该复位信号由外部输入，每次自动选段功能启动前该信号开始对状态机13进行复位，复位完成后状态机13开始重新工作；比较器12的相同指示信号输出端连接第零或门OR的一个输入端，第零或门OR的另一个输入端连接第η寄存器DSn的输出端Q,第零或门OR的输出端输出开关控制信号到控制开关19,控制控制开关19与基准电压信号连接或与可变计数器17连接，输出“I”表示状态机工作完成；控制控制开关19与基准电压信号断开，与可变计数器17连接。状态 机13的输入输出信号如表I所不。表I
权利要求
1.有自适应频率校准电路的锁相频率合成器，包括鉴频鉴相器(14)、电荷泵(15)、环路滤波器(16)、可变计数器(17)、压控振荡器(18)、自适应频率校准电路(10)和控制开关(19)，其特征在于:自适应频率校准电路(10)包括计数器(11)、比较器(12)以及状态机(13)； 压控振荡器(18)通过控制开关(19)接收基准电压信号，产生频率信号输出到可变计数器(17)； 可变计数器(17)将收到的信号进行分频处理后输出压控振荡器的分频时钟信号到计数器(11)和鉴频鉴相器(14)； 计数器(11)同时接收参考时钟信号和压控振荡器的分频时钟信号进行计数，当其中一个时钟信号计数结束时，计数器(11)产生一个脉冲信号输出到比较器(12)； 比较器(12)收到计数器(11)输出的脉冲信号后进行比较，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机(13)； 状态机(13)受比较器(12)输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器(18)，以调整压控振荡器(18)的时钟信号频率；当压控振荡器的分频时钟信号频率等于参考时钟信号频率，状态机(13)输出开关控制信号，使控制开关(19)与基准电压信号断开并与环路滤波器(16)接通，压控振荡器(18)通过控制开关(19)接收环路滤波器(16)输出的控制电压信号。
2.根据权利要求1所述的具有自适应频率校准电路的锁相频率合成器，所述状态机(13)包括逻辑电路(33)、寄存器组一(31)和寄存器组二(32);寄存器组一(31)和寄存器组二(32)均受比较器(12)输出的状态机时钟信号的控制；寄存器组一(31)作为存储加/减数的寄存器；逻辑电路(33)接收寄存器组一(31)输出的数据，并同时接收比较器(12)输出的指示信号，进行逻 辑运算后输出到寄存器组二(32)，寄存器组二(32)产生控制信号输出到压控振荡器(18)，以调整压控振荡器(18)的时钟信号频率。
3.根据权利要求2所述的具有自适应频率校准电路的锁相频率合成器，所述寄存器组一 (31)由第η寄存器、第η-1寄存器、第η_2寄存器……第一寄存器、第零寄存器组成；寄存器组二(32)由第m寄存器、第m- 寄存器……第I寄存器组成；逻辑电路由η个逻辑电路单元和第零或门构成，其中:n ^ 2的自然数;m=n ;每个逻辑电路单元均包括一个与门、一个或门和一个异或门;第η寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器采用串行环形连接；第η与门的I个输入端连接第η-1寄存器的输出端Q，第η与门的另I个输入端连接比较器的比较指示信号输出端；第η与门的输出端连接第η或门的一个输入端,第η或门的另一个输入端连接第η寄存器的输出端Q,第η或门的输出端连接第η异或门的一个输入端，第η异或门的另一个输入端连接第m寄存器的输出端Q，第η异或门的输出端连接第m寄存器的输入端D ;依次类推，第一与门的I个输入端连接第零寄存器的输出端Q，第一与门的另I个输入端连接比较器的比较指示信号输出端；第一与门的输出端连接第一或门的一个输入端，第一或门的另一个输入端连接第一寄存器的输出端Q，第一或门的输出端连接第一异或门的一个输入端，第一异或门的另一个输入端连接第I寄存器的输出端Q，第一异或门的输出端连接第I寄存器的输入端D ;第m寄存器、第m-Ι寄存器……第I寄存器的输出端Q共输出η位控制信号到压控振荡器(18);第η寄存器、第η_1寄存器、第η-2寄存器……第一寄存器、第零寄存器的时钟信号输入端以及第m寄存器、第m-1寄存器……第I寄存器的时钟信号输入端均连接比较器(12)的状态机时钟信号输出端；第η寄存器、第η-2寄存器……第一寄存器、第零寄存器的复位端CLR、第η_1寄存器的置位端SET以及第m-Ι寄存器……第1寄存器的复位端CLR和第m寄存器的置位端SET均连接复位信号，该复位信号由外部输入，比较器(12)的相同指示信号输出端连接第零或门的一个输入端，第零或门的另一个输入端连接第η寄存器的输出端Q，第零或门的输出端输出开关控制信号到控制开关(19)，控制控制开关(19)与基准电压信号连接或与可变计数器(17)连接。
4.相频率合成器分段式压控振荡器自适应频率校准电路，包括计数器(11)、比较器(12)以及状态机(13)，其特征在于: 参考时钟信号和压控振荡器的分频时钟信号同时输入计数器(11)进行计数，当其中一个时钟信号计数结束时，计数器(11)产生一个脉冲信号输出到比较器(12)； 比较器(12)收到计数器(11)输出的脉冲信号后进行比较，再根据比较结果产生指示信号并同时产生状态机时钟信号一并输出给状态机(13)； 状态机(13)受比较器(12)输出的状态机时钟信号的控制，并根据指示信号，产生控制信号输出到压控振荡器(18)，以调整压控振荡器(18)的时钟信号频率。
5.根据权利要求4所述的锁相频率合成器分段式压控振荡器自适应频率校准电路，其特征在于:所述状态机(13)包括逻辑电路(33)、寄存器组一(31)和寄存器组二(32);寄存器组一(31)和寄存器组二(32)均受比较器(12)输出的状态机时钟信号的控制；寄存器组一(31)作为存储加/减数的寄存器；逻辑电路(33)接收寄存器组一(31)输出的数据，并同时接收比较器(12)输出的指示信号，进行逻辑运算后输出到寄存器组二(32)，寄存器组二(32)产生控制信号输出到压控振荡器(18)，以调整压控振荡器(18)的时钟信号频率。
6.根据权利要求5所述的锁相频率合成器分段式压控振荡器自适应频率校准电路，其特征在于:所述寄存器组一(31)由第η寄存器、第η-1寄存器、第η_2寄存器……第一寄存器、第零寄存器组成；所述寄存器组二(32)由第m寄存器、第m-Ι寄存器……第I寄存器组成；逻辑电路由η个逻辑电路单元和第零或门构成，其中:η > 2的自然数;m=n ;每个逻辑电路单元均包括一个与门、一个或门和一个异或门；第11寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器采用串行环形连接；第η与门的I个输入端连接第η-1寄存器的输出端Q，第η与门的另1个输入端连接比较器的比较指示信号输出端；第η与门的输出端连接第η或门的一个输入端，第η或门的另一个输入端连接第η寄存器的输出端Q，第η或门的输出端连接第η异或门的一个输入端，第η异或门的另一个输入端连接第m寄存器的输出端Q，第η异或门的输出端连接第m寄存器的输入端D ;依次类推，第一与门的I个输入端连接第零寄存器的输出端Q，第一与门的另I个输入端连接比较器的比较指示信号输出端；第一与门的输出端连接第一或门的一个输入端，第一或门的另一个输入端连接第一寄存器的输出端Q，第一或门的输出端连接第一异或门的一个输入端，第一异或门的另一个输入端连接第I寄存器的输出端Q，第一异或门的输出端连接第I寄存器的输入端D ;第m寄存器、第m-Ι寄存器……第I寄存器的输出端Q共输出η位控制信号到压控振荡器；第η寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器的时钟信号输入端以及第m寄存器、第m-Ι寄存器……第I寄存器的时钟信号输入端均连接比较器(12)的状态机时钟信号输出端；第η寄存器、第η-2寄存器……第一寄存器、第零寄存器的复位端CLR、第n-1寄存器的置位端SET以及第m-Ι寄存器……第I寄存器的复位端CLR和第m寄存器的置位端SET均连接复位信号，该复位信号由外部输入，比较器(12)的相同指示信号输出端连接第零或门的一个输入端，第零或门的另一个输入端连接第η寄存器的输出端Q，第零或门的输出端输出开关控制信号到控制开关(19)，控制控制开关(19)与基准电压信号连接或与可变计数器(17)连接。
7.段式压控振荡器自适应频率校准方法，其特征在于:包括如下步骤: 将一个标准电压输入压控振荡器(18)作为压控振荡器(18)的压控电压； 将参考时钟信号和压控振荡器输出的频率信号经分频处理后得到的分频时钟信号同时输入计数器(11)进行计数； 当参考时钟信号和压控振荡器的分频时钟信号中的其中一个时钟信号计数结束时，计数器(11)产生一个脉冲信号输出到比较器(12)； 比较器(12)收到计数器(11)输出的脉冲信号后，判断压控振荡器的分频时钟信号频率与参考时钟信号频率的大小，判断结束后，产生指示信号并同时产生状态机时钟信号一并输出给状态机(13); 状态机(13)根据指示信号和状态机时钟信号，如果压控振荡器的分频时钟信号频率不等于参考时钟信号频率，则增加或减少控制信号的控制码值，并将控制信号输出到压控振荡器，如果压控振荡器的分频时钟信号频率等于参考时钟信号频率，则校准结束； 校准结束，使压控振荡器的压控电压从标准电压切换为环路滤波器(16)产生的控制电压。
8.根据权利要求7所述的分段式压控振荡器自适应频率校准方法，其特征在于:如果压控振荡器的分频时钟信号频 率不等于参考时钟信号频率，则增加或减少控制信号的控制码的值，具体为: 如果压控振荡器的分频时钟信号频率大于参考时钟信号频率，减小控制信号的控制码值；如果压控振荡器的分频时钟信号频率小于参考时钟信号频率，增大控制信号的控制码值。
9.根据权利要求8所述的分段式压控振荡器自适应频率校准方法，其特征在于:状态机(13)的具体工作步骤为: 第一步:初始化，设Ν=〗11—1，δη=2η_2;其中N为状态机输出的控制信号的控制码值，δη为状态机输出的控制信号的控制码值的调整数； 第二步:接收比较器(12)输出的信号； 第三步:判断压控振荡器的分频时钟信号频率fva)是否等于参考时钟信号频率fKEF，如果相等，进入第七步；如果不相等，判断调整数S η是否为2°，如果调整数为2°，进入第六步；如果调整数S η不为2°，进入第四步； 第四步:判断压控振荡器的分频时钟信号频率fva)是否小于参考时钟信号频率fKEF，如果是小于，调整N=N+ δ η,进入第五步；如果fTC。大于fKEF,调整N=N- δ η,进入第五步；第五步:设δ η= δ η/2,返回第二步； 第六步:判断压控振荡器的分频时钟信号频率fva)是否小于参考时钟信号频率fKEF，如果是小于，调整N=N+1,进入第七步；如果fTC。大于fKEF,调整N=N-1,进入第七步； 第七步:校准结束，使压控振荡器(18)的压控电压从标准电压切换为环路滤波器(16)产生的控制电 压。
全文摘要
本发明公开了锁相频率合成器及自适应频率校准电路和校准方法，具有自适应频率校准电路的锁相频率合成器，包括鉴频鉴相器、电荷泵、环路滤波器、可变计数器、压控振荡器、自适应频率校准电路和控制开关，其特征在于自适应频率校准电路包括计数器、比较器以及状态机；压控振荡器通过控制开关接收基准电压信号，产生频率信号输出到可变计数器；可变计数器将收到的信号进行分频处理后输出压控振荡器的分频时钟信号到计数器和鉴频鉴相器；本发明使压控振荡器输出频率首先由自适应频率校准电路输出的数字信号进行控制，使压控振荡器的分频时钟信号频率调整到与参考时钟信号频率相近，再由环路滤波器输出的控制电压进一步调整压控振荡器的频率。
文档编号H03L7/18GK103095295SQ20121058969
公开日2013年5月8日 申请日期2012年12月28日 优先权日2012年12月28日
发明者徐骅, 李明剑, 刘永光, 吴炎辉, 范麟, 万天才 申请人:重庆西南集成电路设计有限责任公司