一种存储装置的制作方法

本发明实施例涉及一种存储装置，具体涉及一种用在印刷电路板PCB上存储装置，以及一种电子装置包括所述存储装置。

背景技术：

在设计PCB时，一个问题是如何布线所有的连接线，尤其是当将中央处理器(CPU)连接到存储芯片时，会出现该问题。存储芯片通常是对称的并且具有多个接脚。存储芯片的每个接脚都必须连接到CPU。由于时序要求，分组或成对的连接线必须具有相同的长度，这通常通过使用T型分支拓扑来实现。图1显示了使用对称和非对称T型分支拓扑的PCB布局示例。T型分支拓扑的一个缺点是额外的短截线和短截线长度，会增加了命令和地址线的长度以及数据和选通总线长度。这将抑制信号的有效传输速度。更具体地说，随着地址线和数据总线的延长，传输线效应增加，这限制了有效信号速度。此外，当使用越来越多的存储芯片，并且在每个存储芯片上具有多个接脚时，将所有连接线容纳在PCB的有限区域中是一个挑战。

US5260892公开了一种方法，可以在不显著增加信号迹线长度的情况下使随机存取存储(RAM)芯片的密度加倍。如图2所示，RAM芯片65安装在双面电路板66上，双面电路板的另一侧安装有镜像RAM芯片67。除了RAM芯片的引线是镜像RAM芯片的引线的镜像之外，RAM芯片65与镜像RAM芯片67相同。也就是说，在该示例中，从芯片的顶部看，RAM芯片65的前左接脚68具有与镜像RAM芯片67的前右接脚69相同的电子功能。RAM芯片65跟于其镜像RAM芯片67以这样的方式彼此相对地安装在电路板66上，使得RAM芯片65的左前接脚68通过电路板66上的通孔70与其镜像RAM芯片67的右前接脚69电连接，该通孔70还电连接到接通两个接脚的信号迹线71。类似地，RAM芯片65的左前部的第二接脚72对应于镜像RAM芯片67的右前部的第二接脚73等。

然而，迹线71位于PCB的一侧，因此RAM芯片65和RAM芯片67的总连接迹线的长度不同，即差别于通孔的长度。对于厚度例如为1.6mm的PCB，这是显著差异。这样的厚度可能相当于8-9皮秒的时间差，而这需要跟与许多规格中所要求的约3皮秒的精度进行比较。此外，两个RAM芯片仍然是两个单独的芯片。此外，目前市场上仍然没有这样的镜像存储芯片，以至于它们可以直接成对地使用放置于PCB的各一侧。

US2005097249公开了一种安装在电路板的正面和背面表面上的两个存储器装置。存储器装置安装在电路板上，使得来自一个存储器装置的至少一些接脚与另一个存储器装置的至少一些接脚对准，以提供对齐的接脚对。通孔设置在电路板中在对齐的接脚对之间延伸，并连接各个接脚。

US2014301125公开了一种包括多个半导体存储器件和电路板的存储器模块。电路板电连接到多个半导体存储器件，并且信号线设置在电路板的最外层中。信号线的电参考由电路板的不与最外层相邻的层而提供。相应地，信号线的阻抗可以增加，并且可以改善通过信号线传输的信号整体性。

技术实现要素：

鉴于上述，本申请实施例的目的是提供一种改进的方法和装置,以及用于排布和连接PCB上的存储芯片。

本发明申请是通过一种存储装置实现的。该存储装置包括印刷电路板PCB和位于所述PCB上的至少两个存储芯片，其中第一存储芯片位于所述PCB的第一表面上，第二存储芯片位于所述PCB的第二表面上；并且其中每个存储芯片是以中心轴对称，使得每个存储芯片被所述中心轴分割的第一半部分和第二半部分上的接脚按照其功能彼此镜像对称。且所述第二存储芯片的位置与所述第一存储芯片背靠背，使得在所述第一存储芯片和第二存储芯片上具有相同功能的各接脚的位置彼此相对。且所述第一和第二存储芯片上的具有地址，命令和时钟中的任一个功能的各接脚，通过各镀层PTH通孔跟位于所述PCB中心层上的各信号迹线连接。

本申请还提供一种用于排布PCB上的存储芯片的方法，其中，各存储芯片是相对中心轴线对称，使得每个存储芯片被所述中心轴线分割的第一半部分和第二半部分上的接脚按照其功能彼此镜像对称。所述方法包括：将第一存储芯片排布在所述PCB的第一表面上，将第二存储芯片排布在所述PCB的第二表面上，与所述第一存储芯片背靠背，使得在所述第一存储芯片和第二存储芯片上具有相同功能的各接脚的位置彼此相对。且通过各镀层PTH通孔将所述第一和第二存储芯片上的具有地址，命令和时钟中的任一个功能的各接脚跟位于所述PCB中心层上的各信号迹线连接。

进一步地，两个存储芯片被背对背地排布在所述PCB所述相对的表面上。所述第二存储芯片被调整方向，使得所述第一存储芯片和所述第二存储芯片上具有相同功能的各接脚，例如命令接脚，地址接脚，数据接脚，时钟接脚，电源接脚，接地接脚等，彼此相对地排布。因此所述第一和第二存储芯片上具有相同功能的每对接脚可以通过单个通孔连接在一起，然后连接到所述PCB的所述两个相对的表面之间的各个信号迹线，例如命令线，地址线，数据总线，时钟总线，电源平面，接地平面等。这种排布基于的想法是，使用两个物理存储封装构建出一个虚拟存储封装。因此，存储器的排布不再受物理封装的限制。所述两个物理存储芯片的各自一半可以一起形成一个存储单元。以这种方式，所述第二存储芯片可以看作与所述第一存储芯片镜像对称。由于对称性并且背对背地放置在PCB的两个表面上，用于将两个存储芯片连接到CPU的T型分支被缩减为通孔。因此，连接线的布局占用较少的空间，拓扑结构不太复杂，有效地避免了T型分支。此外，两个存储芯片的信号迹线的总长度没有差别。

通过本发明中的这种解决方案，由于拓扑结构不再复杂，使得信号整体性更好，对PCB面积的要求更小，制造成本较低。

本申请还提供一种电子设备实现，该电子设备包括采用本申请实施例的存储装置。

附图说明

图1是根据现有技术的T型分支拓扑的示意性布局图；

图2是根据现有技术的具有两个存储芯片的PCB侧切示意图；

图3是具有接脚功能的存储芯片示例示意性俯视图；

图4是根据本申请实施例的存储装置透视示意图；

图5是根据本申请实施例PCB的连接层分布的示例性的侧切示意图，用于将存储装置连接到CPU；图6是包含根据本申请实施例存储装置的电子设备框图；

图7是在PCB上排布存储芯片的方法流程图。

具体实施方式

图3是一种存储芯片300的示意性俯视图，存储芯片300包含具有多个接脚。不同的接脚用不同的形状或符号示出，以标识其功能。例如，与地平面相连的具有接地功能GND的接脚，用实心圆点符号表示；与电源平面相连的具有供电功能VCC的接脚，用圆圈符号表示；与数据总线连接的具有数据功能DATA的接脚，用方形符号表示；与时钟总线连接的具有时钟功能CLK的接脚，用倒三角形符号表示；与命令/地址线连接的具有命令和地址功能CMD/ADDR的接脚，用三角形符号表示。存储芯片300可以是任何对称的存储芯片，例如，低功率双倍数据速率(LPDDR)4内存芯片。存储芯片300以中心轴线，例如，如图3所示的X轴或Y轴对称。这意味着存储芯片300可以沿着垂直轴线Y或水平轴线X被虚拟地分割为第一半部分和第二半部分。该第一半部分和第二半部分上的接脚按其功能彼此镜像对称。在图3所示的示例中，沿着X轴分割的第一半部分和第二半部分上的接脚以其功能彼此镜像对称。此外，从芯片300的顶部看，左上方的接脚被示为接脚1，左下方的接脚被示为接脚14。

图4示出了包括本实施例的存储芯片的一种存储装置400。如图4所示，存储装置400包括排布在PCB上的至少两个存储芯片M1，M2。第一存储芯片M1排布在PCB的第一表面上，第二存储芯片M2排布在PCB的第二表面上。第二存储芯片M2与第一存储芯片M1背对背放置，且方向被调整，使得在第一存储芯片M1和第二存储芯片M2上具有相同功能的各个接脚的位置彼此相对。例如，如图3所示的所述第一个存储芯片M1上的命令接脚CMD，地址接脚ADDR，数据接脚DATA，时钟接脚CLK，电源接脚VCC，接地接脚GND等，与所述第二存储芯片M2上的命令接脚CMD，地址接脚ADDR，数据接脚DATA，时钟接脚CLK，电源接脚VCC，接地接脚GND等位置彼此相对。由于在所述第一和第二存储芯片上具有相同功能的接脚位置彼此相对，所以每对接脚可以通过通孔连接在一起，然后连接到位于所述PCB的所述第一和第二表面之间的相应的信号迹线，诸如命令线，地址线，数据总线，时钟总线，电源平面，接地平面等。

类似于图3所示的实施例，图4示出了上述第二存储芯片M2围绕其中心点旋转180°的实施例，使得所述第一存储芯片M1的第一半部分与所述第二存储芯片M2的第一半部分的位置相对，第一存储芯片M1的第二半部分与第二存储芯片M2的第二半部分的位置相对。这里，每个存储芯片M1，M2的第一半部分和第二半部分是指被沿着上述Y轴分割的两个半部分。本领域技术人员可以理解，取决于存储芯片的结构，以上同样适用于沿着所述X轴分割的两个半部分。换句话说，例如，从芯片M1，M2的顶部看，以图3为例，M1的左上方的接脚Pin1将与M2的左下方的接脚Pin14位置相对，且M2的左上方的接脚Pin1将与M1的左下方接脚Pin14的位置相对。尽管这两个接脚位于该存储芯片的不同位置，但是它们具有相同的电功能，例如，都是接地接脚。

因此，本申请的实施例所基于的想法是，使用两个物理存储封装构建出一个虚拟存储封装。这通过将存储芯片看作具有两个半部分的对称存储芯片来实现，且将两个这样的存储芯片在PCB每一侧各放一个，使得这两个存储芯片各自的一半组成一个存储单元。以这种方式，上述第二存储芯片M2可以看作与上述第一存储芯片M1镜像对称。

由于对称性并且背靠背地放置在PCB的两个表面上，在现有技术中，用于将两个存储芯片连接的使用T型分支被降低到到仅仅为通孔的长度。图5示出了在该PCB的不同层上分布信号迹线的实施例。

根据一些实施例，上述第一和第二存储芯片M1，M2上的设置有例如地址ADDR，命令CMD和时钟CLK功能的相应接脚，可以通过镀层PTH通孔连接到相应的信号迹线，例如命令线，地址线，时钟总线，排布在上述PCB的中心层510上。由于这些信号迹线的时序很重要且对干扰敏感，通过将它们放在中心层上，它们与M1和M2设置有相同的距离。以这种方式，保证了M1和M2相同的信号传输长度和对称性。如图5所示，PTH通孔直接穿过上述PCB的所有层。

根据一些实施例，上述第一和第二存储芯片M1，M2上的电源接脚VCC，可以通过PTH通孔连接到位于PCB中心层510上方的第一层520上的电源平面。该电源平面也可以放置在所述PCB中心层下方。因此，根据上述PCB的朝向，本申请中使用的术语“上/下”应被视为非限制性的。

根据一些实施例，上述第一和第二存储芯片M1，M2上的接地接脚GND可以通过PTH通孔连接到位于PCB中心层下方的第二层530上的接地平面。

通常，在PCB的顶部和底部表面上有印刷或电镀的金属层或金属迹线，可用作上述PCB每一表面上排布的部件的接地平面，如图5所示。

根据一些实施例，在上述第一存储芯片M1上具有DATA功能的接脚可以通过微孔连接到位于PCB中心层上方的第三层540上的至少一个数据总线。微孔是盲孔或埋孔，通常在一个位置经过一个或多个层，根据实际情况需要，在另一个位置通过另一个或多个层，用于连接迹线以避免与其他连接相交。

根据一些实施例，在所述第二存储芯片M2上具有DATA功能的接脚可以通过微孔连接到位于PCB中心层下方的第四层550上的至少一个数据总线。

根据一些实施例，如果一个CPU需要一个存储芯片，另一个CPU或另一个单元需要另一个存储芯片，则可以组合所述第一存储芯片M1的第一半部分和所述第二存储芯片M2的第一半部分，使其成为第一虚拟物理存储单元，连接到第一中央处理单元CPU。上述第一存储芯片M1的第二半部分和上述第二存储芯片M2的第二半部分可以组合成为第二虚拟物理存储单元，连接到第二CPU或另一个单元。

根据一些实施例，当CPU具有两个存储接口时，上述第一存储芯片的第一半部分和上述第二存储芯片的第一半部分可以被组合为第一虚拟物理存储单元，用于连接到该CPU的第一存储接口；且上述第一存储芯片的第二半部分和上述第二存储芯片的第二半部分可以被组合为第二虚拟物理存储单元，用于连接到该CPU的第二存储接口。

根据一些实施例，上述第一存储芯片M1和上述第二存储芯片M2可以被组合成一个虚拟物理存储单元，用于连接到CPU。以这种方式，例如，32位存储可以扩展到64位存储，并连接到该CPU。

根据本申请实施例的存储装置400，500适合于需要存储器的任何电子设备。图6示出了包含根据本申请实施例存储装置400，500的电子装置600。电子设备600可以是计算机，便携式计算机，平板电脑，无线通信设备，无线数据采集设备，照相机，例如监控摄像机，网络录像机，家庭自动化设备，数据记录器，视频编码器，实体进出控制器，门岗设备等。上述电子设备600包括PCB610，该PCB610包括根据本申请实施例的存储装置620。电子设备600可以包括其他单元，例如用于与该存储装置620进行通信和信号处理等的处理单元630。

如图7所示为用于在上述PCB上排布存储芯片的相应方法。该方法包括以下步骤：

步骤701：将第一存储芯片M1排布在上述PCB的第一表面上。

步骤702：将第二存储芯片M2排布在上述PCB的第二表面上，跟上述第一存储芯片背靠背。

步骤703：调整所述第二存储芯片M2的方向，使得在上述第一存储芯片和上述第二存储芯片上具有相同功能的相应接脚位置彼此相对，且通过通孔连接到位于该PCB的上述第一和第二表面之间的相应信号迹线。

总而言之，本申请实施例的上述存储装置400，500具有以下优点，包括：

首先，由于在PCB的两个表面上背靠背地放置两个存储芯片，所以第一和第二存储芯片上的相应接脚位置彼此相对，现有技术中连接两个存储芯片到CPU的T型分支被取代为通孔的形式。因此，信号迹线是对称的，并且比现有技术的解决方案中短得多。因此，降低了传输线效应，提高了信号速度。

其次，由于T型分支被取代了，拓扑结构变得不太复杂，PCB面积要求较小。面积可能减少30-40％。这会使得制造成本降低。

此外，由于存储芯片位于上述PCB每一侧，热量可以在两个方向上散开，这改善了PCB的热特性。

此外，还可以改善供电分布。

当使用“包含”或“包括”一词时，它应被解释为非限制性的，即意为“至少包括”。

这里的实施例不限于上述优选实施例。可以使用各种替代方案，修改和等同替换。因此，上述实施例不应被视为用于限制本发明的保护，本发明的保护范围由所附权利要求而限定。