芯片封装结构的制作方法

芯片封装结构的制作方法【专利摘要】本发明提供一种芯片封装结构的制作方法，包括下列步骤。首先，提供承载器。承载器具有金属层。接着，形成图案化光阻层于金属层上。图案化光阻层具有多个第一开口以暴露部份金属层。接着，分别形成多个连接端子于第一开口内，且连接端子连接金属层。接着，将芯片设置于承载器上，并通过多个连接导体分别连接连接端子与芯片的多个第一接垫。接着，将芯片设置于承载器上后，移除图案化光阻层。之后，形成封装材料于承载器上。封装材料包覆芯片、连接导体以及金属层。接着，移除承载器以及金属层，以暴露连接端子。【专利说明】【
技术领域：
】[0001]本发明是有关于一种封装结构的制作方法，且特别是有关于一种芯片封装结构的制作方法。芯片封装结构的制作方法【
背景技术：
】[0002]近年来，随着电子技术的日新月异，以及高科技电子产业的相继问世，使得更人性化、功能更佳的电子产品不断地推陈出新，并朝向轻、薄、短、小的趋势迈进。在此趋势之下，由于电路板具有布线细密、组装紧凑及性能良好等优点，因此电路板便成为承载多个电子元件(例如：芯片）以及使这些电子元件彼此电性连接的主要媒介之一。[0003]倒装式（flipChip)封装是芯片与电路板封装的一种方式。电路板上具有多个接垫，且电路板可借由配置于接垫上的焊料以回焊的方式与芯片作电性连接。近年来，由于电子元件(例如芯片）之间所需传递的信号日益增加，因此电路板所需具有的接垫数也日益增加，然而，电路板上的空间有限，因此接垫之间的间距朝向微间距（finepitch)发展。[0004]在已知技术中，芯片封装结构包括芯片、基板、多个接垫、防焊层以及多个焊料凸块。接垫配置于基板的表面上。防焊层覆盖基板的表面，并具有多个焊罩定义型（SolderMaskDefined，SMD)开口，其中这些开口分别暴露出这些接垫。这些焊料凸块分别覆盖于这些接垫上且分别突出于这些开口外。接着再以回焊的方式使基板与芯片借由配置于两者之间的这些焊料凸块电性与结构性连接。[0005]然而，为了符合接垫微间距的趋势，防焊层的开口孔径也随之缩小，导致开口的纵横比增加，更不利于印刷或植入大尺寸的焊料凸块，亦提高了焊料凸块与接垫间的对位困难度。同时，当在这些接垫上配置大尺寸的焊料凸块并与芯片以回焊的方式接合时，这些焊料凸块会因回焊受热而呈现熔融状态，由于这些接垫是以微间距排列于基板的表面上，因此容易导致回焊过程中呈熔融状态的焊料凸块发生桥接现象及短路问题，而无法提供微间距的电性连接结构。【
发明内容】[0006]本发明提供一种芯片封装结构的制作方法，其可提高焊料与接垫间的对位精准度，以及避免回焊焊料时发生焊料桥接短路的现象。[0007]本发明更提供一种芯片封装结构的制作方法，其可于形成接垫时，同时形成重配置线路层，以简化工艺，提高生产效率。[0008]本发明的芯片封装结构的制作方法包括下列步骤。首先，提供承载器。承载器具有金属层。接着，形成图案化光阻层于金属层上。图案化光阻层具有多个第一开口以暴露部份金属层。接着，分别形成多个连接端子于第一开口内，且连接端子连接金属层。接着，将芯片设置于承载器上，并通过多个连接导体分别连接连接端子与芯片的多个第一接垫。接着，将芯片设置于承载器上后，移除图案化光阻层。之后，形成封装材料于承载器上。封装材料包覆芯片、连接导体以及金属层。接着，移除承载器以及金属层，以暴露连接端子。[0009]本发明的芯片封装结构的制作方法包括下列步骤。首先，提供承载器。承载器具有金属层。接着，形成图案化光阻层于金属层上。图案化光阻层暴露部份金属层。接着，形成第一重配置线路层于被图案化光阻层暴露的金属层上。第一重配置线路层包括多个连接端子以及至少一导线图案。导线图案连接对应的连接端子。之后，移除图案化光阻层。接着，将芯片设置于承载器上，并通过多个连接导体分别连接连接端子与芯片的多个第一接垫。接着，形成封装材料于承载器上。封装材料包覆芯片、连接导体、第一重配置线路层以及金属层。接着，移除承载器以及金属层，以暴露第一重配置线路层。[0010]基于上述，本发明的芯片封装结构工艺是在芯片通过连接导体与承载器的连接端子接合后，才移除图案化光阻层，不但有益于提升连接导体与连接端子的对位精准度，更可减少连接导体与连接端子在接合过程中发生焊料桥接进而造成短路的现象。此外，本发明的芯片封装结构工艺亦可在形成连接端子时，同步形成与连接端子连接的导线图案，以对连接端子的电性接点进行重新配置，因而可减少后续的重配置线路层的制作次数。因此，本发明不但可节省制造成本，更可提升工艺的良率及效率。[0011]为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合所附附图详细说明如下。【专利附图】【附图说明】[0012]图1A至图1J是依照本发明一实施例的一种芯片封装结构的制作方法的流程剖面示意图。[0013]图2A至图2G是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面不意图。[0014]图3A至图31是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面不意图。[0015]图4A至图41是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面不意图。[0016]【符号说明】[0017]100、200、300、400:芯片封装结构[0018]110:承载器[0019]112:金属层[0020]120、320、420:图案化光阻层[0021]122、322:第一开口[0022]130、230、330、432:连接端子[0023]140:芯片[0024]142:第一接垫[0025]15〇、25〇、35〇、45〇:连接导体[0026]152:焊帽[0027]160、460:封装材料[0028]170:重配置线路层[0029]172、472:第一保护层[0030]174、474:图案化导线层[0031]176、476:第二保护层[0032]178、478:焊垫[0033]180:第二焊球[0034]332:润湿层[0035]430:第一重配置线路层[0036]434:导线图案[0037]470:第二重配置线路层【具体实施方式】[0038]图1A至图1J是依照本发明一实施例的一种芯片封装结构的制作方法的流程剖面示意图。请先参照图1A及图1B，本实施例的芯片封装结构的制作方法包括下列步骤：首先，提供承载器110,其中，承载器110具有金属层112。接着，形成图案化光阻层120于金属层112上。图案化光阻层如图1B所示具有多个第一开口122,以暴露部份金属层112。接着，请参照图1C，分别形成多个连接端子130于第一开口122内，且连接端子130连接金属层112。接着，请同时参照图1D以及图1E，将芯片140设置于承载器110上，并通过多个连接导体150分别与连接端子130及芯片140的多个第一接垫142连接。在本实施例中，上述的连接导体150是预先形成于芯片140的第一接垫142上，形成连接导体150的方式例如是电镀或溅镀。之后，再与连接端子130形成电性连接，其中，连接导体150与连接端子130的电连接方式，例如是通过回焊、热压合或超声波焊接等方式进行接合。在本实施例中，连接端子130为设置于承载器110上的第二接垫，而连接导体150为导电柱，其材质可为金、银、铜或其它类似的导电材质。于其它较佳的实施例中，导电柱顶部可预先形成焊帽152或亦可于连接端子130上预先形成焊帽(未绘示)，以供焊接接合。当然，本实施例仅作为举例说明之用，本发明并不限制连接导体以及连接端子的种类。[0039]此外，将芯片140设置于承载器110上的步骤可包括先提供晶圆（未绘示)，而此晶圆包括多个彼此连接且阵列排列的芯片，接着再切割晶圆以使上述的多个芯片彼此分离。接着再将彼此分离的芯片的其中之一(也就是芯片140)设置于承载器110上。而连接导体150亦可在晶圆切割前，先形成于其彼此连接且阵列排列的芯片的第一接垫上。[0040]请接续参照图1F，在将芯片140设置于承载器110上后，移除如图1E所示的图案化光阻层120。之后，再如图1G所示形成封装材料160于承载器110上。封装材料160包覆芯片140、连接导体150、连接端子130以及金属层112。接着，再移除如图1G所示的承载器110以及金属层112,以如图1H所示暴露出连接端子130。[0041]请接续参照图II，在暴露出连接端子130后，形成重配置线路层170,其中，重配置线路层170覆盖封装材料160的部分区域，并且与暴露出的连接端子130电性连接，以对连接端子130与外部电子元件进行电性连接的接点位置进行重新配置。在本实施例中，形成重配置线路层170的步骤可包括下列步骤：首先，形成第一保护层172,其中第一保护层172覆盖封装材料160的部分区域，并且暴露连接端子130。接着，形成图案化导线层174于第一保护层172以及连接端子130上，其中图案化导线层174如图II所示覆盖第一保护层172的部份区域并与连接端子130连接。接着，再形成第二保护层176于第一保护层172以及图案化导线层174上，其中第二保护层176暴露部份图案化导线层174。之后，再形成多个焊垫178于图案化导线层174上，且焊垫178分别连接第二保护层176暴露出的图案化导线层174。如此，芯片140的接点位置即可通过重配置线路层170由连接端子130的位置重新配置到焊垫178的位置，以与外部电子元件进行电性连接。形成上述图案化导線层174及焊垫178的方式例如为电镀或溅镀等方式。[0042]接着，再如图1J所示，分别形成多个第二焊球180于焊垫178上。如此，即初步完成芯片封装结构100的制作。本实施例的芯片封装结构工艺是在芯片140设置于承载器110上后，才移除图案化光阻层120,不但有益于提升连接导体150与连接端子130的对位精准度，更可减少连接导体150与连接端子130在接合过程中发生焊料桥接进而造成短路的现象。[0043]图2A至图2G是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面示意图。在此须说明的是，本实施例沿用前述实施例的元件标号与部分内容，其中采用相同的标号来表示相同或近似的元件，并且省略了相同技术内容的说明。关于省略部分的说明可参照前述实施例，本实施例不再重复赘述。[0044]本实施例的芯片封装结构的制作方法沿用前述实施例中的图1A至图1C的步骤，也就是说，本实施例的芯片封装结构的制作方法包括先执行如前述实施例中的图1A至图1C的步骤，在形成如图1C所示的连接端子130于图案化光阻层120的第一开口122内后，再接续参照图2A及图2B，将芯片140设置于承载器110上，并通过多个连接导体250分别与连接端子130及芯片140的多个第一接垫142连接。在本实施例中，连接端子130如前一实施例所述为第二接垫，而连接导体250则为第一焊球。连接导体250可例如预先形成于芯片140的第一接垫142上，再与连接端子130形成电性连接，且连接导体250与连接端子130以及连接导体250与第一接垫142之间是通过回焊、热压合、超声波焊接等方式进行接合。于另一较佳的实施例中，连接导体250可采用电镀、溉镀、网版印刷或置球（balldrop)的方式形成于第一接垫142上。值得注意的是，由于图案化光阻层120于此阶段尚未移除，再加上连接端子130的形成厚度可较图案化光阻层120为低，因此于接合时，该图案化光阻层120具有辅助芯片140的连接导体250定位于连接端子130的效果。[0045]接着，请接续参照图2C，在将芯片140设置形成于承载器110上后，移除如图2B所示的图案化光阻层120。之后，再如图2D所示形成封装材料160于承载器110上。封装材料160如前一实施例所述包覆芯片140、连接导体250、连接端子130以及金属层112。接着，再移除如图2D所示的承载器110以及金属层112,以如图2E所示暴露出连接端子130。[0046]接着，请参照图2F，在暴露出连接端子130后，形成重配置线路层170,其中，重配置线路层170如前一实施例所述包括第一保护层172、图案化导线层174、第二保护层176以及焊垫178。至于重配置线路层170的详细配置方式以及制作过程可参照前一实施例所述，于此不再赘述。接着，再如图2G所示，分别形成多个第二焊球180于焊垫178上，使芯片140的接点位置能通过重配置线路层170由连接端子130的位置重新配置到焊垫178的位置，并通过第二焊球180与外部电子元件进行电性连接。如此，即初步完成芯片封装结构200的制作。[0047]图3A至图31是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面示意图。在此须说明的是，本实施例沿用前述实施例的元件标号与部分内容，其中采用相同的标号来表示相同或近似的元件，并且省略了相同技术内容的说明。关于省略部分的说明可参照前述实施例，本实施例不再重复赘述。[0048]本实施例的芯片封装结构的制作方法沿用前述实施例中的图1A的步骤，也就是说，本实施例的芯片封装结构的制作方法包括先如图1A所示提供具有金属层112的承载器110后，再接续参照图3A，形成图案化光阻层320于金属层112上。图案化光阻层320如图3A所示具有多个第一开口322,以暴露部份金属层112。接着，请参照图3B，分别形成多个连接端子330于第一开口322内，且连接端子330连接金属层112。在本实施例中，连接端子330为导电凸块，因此，用以形成连接端子330的图案化光阻层320的厚度可实质上大于前述的图案化光阻层120的厚度。连接端子330的形成方式可为电镀、溅镀或网版印刷等。接着，请参照图3C及图3D，将芯片140设置于承载器110上，并通过多个连接导体350分别与连接端子330及芯片140的多个第一接垫142连接。在本实施例中，连接导体350为第一焊球。连接导体350可例如先形成于芯片140的第一接垫142上，再以覆晶方式与连接端子330形成电性连接。于较佳的实施例中，连接导体350与连接端子330的接合面上进一步设置有一层可辅助接合的润湿层332(wettablelayer),例如是镍、金或有机助焊剂(organicsolderabilitypreservation,0SP)，且连接导体350与连接端子330以及连接导体350与第一接垫142之间是通过回焊、热压合或超声波焊接等方式进行接合。值得注意的是，由于图案化光阻层320于此阶段尚未移除，因此具有辅助芯片140的连接导体350定位于连接端子330的效果。[0049]接着，请接续参照图3E，在将芯片140设置于承载器110上后，移除如图3D所示的图案化光阻层320。之后，再如图3F所示形成封装材料160于承载器110上。封装材料160如前一实施例所述包覆芯片140、连接导体350、连接端子330以及金属层112。接着，再移除如图3F所示的承载器110以及金属层112,以如图3G所示暴露出连接端子330。[0050]接着，请参照图3H，在暴露出连接端子330后，形成重配置线路层170,其中，重配置线路层170如前述实施例所述包括第一保护层172、图案化导线层174、第二保护层176以及焊垫178。至于重配置线路层170的详细配置方式以及制作过程可参照前述实施例，于此不再赘述。接着，再如图31所示，分别形成多个第二焊球180于焊垫178上，使芯片140的接点位置能通过重配置线路层170由连接端子330的位置重新配置到焊垫178的位置，并通过第二焊球180与外部电子元件进行电性连接。如此，即初步完成芯片封装结构300的制作。[0051]图4A至图41是依照本发明另一实施例的一种芯片封装结构的制作方法的部份流程剖面示意图。在此须说明的是，本实施例沿用前述实施例的元件标号与部分内容，其中采用相同的标号来表示相同或近似的元件，并且省略了相同技术内容的说明。关于省略部分的说明可参照前述实施例，本实施例不再重复赘述。[0052]本实施例的芯片封装结构的制作方法沿用前述实施例中的图1A的步骤，也就是说，本实施例的芯片封装结构的制作方法包括先如图1A所示提供具有金属层112的承载器110后，再接续参照图4A，形成图案化光阻层420于金属层112上。图案化光阻层420暴露部份金属层112。接着，如图4B所示，形成第一重配置线路层430于被图案化光阻层420暴露的金属层112上。第一重配置线路层430包括多个连接端子432以及至少一导线图案434。导线图案434如图4B所示连接对应的连接端子432。在本实施例中，连接端子432为第二接垫。请参照图4C，移除图4B所示的图案化光阻层420,并如图4D及图4E所示，将芯片140设置于承载器110上，且通过多个连接导体450分别连接连接端子432与芯片140的多个第一接垫142。在本实施例中，连接导体450为第一焊球，当然，本发明并不以此为限，在其他实施例中，连接导体亦可为导电柱。连接导体450可例如先形成于芯片140的第一接垫142上，再与连接端子432形成电性连接，且连接导体450与连接端子432以及连接导体450与第一接垫142的间是通过回焊、热压合或超声波焊接等方式进行接合。[0053]此外，将芯片140设置于承载器110上的步骤可如前所述包括先提供晶圆（未绘示)，而此晶圆包括多个彼此连接且阵列排列的芯片，接着再切割晶圆以使上述的多个芯片彼此分离。接着再将彼此分离的芯片的其中之一(也就是芯片140)设置于承载器110上。而连接导体150亦可在晶圆切割前，先形成于其彼此连接且阵列排列的芯片的第一接垫上。[0054]请接续参照图4F，形成封装材料460于承载器110上。封装材料460包覆芯片140、连接导体450、第一重配置线路层430以及金属层112。接着，移除图4F所示的承载器110以及金属层112,以如图4G所示暴露出第一重配置线路层430。[0055]请接续参照图4H，暴露出第一重配置线路层430后，形成第二重配置线路层470，其中第二重配置线路层470覆盖封装材料460的部分区域，并且与第一重配置线路层430电性连接，以对连接端子432与外部电子元件进行电性连接的接点位置进行重新配置。在本实施例中，形成第二重配置线路层470的步骤可包括下列步骤：首先，形成第一保护层472,其中第一保护层472覆盖封装材料460的部分区域，并且暴露连接端子432以及部份导线图案434。接着，形成图案化导线层474于第一保护层472以及连接端子432上，其中图案化导线层474覆盖第一保护层472的部份区域并连接第一保护层472暴露出的连接端子432以及部份导线图案434。之后，形成第二保护层476于第一保护层472以及图案化导线层474上，其中第二保护层476暴露部份图案化导线层474。接着再形成多个焊垫478于图案化导线层474上。焊垫478分别连接第二保护层476暴露出的图案化导线层474。[0056]接着，再如图41所示，分别形成多个第二焊球180于焊垫478上。如此，即初步完成芯片封装结构400的制作。本实施例的芯片封装结构工艺在形成连接端子432时，同步形成与连接端子432连接的导线图案434,以对连接端子432的电性接点进行重新配置。因此可减少后续的重配置线路层的制作次数及节省成本，进而提升工艺效率。[0057]综上所述，本发明的芯片封装结构工艺是在芯片通过连接导体与承载器的连接端子接合后，才移除图案化光阻层，不但有益于提升连接导体与连接端子的对位精准度，更可减少连接导体与连接端子在接合过程中发生焊料桥接进而造成短路的现象。此外，本发明的芯片封装结构工艺亦可在形成连接端子时，同步形成与连接端子连接的导线图案，以对连接端子的电性接点进行重新配置，因而可减少后续的重配置线路层的制作次数。因此，本发明不但可提升工艺良率，更可提升工艺的效率。[0058]虽然本发明已以实施例揭露如上，然其并非用以限定本发明，任何所属【
技术领域：
】中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视权利要求所界定者为准。【权利要求】1.一种芯片封装结构的制作方法，其特征在于包括：提供承载器，该承载器具有金属层；形成图案化光阻层于该金属层上，该图案化光阻层具有多个第一开口以暴露部份该金属层；分别形成多个连接端子于该多个第一开口内，且该多个连接端子连接该金属层；将芯片设置于该承载器上，并通过多个连接导体分别连接该多个连接端子与该芯片的多个第一接垫；将该芯片设置于该承载器上后，移除该图案化光阻层；形成封装材料于该承载器上，该封装材料包覆该芯片、该多个连接导体以及该金属层；以及移除该承载器以及该金属层，以暴露该多个连接端子；在移除该金属层之后，形成重配置线路层，其中该重配置线路层覆盖该封装材料的部分区域，并且与该多个连接端子电性连接。2.如权利要求1所述的芯片封装结构的制作方法，其特征在于，在该多个连接端子与该多个第一接垫通过该多个连接导体连接之前，该多个连接导体是先形成于该多个第一接垫上。3.如权利要求1所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为导电柱，该多个连接端子为第二接垫。4.如权利要求1所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为第一焊球，该多个连接端子为第二接垫。5.如权利要求2所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为第一焊球，该多个连接端子为导电凸块。6.如权利要求1所述的芯片封装结构的制作方法，其特征在于，在该多个连接端子与该多个第一接垫通过该多个连接导体连接之前，该多个连接导体是形成于该多个连接端子上。7.如权利要求5所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为多个第一焊球，该多个连接端子为导电凸块。8.如权利要求1所述的芯片封装结构的制作方法，其特征在于，该多个连接导体与该多个连接端子之间是通过回焊、热压合或超声波焊接进行接合。9.如权利要求1所述的芯片封装结构的制作方法，其特征在于，该多个连接导体是利用电镀、溅镀、印刷或置球方式形成于该多个第一接垫上。10.如权利要求1所述的芯片封装结构的制作方法，其特征在于，形成该重配置线路层的步骤更包括：形成第一保护层，其中该第一保护层覆盖该封装材料的部分区域，并且暴露该多个连接端子；形成图案化导线层于该第一保护层以及该多个连接端子上，其中该图案化导线层覆盖该第一保护层的部份区域并连接该多个连接端子；以及形成第二保护层于该第一保护层以及该图案化导线层上，其中该第二保护层暴露部份该图案化导线层；以及形成多个焊垫于该图案化导线层上，该多个焊垫分别连接该第二保护层暴露出的该图案化导线层。11.如权利要求10所述的芯片封装结构的制作方法，其特征在于，更包括：分别形成多个第二焊球于该多个焊垫上。12.-种芯片封装结构的制作方法，其特征在于包括：提供承载器，该承载器具有金属层；形成图案化光阻层于该金属层上，该图案化光阻层暴露部份该金属层；形成第一重配置线路层于被该图案化光阻层暴露的该金属层上，该第一重配置线路层包括多个连接端子以及至少一导线图案，该至少一导线图案连接对应的至少一连接端子；移除该图案化光阻层；将芯片设置于该承载器上，并通过多个连接导体分别连接该多个连接端子与该芯片的多个第一接垫；形成封装材料于该承载器上，该封装材料包覆该芯片、该多个连接导体、该第一重配置线路层以及该金属层；移除该承载器以及该金属层，以暴露该第一重配置线路层。13.如权利要求12所述的芯片封装结构的制作方法，其特征在于，在该多个连接端子与该多个第一接垫通过该多个连接导体连接之前，该多个连接导体是形成于该多个第一接垫上。14.如权利要求12所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为导电柱，该多个连接端子为第二接垫。15.如权利要求12所述的芯片封装结构的制作方法，其特征在于，该多个连接导体为第一焊球，该多个连接端子为第二接垫。16.如权利要求12所述的芯片封装结构的制作方法，其特征在于，该多个连接导体与该多个连接端子之间是通过回焊、热压合或超声波焊接进行接合。17.如权利要求12所述的芯片封装结构的制作方法，其特征在于，该多个连接导体是利用电镀、溅镀、印刷或置球方式形成于该多个第一接垫上。18.如权利要求12所述的芯片封装结构的制作方法，其特征在于，更包括：移除该金属层后，形成第二重配置线路层，其中该重配置线路层覆盖该封装材料的部分区域，并且与该第一重配置线路层电性连接。19.如权利要求18所述的芯片封装结构的制作方法，其特征在于，形成该第二重配置线路层的步骤更包括：形成第一保护层，其中该第一保护层覆盖该封装材料的部分区域，并且暴露该多个连接端子以及部份该导线图案；形成图案化导线层于该第一保护层以及该第一重配置线路层上，该图案化导线层覆盖该第一保护层的部份区域并连接该第一保护层暴露出的该多个连接端子以及部份该导线图案；以及形成第二保护层于该第一保护层以及该图案化导线层上，该第二保护层暴露部份该图案化导线层；以及形成多个焊垫于该图案化导线层上，该多个焊垫分别连接该第二保护层暴露出的该图案化导线层。20.如权利要求19所述的芯片封装结构的制作方法，其特征在于，更包括：分别形成多个第二焊球于该多个焊垫上。【文档编号】H01L21/60GK104124180SQ201310487536【公开日】2014年10月29日申请日期:2013年10月17日优先权日:2013年4月25日【发明者】王建皓申请人:南茂科技股份有限公司