专利名称：半导体器件及使用金属镶嵌工艺制造半导体器件的方法
技术领域：
本公开涉及半导体器件，特别涉及使用了镶嵌位线的半导体器件及半导体器件的制造方法，提高了工艺余量并简化了制造工艺。
背景技术：
随着半导体器件尺寸的缩小，半导体器件的互连变得更精细。因此，蚀刻互连会产生很多问题。要确保具有电容器位于位线上的COB结构的半导体器件的工艺余量，同时保持存储节点接触和位线之间需要的介电性能变得更加困难。
图1A到1D示出了具有电容器位于位线上(COB)结构的常规半导体器件的制造方法的剖面图。
参考图1A，通过常规的浅沟槽隔离(STI)工艺，场隔离膜105形成在包括有源区101的半导体衬底100的场区上。
具有栅绝缘膜111、栅电极材料112以及帽盖层113的叠置结构的栅极110形成在半导体衬底100上。间隔层115形成在栅极110的侧壁上。第一层间绝缘膜120形成在包括栅极110的衬底上。通过自对准接触(SAC)工艺形成接触125露出部分有源区101。
如多晶硅膜的导电材料淀积在衬底上以填充接触125形成存储节点接触焊盘131和位线接触焊盘135。此时，将存储节点接触焊盘131和位线接触焊盘135连接到有源区101中形成的预定导电类型的杂质区(未示出)。
接下来，第二层间绝缘膜140淀积在第一层间绝缘膜120上，然后构图形成位线接触141，露出接触焊盘131和135的位线接触焊盘135。
参考图1B，如钨膜的金属膜淀积在包括位线接触141的衬底上，然后同时深腐蚀(etch back)或CMP工艺蚀刻形成位线接触141中的位线接触栓塞145。
阻挡金属膜161、用于位线的导电材料162以及用于位线的帽盖材料163依次形成在第二层间绝缘膜140上。使用掩模(未示出)蚀刻帽盖材料163、导电材料162以及阻挡金属膜161形成位线160。
接下来，间隔层材料淀积在第二层间绝缘膜140和位线160上，然后蚀刻形成位线160侧壁上的位线间隔层165。
参考图1C，第三层间绝缘膜170淀积在第二层间绝缘膜140以及位线160上，然后蚀刻第二和第三层间绝缘膜140和170形成存储节点接触171，露出存储节点接触焊盘131。
参考图1D，用于接触栓塞的导电材料，例如多晶硅膜，淀积在第三层间绝缘膜170上，填充了存储节点接触171。然后通过CMP或深腐蚀蚀刻导电材料形成存储节点接触171中的存储节点接触栓塞175。
接下来，蚀刻终止层180和模制(mold)氧化膜(未示出)淀积在衬底上，然后蚀刻形成开口(未示出)露出存储节点接触栓塞175。用于存储节点的多晶硅膜淀积在包括开口的模制氧化膜上，然后在用于节点分离的CMP工艺期间除去模制氧化膜。由此，形成接触存储节点接触栓塞175的电容器的存储节点190。
如上所述，由于制造半导体器件以形成位线的常规方法包括淀积和构图金属膜，工艺很复杂并且很难。此外，很难确保工艺余量同时保持存储节点接触形成期间存储节点接触与位线之间需要的介电性能。
本发明的各实施例解决了现有技术的这些和其它不足之处。
发明内容
本发明的各实施例通过形成存储节点接触然后形成位线图形提供了一种半导体器件及半导体器件的制造方法，由此提高了工艺余量同时保持了存储节点接触和位线之间的介电性能。
本发明的另一实施例通过形成金属镶嵌位线和存储节点接触栓塞提供了一种半导体器件及半导体器件的制造方法，由此简化了制造工艺。
本发明的另一实施例提供了一种半导体器件及半导体器件的制造方法，能够增加电容器的电容量同时增加了存储节点面积。
为了完整地理解本发明及优点，参考下面的附图进行说明，其中类似的参考数字表示类似的元件。
图1A到1D示出了具有常规COB结构的常规半导体器件的制造方法剖面图。
图2A到2I示出了根据本发明的一个实施例的半导体器件的制造方法剖面图。
图3示出了根据本发明另一实施例的半导体器件的制造方法剖面图。
具体实施例方式
现在参考附图介绍根据本发明各实施例的半导体器件及器件的制造方法。
图2A到2I示出了根据本发明的一个实施例的半导体器件的制造方法剖面图。
参考图2A，半导体衬底200包括有源区201和场区(未示出)。通过常规的浅沟槽隔离SIT工艺，场隔离区205形成在半导体衬底200的场区中。
具有栅极绝缘膜211、栅电极材料212以及帽盖层213的叠层结构的栅极210形成在半导体衬底100上。间隔层215形成在栅极210的侧壁上。
第一层间绝缘膜220淀积在包括栅极210的衬底上，并通过CMP工艺或深腐蚀工艺平面化。自对准并蚀刻第一层间绝缘膜220形成自对准的接触225露出栅极之间的部分有源区201。
如多晶硅膜的导电材料淀积在衬底上以填充接触225。然后使用深腐蚀或CMP工艺形成存储节点接触焊盘231和位线接触焊盘235。存储节点接触焊盘231和位线接触焊盘235借助接触225连接到在有源区201中形成的预定导电类型的杂质区(未示出)。
接下来，第二层间绝缘膜240淀积在第一层间绝缘膜220上，进行CMP工艺或深腐蚀工艺用于平面化。蚀刻第二层间绝缘膜240形成位线接触241，露出接触焊盘231和235的位线接触焊盘235。
随后，用做栓塞的导电材料，例如如钨膜的金属膜淀积在包括位线接触241的衬底。然后使用CMP工艺形成位线接触241中的位线接触栓塞245。然后，蚀刻终止层251和第三层间绝缘膜260依次形成在衬底上。
参考图2B，蚀刻第三层间绝缘膜260、蚀刻终止层251以及第二层间绝缘膜240形成存储节点接触261，露出接触焊盘231和235的存储节点接触焊盘231。
参考图2C，光敏膜270形成在包括存储节点接触261的第三层间绝缘膜260上，然后构图露出将形成位线图形的那部分第三层间绝缘膜260。
使用构图的光敏膜270作为掩模蚀刻第三层间绝缘膜260的露出部分和蚀刻终止层251，形成位线图形265，露出位线接触栓塞245。此时，位线图形265为在随后的工艺中形成位线的金属镶嵌图形，并具有凹槽形状。存储节点接触261和位线图形265形成在第三层间绝缘膜260中，由此存储节点接触261和位线图形265具有相互同样高度的上部分，没有台阶。换句话说，形成在第三层间绝缘膜260中的存储节点接触261和位线图形265的上部分共平面。
参考图2D，除去光敏膜270。用于位线的导电材料，例如钨膜的金属膜淀积在包括存储节点接触261和位线图形265的第三层间绝缘膜260上。
参考图2E，通过钨膜280上的CMP工艺，接触位线接触栓塞245的位线285形成在位线图形265中，同时接触存储节点接触焊盘231的存储节点接触栓塞281形成在存储节点接触261中。因此，存储节点接触栓塞281和位线285具有相互同样高度的上表面，没有台阶。换句话说，存储节点接触栓塞281和位线285的上表面共平面。
参考图2F，蚀刻终止层253和模制氧化膜290淀积在衬底上。模制氧化膜290位形成存储节点的牺牲氧化膜。蚀刻模制氧化膜290和蚀刻终止层253形成开口291，露出接触栓塞281。
参考图2G，通过湿蚀刻工艺除去露出的接触栓塞281，露出存储节点接触261。因此，形成开口291，由此露出了存储节点接触焊盘231。参考图2H，如多晶硅膜293的导电材料淀积在包括开口291a的模制氧化膜290上。
参考图2I，淀积牺牲氧化膜(未示出)以填充开口291a。进行用于节点分离的CMP工艺，然后除去牺牲氧化膜和模制氧化膜290形成接触存储节点接触焊盘231的存储节点295。在存储节点295上形成用于电容器(未示出)的介质膜(未示出)和极板节点，以完成电容器。
第一到第三层间绝缘膜220，240和260为氧化物系列的绝缘膜。蚀刻终止层251和253使用相对于第二和第三层间绝缘膜240和260具有蚀刻选择性的材料，模制氧化膜290例如为氮化物系列的绝缘膜。
如果半导体器件的制造方法应用到具有金属-绝缘体-金属(MIM)电容器的半导体器件的制备方法时，那么可以使用MIM电容器的接触栓塞，不必除去存储节点接触中形成的接触栓塞。
图3示出了根据本发明的另一实施例具有MIM电容器的半导体器件的剖面图。根据本实施例的位线385和存储节点接触栓塞381的形成工艺与图2A-2I中介绍的实施例相同。
参考图3，场隔离膜305形成在衬底300的一个区域上。衬底300包括有源区301。在半导体衬底300上形成具有栅极绝缘膜311、栅电极材料312以及帽盖层313的叠层结构的栅极310，间隔层315形成在栅极310的侧壁上。第一层间绝缘膜320淀积并蚀刻形成SAC(自对准的接触)325。存储节点接触焊盘331和位线接触焊盘335形成在接触225中。第二层间绝缘膜340形成在第一层间绝缘膜320上，然后蚀刻形成位线接触341，露出位线接触焊盘335。
由导电材料，例如钨膜的金属膜制成的位线接触栓塞345形成在位线接触341中，蚀刻终止层351和第三层间绝缘膜360淀积在衬底上。蚀刻第二和第三层间绝缘膜340，360以及蚀刻终止层351形成存储节点接触361，露出存储节点接触焊盘331，然后使用光敏膜(未示出)蚀刻第三层间绝缘膜360和蚀刻终止层351形成位线图形265，露出位线接触栓塞345。
接下来，导电材料，例如钨膜的金属膜淀积在包括存储节点接触361和位线图形365的衬底上。然后使用用于节点分离的CMP工艺形成位线图形365中的位线385，同时在存储节点接触261中形成存储节点接触栓塞381。
此后，绝缘膜390淀积在衬底上，然后蚀刻形成接触开口391，露出接触栓塞381。绝缘膜390可以使用如SiN的蚀刻终止层、氧化物系列的层间绝缘膜或其它类型的绝缘膜，例如包括蚀刻终止层和层间绝缘膜的叠置结构。
形成叠置下金属电极401、介质膜402和上金属电极403的金属绝缘体金属MIM电容器400，借助接触开口391接触存储节点接触栓塞381。
根据本发明该实施例的半导体器件的制备方法不仅适用于具有图3所示结构的MIM电容器，也适用于具有各种其它结构的MIM电容器。
现在以非限定的方式介绍本发明的各实施例。
根据本发明一个实施例的半导体器件的制造方法包括制备具有第一接触焊盘和第二接触焊盘的半导体衬底；在衬底上形成第一绝缘膜；蚀刻第一绝缘膜形成接触和槽形位线图形，露出第一接触焊盘和第二接触焊盘；同时分别在接触和位线图形中形成接触栓塞和位线，接触栓塞和位线具有共平面的上表面；以及形成连接到第一接触焊盘的电容器的下电极。
根据本发明另一个实施例的半导体器件的制造方法包括在半导体衬底上形成具有存储节点接触焊盘和位线接触焊盘的第一绝缘膜；在第一绝缘膜上形成具有位线接触的第二绝缘膜，露出位线接触焊盘；在衬底上形成第三绝缘膜；蚀刻第二和第三绝缘膜形成槽形位线图形和存储节点接触；同时分别在位线图形和存储节点接触中形成位线和接触栓塞，位线和接触栓塞具有共平面的上表面；在半导体衬底上形成第四绝缘膜和第五绝缘膜；通过蚀刻第四绝缘膜和第五绝缘膜形成开口，露出接触栓塞；除去露出的接触栓塞，露出存储节点接触；在包括露出的存储节点接触的开口中形成与存储节点接触焊盘接触的存储节点；以及除去第五绝缘膜。
根据本发明另一个实施例的半导体器件的制造方法包括在半导体衬底上形成具有存储节点接触焊盘和位线接触焊盘的第一绝缘膜；在第一绝缘膜上形成具有位线接触的第二绝缘膜，露出位线接触焊盘；在位线接触中形成位线接触栓塞；在衬底上形成第三绝缘膜；蚀刻第二和第三绝缘膜形成槽形位线图形和存储节点接触；同时分别在位线图形和存储节点接触中形成位线和接触栓塞，位线和接触栓塞具有共平面的上表面；在半导体衬底上形成第四绝缘膜；以及通过第四绝缘膜上的开口形成接触接触栓塞的金属电极。
根据本发明的一个实施例的半导体器件包括具有位线接触焊盘和存储节点接触焊盘的半导体衬底；第一绝缘膜，包括露出位线接触焊盘的槽形位线图形以及露出存储节点接触焊盘的存储节点，位线图形和存储节点接触具有共平面的上部；形成在位线图形上的位线；第二绝缘膜，具有露出存储节点接触的开口；以及电容器的下电极，接触存储节点接触焊盘，形成在存储节点接触中并由第二绝缘膜伸出。
根据本发明的一个实施例的半导体器件包括具有位线接触焊盘和存储节点接触焊盘的半导体衬底；第一绝缘膜，包括露出位线接触焊盘的槽形位线图形以及露出存储节点接触焊盘的存储节点，位线图形和存储节点接触具有共平面的上部；形成在位线图形上的位线；形成在存储节点接触中的接触栓塞；第二绝缘膜，具有露出存储节点接触的开口；以及形成在第二绝缘膜上的电容器的下电极，穿过开口接触露出的接触栓塞。
虽然具体示出并参考优选实施例介绍了本发明，但是本领域中的普通技术人员应该理解，可以在不脱离下面的权利要求书中限定的本发明的精神和范围的情况下，进行形式和细节中的以上及其它改变。
权利要求
1.一种半导体器件的制造方法，包括制备具有第一接触焊盘和第二接触焊盘的半导体衬底；在衬底上形成第一绝缘膜；蚀刻第一绝缘膜形成接触和槽形位线图形，分别露出第一接触焊盘和第二接触焊盘；同时分别在接触和位线图形中形成接触栓塞和位线，其中接触栓塞和位线具有共平面的上表面；以及形成电容器的下电极，下电极连接到第一接触焊盘。
2.根据权利要求1的方法，其中蚀刻第一绝缘膜形成槽形位线图形和接触包括在包括接触的第一绝缘膜上形成掩模层，以露出对应于第二接触焊盘的那部分第一绝缘膜；以及使用掩模层同时蚀刻第一绝缘膜的露出部分形成位线图形。
3.根据权利要求2的方法，其中在第一绝缘膜上形成掩模层包括在第一绝缘膜上形成光敏膜。
4.根据权利要求1的方法，其中蚀刻第一绝缘膜包括倾斜蚀刻第一绝缘膜。
5.根据权利要求1的方法，其中同时形成接触栓塞和位线包括在包括位线图形和接触的衬底上淀积金属膜；以及进行化学机械抛光。
6.根据权利要求1的方法，其中形成电容器的下电极包括在衬底上依次形成第二绝缘膜和第三绝缘膜；蚀刻第二和第三绝缘膜形成露出接触栓塞的第一开口；除去接触栓塞形成露出接触的第二开口；在第一和第二开口中形成下电极；以及除去第三绝缘膜。
7.根据权利要求6的方法，其中除去接触栓塞包括用湿蚀刻工艺除去接触栓塞。
8.根据权利要求6的方法，其中在衬底上依次形成第二绝缘膜和第三绝缘膜包括依次形成蚀刻终止层和牺牲氧化膜。
9.根据权利要求1的方法，其中形成电容器的下电极包括在衬底上形成第二绝缘膜；蚀刻第二绝缘膜形成露出接触栓塞的开口；在第二绝缘膜上和开口内形成下电极。
10.根据权利要求9的方法，其中第二绝缘膜包括由蚀刻终止层、层间绝缘膜、蚀刻终止层和层间绝缘膜的叠层膜组成的组中选择的绝缘膜。
11.一种半导体器件的制造方法包括在半导体衬底上形成具有存储节点接触焊盘和位线接触焊盘的第一绝缘膜；在第一绝缘膜上形成具有位线接触的第二绝缘膜，露出位线接触焊盘；在位线接触中形成位线接触栓塞；在衬底上形成第三绝缘膜；蚀刻第二和第三绝缘膜形成槽形位线图形和存储节点接触；同时分别在位线图形和存储节点接触中形成位线和接触栓塞，位线和接触栓塞具有共平面的上表面；在半导体衬底上形成第四绝缘膜和第五绝缘膜；蚀刻第四绝缘膜和第五绝缘膜形成开口，露出接触栓塞；除去存储节点接触栓塞以露出存储节点接触；在开口和存储节点接触中，形成与存储节点接触焊盘接触的存储节点；以及除去第五绝缘膜。
12.根据权利要求11的方法，其中蚀刻第二和第三绝缘膜形成槽形位线图形和接触包括蚀刻第二后第三绝缘膜，露出存储节点接触焊盘；在包括存储节点接触的第三绝缘膜上形成掩模层，以露出对应于位线接触焊盘的那部分第三绝缘膜；以及使用掩模层通过蚀刻第三绝缘膜的露出部分形成位线图形，露出位线接触栓塞。
13.根据权利要求12的方法，其中第一、第二和第三绝缘膜为层间绝缘膜，第四绝缘膜为相对于第二绝缘膜、第三绝缘膜以及第五绝缘膜具有蚀刻选择性的蚀刻终止层，第五绝缘膜为牺牲氧化膜。
14.一种半导体器件的制造方法，包括在半导体衬底上形成具有存储节点接触焊盘和位线接触焊盘的第一绝缘膜；在第一绝缘膜上形成具有位线接触的第二绝缘膜，露出位线接触焊盘；在位线接触中形成位线接触栓塞；在衬底上形成第三绝缘膜；蚀刻第二和第三绝缘膜形成槽形位线图形和存储节点接触；同时分别在位线图形和存储节点接触中形成位线和接触栓塞，位线和接触栓塞具有共平面的上表面；在半导体衬底上形成具有露出接触栓塞的开口的第四绝缘膜；以及通过第四绝缘膜上的开口形成接触接触栓塞的金属电极。
15.根据权利要求14的方法，其中蚀刻第二和第三绝缘膜形成槽形位线图形和存储节点接触包括蚀刻第二和第三绝缘膜，露出存储节点接触焊盘；在包括存储节点接触的第三绝缘膜上形成掩模层，以露出对应于位线接触焊盘的那部分第三绝缘膜；以及使用掩模层通过蚀刻第三绝缘膜的露出部分形成位线图形，露出位线接触栓塞。
16.根据权利要求14的方法，其中第四绝缘膜包括由蚀刻终止层、层间绝缘膜、蚀刻终止层和层间绝缘膜的叠层膜组成的组中选择的膜。
17.一种半导体器件包括具有位线接触焊盘和存储节点接触焊盘的半导体衬底；第一绝缘膜，包括露出位线接触焊盘的槽形位线图形以及露出存储节点接触焊盘的存储节点接触，位线图形和存储节点接触具有共平面的上部；形成在位线图形上的位线；第二绝缘膜，具有露出存储节点接触的开口；以及电容器的下电极，形成在存储节点接触中并且接触存储节点接触焊盘。
18.根据权利要求17的半导体器件，其中第二绝缘膜包括相对于第一绝缘膜具有蚀刻选择性的材料。
19.一种半导体器件包括具有位线接触焊盘和存储节点接触焊盘的半导体衬底；第一绝缘膜，包括露出位线接触焊盘的槽形位线图形以及露出存储节点接触焊盘的存储节点接触，位线图形和存储节点接触具有共平面的上部；形成在位线图形上的位线；形成在存储节点接触中的接触栓塞；第二绝缘膜，具有露出存储节点接触的开口；以及形成开口中的电容器的下电极，并且接触接触栓塞。
20.根据权利要求19的半导体器件，其中第二绝缘膜包括由蚀刻终止层、层间绝缘膜、以及蚀刻终止层和层间绝缘膜的叠层膜组成的组中选择的膜。
全文摘要
根据本发明的一个实施例的半导体器件的制造方法包括制备具有第一接触焊盘和第二接触焊盘的半导体衬底；在衬底上形成第一绝缘膜；蚀刻第一绝缘膜形成接触和槽形位线图形，露出第一接触焊盘和第二接触焊盘；同时分别在接触和位线图形中形成接触栓塞和位线，接触栓塞和位线具有共平面的上表面；以及形成连接到第一接触焊盘的电容器的下电极。
文档编号H01L21/8242GK1497701SQ20031010139
公开日2004年5月19日 申请日期2003年10月17日 优先权日2002年10月18日
发明者李昌宪, 郑文谟 申请人:三星电子株式会社