基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变sgoi的制作方法
【专利摘要】本发明公开了一种基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变SGOI的制作方法，其实现步骤为：1.对绝缘层上硅锗SGOI晶圆进行清洗，并进行He离子注入；2.在离子注入后的SGOI晶圆顶层SiGe层上淀积?1GPa以上的压应力SiN薄膜或1GPa以上的张应力SiN薄膜，并刻蚀SiN薄膜成条形阵列；3.对带有SiN薄膜阵列的SGOI晶圆进行退火；4.腐蚀去除SGOI晶圆表面上的SiN薄膜阵列，得到晶圆级单轴应变SGOI材料。本发明利用在条形SiN薄膜阵列作用下顶层Ge层会发生单轴拉伸或单轴压缩形变的特性引入应变，与现有工艺兼容，可制作用于光电集成、系统级芯片所需的SGOI晶圆。
【专利说明】
基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变SGOI的制作方法
技术领域
[0001]本发明属于微电子技术领域，涉及半导体衬底材料制作工艺技术，具体的说是一种晶圆级单轴应变SGOI材料的制作方法，可制作用于高频、低功耗、抗辐射集成电路所需的SGOI晶圆。
【背景技术】
[0002]业内所知，SiGe兼具Si和Ge的优点，以其器件与电路的工作频率高、功耗小、比GaAs价廉、与Si CMOS工艺兼容、成本低等诸多优点，在微波器件、移动通信、高频电路等产业领域有着广泛的应用前景和竞争优势。SiGe还是极优异的光电材料，在探测器、调制器、光波导、光发射器、太阳能电池等方面有着广泛的应用。与应变Si相似，应变SiGe也具有载流子迀移率高的特性。
[0003]与体Si相比，SOI器件与电路具有功耗低、抗干扰能力强、集成密度高、速度高、寄生电容小、工艺简单、抗辐照能力强、并可彻底消除体硅CMOS的闩锁效应等优点，在高速、低功耗、抗辐照等器件与电路领域被广泛应用，是21世纪Si集成电路技术的发展方向。
[0004]绝缘层上应变锗硅SSGOI结合了应变SiGe和SOI的优点，为研发新型的超高速、低功耗、抗辐射、高集成度硅基器件和芯片提供一种新的解决方案，在光电集成、系统级芯片等方面也有着重要的应用前景。
[0005]传统的应变SGOI是基于SOI晶圆的双轴压应变，即在SOI晶圆上直接生长应变SiGe，或先在SOI晶圆上生长Ge组分渐变的SiGe层作虚衬底，再在该SiGe层上外延生长所需的应变SiGe层。传统应变SGOI的主要缺点是位错密度高、只能是双轴压应变、迀移率提升不高、SiGe虚衬底增加了热开销和制作成本、SiGe虚衬底严重影响了器件与电路的散热、应变SiGe层临界厚度受Ge组分限制、高场下空穴迀移率的提升会退化等。相对于双轴应变SGOI，单轴应变对载流子迀移率的提升不随电场的升高而退化，而且在相同的应变量下，单轴应变对载流子迀移率的提升高于双轴应变对载流子迀移率的提升。
[0006]2011年西安电子科技大学获得的一种采用机械弯曲并在弯曲状态下退火制作圆片级单轴应变SGOI材料的新方法专利(CN201110361525.4)，用以制作晶圆级全局单轴应变SGOI材料，其主要工艺如图1所示，步骤如下:
[0007]1、将SGOI晶圆顶层SiGe层向上放置在弧形弯曲台上，其弯曲方向与〈110〉或〈100〉方向平行。
[0008]2、弯曲台上的两根圆柱形水平压杆分别放置在SGOI晶圆片两端，用圆柱形水平压杆使SGOI晶圆与弧形台面完全贴合。
[0009]3、在温度200°C至1250°C的退火炉中退火1.5小时至10小时，使3102埋绝缘层在此过程中发生塑性形变。
[0010]4、卸下SGOI晶圆恢复原状后，由于S12埋绝缘层的塑形形变，形成顶层全局单轴应变SiGe层。
[0011]但是该方法存在以下几个缺点:1)与传统集成电路工艺兼容性差:为了获得不同应变量的SGOI，该方法需要额外制作对应的不同曲率半径的弯曲台，且所制作的弯曲台需要兼容现有退火设备。2)可靠性较差:该工艺方法需使用压杆施加机械外力使SGOI晶圆弯曲，会在顶层SiGe中引入缺陷；若SGOI晶圆弯曲度过大，会造成圆片碎裂。3)由于担心SGOI晶圆碎裂，所以机械弯曲的弯曲度不能过大，这就限制了在顶层SiGe中引入的应变量的大小，所能实现的应变量较小。
【发明内容】
[0012]本发明的目的在于针对上述现有技术的不足，提出一种基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变SGOI的制作方法，以降低应变SGOI晶圆的制作工艺复杂度和成本，提高单轴应变SGOI的应变量，增强SGOI晶圆片的电子迀移率与空穴迀移率，满足SGOI器件与集成电路的电学和光学性能要求。
[0013]为实现上述目的，本发明的技术方案包括如下:
[0014](I)对绝缘层上硅锗SGOI晶圆进行清洗，该SGOI晶圆包括顶层SiGe层、S12埋绝缘层和Si衬底三层结构；
[0015](2)对清洗过的SGOI晶圆进行He离子注入，即将He离子注入到SGOI晶圆的S12埋绝缘层与Si衬底界面处；
[0016](3)在离子注入后的SGOI晶圆顶层SiGe上采用PECVD等工艺淀积-1GPa以上的压应力SiN薄膜或IGPa以上的张应力SiN薄膜；
[0017](4)利用半导体光刻和干法刻蚀工艺，对SiN薄膜进行条形图形化，形成条宽和间距均为0.ΙΟμπι?0.16μπι的条形SiN薄膜阵列，用以消除宽度方向的应力，得到只有长度方向应力的氮化硅压应力条或张应力条，使顶层SiGe层和S12埋绝缘层发生整体的拉伸形变或压缩形变，进而导致SGOI晶圆转变为晶圆级的单轴张应变SGOI或单轴压应变SGOI;
[0018](5)对顶层SiGe表面形成条形SiN薄膜阵列的SGOI晶圆进行退火，使SiN薄膜的应力进一步增强，并使S12埋绝缘层发生塑性形变，保证SiN薄膜去除后顶层SiGe层应力不消失;
[0019](6)通过湿法腐蚀去除SGOI晶圆表面上的条形SiN薄膜阵列，最终得到晶圆级单轴张应变SGOI或单轴压应变SGOI材料。
[0020]本发明具有如下优点:
[0021]1、与现有集成电路工艺完全兼容:本发明的晶圆级单轴应变SOI的制作，可通过PECVD工艺淀积、图形光刻、刻蚀等现有的常规Si工艺实现，工艺简单，不需要额外定制工艺所需设备。
[0022]2、可靠性高:本发明通过将高应力SiN条形阵列引入晶圆级单轴应变，不需要对SGOI施加机械外力，从而防止了圆片发生弯曲，避免了顶层SiGe中的缺陷产生和圆片碎裂，提尚了成品率。
[0023]3、成本低:本发明由于采用高应力SiN条形阵列，能直接引入晶圆级的单轴应变，故可采用普通SGOI晶圆来制作单轴全局应变SGOI材料，而非双轴应变SGOI晶圆，降低了工艺成本。
[0024]4、应变量大:本发明通过条形SiN条形阵列的单轴应力使顶层SiGe层和S12埋绝缘层发生整体的单轴拉伸形变或压缩形变来引入应变，故可以通过调整SiN薄膜淀积工艺增大应变量。
【附图说明】
[0025]图1为现有晶圆级单轴应变SGOI晶圆的工艺流程图。
[0026]图2为本发明的晶圆级单轴应变SGOI工艺流程图。
[0027]图3为本发明中淀积在顶层SiGe层上的条形SiN薄膜阵列的俯视图。
【具体实施方式】
[0028]本发明的技术原理如下:
[0029]本发明根据离子注入工艺原理，将He离子注入到S12埋绝缘层与衬底Si层的界面处，会导致S12埋绝缘层和衬底Si层的界面结合变得疏松，以使S12埋绝缘层及其上的顶层Si层在淀积高应力SiN薄膜后容易发生相应的应变。又根据材料力学的尺度效应原理，通过半导体工艺技术制作宽度和间距均为10nm?160nm的条形SiN薄膜阵列，使得条形宽度方向的应力释放，而沿条形长度方向的应力大小不发生变化，从而使条形SiN薄膜阵列拥有单轴压应力或单轴张应力，以在顶层SiGe层和S12埋绝缘层中引入单轴张应变或单轴压应变。在退火过程中，条形SiN薄膜阵列的应力会进一步增强，并同时导致S12埋绝缘层产生拉伸或压缩的塑性形变，而顶层SiGe仍处于弹性形变。当去除条形SiN薄膜阵列后，由于S12埋绝缘层拉伸或压缩的塑性形变作用，导致顶层SiGe发生单轴张应变或单轴压应变，最终形成拥有应变顶层SiGe层的晶圆级单轴应变SOI。
[0030]SGOI晶圆包括3英寸、4英寸、5英寸、6英寸、8英寸、12英寸的不同规格，顶层SiGe层的厚度为100?500nmo
[0031 ]参照图2，本发明给出基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变SGOI的制作方法的三个实施例，即制备6英寸、8英寸、12英寸的单轴应变SGOI晶圆材料，不同规格的SGOI晶圆均包括三层结构:Si衬底3、S12埋绝缘层2和顶层SiGe层I，如图2a所示。其中:
[0032]6英寸SGOI晶圆，其Si衬底的厚度为550ym，Si02埋绝缘层的厚度为500nm，顶层SiGe层的厚度为10nm;
[0033]8英寸SGOI晶圆，其Si衬底的厚度为550ym，Si02埋绝缘层的厚度为500nm，顶层SiGe层的厚度为200nm;
[0034]12英寸SGOI晶圆，其Si衬底的厚度为550ym，Si02埋绝缘层的厚度为500nm，顶层SiGe层的厚度为300nmo
[0035]实施例1，制备6英寸单轴张应变SGOI晶圆材料。
[0036]步骤1:清洗SGOI晶圆，以去除表面污染物。
[0037](1.1)使用丙酮和异丙醇对SGOI晶圆交替进行超声波清洗，以去除衬底表面有机物污染；
[0038](1.2)配置1: 1:3的氨水、双氧水、去离子水的混合溶液，并加热至120°C，将SGOI晶圆置于此混合溶液中浸泡12分钟，取出后用大量去离子水冲洗，以去除SGOI晶圆表面无机污染物；
[0039](1.3)将SGOI晶圆用HF酸缓冲液浸泡2分钟，去除表面的氧化层。
[0040] 步骤2:离子注入。
[0041 ] 通过离子注入机对已清洗的SGOI晶圆注入剂量为1.4E14cm—2，能量60Kev的He离子，以使Si衬底3和S12埋绝缘层2界面4疏松，如图2b所示。
[0042]步骤3:淀积SiN薄膜。
[0043](3.1)将离子注入后的SGOI晶圆取出，再放置于等离子体增强化学气相淀积PECVD反应室中，先启动真空栗，将反应室抽真空至2.STorr，再启动加热器将反应室的温度升至400 °C并保持恒温；
[0044](3.2)向反应室内依次通入0.41slm的高纯SiH4，2.0slm的高纯NH3，2.0slm的高纯
N2;
[0045](3.3)设高频HF功率为0.2IKW，低频LF功率为0.8IKW，在SGOI晶圆上淀积厚度为0.8μ??，应力为-1GPa的SiN压应力膜5，如图2c所示；
[0046](3.4)淀积完成后将反应室抽真空，再将反应室温度降温至室温后，取出淀积了SiN压应力膜的SGOI晶圆。
[0047]步骤4:利用半导体光刻和刻蚀技术，刻蚀压应力SiN薄膜5，形成条形SiN薄膜阵列6，如图2(1所示。
[0048](4.1)在压应力SiN层5上涂正光刻胶，将光刻胶烘干，利用具有条形宽度和间隔均为0.16μηι的光刻板进行曝光，曝光的区域为宽度和间隔均为0.16μηι的条状阵列，用显影液去除掉曝光区域易溶于显影液的正光刻胶，在SiN层上形成条状光刻胶掩蔽膜阵列；
[0049](4.2)采用反应离子刻蚀RIE工艺，在反应腔压强为4Pa，反应室温度为40°C，基片温度为5°C，13.56MHz高频射频功率为400W，刻蚀气体CHF4流量为30sccm，02气体流量为3SCCm的条件下，对淀积在SGOI晶圆顶层Si层上的压应力SiN薄膜5进行刻蚀，形成宽度为0.16μπι的条形SiN薄膜阵列6，用以消除宽度方向的应力，得到只有长度方向应力的氮化硅应力条，得到的带有SiN薄膜阵列6的SGOI晶圆俯视图如图3所示；
[0050](4.3)去除条形SiN薄膜阵列上的光刻胶。
[0051 ] 步骤5:退火。
[0052]对顶层SiGe层I表面形成条形SiN薄膜阵列6的SGOI晶圆进行退火，如图2e所示，SP在升温速率为4°C/min，温度为340°C的条件下在惰性气体Ne中退火3.2小时，再以4°(:/11^11的速率降温至室温；
[0053]在退火过程中，条形SiN薄膜阵列6的应力会进一步增强，导致S12埋绝缘层2产生拉伸的塑性形变。
[0054]步骤6:去除条形SiN薄膜。
[0055]把淀积了条形SiN薄膜阵列6的SOI晶圆放入体积分数为85%的磷酸溶液中，在150°C下进行6分钟的湿法刻蚀，最终得到具有应变顶层Si层7的单轴张应变SOI晶圆材料，如图2f所示。
[0056]实施例2，制备8英寸单轴压应变SGOI晶圆材料。
[0057]步骤一:清洗SGOI晶圆，以去除表面污染物。
[0058]本步骤的实现与实施例1的步骤I相同。
[0059]步骤二:对已清洗的SGOI晶圆注入剂量为1.4E15cm—2，能量IlOKev的He离子，以使Si衬底3和S12埋绝缘层2界面4疏松，如图2b所示。
[0060]步骤三:在已完成离子注入的SGOI晶圆的顶层SiGe层I的表面淀积厚度为0.9μπι，应力为I.IGPa的张应力SiN薄膜5，如图2c所示。
[0061]本步骤的实现过程与实施例1的步骤3相同，其工艺参数如下:
[0062]反应室温度为400°C，反应室压强为3.11'0^高频冊功率为1.21(￥，低频1^功率为
0.3矹，51!14流量为0.381111，順3流量为1.881111，高纯氮气流量为1.081111。
[0063]步骤四:利用半导体光刻和刻蚀技术，刻蚀张应力SiN薄膜5，形成条形SiN薄膜阵列6，如图2d所示。
[0064](4a)在张应力SiN层5上涂正光刻胶，将光刻胶烘干，利用具有条形宽度和间隔均为0.15μηι的光刻板进行曝光，曝光的区域为宽度和间隔均为0.15μηι的条状阵列，用显影液去除掉曝光区域易溶于显影液的正光刻胶，在SiN层上形成条状光刻胶掩蔽膜阵列；
[0065](4b)采用反应离子刻蚀RIE工艺，对淀积在SGOI晶圆顶层Si层上的张应力SiN薄膜
5进行刻蚀，形成宽度为0.15μπι的条形SiN薄膜阵列6，用以消除宽度方向的应力，得到只有长度方向应力的氮化硅应力条，得到的带有SiN薄膜阵列6的SGOI晶圆俯视图如图3所示，反应离子刻蚀RIE工艺条件与实施例1中的步骤(4.1)相同；
[0066](4c)去除条形SiN薄膜阵列6上的光刻胶。
[0067]步骤五:对顶层SiGe层I表面形成条形SiN薄膜阵列6的SGOI晶圆进行退火，如图2e所示，即在升温速率为4°(:/1^11，温度为390°(:的条件下在惰性气体他中退火2.7小时，再以4°C/min的速率降温至室温。在退火过程中，条形SiN薄膜阵列6的应力会进一步增强，导致S12埋绝缘层2产生压缩的塑性形变。
[0068]步骤六:去除SGOI晶圆顶层SiGe层I表面的条形SiN薄膜阵列6，如图2f所示。
[0069]把淀积了条形SiN薄膜阵列6的SOI晶圆放入体积分数为85%的磷酸溶液中，在170°C下进行9分钟的湿法刻蚀，最终得到具有应变顶层Si层7的单轴压应变SOI晶圆材料。
[0070]实施例3，制备12英寸单轴张应变SGOI晶圆材料。
[0071 ]步骤A:清洗SGOI晶圆，以去除表面污染物。
[0072]本步骤的实现与实施例1的步骤I相同。
[0073]步骤B:对已清洗的SGOI晶圆进行离子注入，以使Si衬底3和S12埋绝缘层2界面4疏松，如图2b所示。
[0074]离子注入的工艺是:注入剂量为1.4E16cm—2，注入能量140Kev，注入离子为He离子。
[0075]步骤C:淀积SiN薄膜。
[0076]在已完成离子注入的SGOI晶圆的顶层SiGe层I的表面淀积厚度为0.8μπι，应力为-1.2GPa的压应力SiN薄膜5，如图2c所示；
[0077]本步骤的实现过程与实施例1的步骤3相同，其工艺参数如下:
[0078]反应室温度为4000C，反应室压强为3.0Torr，高频HF功率为0.41KW，低频LF功率为
0.61鼎，5丨!14流量为0.2181111，順3流量为2.281111，高纯氮气流量为2.481111。
[0079]步骤D:利用半导体光刻和刻蚀技术，刻蚀压应力SiN薄膜5，形成条形SiN薄膜阵列6，如图2(1所示。
[0080](Dl)在压应力SiN层5上涂正光刻胶，将光刻胶烘干，利用具有条形宽度和间隔均为0.1 Ομπι的光刻板进行曝光，曝光的区域为宽度和间隔均为0.1 Ομπι的条状阵列，用显影液去除掉曝光区域易溶于显影液的正光刻胶，在SiN层上形成条状光刻胶掩蔽膜阵列；[0081 ] (D2)采用反应离子刻蚀RIE工艺，对淀积在SGOI晶圆顶层Si层上的压应力SiN薄膜5进行刻蚀，形成宽度为0.ΙΟμπι的条形SiN薄膜阵列6，用以消除宽度方向的应力，得到只有长度方向应力的氮化硅应力条，得到的带有SiN薄膜阵列6的SGOI晶圆俯视图如图3所示，反应离子刻蚀RIE工艺条件与实施例1的步骤(4.1)相同；
[0082](D3)去除条形SiN薄膜阵列6上的光刻胶。
[0083]步骤E:退火。
[0084]对顶层SiGe层I表面形成条形SiN薄膜阵列6的SGOI晶圆进行退火，如图2e所示，SP在升温速率为4°C/min，温度为440°C的条件下在惰性气体Ne中退火2.2小时，再以4°(:/11^11的速率降温至室温。在退火过程中，条形SiN薄膜阵列6的应力会进一步增强，导致S12埋绝缘层2产生拉伸的塑性形变。
[0085]步骤F:去除条形SiN薄膜阵列。
[0086]把淀积了条形SiN薄膜阵列6的SOI晶圆放入体积分数为85%的磷酸溶液中，在190°C下进行8分钟的湿法刻蚀，最终得到具有应变顶层Si层7的单轴张应变SOI晶圆材料，如图2f所示。
【主权项】
1.基于氮化硅应力薄膜与尺度效应的晶圆级单轴应变SGOI的制作方法，包括如下步骤: (1)对绝缘层上硅锗SGOI晶圆进行清洗，该SGOI晶圆包括顶层SiGe层、S12埋绝缘层和Si衬底三层结构； (2)对清洗过的SGOI晶圆进行He离子注入，即将He离子注入到SGOI晶圆的Si0d_i绝缘层与Si衬底界面处； (3)在离子注入后的SGOI晶圆顶层SiGe上采用PECVD等工艺淀积-1GPa以上的压应力SiN薄膜或IGPa以上的张应力SiN薄膜； (4)利用半导体光刻和干法刻蚀工艺，对SiN薄膜进行条形图形化，形成条宽和间距均为0.ΙΟμπι?0.16μπι的条形SiN薄膜阵列，用以消除宽度方向的应力，得到只有长度方向应力的氮化硅压应力条或张应力条氮化硅应力条，使顶层SiGe层和S12埋绝缘层发生整体的拉伸形变或压缩形变，进而导致SGOI晶圆转变为晶圆级的单轴张应变SGOI或单轴压应变SGOI ； (5)对顶层SiGe表面形成条形SiN薄膜阵列的SGOI晶圆进行退火，使SiN薄膜的应力进一步增强，并使S12埋绝缘层发生塑性形变，保证SiN薄膜去除后顶层SiGe层应力不消失； (6)通过湿法腐蚀去除SGOI晶圆表面上的条形SiN薄膜阵列，最终得到晶圆级单轴张应变SGOI或单轴压应变SGOI材料。2.根据权利要求1所述的方法，其中步骤(I)中的SGOI晶圆，其包括3英寸、4英寸、5英寸、6英寸、8英寸、12英寸的不同规格，顶层SiGe层厚度为100?500nm。3.根据权利要求1所述的方法，其中步骤(I)中对SGOI晶圆进行清洗，其步骤如下: (Ia)使用丙酮和异丙醇对SGOI晶圆交替进行超声波清洗，以去除衬底表面有机物污染； (Ib)配置I: 1:3的氨水、双氧水、去离子水的混合溶液，并加热至1200C，将SGOI晶圆置于此混合溶液中浸泡12分钟，取出后用大量去离子水冲洗，以去除SGOI晶圆表面无机污染物； (I c)将SGOI晶圆用HF酸缓冲液浸泡2分钟，去除表面的氧化层。4.根据权利要求1所述的方法，其中步骤(2)中的离子注入，采用He离子，其注入剂量从1.4E14cm—2?1.4E16cm—2变化，注入能量根据顶层SiGe层厚度的不同从60Kev?140Kev变化。5.根据权利要求1所述的方法，其中步骤(3)在顶层SiGe上淀积压应力SiN层的工艺，采用等离子体化学气相淀积PECVD工艺，其参数如下: 高频功率HF为0.2IKW?0.4IKW; 低频功率LF从0.6IKW?0.81KW； 高纯SiH4流量0.21slm?0.41slm，高纯NH3流量2.0slm?2.2slm，高纯氮气流量2.0slm?2.4slm； 反应室压强2.8Torr?3.0Torr ； 反应室温度400 °C; 淀积厚度0.8μηι?1.Ομπι。6.根据权利要求1所述的方法，其中步骤(3)在顶层Si上淀积张应力SiN层的工艺，采用等离子体化学气相淀积PECVD工艺，其参数如下: 高频功率HF为1.1KW?1.3KW； 低频功率LF从0.2KW?0.4KW ； 高纯SiH4流量0.2slm?0.4slm，高纯冊3流量1.7slm?1.9slm，高纯氮气流量0.8slm?1.2slm； 反应室压强2.0Torr?3.3Torr ； 反应室温度400 °C; 淀积厚度0.8μηι?1.2μηι。7.根据权利要求1所述的方法，其特征在于步骤(4)中使用光刻和反应离子刻蚀RIE工艺方法将SiN层刻蚀成条状阵列，按如下步骤进行: (4a)在SiN层上涂正光刻胶，将光刻胶烘干，利用具有条形宽度和间隔均为0.ΙΟμπι?0.16μηι的光刻板进行曝光，曝光的区域为宽度和间隔均为0.ΙΟμπι?0.16μηι的条状阵列，用显影液去除掉曝光区域易溶于显影液的正光刻胶，在SiN层上形成条状光刻胶掩蔽膜阵列； (4b)采用反应离子刻蚀RIE工艺刻蚀掉淀积在SGOI晶圆顶层SiGe上的无光刻胶掩蔽膜区域，即曝光区域下的SiN，留下条状光刻胶掩蔽膜下的SiN，得到宽度和间距均为0.ΙΟμπι?0.16μπι的SiN条状阵列； (4c)去除条状光刻胶掩蔽膜，仅留下SiN条状阵列。8.根据权利要求1所述的方法，其中步骤(5)中的退火，其工艺条件是:温度:340°C?440 °C，时间:2.2?3.2小时，环境:He、Ne、Ar或它们的混合物。9.根据权利要求1所述的方法，其中步骤(6)中的湿法刻蚀去除SiN薄膜，是采用体积分数为85 %的磷酸溶液，在温度为150 0C?200 0C下进行5?20分钟的刻蚀。
【文档编号】H01L21/762GK106098611SQ201610446181
【公开日】2016年11月9日
【申请日】2016年6月20日
【发明人】郝跃, 戴显英, 焦帅, 苗东铭, 梁彬, 祁林林
【申请人】西安电子科技大学