用于显示控制器的半导体集成电路装置的制作方法

专利名称：用于显示控制器的半导体集成电路装置的制作方法
技术领域：
本发明涉及一种用于显示控制器的半导体集成电路装置，其中 具有用于存储显示数据和控制显示装置的RAM(随机访问存储器)， 并且涉及一种有效地用于例如液晶显示控制驱动器的技术，该液晶 显示控制驱动器用来驱动液晶显示面板。
背景技术：
近年来，作为诸如蜂窝电话或者PDA (个人数字助理)的便携 式电子装置的显示装置，通常使用其中将多个显示像素以矩阵形式 二维地进行排列的点阵式液晶面板。该装置其中具有液晶显示 (LCD)控制器(液晶控制器)和液晶驱动器，该液晶显示控制器 作为半导体集成电路而形成，用于执行液晶面板的显示控制，该液
晶驱动器用于在该液晶显示控制器的控制下驱动液晶面板；或者具 有其中包括有液晶控制器和液晶驱动器的液晶显示控制驱动器(液 晶控制驱动器)。
迄今，液晶显示控制驱动器(包括液晶控制器)其中一直在芯 片中具有用于存储显示数据的RAM。内置RAM的存储容量通常根 据待驱动的液晶面板的显示屏幕尺寸来确定。与普通存储器相比， 该RAM的存储容量更小，因此未提供用于修复缺陷位(defective bit) 的所谓冗余电路。
内置RAM的存储容量之所以由液晶面板的屏幕尺寸来规定，是 基于下述原因。在液晶控制驱动器中，即使当内置RAM的容量被设 置为存储液晶面板中一屏显示数据的大小时，由于RAM占用芯片区 域的比例相对较大，因此存储容量的增加直接导致芯片成本的增加。 对于具有存储一屏显示数据的容量的内置RAM而言，因RAM中的 缺陷而引起的产量降低并不是大问题，因此几乎不需要提供冗余电
例如，日本未审专利公开No. 2000-347646公开了将液晶控制驱 动器中内置RAM的存储容量设置为用于存储液晶面板的一屏显示 数据的大小。

发明内容
本发明的发明人使用微制造工艺来增加内置RAM的密度，以降 低液晶控制驱动器的芯片尺寸和芯片成本。然而，应当理解的是， 当内置RAM的密度增加时，缺陷的出现也增加，因此RAM中缺陷 所引起的产量降低成为问题。
通过应用一种利用普通RAM中使用的冗余电路的存储器缺陷 修复技术，本发明的发明人已经检验到产量方面的提高。然而，在 普通RAM中使用的冗余电路中，分开地提供了用于选择常规存储器
(冗余存储器)的控制电路。因此，诸如读取速度的操作特性在访 问常规存储器行或列时与访问备用存储器行或列时不同，以致于存 储器外围电路的定时设计变得困难。在普通RAM所使用的存储器缺 陷修复技术中，除具有诸如熔断器的可编程元件且用于存储待修复 的行或列地址的电路(下文中称之为熔断器电路)之外，用于存储 是否执行修复(即是否使用备用存储区域)的熔断器电路也是必需
控制信号。另外，在普通RAM的冗余电路设置有多个备用行或者列 的情况下，还必须提供用于指定待使用的行或者列的选择信号。因 而，当普通RAM的存储器缺陷修复技术按照原样应用于液晶控制驱
动器时，冗余电路和导线的占用面积变得很大，因此就会妨碍芯片 尺寸的降低。
在液晶控制驱动器的情况下，在从存储器阵列读取显示数据以 及将显示数据输出至后 一级的电路时，基于字线单元的修复不必对 应于液晶显示装置中的显示位置，而是改变待选择的地址就足够了 。 然而，为了修复数据线，则必须替换数据的位置，以与显示装置中
的显示位置对应。因此，不能按照原样将普通RAM的存储器缺陷修 复技术应用于液晶控制驱动器。
本发明的一个目的是提供一种用于修复包括在半导体集成电路 装置的存储器内的缺陷位的技术，该半导体集成电路装置用于显示 控制器，诸如其中具有用于存储显示数据的存储器的液晶控制驱动 器。
通过对说明书和附图的描述，本发明的上述目的、其他目的及 新颖的特征都将变得显而易见。
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在用于显示控制器的半导体集成电路装置中，包括在存储器中 的缺陷位可以得到修复，该显示控制器诸如是其中具有用于存储显
示数据的RAM的液晶控制驱动器。
下面将简要介绍通过本说明书中公开的那些典型发明所得到的 效果。
本发明提供了一种用于显示控制器的半导体集成电路装置，包 括显示存储器，该显示存储器具有存储区域且能够将用于显示装 置的显示数据存储至存储区域中；备用存储区域，该备用存储区域 提供在用于存储显示数据的常规存储区域的外部；修复电路，该修 复电路能够通过使用备用存储区域替换显示存储器中包括缺陷的区 域来修复缺陷；以及选择器电路，该选择器电路提供在来自显示存 储器的输出数据的传送通路上，并用于根据来自修复电路的控制信 号，使用来自备用存储区域的输出数据选择性地替换来自常规存储 区域的输出数据。
利用这种方法，提供选择器电路，其位于来自显示存储器的输 出数据的传送通路中，并用于根据来自修复电路的控制信号，使用 来自备用存储区域的输出数据选择性地替换来自常规存储区域的输 出数据。因此，该选择器电路实现了修复包括在半导体集成电路装 置的存储器内的缺陷位的本发明目的，该半导体集成电路装置用于 显示控制器，诸如其中具有用于存储显示数据的存储器的液晶控制 驱动器。
本发明还提供了一种用于显示控制器的半导体集成电路装置，
包括显示存储器，该显示存储器具有存储区域且能够将用于显示 装置的显示数据存储至存储区域中；备用存储区域，该备用存储区 域提供在用于存储显示数据的常规存储区域的外部；修复电路，该 修复电路能够通过使用备用存储区域替换显示存储器中包括缺陷的
区域来修复缺陷；数据总线，该数据总线用于将来自显示存储器的 输出数据传送至后一级的电路；多个三态电路，该多个三态电路被 提供为与显示存储器的数据输出端子相对应，并且能够将来自显示 存储器的数据输出端子的输出数据提供至数据总线；逻辑电路，该 逻辑电路用于接收经由数据总线从显示存储器传送来的数据；以及 控制电路，该控制电路用于使多个三态电路以时分方式切换至数据 输出状态。该修复电路使得与备用存储区域对应的三态电路代替与 显示存储器中包括缺陷的区域对应的三态电路而切换至数据输出状 态。
控制电路利用这种方法顺序地使得该多个三态电路以时分方式 切换至数据输出状态。在这种情况下，修复电路使得与备用存储区 域对应的三态电路代替与显示存储器中包括缺陷的区域对应的三态 电路而切换至数据输出状态。因此，该修复电路实现了修复包括在 半导体集成电路装置的存储器内的缺陷位的本发明目的，该半导体
集成电路装置用于显示控制器，诸如其中具有用于存储显示数据的 存储器的液晶控制驱动器。
当把除0以外的正整数设置为n时，通过将显示存储器划分成
多个存储区域且使每个存储区域都小于2的n次幂的地址空间来确 保未使用的地址，并且将未使用的地址分配给对应于备用存储区域 的三态电路，从而执行地址控制，使得与备用存储区域对应的三态 电路代替与显示存储器中包括缺陷的区域对应的三态电路而切换至 数据输出状态。
数据总线可以由多个存储块(mat)来共享，该多个存储块通过 将显示存储器划分成若干存储区域且使每个存储区域都小于2的n 次幂的地址空间而形成。
数据总线包括第 一 数据总线和第二数据总线，三态电路的输出 端子耦合至第 一数据总线，逻辑电路的输入端子耦合至第二数据总 线，第 一和第二数据总线可以经由能够对输入数据执行预定逻辑运 算的逻辑电路向对方发送数据/从对方接收数据。
半导体集成电路装置还可以包括能够将从外部提供的地址信号 转换为内部地址信号和存储块选择信号的内部地址转换电路。通过 存储块选择信号来选择存储块，通过使用内部地址信号来执行地址 控制，使得与备用存储区域对应的三态电路切换至数据输出状态。
本发明还提供了一种用于显示控制器的半导体集成电路装置， 包括显示存储器，该显示存储器具有存储区域且能够将用于显示 装置的显示数据存储至存储区域中；备用存储区域，该备用存储区 域提供在用于存储显示数据的常规存储区域的外部；修复电路，该 修复电路能够通过使用备用存储区域替换显示存储器中包括缺陷的 区域来修复缺陷；数据总线，该数据总线用于将来自显示存储器的 输出数据传送至后一级的电路；多个三态电路，该多个三态电路被 提供为与显示存储器的数据输出端子相对应，并且能够将来自显示 存储器的数据输出端子的输出数据提供至数据总线；逻辑电路，该 逻辑电路用于接收经由数据总线从显示存储器传送来的数据；以及 地址切换器，该地址切换器是针对在多个三态电路和逻辑电路之间 的数据传送通路而布置，用于根据修复信息切换用于选择三态电路 的地址，从而使得与备用存储区域对应的三态电路代替与显示存储
器中包括缺陷的区域对应的三态电路而切换至数据输出状态。
利用这种方法，地址切换器根据修复信息切换用于选择三态电 路的地址，从而使得与备用存储区域对应的三态电路代替与显示存 储器中包括缺陷的区域对应的三态电路而切换至数据输出状态。因 此，该地址切换器实现了修复包括在半导体集成电路装置的存储器 内的缺陷位的本发明目的，该半导体集成电路装置用于显示控制器， 诸如其中具有用于存储显示数据的存储器的液晶控制驱动器。
可以布置选择器以使其能够将传送通路上的数据切换至相邻的 数据传送通路。
作为三态电路，可以应用钟控反相器。


图1是示出了液晶控制驱动器的配置实例的框图，其中液晶控 制驱动器作为根据本发明的用于显示控制器的半导体集成电路装置 的一个实例。
图2是示出了液晶控制驱动器中的主要部分的配置实例的框图。 图3是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图4是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图5是示出了图4的配置中的传送地址的图示。 图6是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图7是示出了图6的配置中的传送地址的图示。
图8是示出了图6的配置中伪未使用地址的确保的图示。
图9是示出了液晶控制驱动器中的主要部分的另一配置实例的框图。
图IO是示出了图9的配置中的传送地址的图示。
图11是示出了图9的配置中未使用地址的伪确保(pseudo
assurance )的图示。
图12是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图13是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图14是示出了在图13的配置中外部地址与内部地址之间的对 应关系的图示。
图15是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
图16是示出了图15的配置中的传送地址的图示。 图17是示出了液晶控制驱动器中的主要部分的另一配置实例的 框图。
具体实施例方式
图1示出了液晶显示(LCD)控制驱动器(下文中称为液晶控制 驱动器)，作为根据本发明的用于显示控制器的半导体集成电路装 置的一个实例。
图1示出的液晶控制驱动器200其中具有RAM (下文中称作显 示存储器)，作为用于存储以图形方式显示在点阵式液晶显示面板 上的数据的存储器。液晶控制驱动器200被构造为与写电路、读电 路以及驱动器一起位于单一半导体衬底上的半导体集成电路，其中 该驱动器用于输出液晶显示面板的驱动信号。
液晶控制驱动器200具有基于来自外部微处理器或者微计算机 (下文中称作微计算机)等的命令来控制整个芯片内部的控制器 201。液晶控制驱动器200还具有脉冲发生器202和定时控制电路 203，脉沖发生器202用于基于来自外部的振荡信号或者来自连接至 外部端子的振荡器的振荡信号在芯片内生成参考时钟脉冲，定时控
定时的定时信号。
液晶控制驱动器200还具有系统接口 204和外部显示接口 205, 系统接口 204主要用于经由未示出的系统总线来从微计算机等接收 诸如指令和静态显示数据的数据以及向微计算机等传送诸如指令和 静态显示数据的数据，外部显示接口 205用于经由未示出的显示数 据总线来主要从应用处理器等接收运动图像数据以及水平和垂直同 步信号HSYNC和VSYNC。
液晶控制驱动器200还具有显示存储器206,用于以位图方法 来存储显示数据；位转换电路207，用于执行位处理，诸如重新排列 来自微计算机的RGB写数据的位；写数据锁存器208，用于锁存和 保持由位转换电路207转换的显示数据或者经由外部显示接口 205 输入的显示数据；读数据锁存电路209，用于保持从显示存储器206 读取的显示数据；以及地址生成电路210，用于生成至显示存储器 206的选择地址。
显示存储器206由包括多个存储器单元、字线和位线(数据线) 的存储器阵列以及具有地址解码器的可读写RAM来构成，其中该地 址解码器用于对从地址生成电路210提供的地址进行解码并生成用 于选择存储器阵列中的字线和位线的信号。显示存储器206还包括 读出放大器和写驱动器，读出放大器用于放大从存储器单元读取的 信号，写驱动器用于根据写数据对存储器阵列中的位线施加预定的 电压。尽管并非限制，但是在本实施例中，存储器阵列具有172, 800 字节的存储容量，并且可以基于列单元(18位)通过17位地址信号 来读/写数据。
液晶控制驱动器200还包括锁存电路212、选择器电路213和逻 辑电路214，锁存电路212用于顺序地锁存从显示存储器206中读取 的显示数据，选择器电路213能够选择性地将锁存的显示数据传送 至后面的电路，逻辑电路214用于接收由选择器电路213选择性传 送的显示数据。逻辑电路214包括用于生成用于AC驱动的数据的 AC电路和用于锁存AC电路生成的数据的锁存电路，AC驱动防止 了由于从选择器电路213中选择性传送的显示数据而引起的液晶退 化。液晶控制驱动器200还包括液晶驱动电平生成电路216、色调电 压生成电路217和y调整电路218,液晶驱动电平生成电路216用 于生成驱动液晶面板所必需的多种电平的电压，色调电压生成电路 217用于基于液晶驱动电平生成电路216所生成的电压生成适合于 色彩显示和色调显示的波形信号的生成所必需的色调电压，y调整 电路218用于设置色调电压以校正液晶面板的y特性。
在逻辑电路214的后一级，提供源极线驱动电路215。源极线驱 动电路215通过根据逻辑电路214的输出数据从色调电压生成电路 217提供的色调电压中选择一个电压来输出电压(源极线驱动信号) Sout,电压Sout将被施加至作为液晶面板中的信号线的源极线。液 晶控制驱动器200还包括栅极线驱动电路219和扫描数据生成电路 220,栅极线驱动电路219用于输出电压(栅极线驱动信号)Gout, 电压Gout将被施加至作为液晶面板中的选择线的栅极线(也称作公 共线)，扫描数据生成电路220由移位寄存器等形成，用于生成顺 序地将液晶面板中的栅极线逐 一 驱动至选择电平的扫描数据。
另外，液晶控制驱动器200包括内部参考电压生成电路221以 及电压调节器222,内部参考电压生成电路221用于生成内部参考电 压，电压调节器222用于通过降低从外部提供的诸如3.3或者2.5V 的电压Vcc来生成内部逻辑电路的诸如1.5V的电源电压Vdd。在图 1中，SEL1和SEL2指示了数据选择器，这些数据选择器由从定时 控制电路203输出的切换信号来控制，以选择性地使多个输入信号 中的任意信号通过。
控制器210设置有诸如控制寄存器CTR和索引寄存器IXR的寄 存器，控制寄存器CTR用于控制整个芯片的操作状态，诸如液晶控 制驱动器200的操作模式，索引寄存器IXR用于存储用来参考控制 寄存器CTR和显示存储器206的索引信息。当通过把数据从外部微 计算机等写入至索引寄存器IXR中来指定待执行的指令时，控制器 201根据所指定的指令来生成并输出控制信号。
通过如上所构造的控制器201的控制，在基于来自微计算机等
的指令和数据将数据显示在未示出的液晶显示面板上时，液晶控制
驱动器200执行将显示数据顺序写入至显示存储器206的绘图处理。 执行从显示存储器206周期性地读取显示数据的读取处理，生成并 输出将施加至液晶面板中的源极线的信号，并且生成和输出将顺序 施加至栅极线的信号。
系统接口 204向诸如微计算机的系统控制器传送将数据绘图至 显示存储器206所必需的到寄存器的信号(诸如设置数据和显示数 据)以及从系统控制器接收该信号。在实施例中，可以根据IM3-1 和IMO/ID端子的状态，选4奪任何18位、16位、9位和8位并行输 入/输出或者串行输入/输出接口作为80系列的接口 。
液晶控制驱动器200具有修复电路230和修复信息设置电路 240，修复电路230用于修复显示存储器206中的缺陷位，修复信息 设置电路240用于保持包括缺陷位的待修复存储器行的地址作为修 复信息。尽管并非限制，但是修复信息设置电路240是能够存储待 修复的存储器行或列的地址的熔断器电路。根据修复信息设置电路 240中设置的修复信息，修复电路230基于字线单元或基于数据线单 元使用冗余区域来替换显示存储器206中包括缺陷位的区域。显示 存储器206包括与用于存储显示数据的常规存储区域分开提供的修 复区域(备用存储区域)206a。修复区域206a包括用于修复字线的 字线修复区域和用于修复数据线的数据线修复区域。在经由写数据 锁存电路208将显示数据写入至显示存储器206的情形中、在经由 读数据锁存电路209将存储在显示存储器206中的数据读取到系统 侧的情形中以及在经由锁存电路212读取存储在显示存储器206中 的数据的情形中的每种情形中，基于修复信息设置电路240的设置 信息来执行由修复电路230进行的冗余修复。在从显示存储器206 读取显示数据以及向随后一级的锁存电路212输出读取的显示数据 的情况下，基于字线单元的修复并非必须与液晶显示器中的显示位 置对应。改变待选择的地址就足够了。为了修复数据线，则必须替 换数据的位置，以与液晶显示器中的显示位置对应。如下所述来替 换数据的位置。
图2示出了液晶控制驱动器200中的主要部件与液晶显示器的 关系。
尽管并非限制，但是图2中示出的液晶显示器100是7像素x7 像素的8色显示器。 一个像素由红、绿和蓝三点构成。来自液晶控 制驱动器200的源极线驱动信号Sout被提供至液晶显示器100。来 自液晶控制驱动器200的栅极线驱动信号Gout (未示出)也被提供 至液晶显示器100。
显示存储器206包括存储器单元阵列206b以及地址解码器和字 线驱动器206c，在存储器单元阵列206b中以阵列形状布置了多个存 储器单元，地址解码器和字线驱动器206c用于解码输入地址信号并 生成用于将字线驱动至选择电平的信号。存储器单元阵列206b具有 修复区域206a。修复区域206a包括用于修复字线的字线修复区域和 用于修复数据线的数据线修复区域。
如图2所示，图1所示的修复信息设置电路240包括能够设置 字线修复信息的修复信息设置电路240a和能够设置数据线修复信息 的修复信息设置电路240b。如图2所示，图1中所示的修复电路230 包括字线修复电路23Oa和数据线修复电路23Ob ，字线修复电路23Oa 用于根据在修复信息设置电路240a中设置的修复信息来修复字线， 数据线修复电路230b用于根据在修复信息设置电路240b中设置的 修复信息来修复数据线。
选择器电路213布置在来自显示存储器206的输出数据的传送 通路上，并且布置在锁存电路212和逻辑电路214之间。选择器电 路213具有根据来自修复电路的控制信号使用来自备用存储区域的 输出数据选择性地替换来自常规存储区域的输出数据的功能。锁存 电路212包括对应于显示存储器206中的常规存储区域的多个锁存 器以及对应于用于修复数据线的区域的多个锁存器。多个锁存器中 的每个锁存器都耦合至显示存储器206中的数据输出端子。经由相 应锁存器将从显示存储器206中的输出端子输出的数据传送至随后
一级的选择器电路213。
选择器电路213包括多个选择器，与多个对应于显示存储器206 中的常规存储区域的锁存器对应。多个选择器中的每个选择器具有 示出为"-"和"+ "的两个输入端子，传送至两个输入端子的数 据被选择性地传送至后一级的逻辑电路214。选择操作由从数据线修 复电路230b输出的数据线修复信号来控制。来自锁存电路212中相 应锁存器的输出数据被传送至多个选择器中的输入端子"-"。来 自与数据线修复区域对应的锁存器的输出数据被传送至多个选择器 中的输入端子"+ "。
图3示出了使用图2中的配置进行冗余修复的状态。 在性能测试中，如图3所示，在确定由标记X所指示的区域为 显示存储器206中常规存储区域内的缺陷部分时，在修复信息设置 电路204b中设置将区域90指示为包括缺陷部分的数据线修复目标 的信息，即指示对应于传送地址add2的区域是缺陷区域。在进行了 修复信息设置之后，通过基于来自数据线修复电路230b的数据线修 复信号来控制选择器电路213的操作，代替来自作为包括缺陷部分 的数据线修复目标的区域90 (对应于传送地址add2的区域)的输出 数据，将来自数据线修复区域(对应于传送地址add7的区域)的输 出数据选择性地传送至逻辑电路214。具体来讲，在选择器电路213 中，与传送地址addO、 addl、 add3、 add4、 add5和add6对应的锁存 器选择性地把传送至输入端子"-"的数据传送至逻辑电路214。与 传送地址add2对应的锁存器(以80来指示)选择性地把传送至输 入端子"+"的数据(即来自与传送地址add7对应的数据线修复区 域的数据)传送至逻辑电路214。通过基于来自数据线修复电路230b 的数据线修复信号来控制选择器电路213的操作，代替来自作为包 括缺陷部分的数据线修复目标的区域90(对应于传送地址add2的区 域)的输出数据，将来自数据线修复区域(对应于传送地址add7的 区域)的输出数据选择性地传送至逻辑电路214。以这样的方式来执 行数据线修复。
在优选使用字线修复区域进行修复的情况下，在修复信息设置
电路240a中设置修复信息。在地址生成电路210的输出地址与字线 的修复设置电路240a中设置的修复信息匹配的情况下，通过代替常 规存储区域中的字线将字线修复区域中的字线驱动至选择电平，来 执行基于字线单元的修复。
在该实施例中，可以得到下列效果。
(1) 在从存储器阵列读取显示数据并向下一级的电路中输出显示 数据的情况下，不需要与液晶显示器100中的显示位置相对应地执 行基于字线单元的修复，而是改变待选择的地址就足够了。然而， 为了修复数据线，则必须替换数据的位置，以与显示器中的显示位 置对应。在图2示出的配置中，通过提供选择器电路213来替换数 据的位置。因此，可以容易地修复数据线。
(2) 在普通RAM中使用的冗余电路内，分开地提供用于选择常规 存储器行或列的控制电路以及用于选择将用来替换缺陷位的备用行 或列(冗余存储器)的控制电路。因而，诸如读取速度的操作特性 在访问常规存储器行或列时与访问备用存储器行或列时不同，以致 于存储器外围电路的定时设计变得困难。而在前面的实施例中，不 需要作为分离电路来构造用于选择常规行或列的控制电路以及用于 选择将用来替换缺陷位的备用行或列的控制电路。因此，有利于显 示存储器206的外围电路的定时设计。
图4示出了液晶控制驱动器200中的主要部分的另 一 配置实例。 就显示存储器206的输出数据由以三态(高、低和高阻抗)电 路为例的钟控反相器电路312来接收并且在钟控反相器电路312与 逻辑电路214之间提供使用公共地址的数据总线D-BUS的角度以及 提供用于控制传送地址的传送地址控制电路250的角度而言，图4 示出的配置与图2示出的配置有很大不同。
钟控反相器电路312包括与显示存储器206的输出端子相对应 地布置的多个钟控反相器。按每个对应于一个像素的数据大小，将 传送地址add0至add7分配给多个钟控反相器。同样，逻辑电路214
包括多个逻辑电路，并且按每个对应于一个像素的数据大小，将传
送地址ADDO至ADD6分配给多个逻辑电路。钟控反相器电路312 和逻辑电路214受到通过传送地址进行的时分控制。通过时分控制， 经由数据总线D-BUS将钟控反相器电路312的输出信号传送至逻辑 电路214。
将传送地址信号313从传送地址控制电路250提供至逻辑电路 214,并且将传送地址信号314经由数据线修复电路230b从传送地 址控制电路250提供至钟控反相器电路312。使用传送地址信号313 来冲丸行对于传送地址ADDO至ADD6的时分控制。使用传送地址信 号314来执行对于传送地址addO至add7的时分控制。数据线修复 电路230b根据在修复信息设置电路240b中设置的修复信息来替换 传送地址。例如，当91所指示的区域是数据线修复目标时，那么如 图5所示，使用与数据线修复电路230b中的数据线修复区域对应的 传送地址add7来代替与作为数据线修复目标的区域91对应的传送 地址add2。因此，在时分控制下，以传送地址addO、 addl、 add7、 add3、 add4、 add5和add6的顺序将数据从钟控反相器电路312输出 至数据总线D-BUS。此时，逻辑电路214以传送地址ADDO、 ADD1、 ADD2、 ADD3、ADD4、ADD5和ADD6的顺序对来自数据总线D-BUS 的数据进行锁存。在进行从钟控反相器312至逻辑电路214的时分 传送时，通过代替来自作为数据线修复目标的区域91的输出数据而 将来自数据线修复区域的输出数据传送至逻辑电路214，来执行数据 线修复。
通过上述实施例，可以得到下列效果。
(l)在从存储器阵列读取显示数据并向随后一级的电路输出显示 数据的情况下，基于字线单元的修复并非必须与显示器中的显示位 置对应。改变待选择的地址就足够了。为了修复数据线，则必须替 换数据的位置，以与显示器中的显示位置对应。在图4的配置中， 由钟控反相器电路312接收显示存储器206的输出数据，在钟控反 相器电路312和逻辑电路214之间提供了使用公共地址的数据总线
D-BUS，并且进一步提供了用于控制传送地址的传送地址控制电路 250。使用该配置，允许与备用存储区域对应的钟控反相器代替与显 示存储器206中包括缺陷的区域对应的钟控反相器而进入数据输出 状态，从而替换数据的位置。因此，可以容易地修复数据线。
(2)使用图4示出的配置，就不需要图2中示出的选择器电路213, 因此可以减小芯片面积。
图6示出了液晶控制驱动器200中的主要部分的另一配置实例。
就显示存储器206被划分为多个存储块并且与存储块划分相关 联地布置外围电路的角度而言，图6示出的液晶控制驱动器200与 图4所示的液晶控制驱动器200有很大不同。尽管并非限制，但是 显示存储器206被划分为左存储块206L和右存储块206R。对于左 存储块206L,布置了钟控反相器电路312L、数据总线D-BUSL、逻 辑电路214L以及地址解码器和字线驱动器206CL。对于右存储块 206R,布置了钟控反相器电路312R、数据总线D-BUSR、逻辑电路 214R以及地址解码器和字线驱动器206CR。左存储块206L和右存 储块206R中每一个都具有小于2的n次幂的地址空间的存储区域。 "n，，指除0以外的正整数(1， 2, 3，...)。该操作是要确保左、右 存储块206L、 206R的每一个中的数据线修复区域的传送地址，并将 其分配给与备用存储区域对应的钟控反相器。即，在将左、右存储 块206L、206R的每一个都设置为小于2的n次幂地址空间的存储区 域的情况下(在该实例中，是3,其小于22)，如图8所示，当仅关 注三位地址A2、 Al和AO中的较低地址Al和AO时可以确保伪未 使用地址"ll"和"10"。在数据线修复电路230b中，由未使用地址"ll" 来选择左存储块206L中的数据线修复区域，并且由未使用地址"10" 来选择右存储块206R中的数据线修复区域。
例如，在图6中，在由91L和91R指示的区域是数据线修复目 标的情况下，如下所述对该区域进行修复。数据线修复电路230b基 于修复信息设置电路240b中的存储信息，在存储块206L侧上选择 "11"，以代替地址"010"。在时分传送时，如图7所示，^使得与add3 对应的钟控反相器激活，以代替左存储块206L侧的传送地址add2。 可以使与add3对应的钟控反相器激活，以代替右存储块206R侧的 传送地址addl。
在该实施例中，可以得到下列效果。
即使在显示存储器206被划分为多个存储块的情况下，通过分 别由钟控反相器电路312L和312R接收左、右存储块206L、 206R 的输出数据，在钟控反相器电路312L和312R与逻辑电路214L和 214R之间提供数据总线D-BUSL和D-BUSR，以及提供用于传送地 址控制的传送地址控制电路250，从而允许与备用存储区域对应的钟 控反相器能够代替与左、右存储块206L和206R中包括缺陷的区域 对应的钟控反相器而进入数据输出状态，从而替换数据的位置。因 此，能够以与图4所示情况类似的方式容易地修复数据线。
图9示出了液晶控制驱动器200中的主要部分的另一配置实例。
就不与左、右存储块206L和206R相对应地划分数据总线 D-BUS的角度而言，图9示出的液晶控制驱动器200与图6所示液 晶控制驱动器200有很大不同。
从数据线修复电路23Ob提供至钟控反相器电路312L和312R的 传送地址信号具有3位的结构(A2， Al， AO),如图ll所示。当AO位 为"O"时，选择钟控反相器电路312L。当A0位为"1"时，选择钟控反 相器电路312R。当Al和A2均被设置为关注位时，根据Al和A2 位，使得钟控反相器电路312L和312R中的钟控反相器激活。
反相器电路312L和312R的传送地址之间的关系。
由91L和91R指示的区域是数据线修复目标。通过在数据线修 复电路230b的控制下选择传送地址add6来代替与数据线修复区域 91L对应的钟控反相器的传送地址add4，来使用左存储块206L中的 数据线修复区域。通过选择传送地址add7来代替与数据线修复区域 91R对应的钟控反相器的传送地址add3，来使用右存储块206R中的 数据线修复区域。
在该实施例中，可以得到下列效果。
(1) 即使在显示存储器206被划分为多个存储块的情况下，通过 分别由钟控反相器电路312L和312R接收左、右存储块206L、 206R 的输出数据，在钟控反相器电路312L和312R与逻辑电路214L和 214R之间提供数据总线D-BUS,以及提供用于传送地址控制的传送 地址控制电路250,来允许与备用存储区域对应的钟控反相器能够代 替与左、右存储块206L和206R中包括缺陷的区域对应的钟控反相 器而进入数据输出状态，从而替换数据的位置。因此，能够以与图4 所示情况类似的方式容易地修复数据线。
(2) 由于未与左、右存储块206L和206R相对应地划分数据总线 D-BUS,因此可以任意地改变逻辑电路214L和214R中用于传送地 址ADDO至ADD5的数据布置。
图12示出了液晶控制驱动器200中的主要部分的另一配置实例。
就逻辑电路侧数据总线D-BUS-1布置在逻辑电路214侧、钟控 反相器电路侧数据总线D-BUS-2布置在钟控反相器电路312侧以及 逻辑电路97布置在逻辑电路侧数据总线D-BUS-1和钟控反相器电路 侧数据总线D-BUS-2之间的角度而言，图12示出的液晶控制驱动器 200与图4所示液晶控制驱动器200有很大不同。逻辑电路97中的 处理包括用于转换显示色彩的色彩转换处理和用于改变字符大小的 尺寸加^吾处理。
在该实施例中，可以得到下列效果。
(1) 在逻辑电路97布置在逻辑电路侧数据总线D-BUS-1和钟控 反相器电路侧数据总线D-BUS-2之间的情况下，允许与备用存储区 域对应的钟控反相器以类似于图6的方式代替与显示存储器206中 包括缺陷的区域对应的钟控反相器而进入数据输出状态，从而替换 数据的位置。因此，可以容易地修复数据线。
(2) 由于逻辑电路97布置在逻辑电路侧数据总线D-BUS-1和钟 控反相器电路侧数据总线D-BUS-2之间，因此可以集中(inalump)
对显示数据执行诸如色彩转换处理和尺寸加倍处理的图像处理。
图13示出了液晶控制驱动器200中的主要部分的另一配置实例。
就^t巴内部/外部地址转换为内部地址的角度而言，图13示出的液 晶控制驱动器200与图4示出的液晶控制驱动器200有很大不同。 经由接口 87来接收字线地址信号和数据线地址信号。字线地址信号 被传送至字线地址控制电路8 8 。在修复信息设置电路240c中设置字 线修复信息。字线修复电路230a根据在修复信息设置电路240c中 设置的字线修复信息来修复字线。经由数据线地址控制电路89将经 由接口 87从外部接收的数据线地址信号A2、 Al和AO传送至内部 地址转换电路86。内部地址转换电路86把输入的数据线地址信号 A2、A1和AO转换为内部地址信号al和a0以及存卡者块选才奪信号m0。 将内部地址信号al和a0以及存储块选择信号mO传送至布置在后一 级的数据线修复电路230c。数据线修复电路230c将从内部地址转换 电路8 6传送来的数据线地址信号与修复信息设置电路中设置的修复 信息进行比较。当数据线地址信号与修复信息相符合时，替换显示 存储器206中的数据写地址，以修复数据线。存储块选择信号m0 被传送至写定时控制电路203b。在将数据写入至显示存储器206时， 写定时控制电路203b基于存储块选择信号mO选择存储块。经由写 数据锁存器208来锁存待写入的数据。
提供了传送定时控制电路203a。传送定时控制电路203a基于经 由未示出的接口等传送的控制信号来控制传送定时。提供了传送地 址定时控制电路250。传送地址控制电路250生成传送地址信号，用 于选择性地使逻辑电路214L和214R与来自传送定时控制电路203a 的定时控制信号同步地进入写状态。数据线修复电路23 0b将从传送 地址控制电路250传送来的传送地址信号与修复信息设置电路240b 中设置的修复信息进行比较。当传送地址信号与修复信息相符合时， 替换用于激活钟控反相器312L和312R中的每个钟控反相器的传送 地址信号，以修复数据线。当区域91R和91L是数据线修复目标时
通过时分传送来替换数据的情况例如与图6中示出的配置的情况类 似。将不再重复进行这种情况的详细描述。
图14示出了外部地址(^t据线地址A2、 Al和AO)和内部地址 之间的对应关系。在仅仅利用从外部看到的地址来执行控制而无需 执行内部地址转换的情况下，对应于addO、 addl和add2的A2、 Al 和AO在存储块之间不同。相反，当在图13示出的配置中执行了内 部地址转换时，存储块中的内部地址(al, aO)是重复的。在外部地址 中，ADD2和ADD3 (左存储块中的add2和右存储块中的addO )是 连续的，使得在液晶控制驱动器200的制造时显示存储器206的处 理变得容易。
在该实施例中，可以得到下列效果。
(1) 允许与备用存储区域对应的钟控反相器代替与左、右存储块 207L和207R中包括缺陷的区域对应的钟控反相器而进入数据输出 状态，从而替换数据的位置。因此，数据线能够以类似于图4、 6和 9所示情况的方式容易地来修复。
(2) 通过执行内部地址转换，使得存储块中的内部地址(a0， al) 重复。因此，存在这样的优点，即存储块的数量越大，控制、布局 设计和校验越容易。由于与数据线修复区域(冗余区域)对应的地 址在所有的存储块中都相同，因此也方便了修复信息的处理。例如， 当没有必要修复时，将修复信息设置为"ll"就足够了。在修复存储 块的左端的数据线的情况下，设置为"00"就足够了。因此，修复信 息可以得到简化。
图15示出了液晶控制驱动器200中的主要部分的另一配置实例。
就用于切换地址的地址切换器85提供在钟控反相器电路312与 数据总线D-BUS之间的角度而言，图15示出的液晶控制驱动器200 与图4中示出的液晶控制驱动器200有很大不同。具体来讲，当区 域91是数据线修复目标时，尽管并非限制，但是地址切换器85根 据在修复信息设置电路240b中设置的修复信息，使对应于数据线修
复目标的钟控反相器未被选择，而使得选择存在于该钟控反相器右 侧的钟控反相器。由于对应于数据线修复目标的钟控反相器未被选 择，因此所选择的数据被逐个像素进行切换，而对应于数据线修复 区域的钟控反相器被选择，从而数据线得到修复。如图16所示，经
由数据总线D-BUS以时分方式传送数据。
图17示出了液晶控制驱动器200中的主要部分的另一配置实例。
就基于修复信息设置电路240b中设置的修复信息通过选择器电 路213来切换选择数据的角度而言，图17示出的液晶控制驱动器200 与图2示出的液晶控制驱动器200有很大不同。选择器电路213中 的每个选择器电路选择性地将与该选择器对应的钟控反相器的输出 数据和与该钟控反相器相邻的钟控反相器的输出数据传送到逻辑电 路215。在区域91是数据线修复目标并且执行数据线修复的情况下， 通过选择器213使与区域91 (对应于传送地址addl )对应的钟控反 相器的输出未被选择。通过逐个像素地切换选择数据，来执行数据 线修复。在这种配置中，自钟控反相器212到逻辑电路215的数据 传送通路的长度几乎相等，而不需考虑待修复的数据线。因此就不 需要考虑数据传送通路上的时间延迟的变化。
发明并不限于上述情形，并且还可以进行各种改变。
已经描述了在与本发明的背景技术相同的应用领域中，将此处 发明人实现的本发明应用到用来生成和输出用于液晶面板的驱动信 号的液晶控制驱动器的情况。但是本发明并不限于这种情况，而是 还可以用于显示控制器的半导体集成电路，用来驱动除液晶之外的 显示器，诸如有才几EL显示面板。
权利要求
1.一种用于显示控制器的半导体集成电路装置，包括显示存储器，所述显示存储器具有存储区域且能够将用于显示装置的显示数据存储至所述存储区域中；备用存储区域，所述备用存储区域提供在用于存储所述显示数据的常规存储区域的外部；修复电路，所述修复电路能够通过使用所述备用存储区域替换所述显示存储器中包括缺陷的区域来修复缺陷；以及选择器电路，所述选择器电路提供在来自所述显示存储器的输出数据的传送通路上，并用于根据来自所述修复电路的控制信号，使用来自所述备用存储区域的输出数据选择性地替换来自所述常规存储区域的输出数据。
2. —种用于显示控制器的半导体集成电路装置，包括 显示存储器，所述显示存储器具有存储区域且能够将用于显示装置的显示数据存储至所述存储区域中；备用存储区域，所述备用存储区域提供在用于存储所述显示数据 的常规存储区域的外部；修复电路，所述修复电路能够通过使用所述备用存储区域替换所 述显示存储器中包括缺陷的区域来修复缺陷；数据总线，所述数据总线用于将来自所述显示存储器的输出数据 传送至后一级的电路；多个三态电路，所述多个三态电路被提供为与所述显示存储器的 数据输出端子相对应，并且能够将来自所述显示存储器的所述数据 输出端子的输出数据提供至所述数据总线；存储器传送来的数据；以及控制电路，所述控制电路用于使得所述多个三态电路以时分方式 切换至数据输出状态， 其中所述修复电路使得与所述备用存储区域对应的所述三态电 路代替与所述显示存储器中包括所述缺陷的所述区域对应的三态电 路而切换至数据输出状态。
3. 根据权利要求2所述的用于显示控制器的半导体集成电路装置，其中当把除0以外的正整数设置为n时，通过将所述显示存储器 划分成多个存储区域且使每个存储区域都小于2的n次幂的地址空 间，来确保未使用的地址，并且将所述未使用的地址分配给对应于 所述备用存储区域的所述三态电路，从而执行地址控制，使得与所 述备用存储区域对应的所述三态电路代替与所述显示存储器中包括 所述缺陷的所述区域对应的所述三态电路而切换至数据输出状态。
4. 根据权利要求2所述的用于显示控制器的半导体集成电路装置，其中所述数据总线可以由多个存储块来共享，所述多个存储块通2的n次幂的地址空间而形成。
5. 根据权利要求4所述的用于显示控制器的半导体集成电路装置，其中所述数据总线包括第一数据总线，所述三态电路的输出端 子耦合至所述第一数据总线；以及第二数据总线，所述逻辑电路的 输入端子耦合至所述第二数据总线，并且其中所述第 一和第二数据总线经由能够对输入数据执行预定逻 辑运算的逻辑电路向对方发送数据/从对方接收数据。
6. 根据权利要求4所述的用于显示控制器的半导体集成电路装 置，还包括内部地址转换电路，所述内部地址转换电路能够将从外 部提供的地址信号转换为内部地址信号和存储块选择信号，其中存储块通过所述存储块选择信号来选择，地址控制通过使用 所述内部地址信号来执行，所述地址控制用于使与所述备用存储区 域对应的所述三态电路切换至数据输出状态。
7. —种用于显示控制器的半导体集成电路装置，包括 显示存储器，所述显示存储器具有存储区域且能够将用于显示装置的显示数据存储至所述存储区域中；备用存储区域，所述备用存储区域提供在用于存储所述显示数据 的常规存储区域的外部；修复电路，所述修复电路能够通过使用所述备用存储区域替换所 述显示存储器中包括缺陷的区域来修复缺陷；数据总线，所述数据总线用于将来自所述显示存储器的输出数据 传送至后一级的电路；多个三态电路，所述多个三态电路被提供为与所述显示存储器的 数据输出端子相对应，并且能够将来自所述显示存储器的所述数据 输出端子的输出数据提供至所述数据总线；逻辑电路，所述逻辑电路用于接收经由所述数据总线从所述显示 存储器传送来的数据；以及地址切换器，所述地址切换器布置在所述多个三态电路和所述逻 辑电路之间的数据传送通路中，并用于根据修复信息切换用于选择 所述三态电路的地址，从而使得与所述备用存储区域对应的所述三 态电路代替与所述显示存储器中包括缺陷的区域对应的所述三态电 路而切换至数据输出状态。
8. 根据权利要求1所述的用于显示控制器的半导体集成电路装置，其中所述选择器布置成使得能够将所述传送通路上的数据切换 至相邻的数据传送通路。
全文摘要
本发明旨在修复包括在用于显示控制器的半导体集成电路装置的存储器中的缺陷位。该半导体集成电路装置具有显示存储器和修复电路，该显示存储器能够在存储区域中存储显示数据，该修复电路能够通过使用提供在用于存储显示数据的常规存储区域外部的备用存储区域替换显示存储器中包括缺陷的区域来修复缺陷。该装置还包括选择器电路，该选择器电路提供在来自显示存储器的输出数据的传送通路上，并用于根据来自修复电路的控制信号，使用来自备用存储区域的输出数据选择性地替换来自常规存储区域的输出数据。通过根据来自修复电路的控制信号使用来自备用存储区域的输出数据选择性地替换来自常规存储区域的输出数据，使缺陷位得到修复。
文档编号G09G5/36GK101174404SQ20071016757
公开日2008年5月7日 申请日期2007年10月29日 优先权日2006年10月30日
发明者辻壮介, 饭塚胜 申请人:株式会社瑞萨科技