扫描信号线驱动电路以及具备其的显示装置的制作方法

专利名称：扫描信号线驱动电路以及具备其的显示装置的制作方法
技术领域：
本发明涉及显示装置及其驱动电路，详细来讲，涉及包括对配置于显示装置的显示部的扫描信号线进行驱动的多个移位寄存器的扫描信号线驱动电路。
背景技术：
近年来，在液晶显示装置中，用于驱动栅极总线(扫描信号线)的栅极驱动器(扫描信号线驱动电路)的单片化正在发展。从前，栅极驱动器作为ICantegrated Circuit)芯片搭载于构成液晶面板的基板的周边部的情况较多，但近年来，在基板上直接形成栅极驱动器的情况逐渐变多。这样的栅极驱动器称为“单片栅极驱动器”等。在具备单片栅极驱动器的液晶显示装置中，从前使用有非晶硅(a-Si)的薄膜晶体管(以下称为“a-SiTFT”)作为驱动元件被采用，但近年来，使用有微晶硅(μ c-Si)的薄膜晶体管(以下称为“ μ C-SiTFTO的采用被实现。微晶硅的迁移率比非晶硅的迁移率大，且μ c-SiTFT通过与a-SiTFT相同的工序形成。因此，通过在驱动元件中采用μ c-SiTFT，来期待边框面积的减小和/或驱动器IC的芯片数量的削减等的成本的降低、安装成品率的提高、显示装置的大型化的实现等。但是，有源矩阵型的液晶显示装置的显示部，包含多条源极总线(视频信号线);多条栅极总线；和与这些多条源极总线和多条栅极总线的交叉点各自对应设置的多个像素形成部。这些像素形成部配置为矩阵状，构成像素阵列。各像素形成部，包含薄膜晶体管，其为栅极端子与通过对应的交叉点的栅极总线连接并且源极端子与通过该交叉点的源极总线连接的开关元件；和用于保持像素电压值的像素电容等。在有源矩阵型的液晶显示装置中，还设置有上述的栅极驱动器和用于驱动源极总线的源极驱动器(视频信号线驱动电路)。表示像素电压值的视频信号通过源极总线传达，但各源极总线不能在一个时间(同时)传达多行的表示像素电压值的视频信号。因此，向配置为矩阵状的上述的像素形成部内的像素电容的视频信号的写入(充电)逐行地依次进行。因此，多条栅极总线以规定期间依次被选择，栅极驱动器包括包含多个级的移位寄存器。移位寄存器的各级成为双稳态电路，该双稳态电路在各时刻成为2个状态(第一状态和第二状态)中的任一个状态，并将表示该状态的信号(以下称为“状态信号”。)作为扫描信号进行输出。而且，通过从移位寄存器内的多个双稳态电路依次输出有效的扫描信号，如上所述，向像素电容的视频信号的写入逐行地依次进行。另外，关于本申请发明，已知有以下那样的现有技术。在日本的特开2005-94335号公报中，关于设置于图像读取装置等的电子装置的移位寄存器，公开有抑制晶体管的阀值特性的变动的结构。在日本的特开2003-16794号公报中，关于设置于电子装置的移位寄存器的晶体管，公开有防止由晶体管的寄生电容引起的误动作的结构。在日本的特开2006-106394号公报中，关于液晶显示装置，公开有使用其它相时钟使2个栅极驱动器动作的结构。在日本的特开2006-107692号公报中，关于设置于显不面板的移位寄存器,公开有对由晶体管的阀值电压的变动弓I起的误动作进行抑制的结构。在日本的特开2006-127630号公报中，关于用于液晶显示装置的移位寄存器，公开有使用多个时钟使移位寄存器动作的结构。在日本的特开2001-52494号公报中，关于设置于电子装置的移位寄存器，公开有防止输出信号的电平的衰减和移位寄存器的阀值电压特性的变动的结构。现有技术文献专利文献专利文献I :日本特开2005-94335号公报专利文献2 日本特开2003-16794号公报专利文献3 :日本特开2006-106394号公报专利文献4 :日本特开2006-107692号公报专利文献5 :日本特开2006-127630号公报专利文献6 :日本特开2001-52494号公报

发明内容
发明想要解决的问题但是，近年来，在具有单片栅极驱动器的液晶显示装置中，面板的大型化和高精细化正在发展。当面板大型化时，栅极总线的负载电容随其增大。由此，扫描信号(状态信号)的下降所需要的时间变长。这样，在对某行的像素电容的充电期间的结束后至对下一行的像素电容的充电期间开始之前，发生该某行的扫描信号并不下降至低电平(像素形成部内的薄膜晶体管成为断开状态的电平)的情况。其结果，产生由要在某行显示的颜色和要在下一行显示的颜色的混色引起的显示不良。此外，即使面板高精细化，也因为每一条线的充电时间变短，所以产生由上述那样的混色引起的显示不良。对于产生由这样的混色引起的显不不良，表不移位寄存器所包含的双稳态电路的结构和双稳态电路的输入输出信号的波形，并进行说明。另外，以下，以设置于双稳态电路内的薄膜晶体管全部为η沟道型的情况进行说明。图19是表示栅极驱动器内的移位寄存器所包含的双稳态电路的结构例的电路图。如图19所示，双稳态电路具备12个薄膜晶体管Tl Τ12 ;和电容器CAP。此外，该双稳态电路，除了低电平的电源电压VSS用的输入端子之外，还具有7个输入端子41 47 ;和用于输出状态信号Q的2个输出端子51、52。另外，从输出端子51输出的状态信号Q,作为扫描信号GOUT供给到与该双稳态电路对应的栅极总线。此外，从输出端子52输出的状态信号Q作为用于控制与该双稳态电路不同级的双稳态电路的动作的信号(以下称为“其它级控制信号”。)Z，供给到该不同级的双稳态电路。薄膜晶体管Tl的栅极端子、薄膜晶体管T2的源极端子、薄膜晶体管T3的漏极端子、薄膜晶体管T4的漏极端子、薄膜晶体管T5的漏极端子、薄膜晶体管T7的栅极端子和 薄膜晶体管Tll的栅极端子相互连接。另外，为了方便将这些相互连接的区域(配线)称为“netA”。薄膜晶体管T5的栅极端子、薄膜晶体管T6的源极端子、薄膜晶体管T7的漏极端子和薄膜晶体管T8的漏极端子相互连接。另外，为了方便将这些相互连接的区域(配线)称为 “netB”。但是，在此说明的栅极驱动器以包含2个移位寄存器为前提。而且，从一个移位寄存器内的双稳态电路输出的扫描信号GOUT供给到第奇数行的栅极总线，从另一个移位寄存器内的双稳态电路输出的扫描信号GOUT供给到第偶数行的栅极总线。S卩，能够考虑“通过这2个移位寄存器，来实现逐条地依次选择显示部内的多条栅极总线的I个移位寄存器”。因此，以下，将组合了为了逐条地依次选择多条栅极总线而设置的多个(在此为2个)移位寄存器的结构称为“移位寄存器整体”。在以上那样的结构中，移位寄存器整体中的第η级双稳态电路如下动作(参照图20)。另外，输入端子43、47、45和46各自被供给第一时钟CKA、第二时钟CKB、第三时钟CKC和第四时钟CKD。此外，对输入端子41供给从第(η-2)级双稳态电路输出的其它级控制信号Z (η-2)作为置位信号S。并且，对输入端子44供给从第(η+2)级双稳态电路输出的其它级控制信号Z (η+2)作为复位信号R。另外，从时刻tl至时刻t2的期间和从时刻t3至时刻t4的期间一般不设置，或者设置为非常短的期间，在图20中，图示从时刻tl至时刻t2 的期间和从时刻t3至时刻t4的期间比本来的期间长。以下，为了方便，将时刻tl和时刻t2、以及时刻t3和时刻t4分开说明。对此，对于图3、图11、图18和它们的说明也是同样的。到时刻t0时，置位信号S从低电平向高电平变化。由此，薄膜晶体管T2成为导通状态，电容器CAP充电，netA的电位从低电平向高电平变化。其结果，薄膜晶体管Tl、Tll成为导通状态。到时刻tl时，置位信号S从高电平向低电平变化。由此，薄膜晶体管T2成为断开状态。此时，netA的电位被电容器CAP维持，因此维持为高电平。至IJ时刻t2时，第一时钟CKA从低电平向高电平变化。此时，薄膜晶体管TUTll成为导通状态，所以随着输入端子43的电位的上升，状态信号Q的电位(输出端子51、52的电位)也上升。当输出端子51的电位上升时，隔着电容器CAP，netA的电位也上升。其结果，薄膜晶体管Tl、Tll的栅极端子被施加较大的电压，与该双稳态电路的输出端子51连接的栅极总线成为选择状态，但状态信号Q的电位上升至充分的电平。至Ij时刻t3时，第一时钟CKA从高电平向低电平变化。此时，薄膜晶体管TUTll成为导通状态，因此通过输入端子43的电位降低，电流在薄膜晶体管TUTll的源极-漏极之间流动，状态信号Q的电位(输出端子51、52的电位)逐渐降低。此外，如图19所不,在输出端子51-netA之间设置有电容器CAP，因此随着输出端子51的电位的降低，netA的电位也降低。其中，netA的电位降低大约输出端子51的电位的降低的量，因此并不降低至低电平，而维持为高电平。到时刻t4时，复位信号R和第二时钟CKB从低电平向高电平变化。由此，薄膜晶体管T4、T9和TlO成为导通状态。通过薄膜晶体管T4成为导通状态，netA的电位降低至低电平。此时，通过薄膜晶体管T9、TlO成为导通状态，输出端子51的电位也降低，但其电位降低变得缓慢。其理由是因为，到时刻t4时，netA的电位成为低电平，薄膜晶体管Tl成为断开状态，从时刻t3至时刻t4期间一般不设置或者设置为非常短的期间，因此，不能获得由电流在薄膜晶体管Tl的源极-漏极之间流动引起的输出端子51的电位降低的效果。如以上所述，输出端子51的电位逐渐降低。即，各行的充电期间结束后的扫描信号GOUT的下降变得缓慢。因此，随着面板的大型化和高精细化发展，产生上述的那样的混色引起的显示不良的问题增高。因此，本发明的目的在于实现为了抑制由混色引起的显示不良的产生而能够在各行的充电期间结束后快速使扫描信号下降的栅极驱动器。
用于解决课题的方法本发明的第一方面是一种扫描信号线驱动电路，其特征在于其是对配置于显示部的多个扫描信号线进行驱动的显示装置的扫描信号线驱动电路，上述扫描信号线驱动电路包括多个移位寄存器，上述移位寄存器包括具有第一状态和第二状态且相互串联连接的多个双稳态电路，并基于周期性地重复从第二电平向第一电平变化的第一电平变化与从上述第一电平向上述第二电平变化的第二电平变化的多个时钟信号而进行动作，通过按每个双稳态电路供给上述多个时钟信号中的I个作为扫描信号线驱动用时钟信号，上述多个双稳态电路依次成为第一状态，按每个移位寄存器供给电平发生变化的定时不同的时钟信号作为上述扫描信号 线驱动用时钟信号，各双稳态电路具有输出节点，其与上述扫描信号线连接，输出表示上述第一状态和上述第二状态中的任一状态的状态信号；输出控制用开关元件，上述输出控制用开关元件的第二电极被供给上述扫描信号线驱动用时钟信号，上述输出控制用开关元件的第三电极与上述输出节点连接；第一节点导通部，其用于基于从该各双稳态电路的前一级双稳态电路输出的状态信号，使与上述输出控制用开关元件的第一电极连接的第一节点的电平向导通电平变化；和第一节点断开部，其用于接收从该各双稳态电路的后一级双稳态电路输出的状态信号作为第一节点断开用信号，并基于上述第一节点断开用信号使上述第一节点的电平向断开电平变化，在各双稳态电路中，在该各双稳态电路成为上述第一状态后，上述扫描信号线驱动用时钟信号发生上述第二电平变化，在从包含该各双稳态电路的移位寄存器中的该各双稳态电路的下一级双稳态电路成为上述第一状态之后的时刻至上述扫描信号线驱动用时钟信号进行上述第一电平变化的时刻的期间，上述第一节点断开用信号的电平发生变化，以进行上述第一节点的断开。本发明的第二方面，其特征在于在本发明的第一方面中，各双稳态电路还具有输出节点断开部，上述输出节点断开部用于接收从该各双稳态电路的下一级双稳态电路输出的状态信号作为输出节点断开用信号，并基于上述输出节点断开用信号使上述输出节点断开，在各双稳态电路中，在该各双稳态电路成为上述第一状态之后，在从上述输出节点断开用信号的电平发生变化使得进行上述输出节点的断开的时刻之后的时刻至上述扫描信号线驱动用时钟信号发生上述第一电平变化的时刻的期间，上述第一节点断开用信号的电平发生变化，以进行上述第一节点的断开。本发明的第三方面，其特征在于在本发明的第一方面中，各双稳态电路还具有第一节点控制用开关元件，上述第一节点控制用开关元件的第二电极与上述第一节点连接，且上述第一节点控制用开关元件的第三电极被供给断开电平的电位；和
第二节点控制部，其基于上述多个时钟信号中的上述扫描信号线驱动用时钟信号以外的时钟信号和上述第一节点的电位，对与上述第一节点控制用开关元件的第一电极连接的第二节点的电位进行控制。
本发明的第四方面，其特征在于在本发明的第一方面中，上述扫描信号线驱动电路包括2个上述移位寄存器，上述2个移位寄存器,对上述多个扫描信号线逐条地交替输出上述第一状态的上述状态信号，对包括上述2个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第三级双稳态电路输出的状态信号作为上述第一节点断开用信号。本发明的第五方面，其特征在于在本发明的第四方面中，从上述2个移位寄存器输出上述第一状态的上述状态信号的定时，错开与大约I个水平扫描期间相等的期间，在上述扫描信号线驱动用时钟信号从发生上述第一电平变化至发生上述第二电平变化的期间和从发生上述第二电平变化至发生上述第一的电平变化的期间，是与大约2个水平扫描期间相等的期间。本发明的第六方面，其特征在于在本发明的第四方面中，上述2个移位寄存器基于以下信号进行动作作为上述扫描信号线驱动用时钟信号供给至一个移位寄存器的第一级双稳态电路的第一时钟信号；相位与上述第一时钟信号错开180度的第二时钟信号；与上述第一时钟信号相比相位延迟90度的第三时钟信号；和相位与上述第三时钟信号错开180度的第四时钟信号。本发明的第七方面，其特征在于在本发明的第一方面中，上述扫描信号线驱动电路包括m个上述移位寄存器，上述m个移位寄存器，对上述多个扫描信号线逐条地依次输出上述第一状态的上述状态信号，对包括上述m个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第k级双稳态电路输出的状态信号作为上述第一节点断开用信号，其中，m与k的关系满足下述的式子，m+1 ^ k ^ 2m-l,在此，m为2以上的整数。本发明的第八方面，其特征在于在本发明的第七方面中，从上述m个移位寄存器输出上述第一状态的上述状态信号的定时，各错开与大约I个水平扫描期间相等的期间，上述扫描信号线驱动用时钟信号从发生上述第一电平变化至发生上述第二电平变化的期间和从发生上述第二电平变化至发生上述第一的电平变化的期间，是与大约m个水平扫描期间相等的期间。本发明的第九方面，其特征在于在本发明的第七方面中，作为上述第一节点断开用信号要被供给至各双稳态电路的信号用的配线，以从作为上述输出节点断开用信号要被供给至该各双稳态电路后的第(k-m)级双稳态电路的信号用的配线分岔的方式形成。
本发明的第十方面，其特征在于在本发明的第一方面中，在上述多个移位寄存器共用地设置有配线，该配线用于传达包含上述多个时钟信号的、用于使上述多个移位寄存器进行动作的多个驱动用信号。本发明的第^ 方面，其特征在于在本发明的第一方面中，包含于各双稳态电路的开关元件全部是同一沟道的薄膜晶体管。本发明的第十二方面，其特征在于在本发明的第一方面中，包含于各双稳态电路的开关元件是包括非晶硅的薄膜晶体管。本发明的第十三方面，其特征在于在本发明的第一方面中，包含于各双稳态电路的开关元件是包括微晶硅的薄膜晶体管。本发明的第十四方面，其特征在于在本发明的第一方面中，包含于各双稳态电路的开关元件是包括多晶硅的薄膜晶体管。本发明的第十五方面，其特征在于在本发明的第一方面中，包含于各双稳态电路的开关元件是包括氧化物半导体的薄膜晶体管。本发明的第十六方面是一种显示装置，其特征在于，包括本发明的第一方面所述的扫描信号线驱动电路。本发明的第十七方面是一种驱动方法，其特征在于上述驱动方法通过扫描信号线驱动电路，对配置于显示部的多个扫描信号线进行驱动，上述扫描信号线驱动电路包括多个移位寄存器，上述移位寄存器包括具有第一状态和第二状态且相互串联连接的多个双稳态电路，并基于周期性重复从第二电平向第一电平变化的第一电平变化与从上述第一电平向上述第二电平变化的第二电平变化的多个时钟信号而进行动作，通过按每个双稳态电路供给上述多个时钟信号中的I个作为扫描信号线驱动用时钟信号，上述多个双稳态电路依次成为第一状态，上述驱动方法包括第一驱动步骤，用于使各双稳态电路从上述第二状态变化至上述第一状态；和第二驱动步骤，用于使各双稳态电路从上述第一状态变化至上述第二状态，按每个移位寄存器供给电平发生变化的定时不同的时钟信号作为上述扫描信号线驱动用时钟信号， 各双稳态电路具有输出节点，其与上述扫描信号线连接，输出表示作为导通电平的上述第一状态和作为断开电平的上述第二状态中的任一状态的状态信号；输出控制用开关元件，上述输出控制用开关元件的第二电极被供给上述扫描信号线驱动用时钟信号，上述输出控制用开关元件的第三电极与上述输出节点连接；和与上述输出控制用开关元件的第一电极连接的第一节点，对于各双稳态电路，上述第一驱动步骤包括第一节点导通步骤，基于从该各双稳态电路之前的级双稳态电路输出的状态信号，使上述第一节点的电平向导通电平变化；和状态信号导通步骤，通过上述扫描信号线驱动用时钟信号的上述第一电平变化，使上述状态信号的电平向导通电平变化，
上述第二驱动步骤，包括状态信号断开步骤，通过上述扫描信号线驱动用时钟信号的上述第二电平变化，使上述状态信号的电平向断开电平变化；和第一节点断开步骤，接收从该各双稳态电路的下一级双稳态电路输出的状态信号作为第一节点断开用信号，并基于上述第一节点断开用信号，使上述第一节点的电平向断开电平变化，在上述状态信号导通步骤结束后，开始上述状态信号断开步骤，在从包含该各双稳态电路的移位寄存器中的该各双稳态电路的下一级双稳态电路完成上述状态信号导通步骤之后的时刻至上述扫描信号线驱动用时钟信号发生上述第一电平变化的时刻的期间，开始上述第一节点断开步骤。
本发明的第十八方面，其特征在于在本发明的第十七方面中，上述扫描信号线驱动电路包括2个上述移位寄存器，上述2个移位寄存器，对上述多个扫描信号线逐条地交替输出上述第一状态的上述状态信号，对包括上述2个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第三级双稳态电路输出的状态信号作为上述第一节点断开用信号。本发明的第十九方面，其特征在于在本发明的第十八方面中，从上述2个移位寄存器输出上述第一状态的上述状态信号的定时，错开与大约I个水平扫描期间相等的期间，在上述扫描信号线驱动用时钟信号从发生上述第一电平变化至发生上述第二电平变化的期间和从发生上述第二电平变化至发生上述第一的电平变化的期间，是与大约2个水平扫描期间相等的期间。本发明的第二十方面，其特征在于在本发明的第十七方面中，上述扫描信号线驱动电路包括m个上述移位寄存器，上述m个移位寄存器，对上述多个扫描信号线逐条地依次输出上述第一状态的上述状态信号，对包括上述m个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第k级双稳态电路输出的状态信号作为上述第一节点断开用信号，其中，m与k的关系满足下述的式子，m+1 ^ k ^ 2m-l,在此，m为2以上的整数。本发明的第二十一方面，其特征在于在本发明的第二十方面中，从上述m个移位寄存器输出上述第一状态的上述状态信号的定时，各错开与大约I个水平扫描期间相等的期间，上述扫描信号线驱动用时钟信号从发生上述第一电平变化至发生上述第二电平变化的期间和从发生上述第二电平变化至发生上述第一的电平变化的期间，是与大约m个水平扫描期间相等的期间。发明效果根据本发明的第一方面，在构成扫描信号线驱动电路的多个移位寄存器的各双稳态电路中，在由扫描信号线驱动用时钟信号从第一电平向第二电平变化引起的输出节点的电位降低的开始后，在各移位寄存器的相位差的期间，第一节点维持为导通电平的状态。因此，在输出节点的电位降低的开始后，在各移位寄存器的相位差的期间，输出控制用开关元件维持为导通状态。由此，基于扫描信号线驱动用时钟信号的电平的变化，能够充分获得输出节点的电位降低的效果。因此，从各输出节点输出的扫描信号的电位，在对应的扫描信号线的选择期间结束后，快速降低至断开电平。其结果，例如，由要在某行显示的颜色和要在下一行显示的颜色的混色引起的显示不良的产生被抑制。此外，因为输出控制用开关元件维持为导通状态的期间变长，所以即使扫描信号线的负载电容因面板的大型化等而增大，也能够抑制由扫描信号的波形变钝引起的显示不良的产生。、根据本发明的第二方面，在开始第一节点断开部进行的第一节点的断开之前，开始输出节点断开部进行的输出节点的断开。因此，输出节点的电位更加快速降低。由此，有效地抑制显示不良的产生。根据本发明的第三方面，在第一节点的电位成为断开电平的期间，能够使用时钟信号使第二节点的电位在每规定期间成为导通电平。由此，在第一节点的电位成为断开电平的期间中，第一节点控制用开关元件在每规定期间成为导通状态。因此，例如，即使在产生输出控制用开关元件的阀值电压的移位，该开关元件中的泄露电流变大的情况下，也能够在每规定期间使第一节点的电位可靠地成为断开电平，抑制来自输出节点的异常脉冲的输出。根据本发明的第四方面，各双稳态电路要维持为第一状态的期间成为移位寄存器输出的导通期间，该各双稳态电路从第二状态变化至第一状态后，在移位寄存器输出的导通期间加上2个移位寄存器之间的相位差的期间之后，开始第一节点的断开。因此，第一节点以导通电平的状态维持较长的期间，与本发明的第一方面同样地，基于扫描信号线驱动用时钟信号的电平的变化，能够充分获得输出节点的电位降低的效果。根据本发明的第五方面，通过使移位寄存器的偶数级、奇数级各自的水平扫描期间为相等的期间，与本发明的第四方面相同样地，基于扫描信号线驱动用时钟信号的电平的变化，能够充分获得输出节点的电位降低的效果。根据本发明的第六方面，在包括基于相位各错开90度的4相时钟信号进行动作的多个移位寄存器的扫描信号线驱动电路中，能够获得与本发明的第四方面同样的效果。根据本发明的第七方面，各双稳态电路要维持为第一状态的期间成为移位寄存器输出的导通期间，该各双稳态电路从第二状态变化为第一状态后，在移位寄存器输出的导通期间加上各自的移位寄存器间的相位差的期间之后，开始第一节点的断开。因此，第一节点以导通电平的状态维持较长的期间，与本发明的第一方面同样地，基于扫描信号线驱动用时钟信号的电平的变化，能够充分获得输出节点的电位降低的效果。根据本发明的第八方面，通过使移位寄存器的各级各自的水平扫描期间为相等期间，与本发明的第七方面同样地，基于扫描信号线驱动用时钟信号的电平的变化，能够充分获得输出节点的电位降低的效果。根据本发明的第九方面，能够减小用于传达第一节点断开用信号的配线的面积，能够使包括本发明的第七方面的扫描信号线驱动电路的显示装置小型化。根据本发明的第十方面，能够减小用于传达移位寄存器的驱动用信号的配线的面积，能够使包括本发明的第一方面的扫描信号线驱动电路的显示装置小型化。根据本发明的第十一方面，能够降低扫描信号线驱动电路的制造成本。根据本发明的第十二方面，在采用包括非晶硅的薄膜晶体管作为开关元件的扫描信号线驱动电路中，能够获得与本发明的第一方面同样的效果。根据本发明的第十三方面，在采用包括微晶硅的薄膜晶体管作为开关元件的扫描信号线驱动电路中，能够获得与本发明的第一方面同样的效果。根据本发明的第十四方面，在采用包括多晶硅的薄膜晶体管作为开关元件的扫描信号线驱动电路中，能够获得与本发明的第一方面同样的效果。根据本发明的第十五方面，在采用包括氧化物半导体的薄膜晶体管作为开关元件的扫描信号线驱动电路中，能够获得与本发明的第一方面同样的效果。
根据本发明的第十六方面，能够实现包括获得与本发明的第一方面同样的效果的扫描信号线驱动电路的显示装置。


图I是用于对本发明的第一实施方式的有源矩阵型的液晶显示装置中的“移位寄存器整体”进行说明的块图。图2是表示各实施方式中的双稳态电路的结构的主要部分的电路图。图3是用于说明各实施方式中的双稳态电路的动作的概要的信号波形图。图4是表示上述第一实施方式中的液晶显示装置的整体结构的块图。图5是用于说明上述第一实施方式中的栅极驱动器的结构的块图。图6是表示上述第一实施方式中的栅极驱动器内的移位寄存器的结构的块图。图7是上述第一实施方式中的第一 第四栅极时钟信号的波形图。图8是用于说明上述第一实施方式中的移位寄存器整体的第η级双稳态电路的输入输出信号的图。图9是用于对上述第一实施方式中的栅极驱动器的动作进行说明的信号波形图。图10是表示上述第一实施方式中的移位寄存器所包含的双稳态电路的结构的电路图。图11是用于说明上述第一实施方式中的移位寄存器的各级的动作的信号波形图。图12的A和B是用于对上述第一实施方式中的效果进行说明的图。图13是用于说明上述第一实施方式中的效果的图。图14是表示上述第一实施方式的变形例中的栅极驱动器内的移位寄存器的结构的块图。图15是表示本发明的第二实施方式的有源矩阵型的液晶显示装置的栅极驱动器内的移位寄存器的概略结构的块图。图16是上述第二实施方式中的第一 第六栅极时钟信号的波形图。图17是上述第二实施方式中的各移位寄存器的第一 第六栅极时钟信号和第一 第四时钟的对应关系的例子的图。图18是用于对上述第二实施方式中的双稳态电路的动作进行说明的信号波形图。图19是表示栅极驱动器内的移位寄存器所包含的双稳态电路的结构例的电路图。图20是用于说明移位寄存器的各级的动作的信号波形图。
具体实施例方式以下，参照附图对本发明的实施方式进行说明。此外，在以下的说明中，薄膜晶体管的栅极端子(栅极电极)相当于第一电极，漏极端子(漏极电极)相当于第二电极，源极端
子(源极电极)相当于第三电极。此外，设置于双稳态电路内的薄膜晶体管全部以η沟道型的薄膜晶体管为例进行说明。< I.实施方式中的想法>首先，参照图2和图3，对以下说明的各实施方式中的想法进行说明。图2是表示各实施方式中的移位寄存器的一个级的结构(双稳态电路的结构)的主要部分的电路图。此夕卜，图3是用于说明该双稳态电路的动作的概要的信号波形图。如图2所示，双稳态电路包括5个薄膜晶体管Τ1、Τ2、Τ4、Τ9和Τ11。此外，双稳态电路，除了具有低电平的电源电压VSS用的输入端子之外，还具有4个输入端子41、43、44和48以及2个输出端子51、52。薄膜晶体管Tl的栅极端子、薄膜晶体管Tll的栅极端子、薄膜晶体管Τ2的源极端子和薄膜晶体管Τ4的漏极端子相互连接。另外，为了方便将这些相互连接的区域(配线)称为“netA”(第一节点)。薄膜晶体管Tl的栅极端子与netA连接，漏极端子与输入端子43连接，源极端子与输出端子51连接。薄膜晶体管T2的栅极端子以及漏极端子与输入端子41连接(S卩，形成二极管连接)，源极端子与netA连接。薄膜晶体管T4的栅极端子与输入端子48连接，漏极端子与netA连接，源极端子与电源电压VSS连接。薄膜晶体管T9的栅极端子与输入端子44连接，漏极端子与输出端子51连接，源极端子与电源电压VSS连接。薄膜晶体管Tll的栅极端子与netA连接，漏极端子与输入端子43连接，源极端子与输出端子52连接。另夕卜，在以下的各实施方式中，作为用于输出状态信号Q的端子设置有2个输出端子51、52,但本发明并不限定于此，也可以为设置有I个输出端子51的结构。在以上那样的结构中，双稳态电路进行如下动作(参照图3)。到时刻t0时，置位信号S从低电平向高电平变化。由此，薄膜晶体管T2成为导通状态，netA的电位从低电平向高电平变化。其结果，薄膜晶体管Tl、Tll成为导通状态。其中，在时刻t0 时刻t2期间，第一时钟CKA成为低电平，因此状态信号Q维持为低电平。在时刻tl，第二时钟CKB从高电平变化至低电平后，到时刻t2时，第一时钟CKA从低电平向高电平变化。此时，薄膜晶体管TUTll成为导通状态，因此输入端子43的电位上升，并且状态信号Q的电位(输出端子51、52的电位)上升。由此,与该双稳态电路的输出端子51连接的栅极总线成为选择状态。到时刻t3时，第一时钟CKA从高电平向低电平变化。此时，薄膜晶体管TUTll成为导通状态，因此通过输入端子43的电位降低，薄膜晶体管Tl、Tll的源极-漏极之间流动有电流，状态信号Q的电位(输出端子51、52的电位)降低。到时刻t4时，第一复位信号Rl从低电平向高电平变化。由此，薄膜晶体管T9成为导通状态，输出端子51的电位降低。此时，因为第二复位信号R2维持为低电平，所以薄膜晶体管T4成为断开状态。因此，在状态信号Q从高电平向低电平变化期间，netA的电位维持为高电平。因此，在时刻t4之后，薄膜晶体管Tl也维持为导通状态，基于第一时钟CKA从高电平向低电平变化，能够充分获得状态信号Q的电位降低的效果。其结果，输出端子51的电位快速降低至低电平。到时刻t5时，第二复位信号R2从低电平向高电平变化。由此，薄膜晶体管T4成为导通状态，netA的电位从高电平向低电平变化。如上所述，在各实施方式中，用于使输出端子51的电位降低的信号和用于使netA的电位降低的信号米用不同的信号，与输出端子51的电位从高电平向低电平变化定时相t匕，netA的电位从高电平向低电平变化的定时更加延迟。详细来说，以在比用于使输出端 子51的电位降低的第一复位信号Rl延迟的定时，基于从低电平向高电平变化的第二复位信号R2，netA的电位降低的方式，在以下的各实施方式中，形成如下结构对通过与各双稳态电路的第一复位信号Rl相当的状态信号(扫描信号)Q被驱动的行之后的行进行驱动的状态信号(扫描信号)Q，作为第二复位信号R2供给至该各双稳态电路。通过这样的结构，netA的电位维持为高电平的期间比现有的期间长，基于第一时钟CKA从高电平向低电平变化，能够充分获得状态信号Q的电位降低的效果。因此，在各行的充电期间的结束后，该各行的驱动用的扫描信号的电位快速降低至低电平。<2.第一实施方式><2. I整体结构和动作>图4是表示本发明的第一实施方式涉及的有源矩阵型的液晶显示装置的整体结构的块图。如图4所示,该液晶显示装置包括电源100 ;DC/DC转换器110 ;显示控制电路200 ;源极驱动器(视频信号线驱动电路)300 ;栅极驱动器(扫描信号线驱动电路)400 ;共用电极驱动电路500 ;和显不部600。另外，棚极驱动器400使用非晶娃、多晶娃、微晶娃、氧化物半导体(例如IGZ0)等，形成于含有显示部600的显示面板上。即，在本实施方式中，栅极驱动器400形成单片的结构。显示部600包含多条(j条)的源极总线(视频信号线)SLl SLj ;多条(i条)的栅极总线(扫描信号线)GL1 Gli ;和与这些源极总线SLl SLj与栅极总线GLl GLi的交叉点各自对应设置的多个(iXj个)的像素形成部。这些像素形成部配置为矩阵状，构成像素阵列。各像素形成部包括薄膜晶体管(TFT)60，其为栅极端子与通过对应的交叉点的栅极总线连接并且源极端子与通过该交叉点的源极总线连接的开关元件；与该薄膜晶体管60的漏极端子连接的像素电极；共用电极Ec，其为共用地设置于上述多个像素形成部的相对电极；和液晶层，其共用地设置于上述多个像素形成部且夹持于像素电极与共用电极Ec之间。而且，通过由像素电极和共用电极Ec形成的液晶电容，构成像素电容Cp。另外，通常，为了在像素电容Cp可靠地保持电压，而与液晶电容并列地设置有辅助电容，但辅助电容与本发明无直接关系，所以省略其说明和图示。电源100向DC/DC转换器110、显示控制电路200和共用电极驱动电路500供给规定的电源电压。DC/DC转换器110从电源电压生成用于使源极驱动器300和栅极驱动器400动作的规定的直流电压，并将其供给至源极驱动器300和栅极驱动器400。共用电极驱动电路500向共用电极Ec供给规定的电位Vcom。显示控制电路200接收从外部发送来的图像信号DAT和水平同期信号或垂直同期信号等的定时信号群TG，输出控制数字视频信号DV ;和用于对在显示部600中的图像显示进行控制的源极起始脉冲信号SSP、源极时钟信号SCK、闩锁选通(latch stiOb)信号LS、栅极起始脉冲信号GSP、栅极时钟信号GCK和清除信号CLR。另外，栅极时钟信号GCK，如后文所述，含有4相时钟信号GCK1、GCK2、GCK3和GCK4。此外，栅极起始脉冲信号GSP包含第一栅极起始脉冲信号GSPl和第二栅极起始脉冲信号GSP2。源极驱动器300接收从 显示控制电路200输出的数字视频信号DV、源极起始脉冲信号SSP、源极时钟信号SCK和闩锁选通信号LS，对各源极总线SLl SLj施加驱动用视频信号S (I) S (j)。栅极驱动器400，基于从显示控制电路200输出的栅极起始脉冲信号GSP、栅极时钟信号GCK和清除信号CLR，以I个垂直扫描期间为周期重复对各栅极总线GLl GLi施加有效的扫描信号GOUT (I) GOUT (i)。另外，该栅极驱动器400的详细的说明在后文述说。如以上所述，通过对各源极总线SLl SLj施加驱动用视频信号S (I) S (j),对各栅极总线GLl GLi施加扫描信号GOUT (I) GOUT (i)，基于从外部发送来的图像信号DAT，在显示部600显示图像。< 2. 2栅极驱动器的结构以及动作>接着，参照图I、图5和图6，对本实施方式中的栅极驱动器400的结构进行说明。如图5所示，栅极驱动器400包括2个移位寄存器(第一移位寄存器411和第二移位寄存器412)。在显示部600形成有i行X j列的像素矩阵，以与像素矩阵的第奇数行的各行一对一地对应的方式设置有第一移位寄存器411的各级，以与像素矩阵的第偶数行的各行一对一地对应的方式设置第二移位寄存器412的各级。因此，第一移位寄存器411和第二移位寄存器412全部包括(i/2)级。此外，形成双稳态电路，其中，第一移位寄存器411和第二移位寄存器412的各级，在各时刻中成为2个状态(第一状态以及第二状态)中的任一状态并将表示该状态的信号(状态信号)作为扫描信号进行输出。这样，第一移位寄存器411包含(i/2)个双稳态电路SRl (I) SRl (i/2)，第二移位寄存器412包含(i/2)个双稳态电路SR2 (I) SR2 (i/2)。另外，在本实施方式中，当双稳态电路成为第一状态时，从该双稳态电路输出高电平(H电平)的状态信号作为扫描信号，当双稳态电路成为第二状态时，从该双稳态电路输出低电平(L电平)的状态信号作为扫描信号。此外，从各双稳态电路输出的状态信号，也作为用于对与该各双稳态电路不同的级双稳态电路的动作进行控制的其它级控制信号发挥功能。图6是表示栅极驱动器400内的第一移位寄存器411和第二移位寄存器412的结构的块图。图6如所示，在各双稳态电路设置有用于分别接收4相时钟信号CKA (以下称为“第一时钟”。)、CKB (以下称为“第二时钟”。)、CKC (以下称为“第三时钟”。)和CKD (以下称为“第四时钟”。)的输入端子；用于接收清除信号CLR的输入端子；用于接收低电平的电源电压VSS的输入端子；用于接收作为扫描开始用的信号的置位信号S的输入端子；用于分别接收作为扫描结束用的信号的第一复位信号Rl和第二复位信号R2的输入端子；和用于输出状态信号Q的输出端子。第一移位寄存器411内的双稳态电路的输出端子与第奇数行的栅极总线连接，第二移位寄存器412内的双稳态电路的输出端子与第偶数行的栅极总线连接。
通过上述的结构，第奇数行的栅极总线通过第一移位寄存器411驱动，第偶数行的栅极总线通过第二移位寄存器412驱动。此外，通过第一栅极起始脉冲信号GSPl供给至第一移位寄存器411的第一级SRl (1)，第二栅极起始脉冲信号GSP2供给至第二移位寄存器412的第一级SR2 (1)，显示部600内的栅极总线逐条地依次被选择。根据这样的观点，能够考虑“通过第一移位寄存器411和第二移位寄存器412，来实现逐条地依次选择i条栅极总线GLl GLi的I个移位寄存器”。因此，以下，将组合第一移位寄存器411和第二移位寄存器412的结构称为“移位寄存器整体”，标注符号410。另外，如图I所示，对移位寄存器整体410中的第η级双稳态电路标注符号SR (η)。 对第一移位寄存器411和第二移位寄存器412供给4相时钟信号GCKl (以下称为“第一栅极时钟信号”。)、GCK2 (以下称为“第二栅极时钟信号”。)、GCK3 (以下称为“第三栅极时钟信号”。)和GCK4 (以下“第四栅极时钟信号”。)作为栅极时钟信号GCK。如图7所示，第一 第四栅极时钟信号GCKl GCK4的任一导通期间(维持为高电平的状态的期间)为大约2个水平扫描期间(2H)。另外，各信号的高电平与第一电平相当，低电平与第二电平相当。第一栅极时钟信号GCKl与第三栅极时钟信号GCK3的相位相互错开180度。此外，第二栅极时钟信号GCK2与第四栅极时钟信号GCK4的相位相互错开180度。并且，第一栅极时钟信号GCKl的相位比第二栅极时钟信号GCK2的相位超前90度。另外，该90度的相位差与大约I个水平扫描期间(IH)相当。供给至各级(各双稳态电路)的输入端子的信号如以下方式(参照图6)。在第一移位寄存器411中，第一栅极时钟信号GCKl和第三栅极时钟信号GCK3中的一个作为第一时钟CKA被供给，另一个作为第二时钟CKB被供给。假如，在第奇数级中，第三栅极时钟信号GCK3作为第一时钟CKA被供给时，在第偶数级中第一栅极时钟信号GCKl作为第一时钟CKA被供给。此外，在第一移位寄存器411中，第二栅极时钟信号GCK2和第四栅极时钟信号GCK4中的一个作为第三时钟CKC被供给，另一个作为第四时钟CKD被供给。在第二移位寄存器412中，第二栅极时钟信号GCK2和第四栅极时钟信号GCK4中的一个作为第一时钟CKA被供给，另一个作为第二时钟CKB被供给。此外，在第二移位寄存器412中，第一栅极时钟信号GCKl和第三栅极时钟信号GCK3中的一个作为第三时钟CKC被供给，另一个作为第四时钟CKD被供给。对于清除信号CLR和低电平的电源电压VSS，被共用地供给至全部的双稳态电路。置位信号S、第一复位信号Rl和第二复位信号R2如下所述(参照图8)。当着眼于移位寄存器整体410的第η级SR (η)时，供给从其前的第二级输出的其它级控制信号Z(η-2)作为置位信号S，供给从其后的第二级输出的其它级控制信号Z (η+2)作为第一复位信号R1，供给从其后的第三级输出的其它级控制信号Ζ(η+3)作为第二复位信号R2。例如，当着眼于移位寄存器整体410的第七级SR (7)时，供给从第五级SR (5)输出的其它级控制信号Z (5)作为置位信号S，供给从第九级SR (9)输出的其它级控制信号Z (9)作为第一复位信号R1，供给从第十级SR (10)输出的其它级控制信号Z (10)作为第二复位信号R2。换而言之，当着眼于第一移位寄存器411的第四级SRl (4)时，供给从第一移位寄存器411的第三级SRl (3)输出的状态信号Q作为置位信号S，供给从第一移位寄存器411的第五级SRl (5)输出的状态信号Q作为第一复位信号R1，供给从第二移位寄存器412的第五级SR2 (5)输出的状态信号Q作为第二复位信号R2。接着，对从各级(各双稳态电路)的输出端子输出的信号进行说明。如图8所示，从移位寄存器整体410的第η级SR (η)的输出端子，输出成为对第η行的栅极总线GLn进行驱动用的扫描信号GOUT (η)的状态信号Q。该状态信号Q作为第一复位信号Rl供给至第(η-2)级SR (η-2)，作为第二复位信号R2供给至第(η-3)级SR (η_3)，作为置位信号S供给至第(η+2)级 SR (η+2)。在以上那样的结构中，当向第一移位寄存器411的第一级SRl (I)供给作为置位信号S的第一栅极起始脉冲信号GSPl的脉冲，向第二移位寄存器412的第一级SR2 (I)供给作为置位信号S的第二栅极起始脉冲信号GSP2的脉冲时，基于上述第一 第四栅极时钟信号GCKl 4，在第一移位寄存器411内，一级一级地依次传送第一栅极起始脉冲信号GSPl的脉冲，在第二移位寄存器412内，一级一级地依次传送第二栅极起始脉冲信号GSP2的脉冲。而且，相应于这些脉冲的传送，从移位寄存器整体410的各级输出的状态信号Q依次成为高电平。由此，如图9所示，高电平的状态被维持大约2个水平扫描期间的扫描信号GOUT (I) GOUT (i)，在每大约I个水平扫描期间依次被供给至显示部600内的栅极总线GLl GLi。另外，在本实施方式中，第一时钟CKA相当于扫描信号线驱动用时钟信号，第一复位信号Rl相当于输出节点断开用信号，第二复位信号R2相当于第一节点断开用信号。< 2. 3双稳态电路的结构>图10是表示本实施方式中的双稳态电路的结构(第一移位寄存器411和第二移位寄存器412的一个级的结构)的电路图。如图10所示，该双稳态电路包括12个薄膜晶体管Tl T12 ;和电容器CAP。此外，该双稳态电路，除了低电平的电源电压VSS用的输入端子的之外，还具有8个输入端子41 48和2个输出端子51、52。在此，对接收置位信号S的输入端子标注符号41，对接收清除信号CLR的输入端子标注符号42，对接收第一时钟CKA的输入端子标注符号43，对接收第一复位信号Rl的输入端子标注符号44，对接收第三时钟CKC的输入端子标注符号45，对接收第四时钟CKD的输入端子标注符号46，对接收第二时钟CKB的输入端子标注符号47,对接收第二复位信号R2的输入端子标注符号48。此外,对将状态信号Q作为扫描信号GOUT进行输出的输出端子标注符号51，对将状态信号Q作为其它级控制信号Z进行输出的输出端子标注符号52。接着，对该双稳态电路内的结构要素之间的连接关系进行说明。薄膜晶体管Tl的栅极端子、薄膜晶体管T2的源极端子、薄膜晶体管T3的漏极端子、薄膜晶体管T4的漏极端子、薄膜晶体管T5的漏极端子、薄膜晶体管T7的栅极端子和薄膜晶体管Tll的栅极端子相互连接。另外，为了方便，将这些相互连接的区域(配线)称为“netA”(第一节点)。薄膜晶体管T5的栅极端子、薄膜晶体管T6的源极端子、薄膜晶体管T7的漏极端子和薄膜晶体管T8的漏极端子相互连接。另外，为了方便，将这些相互连接的区域(配线)称为“netB”(第二节点)。薄膜晶体管Tl的栅极端子与netA连接，漏极端子与输入端子43连接，源极端子与输出端子51连接。薄膜晶体管T2的栅极端子和漏极端子与输入端子41连接(即，形成 二极管连接)，源极端子与netA连接。薄膜晶体管T3的栅极端子与输入端子42连接，漏极端子与netA连接，源极端子与电源电压VSS连接。薄膜晶体管T4的栅极端子与输入端子48连接，漏极端子与netA连接，源极端子与电源电压VSS连接。薄膜晶体管T5的栅极端子与netB连接，漏极端子与netA连接，源极端子与电源电压VSS连接。薄膜晶体管T6的栅极端子和漏极端子与输入端子45连接(即，形成二极管连接)，源极端子与netB连接。薄膜晶体管T7的栅极端子与netA连接，漏极端子与netB连接，源极端子与电源电压VSS连接。薄膜晶体管T8的栅极端子与输入端子46连接，漏极端子与netB连接，源极端子与电源电压VSS连接。薄膜晶体管T9的栅极端子与输入端子44连接，漏极端子与输出端子51连接，源极端子与电源电压VSS连接。薄膜晶体管TlO的栅极端子与输入端子47连接，漏极端子与输出端子51与连接，源极端子与电源电压VSS连接。薄膜晶体管Tll的栅极端子与netA连接，漏极端子与输入端子43连接，源极端子与输出端子52连接。薄膜晶体管T12的栅极端子与输入端子41与连接，漏极端子与输出端子52连接，源极端子与电源电压VSS连接。电容器CAP的一端与netA连接，另一端与输出端子51连接。接着，对各结构要素的该双稳态电路中的功能进行说明。薄膜晶体管Tl，当netA 的电位成为高电平时，将第一时钟CKA的电位供给至输出端子51。薄膜晶体管T2，当置位信号S成为高电平时，使netA的电位为高电平。薄膜晶体管T3，当清除信号CLR成为高电平时，使netA的电位为低电平。薄膜晶体管T4，当第二复位信号R2成为高电平时，使netA的电位为低电平。薄膜晶体管T5，当netB的电位成为高电平时，使netA的电位为低电平。薄膜晶体管T6，当第三时钟CKC成为高电平时，使netB的电位为高电平。薄膜晶体管T7，当netA的电位成为高电平时，使netB的电位为低电平。薄膜晶体管T8，当第四时钟CKD成为高电平时，使netB的电位为低电平。薄膜晶体管T9，当第一复位信号Rl成为高电平时，使输出端子51的电位为低电平。薄膜晶体管T10，当第二时钟CKB成为高电平时，使输出端子51的电位为低电平。薄膜晶体管T11，当netA的电位成为高电平时，将第一时钟CKA的电位供给至输出端子52。薄膜晶体管T12，当置位信号S成为高电平时，使输出端子52的电位为低电平。电容器CAP，作为用于在与该双稳态电路连接栅极总线成为选择状态的期间中使netA的电位维持为高电平的补偿电容发挥功能。另外，在本实施方式中，通过薄膜晶体管Tl来实现输出控制用开关元件，通过薄膜晶体管T5来实现第一节点控制用开关元件。此外，通过薄膜晶体管T2来实现第一节点导通部，通过薄膜晶体管T4来实现第一节点断开部，通过薄膜晶体管T9来实现输出节点断开部，通过薄膜晶体管T6 T8来实现第二节点控制部。< 2. 4双稳态电路的动作> 接着，参照图10和图11，对本实施方式中的双稳态电路的动作进行说明。在液晶显示装置的动作中，该双稳态电路被供给如图11所示那样的波形的第一时钟CKA、第二时钟CKB、第三时钟CKC和第四时钟CKD。另外，清除信号CLR在每I帧期间的规定期间成为高电平，由此，在全部的双稳态电路中，netA的电位在每I帧期间为低电平。在时刻t0之前的期间，netA的电位和状态信号Q的电位(输出端子51、52的电位)成为低电平。此外，在时刻to之前的期间，当第三时钟CKC从低电平向高电平变化时，netB的电位从低电平向高电平变化，当第四时钟CKD从低电平向高电平变化时，netB的电位从高电平向低电平变化。这样，netB的电位在每规定期间成为高电平，薄膜晶体管T5成为导通状态，因此在时刻t0之前的期间，netA的电位维持为低电平。
到时刻tO时，置位信号S从低电平向高电平变化。因为如图10所示薄膜晶体管T2为二极管连接，所以通过使置位信号S成为高电平，薄膜晶体管T2成为导通状态，电容器CAP被充电。由此，netA的电位从低电平向高电平变化，薄膜晶体管TI、T11成为导通状态。到时刻tl时，置位信号S从高电平向低电平变化。由此，薄膜晶体管T2成为断开状态。此时，netA的电位通过电容器CAP维持，因此不存在由薄膜晶体管T2成为断开状态而引起的netA的电位发生变动的情况。但是，在时刻tO 时刻t2期间，第一时钟CKA成为低电平。因此，在期间中，状态信号Q维持为低电平。此外，薄膜晶体管T7的栅极端子与netA连接，所以在时刻tO 时刻t2期间，薄膜晶体管T7维持为导通状态。由此，在该期间中，netB的电位维持为低电平，其结果，薄膜晶体管T5维持为断开状态。并且，在该期间中，第二复位信号R2维持为低电平，所以薄膜晶体管T4维持为断开状态。通过以上所述，没有netA的电位在时刻tO 时刻t2期间降低的问题。至Ij时刻t2时，第一时钟CKA从低电平向高电平变化。由此，随着输入端子43的电位的上升，薄膜晶体管Tl、Tll的漏极电位上升。此时，薄膜晶体管TUTll成为导通状态， 所以状态信号Q的电位(输出端子51、52的电位)也上升。当输出端子51的电位上升时，隔着电容器CAP，netA的电位也上升。其结果，薄膜晶体管Tl、Tll的栅极端子被施加大的电压，为了使与该双稳态电路的输出端子51连接的栅极总线成为选择状态，状态信号Q的电位需要上升至充分的电平。第一时钟CKA成为高电平的状态维持至时刻t3，因此在时刻t2 时刻t3期间，状态信号Q维持为高电平。因此，在该期间中，在与和该双稳态电路的输出端子51连接的栅极总线对应的行的像素形成部中，进行向像素电容Cp的视频信号的写入(充电)。到时刻t3时，第一时钟CKA从高电平向低电平变化。此时，薄膜晶体管TUTll成为导通状态，因此输入端子43的电位降低，并且状态信号Q的电位(输出端子51、52的电位)降低。通过输出端子51的电位降低，隔着电容器CAP，netA的电位也降低。其中，netA的电位降低大约输出端子51的电位的降低的量，因此并不降低至低电平，而维持为高电平。到时刻t4时，第一复位信号Rl和第二时钟CKB从低电平向高电平变化。由此，薄膜晶体管T9、TlO成为导通状态，输出端子51的电位降低。此时，第二复位信号R2维持为低电平，因此薄膜晶体管T4成为断开状态。因此，在状态信号Q从高电平向低电平变化的期间，netA的电位维持为高电平。因此，在时刻t4之后，薄膜晶体管Tl也维持为导通状态，基于第一时钟CKA从高电平向低电平变化，能够充分获得状态信号Q的电位降低的效果。其结果，输出端子51的电位快速降低至低电平。到时刻t5时，第二复位信号R2从低电平向高电平变化。由此，薄膜晶体管T4成为导通状态，netA的电位从高电平向低电平变化。此外，第三时钟CKC从低电平向高电平变化。如图10所示，薄膜晶体管T6与二极管连接，因此通过第三时钟CKC成为高电平，薄膜晶体管T6成为导通状态，netB的电位从低电平向高电平变化。由此，薄膜晶体管T5成为导通状态，因此netA的电位可靠地成为低电平。在时刻t5之后的期间，至下一次置位信号S从低电平变化为高电平之前，重复与在时刻to之前的期间同样的动作。另外，在本实施方式中，通过时刻tO的开始信号S的电平的变化来实现第一节点导通步骤，通过时刻t2的第一时钟CKA的电平的变化来实现状态信号导通步骤，通过时刻t3的第一时钟CKA的电平的变化来实现状态信号断开步骤，通过时刻t5的第二复位信号R2的电平的变化来实现第一节点断开步骤。<2.5效果>根据本实施方式，如图10所示，在移位寄存器的各级设置有薄膜晶体管Tl，其作为用于控制状态信号Q的电位的输出控制用开关元件，该薄膜晶体管的栅极端子与netA连接，该薄膜晶体管的漏极端子与被供给第一时钟CKA的输入端子43连接，该薄膜晶体管的源极端子与输出状态信号Q的输出端子51连接。而且，netA的电位基于置位信号S成为高电平，基于第二复位信号R2成为低电平。在这样的结构中，移位寄存器整体410中的各级SR (η)被供给从其前的第二级SR (η-2)输出的其它级控制信号Z (η_2)作为置位信号S。此外，相位相差各90度的4相时钟信号(第一 第四栅极时钟信号GCKl GCK4)被供给移位寄存器整体410，各级SR (η)基于相位比被供给前一级SR (η_1)的时钟信号延迟90度的时钟信号进行动作。但是，在具有输出导通期间为2个水平扫描期间的状态信号(扫描信号)Q的2个移位寄存器的结构中，对移位寄存器整体410中的各级SR (η)，假如基于从其后的第二级SR (η+2)输出的其它级控制信号Z (η+2)使netA的电位从高电平降低至低电平时，在状态信号Q的电位充分降低之前，netA的电位降低至低电平。因此，基于第一时钟CKA从高电平向低电平变化，并不能充分获得状态信号Q的电位降低的效果，状态信号Q的电位并不快速降低至低电平。对于该点，根据本实施方式，对于移位寄存器整体410中的各级SR (n)，从其前的第三级SR (n+3)输出的其它级控制信号作为用于使Z (n+3)netA的电位降低至低电平的信号(上述的第二复位信号R2)而被供给。因此，netA的电位维持为高电平的期间变长，基于第一时钟CKA从高电平向低电平变化，能够充分获得状态信号Q的电位降低的效果。即，在各行的充电期间的结束后，扫描信号的电位快速降低至低电平。其结果，能够抑制由要在某行显示的颜色和要在下一行显示的颜色的混色引起的显示不良的产生。此外，因为netA的电位维持为高电平的期间变长，即使栅极总线的负载电容因面板的大型化等而增大，也能够抑制由扫描信号的波形变钝引起的显示不良的产生。此外，根据本实施方式，当由netA的电位、第三时钟CKC的电位和第四时钟CKD的电位控制的薄膜晶体管T5成为导通状态时，netA的电位成为低电平。因此，即使在例如产生薄膜晶体管Tl的阀值电压的移位，该薄膜晶体管Tl的泄露电流变大的情况下，也能够使netA的电位在每个规定期间可靠地成为低电平，抑制来自输出端子51的异常脉冲的输出。接着，表示模拟结果，对本实施方式中的效果进行说明。图12A是现有例中的信号波形图，图12B是本实施方式中的信号波形图。在图12A中，符号61的粗虚线表示扫描信号的波形，符号62的细虚线表示netA的波形。此外，在图12B中，符号63的粗虚线表示扫描信号的波形，符号64的细虚线表示netA的波形。图13是在图12A和图12B中由符号60表示的部分的放大图。如从图12A和图12B把握的方式，在本实施方式中，与现有例相比，netA的电位维持为高电平的期间变长。其结果，如图13所示，现有的扫描信号下降90%所需要的时间Ta为3. 4 μ S，与此相对，在本实施方式中，扫描信号下降90%所需要的时间Tb为2. 5μ S。即,在本实施方式中，与现有例相比,扫描信号下降所需要的时间大约缩短26%。这样，根据本实施方式，与现有例相比，在各行的充电期间的结束后，扫描信号快速下降。
<2. 6 变形例 >
在上述第一实施方式中,在第一移位寄存器411和第二移位寄存器412各自设置有第一 第四栅极时钟信号GCKl GCK4用的配线清除信号CLR用的配线和低电平的电源电压VSS用的配线。但是本发明并不限定于此。例如，通过如图14所示配置移位寄存器整体的各级，能够使第一 第四栅极时钟信号GCKl GCK4用的配线、清除信号CLR用的配线和低电平的电源电压VSS用的配线各自为I条。由此，能够减小移位寄存器的驱动信号用的配线面积，能够使显示装置小型化。此外，例如关于第η级的第二复位信号R2用的配线，也可以如在图14中符号419所示，从第(η+1)级的第一复位信号Rl用的配线分岔，形成第η级的第二复位信号R2用的配线。通过这样的结构，能够使第二复位信号R2用的配线的长度比较短。<3.第二实施方式>< 3. I移位寄存器的结构>图15是表示本发明的第二实施方式的液晶显示装置中的移位寄存器的概略结构 的块图。另外，液晶显示装置的整体结构的与上述第一实施方式相同，因此省略说明(参照图4)。在上述第一实施方式中，栅极驱动器400包括2个移位寄存器，但在本实施方式中，栅极驱动器400包括3个移位寄存器(第一移位寄存器421、第二移位寄存器422和第三移位寄存器423)。S卩，如图15所示，通过第一移位寄存器421、第二移位寄存器422和第三移位寄存器423，来实现用于逐条地驱动显示部600内的栅极总线GLl GLi的移位寄存器整体 420。与上述第一实施方式相同，在各双稳态电路设置有用于各自接收4相时钟信号CKA、CKB、CKC和CKD的输入端子；用于接收清除信号CLR的输入端子；用于接收低电平的电源电压VSS的输入端子；用于接收置位信号S的输入端子；用于接收第一复位信号Rl的输入端子；用于接收第二复位信号R2的输入端子；和用于输出状态信号Q的输出端子。其中，为了说明的方便，在图15中仅表示用于接收第二复位信号R2的输入端子和用于输出状态信号Q的输出端子。各双稳态电路的电路结构也与上述第一实施方式相同(参照图10)。另外，第一移位寄存器421内的双稳态电路的输出端子与栅极总线GL1、GL4、GL7、…连接，第二移位寄存器422内的双稳态电路的输出端子与栅极总线GL2、GL5、GL8、…连接，第三移位寄存器423内的双稳态电路的输出端子与栅极总线GL3、GL6、GL9、…连接。在本实施方式中，作为6相时钟信号的第一 第六栅极时钟信号GCKl GCK6从显示控制电路200供给至栅极驱动器400(参照图16)。如图16所示，第一 第六栅极时钟信号GCKl GCK6的导通期间全部为大约3个水平扫描期间(3H)。第一栅极时钟信号GCKl与第四栅极时钟信号GCK4的相位相互错开180度。第二栅极时钟信号GCK2与第五栅极时钟信号GCK5的相位相互错开180度。第三栅极时钟信号GCK3与第六栅极时钟信号GCK6的相位相互错开180度。第一栅极时钟信号GCKl的相位比第二栅极时钟信号GCK2的相位超前60度。第二栅极时钟信号GCK2的相位比第三栅极时钟信号GCK3的相位超前60度。另外，该60度的相位差与大约I个水平扫描期间(IH)相当。图17是表不各移位寄存器的第一 第六栅极时钟信号GCKl GCK6与第一 第四时钟CKA CKD的对应关系的例子图。从图17例如把握有下面的情况。对第一移位寄存器421的第奇数级，供给第一栅极时钟信号GCKl作为第一时钟CKA，供给第四栅极时钟信号GCK4作为第二时钟CKB，供给第五栅极时钟信号GCK5作为第三时钟CKC，供给第二栅极时钟信号GCK2作为第四时钟CKD。< 3. 2双稳态电路的动作>图18是用对本实施方式中的双稳态电路的动作进行说明的信号波形图。在本实施方式中，作为置位信号S、第一复位信号Rl和第二复位信号R2被供给至双稳态电路的信号，与上述第一实施方式不同。具体来讲，对移位寄存器整体的第η级SR (η)，供给从第(η-3)级SR (η-3)输出的其它级控制信号Z (η-3)作为置位信号S，供给从第(n+3)级SR(n+3)输出的其它级控制信号Z (n+3)作为第一复位信号R1，供给从第(n+4)级SR (n+4)输出的其它级控制信号Z (n+4)作为第二复位信号R2。如从图11和图18把握的那样，在本实施方式中的双稳态电路中，进行与上述第一实施方式中的双稳态电路相同的动作。即，到时刻t3时，通过第一时钟CKA从高电平向低电平变化，状态信号Q的电位(输出端子51、52的电位)和netA的电位逐渐降低。然后，到 时刻t4时，通过第一复位信号Rl和第二时钟CKB从低电平向高电平变化，薄膜晶体管T9、TlO成为导通状态，输出端子51的电位更加降低。此时，第二复位信号R2维持为低电平，因此薄膜晶体管T4成为断开状态。因此，在时刻t4之后，netA的电位也维持为高电平，薄膜晶体管Tl维持为导通状态。< 3. 3 效果 >根据本实施方式，与上述第一实施方式相同，各双稳态电路的netA的电位维持为高电平的期间变长，基于第一时钟CKA从高电平向低电平变化，能够充分获得状态信号Q的电位降低的效果。由此，在各行的充电期间的结束后，扫描信号GOUT快速下降。其结果，能够抑制由要在某行显示的颜色和要在下一行显示的颜色的混色引起的显示不良的产生和由伴随面板的大型化等的扫描信号GOUT的波形变钝引起的显示不良的产生。< 4.其他 >< 4. I结构的一般化>在上述第一实施方式中，栅极驱动器400包括2个移位寄存器(第一移位寄存器411和第二移位寄存器412)，移位寄存器整体410中的各双稳态电路构成为基于从其后的第三级双稳态电路输出的状态信号Q,netA的电位降低至低电平。此外，在上述第二实施方式中，栅极驱动器400包括3个移位寄存器(第一移位寄存器421、第二移位寄存器422和第三移位寄存器423)，移位寄存器整体420中的各双稳态电路构成为基于从其后的第四级双稳态电路输出的状态信号Q，netA的电位降低至低电平。但是，本发明并不限定于此，能够进行如下的一般化。在每I个水平扫描期间依次驱动栅极总线的、包括m个移位寄存器的栅极驱动器400中，以满足下述的式(I)和从各双稳态电路输出的状态信号Q的导通期间为m个水平扫描期间(mH)为前提，移位寄存器整体中的各双稳态电路能够构成为基于从其后的第k级双稳态电路输出的状态信号QdinetA的电位降低为低电平。m+1 彡 k 彡 2m-l... (I)例如，如上述第一实施方式的方式，在栅极驱动器400包括2个移位寄存器的情况下，根据上式(I)成为“33”。因此，移位寄存器整体中的各双稳态电路也可以构成为基于从该各双稳态电路后的第三级双稳态电路输出的状态信号QdinetA的电位降低为低电平。此外，例如，如上述第二实施方式，在栅极驱动器400包括3个移位寄存器的情况下，根据上式(I)成为“4≤k≤5”。因此，移位寄存器整体中的各双稳态电路可以构成为基于从该各双稳态电路后的第四级或者第五级双稳态电路输出的状态信号Q，使netA的电位降低至低电平。并且，例如，在栅极驱动器400包括4个移位寄存器的情况下，根据上式(I)成为“5≤k≤7”。因此，移位寄存器整体中的各双稳态电路可以构成为基于从该各双稳态电路后的第五 第七级双稳态电路输出的状态信号Q，使netA的电位降低至低电平。< 4. 2对液晶显示装置以外的显示装置的应用>在上述各实施方式中，列举液晶显示装置为例进行了说明，但本发明并不限定于此。也能够将本发明使用于有机EL (ElEctro LuminsEcence,电致发光)等其它的显示装置。符号说明41 48…(双稳态电路的)输入端子51、52…(双稳态电路的)输出端子200…显示控制电路300…源极驱动器(视频信号线驱动电路)400…栅极驱动器(扫描信号线驱动电路)410、420…移位寄存器整体411、421…第一移位寄存器412、422…第二移位寄存器423…第三移位寄存器600…显示部SR、SR1、SR2…双稳态电路CAP…电容器(电容元件)TI T12…薄膜晶体管GLl GLi…栅极总线SLl SLj…源极总线GCKl GCK6···第一 第六栅极时钟信号CKA、CKB、CKC、CKD…第一时钟、第二时钟、第三时钟、第四时钟S…置位信号Rl…第一复位信号R2…第二复位信号Q…状态信号GOUT···扫描信号Z…其它级控制信号VSS…低电平的电源电压
权利要求
1.一种扫描信号线驱动电路，其特征在于其是对配置于显示部的多个扫描信号线进行驱动的显示装置的扫描信号线驱动电路， 所述扫描信号线驱动电路包括多个移位寄存器，所述移位寄存器包括具有第一状态和 第二状态且相互串联连接的多个双稳态电路，并基于周期性地重复从第二电平向第一电平 变化的第一电平变化与从所述第一电平向所述第二电平变化的第二电平变化的多个时钟 信号而进行动作，通过按每个双稳态电路供给所述多个时钟信号中的1个作为扫描信号线 驱动用时钟信号，所述多个双稳态电路依次成为第一状态，按每个移位寄存器供给电平发生变化的定时不同的时钟信号作为所述扫描信号线驱 动用时钟信号，各双稳态电路具有输出节点，其与所述扫描信号线连接，输出表示所述第一状态和所述第二状态中的任 一状态的状态信号；输出控制用开关元件，所述输出控制用开关元件的第二电极被供给所述扫描信号线驱 动用时钟信号，所述输出控制用开关元件的第三电极与所述输出节点连接；第一节点导通部，其用于基于从该各双稳态电路的前一级双稳态电路输出的状态信 号，使与所述输出控制用开关元件的第一电极连接的第一节点的电平向导通电平变化；和 第一节点断开部，其用于接收从该各双稳态电路的后一级双稳态电路输出的状态信号 作为第一节点断开用信号，并基于所述第一节点断开用信号使所述第一节点的电平向断开 电平变化，在各双稳态电路中，在该各双稳态电路成为所述第一状态后，所述扫描信号线驱动用 时钟信号发生所述第二电平变化，在从包含该各双稳态电路的移位寄存器中的该各双稳态 电路的下一级双稳态电路成为所述第一状态之后的时刻至所述扫描信号线驱动用时钟信 号进行所述第一电平变化的时刻的期间，所述第一节点断开用信号的电平发生变化，以进 行所述第一节点的断开。
2.如权利要求1所述的扫描信号线驱动电路，其特征在于各双稳态电路还具有输出节点断开部，所述输出节点断开部用于接收从该各双稳态电 路的下一级双稳态电路输出的状态信号作为输出节点断开用信号，并基于所述输出节点断 开用信号使所述输出节点断开，在各双稳态电路中，在该各双稳态电路成为所述第一状态之后，在从所述输出节点断 开用信号的电平发生变化使得进行所述输出节点的断开的时刻之后的时刻至所述扫描信 号线驱动用时钟信号发生所述第一电平变化的时刻的期间，所述第一节点断开用信号的电 平发生变化，以进行所述第一节点的断开。
3.如权利要求1所述的扫描信号线驱动电路，其特征在于各双稳态电路，还具有第一节点控制用开关元件，所述第一节点控制用开关元件的第二电极与所述第一节点 连接，且所述第一节点控制用开关元件的第三电极被供给断开电平的电位；和第二节点控制部，其基于所述多个时钟信号中的所述扫描信号线驱动用时钟信号以外 的时钟信号和所述第一节点的电位，对与所述第一节点控制用开关元件的第一电极连接的 第二节点的电位进行控制。
4.如权利要求I所述的扫描信号线驱动电路，其特征在于 所述扫描信号线驱动电路包括2个所述移位寄存器， 所述2个移位寄存器，对所述多个扫描信号线逐条地交替输出所述第一状态的所述状态信号， 对包括所述2个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第三级双稳态电路输出的状态信号作为所述第一节点断开用信号。
5.如权利要求4所述的扫描信号线驱动电路，其特征在于 从所述2个移位寄存器输出所述第一状态的所述状态信号的定时，错开与大约I个水平扫描期间相等的期间， 在所述扫描信号线驱动用时钟信号从发生所述第一电平变化至发生所述第二电平变化的期间和从发生所述第二电平变化至发生所述第一的电平变化的期间，是与大约2个水平扫描期间相等的期间。
6.如权利要求4所述的扫描信号线驱动电路，其特征在于 所述2个移位寄存器基于以下信号进行动作作为所述扫描信号线驱动用时钟信号供给至一个移位寄存器的第一级双稳态电路的第一时钟信号；相位与所述第一时钟信号错开180度的第二时钟信号；与所述第一时钟信号相比相位延迟90度的第三时钟信号；和相位与所述第三时钟信号错开180度的第四时钟信号。
7.如权利要求I所述的扫描信号线驱动电路，其特征在于 所述扫描信号线驱动电路包括m个所述移位寄存器， 所述m个移位寄存器，对所述多个扫描信号线逐条地依次输出所述第一状态的所述状态信号， 对包括所述m个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第k级双稳态电路输出的状态信号作为所述第一节点断开用信号， 其中，m与k的关系满足下述的式子， m+≤ k≤ 2m-1, 在此，m为2以上的整数。
8.如权利要求7所述的扫描信号线驱动电路，其特征在于 从所述m个移位寄存器输出所述第一状态的所述状态信号的定时，各错开与大约I个水平扫描期间相等的期间， 所述扫描信号线驱动用时钟信号从发生所述第一电平变化至发生所述第二电平变化的期间和从发生所述第二电平变化至发生所述第一的电平变化的期间，是与大约m个水平扫描期间相等的期间。
9.如权利要求7所述的扫描信号线驱动电路，其特征在于 作为所述第一节点断开用信号要被供给至各双稳态电路的信号用的配线，以从作为所述输出节点断开用信号要被供给至该各双稳态电路后的第(k-m)级双稳态电路的信号用的配线分岔的方式形成。
10.如权利要求I所述的扫描信号线驱动电路，其特征在于 在所述多个移位寄存器共用地设置有配线，该配线用于传达包含所述多个时钟信号的、用于使所述多个移位寄存器进行动作的多个驱动用信号。
11.如权利要求I所述的扫描信号线驱动电路，其特征在于 包含于各双稳态电路的开关元件全部是同一沟道的薄膜晶体管。
12.如权利要求I所述的扫描信号线驱动电路，其特征在于 包含于各双稳态电路的开关元件是包括非晶硅的薄膜晶体管。
13.如权利要求I所述的扫描信号线驱动电路，其特征在于 包含于各双稳态电路的开关元件是包括微晶硅的薄膜晶体管。
14.如权利要求I所述的扫描信号线驱动电路，其特征在于 包含于各双稳态电路的开关元件是包括多晶硅的薄膜晶体管。
15.如权利要求I所述的扫描信号线驱动电路，其特征在于 包含于各双稳态电路的开关元件是包括氧化物半导体的薄膜晶体管。
16.一种显示装置，其特征在于，包括 所述显示部；和 权利要求I所述的扫描信号线驱动电路。
17.—种驱动方法，其特征在于 所述驱动方法通过扫描信号线驱动电路，对配置于显示部的多个扫描信号线进行驱动， 所述扫描信号线驱动电路包括多个移位寄存器，所述移位寄存器包括具有第一状态和第二状态且相互串联连接的多个双稳态电路，并基于周期性重复从第二电平向第一电平变化的第一电平变化与从所述第一电平向所述第二电平变化的第二电平变化的多个时钟信号而进行动作，通过按每个双稳态电路供给所述多个时钟信号中的I个作为扫描信号线驱动用时钟信号，所述多个双稳态电路依次成为第一状态， 所述驱动方法包括 第一驱动步骤，用于使各双稳态电路从所述第二状态变化至所述第一状态；和 第二驱动步骤，用于使各双稳态电路从所述第一状态变化至所述第二状态， 按每个移位寄存器供给电平发生变化的定时不同的时钟信号作为所述扫描信号线驱动用时钟信号， 各双稳态电路具有 输出节点，其与所述扫描信号线连接，输出表示作为导通电平的所述第一状态和作为断开电平的所述第二状态中的任一状态的状态信号； 输出控制用开关元件，所述输出控制用开关元件的第二电极被供给所述扫描信号线驱动用时钟信号，所述输出控制用开关元件的第三电极与所述输出节点连接；和与所述输出控制用开关元件的第一电极连接的第一节点， 对于各双稳态电路， 所述第一驱动步骤包括 第一节点导通步骤，基于从该各双稳态电路之前的级双稳态电路输出的状态信号，使所述第一节点的电平向导通电平变化；和 状态信号导通步骤，通过所述扫描信号线驱动用时钟信号的所述第一电平变化，使所述状态信号的电平向导通电平变化， 所述第二驱动步骤，包括状态信号断开步骤，通过所述扫描信号线驱动用时钟信号的所述第二电平变化，使所述状态信号的电平向断开电平变化；和 第一节点断开步骤，接收从该各双稳态电路的下一级双稳态电路输出的状态信号作为第一节点断开用信号，并基于所述第一节点断开用信号，使所述第一节点的电平向断开电平变化， 在所述状态信号导通步骤结束后，开始所述状态信号断开步骤，在从包含该各双稳态电路的移位寄存器中的该各双稳态电路的下一级双稳态电路完成所述状态信号导通步骤之后的时刻至所述扫描信号线驱动用时钟信号发生所述第一电平变化的时刻的期间，开始所述第一节点断开步骤。
18.如权利要求17所述的驱动方法，其特征在于 所述扫描信号线驱动电路包括2个所述移位寄存器， 所述2个移位寄存器，对所述多个扫描信号线逐条地交替输出所述第一状态的所述状态信号， 对包括所述2个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第三级双稳态电路输出的状态信号作为所述第一节点断开用信号。
19.如权利要求18所述的驱动方法，其特征在于 从所述2个移位寄存器输出所述第一状态的所述状态信号的定时，错开与大约I个水平扫描期间相等的期间， 在所述扫描信号线驱动用时钟信号从发生所述第一电平变化至发生所述第二电平变化的期间和从发生所述第二电平变化至发生所述第一的电平变化的期间，是与大约2个水平扫描期间相等的期间。
20.如权利要求17所述的驱动方法，其特征在于 所述扫描信号线驱动电路包括m个所述移位寄存器， 所述m个移位寄存器，对所述多个扫描信号线逐条地依次输出所述第一状态的所述状态信号， 对包括所述m个移位寄存器的移位寄存器整体中的各双稳态电路，供给从该各稳态电路后的第k级双稳态电路输出的状态信号作为所述第一节点断开用信号， 其中，m与k的关系满足下述的式子， m+1 ^ k ^ 2m-1, 在此，m为2以上的整数。
21.如权利要求20所述的驱动方法，其特征在于 从所述m个移位寄存器输出所述第一状态的所述状态信号的定时，各错开与大约I个水平扫描期间相等的期间， 所述扫描信号线驱动用时钟信号从发生所述第一电平变化至发生所述第二电平变化的期间和从发生所述第二电平变化至发生所述第一的电平变化的期间，是与大约m个水平扫描期间相等的期间。
全文摘要
目的在于实现在各行的充电期间的结束后能够快速地使扫描信号下降的栅极驱动器。栅极驱动器包括2个移位寄存器，移位寄存器整体(410)中的第n级双稳态电路(SR(n))，从输出节点(51、52)输出状态信号(Q)作为扫描信号。与用于使输出节点(51、52)的电平基于第一时钟(CKA)变化的薄膜晶体管(T1、T11)的栅极端子连接的第一节点(netA)，通过输入从第(n-2)级双稳态电路(SR(n-2))输出的状态信号(Q)作为置位信号(S)而成为导通电平，输出节点(51、52)，通过输入从第(n+2)级双稳态电路(SR(n+2))输出的状态信号(Q)作为第一复位信号(R1)而成为断开电平，第一节点(netA)通过输入从第(n+3)级双稳态电路(SR(n+3))输出的状态信号(Q)作为第二复位信号(R2)而成为断开电平。
文档编号G09G3/36GK102667909SQ201080056850
公开日2012年9月12日 申请日期2010年10月14日 优先权日2009年12月15日
发明者岩瀬泰章, 高桥佳久 申请人:夏普株式会社