驱动电路、液晶显示装置和电子信息设备的制作方法

专利名称：驱动电路、液晶显示装置和电子信息设备的制作方法
技术领域：
本发明涉及驱动电路、液晶显示装置以及电子信息设备，并且更具体来说，本发明涉及用于驱动被配置成分散峰值电流的显示面板(比如液晶显示面板)的驱动电路；配备有这种驱动电路的液晶显示装置；以及包括这种液晶显示装置的电子信息设备。
背景技术：
本非临时申请在35 U. S. C. § 119(a)下要求2010年6月23日在日本提交的专利申请No. 2010-143187的优先权，其全部内容由此通过引用被结合。诸如液晶显示装置之类的平面显示装置在常规上已经包括诸如液晶显示器之类的显示面板、用于驱动所述显示面板的驱动器、以及用于控制所述驱动器的控制电路。近年来，随着这些显示装置变得更大、具有更高清晰度并且被更快地驱动，将要作为显示数据输出到显示面板的显示信号(分级(gradation)电压)的输出频率变得更高，并且将要输出的显示信号的数目增多。结果，在用于驱动这种显示面板的数据驱动器中，在数据输出期间所导致的不必要的辐射已经变得成问题。在下文中将提供针对用于驱动显示面板的常规数据驱动器的实例的详细描述。图14是描述常规数据驱动器的配置的框图。图14中所示的数据驱动器901具有η个信号输出端子911-1到911_η，并且数据驱动器901能够输出显示信号以用于向显示面板的数据线表明来自每一个所述输出端子的具有P分级的显示数据(分级数据)。总之，作为从外部向其输入信号的信号输入端子，数据驱动器901包括时钟输入端子902、多个分级数据输入端子903、控制信号输入端子904、以及参考电压端子905到 909。数据驱动器901还包括η个信号输出端子911-1到911_η，信号从该处被输出到液晶显示面板。作为内部提供的电路，数据驱动器901包括参考电压校正电路921、用于基于时钟信号CLK进行操作的指针移位寄存器部分923、用于对显示数据进行锁存并采样的锁存电路部分924、用于对锁存并采样的显示数据进行锁存并保持的保持电路部分925、用于对锁存并保持的显示数据执行D/A转换的D/A转换器(数字模拟转换器)部分926、以及用于输出经过D/A转换的显示数据的输出缓冲器部分927。在这里，指针移位寄存器部分923包括η级移位寄存器923-1到923_η。锁存电路部分拟4包括η个锁存电路924-1到924_η。保持电路部分925包括η个保持电路925-1 到925-n。D/A转换器部分拟6包括η个D/A转换器电路926-1到926_η。输出缓冲器部分 927包括η个输出缓冲器927-1到927_η，每一个由运算放大器构成。接下来将描述上面所描述的装置的操作。在具有这种配置的数据驱动器901中，来自用于控制该驱动器901的控制电路(未示出)的显示数据DATA、数据控制信号LOAD和时钟信号CLK的输入允许指针移位寄存器部分923根据输入到时钟输入端子902的时钟信号CLK来选择锁存电路924-1到924_n的其中之一。在这种情况下，来自分级数据输入端子903的分级数据DATA的输入使得所述分级数据的采样值被存储在锁存电路部分924内的所选锁存电路中。另外，从指针移位寄存器部分923输出的锁存电路选择信号使得第一级锁存电路 924-1到第η级锁存电路924-η通过从时钟输入端子902输入的时钟信号被相继选择。因此，η个时钟的输入使得能够在所有锁存电路924-1到924-η中存储所述分级数据。另外， 通过控制信号LOAD将存储在锁存电路924-1到924_n中的分级数据转移到对应的η个保持电路925-1到925-η，以作为D/A转换器拟6_1到的数字输入数据。D/A转换器拟6-1到拟6_11根据上面的数字输入数据来选择并输出P种类型的分级电压的其中一种以供输入。由参考电压校正电路921基于从相应的参考电压端子905到 909输入的参考电压VO到V4生成ρ种类型的分级电压。此外，输出缓冲器部分927对从D/A转换器拟6_1到输出的分级电压执行阻抗转换，并且所述分级电压被输出到液晶显示面板(未示出)的各条数据线，以作为从每一个信号输出端子911-1到911-η去往所述液晶显示面板的驱动信号。在具有这种配置的常规数据驱动器901中，由于数据转移是按照上面所描述的那样通过控制信号LOAD从保持电路925-1到925_n向D/A转换器电路926-1到926_n —起执行的，因此从D/A转换器电路926-1到926-n输出的分级电压同时发生改变。因此，在数据驱动器901中瞬时生成大量电流。由于信号输出端子911-1到911-η的数目的增多以及输出缓冲器部分927的驱动性能的提高，该电流的值极大。由于这一事实，不仅由数据驱动器901消耗更多电流，而且由所述电流导致的不必要的辐射也变得成问题。相应地，提出了在参考文献1中所公开的方法以作为用于防止峰值电流由于集中电流而增大的方法。图15是描述在参考文献1中所公开的数据驱动器的配置的图。在图15中的数据驱动器300中，电路块CBl到CB4对应于图14中所示的数据驱动器901中的保持电路、D/A转换器电路和输出缓冲器，并且电路块CBl到CB4的相应集合被分组成多个组CGl到CGm。总之，每一个组中的电路块CBl到CB4对应于液晶显示面板的相应数据线，并且它们向对应的数据线输出显示数据。此外，在数据驱动器300中，控制信号LOAD输入经由输入保护电路E (30)被直接输入到第一电路组CG1。来自输入保护电路E (30)的控制信号LOAD经由第一延迟电路 31al被输入到第二电路组CG2。控制信号LOAD经由第一延迟电路31al和第二延迟电路 31a2被输入到第三电路组CG3。总之，控制信号LOAD经由第一到第m_l延迟电路31al到 3Iam-I被输入到第m电路组CGm。因此，在配备有这种数据驱动器的液晶显示装置中，由于在各电路组CG之间提供有延迟电路D，因此从相应的电路组CG输出显示输出信号(分级电压)，其中每一个显示输出信号被偏移每一个延迟电路D的延迟时间段(period)。由于这种配置，显示输出信号对于相应的电路组CG被分散以供输出。因此，即使在由于更高的清晰度和更宽的屏幕而导致信号数目增多的情况下，流经电源线的峰值电流也被分散，并且还可以减少不必要的辐射。参考文献2公开了使得用于将分级数据取入到保持电路中的定时在各数据驱动器之间不同的主题。
参考文献1 日本特许公开公布No. 8-22267。参考文献2 日本特许公开公布No. 2008-262132。

发明内容
如上所述，在参考文献1中所描述的数据驱动器中，从相应的电路组CG输出显示输出信号(分级电压)，其中每一个显示输出信号被偏移每一个延迟电路D的延迟时间段，同时从相应的电路组输出显示信号的间隔是恒定的。因此出现下述问题驱动信号的各频率分量不够分散，并且当显示装置的屏幕更大、清晰度更高并且被更快地驱动时，不必要的辐射增多。在参考文献2中所公开的液晶显示装置中，也存在与参考文献1中所描述的数据驱动器类似的问题。本发明意图解决上面所描述的常规问题。本发明的目的是提供一种能够分散用于驱动显示装置(比如液晶显示装置)的驱动信号的各频率分量的驱动电路，以便减少不必要的辐射；一种配备有这种驱动电路的液晶显示装置；以及一种包括这种液晶显示装置的电子信息设备。根据本发明的一种基于显示数据和控制信号来驱动显示装置的驱动电路包括用于延迟输入控制信号的延迟电路；以及用于在由所述经过延迟的控制信号生成的定时下将输入显示数据加载到所述显示装置的数据加载部分，其中所述延迟电路延迟所述控制信号，从而使得将所述显示数据加载到所述显示装置的加载定时根据由恒定周期确定的固定定时而发生改变，从而实现上面所描述的目的。优选的是，在根据本发明的驱动电路中，所述输入控制信号是用于在所述恒定周期下生成所述固定定时的信号，并且所述延迟电路重复对于所述控制信号的延迟处理，其中在所述加载定时的延迟时间段的极限内，每当经过所述恒定周期的整数倍，就把所述加载定时从所述固定定时延迟给定的延迟时间段。另外优选的是，在根据本发明的驱动电路中，所述显示数据和所述控制信号被包括在提供给显示装置的视频信号中，并且所述恒定周期是基于所述视频信号的水平同步时间段。另外优选的是，在根据本发明的驱动电路中，所述延迟电路包括用于对由所述输入控制信号生成的固定定时进行计数的计数电路；以及用于对所述计数电路的计数输出进行译码的译码器，其中所述控制信号的延迟量是基于所述译码器的输出而确定的。另外优选的是，在根据本发明的驱动电路中，所述延迟电路包括串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述译码器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。另外优选的是，在根据本发明的驱动电路中，所述延迟电路包括用于基于由所述输入控制信号生成的固定定时来执行移位操作的移位寄存器；串联连接的多个延迟元件； 以及用于切换所述控制信号的信号路径的多个开关，从而基于所述移位寄存器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。另外优选的是，根据本发明的驱动电路包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器；用于驱动所述液晶显示面板的多条扫描线的扫描驱动器；以及用于基于输入视频信号生成被提供给所述数据驱动器的显示数据以及生成作为控制信号被提供给所述数据驱动器的数据控制信号和被提供给所述扫描驱动器的扫描控制信号的定时控制器，其中所述延迟电路构成所述数据驱动器；并且所述延迟电路延迟输入到所述数据驱动器的控制信号，从而使得将所述显示数据从所述数据驱动器输出到所述液晶显示面板的数据线的定时根据固定定时而对于每一条水平扫描线发生改变，其中所述固定定时是基于水平同步信号而确定的。另外优选的是，根据本发明的驱动电路包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器；用于驱动所述液晶显示面板的多条扫描线的扫描驱动器；以及用于基于输入视频信号生成被提供给所述数据驱动器的显示数据以及生成作为控制信号被提供给所述数据驱动器的数据控制信号和被提供给所述扫描驱动器的扫描控制信号的定时控制器，其中所述延迟电路构成所述定时控制器；并且所述延迟电路延迟由所述定时控制器基于所述视频信号而生成的控制信号，从而使得将所述显示数据从所述数据驱动器输出到所述液晶显示面板的数据线的定时根据固定定时而对于每一条水平扫描线发生改变，其中所述固定定时是基于水平同步信号而确定的。另外优选的是，根据本发明的驱动电路包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器，其中，所述延迟电路构成所述数据驱动器，其用于延迟输入到所述数据驱动器中的控制信号，并且所述数据驱动器包括为所述液晶显示面板的每一条数据线提供的多个组当中的多个驱动器电路，其用于驱动对应的数据线，所述多个驱动器电路被分组成多个组；以及用于延迟被提供给每一个组中的各驱动器电路的控制信号的信号延迟部分，从而使得相同组中的驱动器电路在相同定时下将显示数据提供到数据线，并且不同组中的驱动器电路在不同定时下将显示数据提供到数据线。另外优选的是，在根据本发明的驱动电路中，所述信号延迟部分包括串联连接在多级上的多个延迟部分；第一级中的延迟部分延迟从所述延迟电路输出的控制信号；并且第二级和后面各级中的延迟部分延迟从前一级中的延迟部分输出的控制信号。另外优选的是，在根据本发明的驱动电路中，构成所述信号延迟部分的各延迟部分分别将输入控制信号延迟预定量。另外优选的是，在根据本发明的驱动电路中，所述多个延迟部分包括用于对由所述输入控制信号生成的固定周期的定时进行计数的计数电路；以及用于对所述计数电路的计数输出进行译码的译码器，其中所述控制信号的延迟量是基于所述译码器的输出而确定的。另外优选的是，在根据本发明的驱动电路中，所述多个延迟部分包括串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述译码器的输出由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。另外优选的是，在根据本发明的驱动电路中，所述多个延迟部分包括用于基于由所述输入控制信号生成的固定周期定时来执行移位操作的移位寄存器；串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述移位寄存器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。根据本发明的一种液晶显示装置包括液晶显示面板，以用于基于视频信号来在所述液晶显示面板上显示图像，所述液晶显示装置还包括用于基于所述视频信号来驱动所述液晶显示面板的驱动装置，其中所述驱动装置包括根据本发明的驱动电路，从而实现上面描述的目的。根据本发明的一种电子信息设备包括液晶显示装置，其中所述液晶显示装置是根据本发明的液晶显示装置，从而实现上面描述的目的。下文中将描述本发明的各项功能。在本发明中包括用于延迟输入控制信号的延迟电路和用于在生成经过延迟的控制信号的定时下将输入显示数据加载到显示装置的数据加载部分。所述控制信号被延迟的方式使得用于将显示数据加载到显示装置的加载定时根据由恒定周期确定的固定定时而发生改变。结果，获得在常规技术中无法充分获得的减少不必要辐射的效果变得有可能。在本发明中，由于参照固定定时的针对控制信号的加载定时是通过延迟控制信号而在一个时间序列中多次生成的，因此可以防止用于多次生成所述控制信号的加载定时的电路尺寸过大，这导致成本降低。在本发明中，所述驱动电路包括用于对控制信号的脉冲上升进行计数的计数器电路，从而可以在不增大电路尺寸的情况下配置能够对于每一个水平时间段改变加载定时的延迟电路，这导致成本降低。在本发明中，对应于每一条数据信号线的多个对应的电路块形成一个组，其具有作为单元的预定数目的数据信号线，其中每一个所述电路块构成一个驱动电路。因此，参照所述固定定时在一个时间序列中多次生成所述控制信号的加载定时。结果，不仅可以分散在所述驱动电路中生成的驱动信号的各频率分量并且可以减少不必要的辐射，而且还可以对于多个电路组当中的每一个偏移用于加载的定时，从而实现不必要辐射的进一步减少。根据如上所述的本发明，获得下述变得有可能一种能够分散用于驱动显示装置 (比如液晶显示装置)的驱动信号的各频率分量的驱动电路，从而减少不必要的辐射；一种配备有这种驱动电路的液晶显示装置；以及一种包括这种液晶显示装置的电子信息设备。通过阅读并理解下面参照附图所做的详细描述，本发明的这些和其他优点对于本领域技术人员将变得显而易见。


图1是示出包括根据本发明的实施例1的驱动电路的显示装置的配置的图。图2是示出作为根据本发明的实施例1的驱动电路的数据驱动器的框图。图3是示出构成根据本发明的实施例1的驱动电路(数据驱动器)的延迟电路的框图。图4是描述根据本发明的实施例1的延迟电路的操作的图，其在时序图中示出经过延迟的加载信号(控制信号)。图5是示出包括根据本发明的实施例2的定时控制器的显示装置的配置的图。图6是示出根据本发明的实施例2的定时控制器的框图。图7是示出包括根据本发明的实施例3的驱动电路的显示装置的配置的图。图8是示出作为根据本发明的实施例3的驱动电路的数据驱动器的框图。图9是示出构成根据本发明的实施例3的驱动电路(数据驱动器)的延迟电路的框图。
图10是示出包括根据本发明的实施例4的驱动电路的显示装置的配置的图。图11是示出作为根据本发明的实施例4的驱动电路的数据驱动器的框图。图12是示出构成根据本发明的实施例4的驱动电路(数据驱动器)的延迟电路的 框图。图13是示出根据本发明的实施例5的驱动电路(数据驱动器)的框图。图14是描述一个常规数据驱动器的配置的实例的框图。图15是描述作为另ー个常规驱动电路的配置的实例的在參考文献1中所公开的 配置的框图。14a控制部分 14b、120、120b、220、D延迟电路 20a 1-20am 电路块 24al-24am、24bl-24bm ±夬延迟电路 100、100a、100b、200 液晶显示装置
101.201.901液晶显示面板
102-109、102a-109a、102b-109b、202-209LSI 数据驱动器
110-113,210-213扫描驱动器
114、114a、214定时控制器
115.215.923移位寄存器部分
115-1到115-n、215-l到215-k移位寄存器
116.216.924锁存电路部分
116-1到 116-n、216-l 到 216-n锁存电路 117、217、925 保持电路部分
117-1到 117-n、217-l 到 217-k保持电路 118,218,926 D/A转换器部分
118-1到 118-n、218-l 到 218-kD/A 转换器 119、219、927 输出缓冲器部分
119-1到119-n、219-l到219-k输出缓冲器 121,221 參考电压校正电路
122.222.902时钟输入端子
123.223.903数据输入端子
124.224.904控制输入端子 125-129,225-229,905-909參考电压输入端子 130,230,911 输出端子部分
130-1到130-n输出端子
131,231计数器
132、232译码器
133-1 到 133-4 开关 134a、134b、134c延迟部分
De延迟元件。
具体实施例方式下文中将描述本发明的各实施例。图1是示出包括根据本发明的实施例1的驱动电路的液晶显示装置的配置的图。根据实施例1的液晶显示装置100包括用于基于视频信号执行图像显示的液晶显示面板101 ；用于驱动所述液晶显示面板的数据信号线的多个数据驱动器102到109 ； 用于驱动所述液晶显示面板的扫描信号线的多个扫描驱动器110到113 ；以及定时控制器 114，用于从视频信号生成显示数据、数据控制信号和扫描控制信号，用于利用所述显示数据和所述数据控制信号控制数据驱动器102到109，以及用于利用所述扫描控制信号控制扫描驱动器110到113。更具体来说，数据驱动器102到109被连接到液晶显示面板101的数据信号线，并且基于来自定时控制器114的显示数据和数据控制信号来驱动所述数据信号线。数据驱动器102到109是通过将驱动器芯片实施为诸如由膜衬底上的半导体集成电路构成的COF (膜上芯片)之类的实施结构而形成的。扫描驱动器110到113被连接到液晶显示面板101 的扫描信号线，并且利用来自定时控制器114的扫描控制信号来驱动所述扫描信号线。扫描驱动器110到113也是通过将驱动器芯片实施为诸如由膜衬底上的半导体集成电路构成的COF (膜上芯片)之类的实施结构而形成的。定时控制器114通过信号线被连接到数据驱动器102到109中的至少一个和扫描驱动器110到113中的至少一个。通过控制数据驱动器102到109中的至少一个和扫描驱动器110到113中的至少一个，定时控制器114在液晶显示面板101上显示视频数据。总之，定时控制器114可以通过数据总线与每一个数据驱动器和每一个扫描驱动器直接相连。可选择地，定时控制器114可以被连接到第一级数据驱动器和第一级扫描驱动器，并且来自定时控制器114的信号可以被从第一级数据驱动器和第一级扫描驱动器传送到后面各级中的数据驱动器和扫描驱动器。图2是示出数据驱动器102的配置的图。数据驱动器103到109分别包括与数据驱动器102相同的配置，因此将省略对其的解释性描述。如图2中所示，数据驱动器102包括用于基于时钟信号CLK来执行移位操作的指针移位寄存器电路部分115，用于对显示数据DATA进行锁存并采样的锁存电路部分116，用于对锁存并采样的显示数据进行锁存并保持的保持电路部分117，用于对锁存并保持的显示数据执行D/A转换的D/A转换器部分118，以及用于输出经过D/A转换的显示数据的输出缓冲器部分119。在这里，指针移位寄存器电路部分115包括η级移位寄存器115_1到115_η。锁存电路部分116包括η个锁存电路116-1到116_η。保持电路部分117包括η个保持电路 117-1到117-n。D/A转换器118包括η个D/A转换器电路118-1到118-η。输出缓冲器部分119包括η个输出缓冲器119-1到119_η，每一个由运算放大器构成。数据驱动器102还包括用于延迟数据控制信号的延迟电路120、以及用于基于将被输入的参考电压VO到V4来生成m种类型的分级电压的参考电压校正电路121。至于输入端子，数据驱动器102还包括时钟输入端子122、显示数据输入端子123、 控制信号输入端子124、以及参考电压端子125到129。至于为把信号输出到液晶显示面板101而提供的输出端子，数据驱动器102还包括η个信号输出端子130-1到130-η。信号输出端子130-1到130_η被分别连接到前面提到的液晶显示面板101的数据信号线。在这里，提供时钟输入端子122以便输入给到指针移位寄存器电路部分115的时钟信号CLK。显示数据输入端子123包括对应于由多个比特构成的分级数据的相应比特的多个信号输入端子。控制信号输入端子1 通过延迟电路120被连接到保持电路部分117， 并且被提供以用于允许输入数据加载信号LOAD。所述数据加载信号被用作控制信号，以用于允许保持电路部分117保留锁存在锁存电路部分116处的显示数据。参考电压端子125 到1 分别被提供以用于输入给到参考电压校正电路121的参考电压VO到V4。信号输出端子130-1到130-η被提供以用于将从构成输出缓冲器部分119的η个输出缓冲器119-1到119-η输出的分级电压输出到液晶显示面板101。接下来将描述上面所描述的装置的操作。在根据实施例1的液晶显示装置100中，在从外部输入视频信号之后，定时控制器114从所述视频信号生成显示数据DATA、数据控制信号LOAD、扫描控制信号和时钟信号 CLK0当显示数据DATA、数据控制信号LOAD和时钟信号CLK被提供到数据驱动器102到109 时，数据驱动器102到109基于所述显示数据和数据控制信号来驱动所述数据信号线。另外，当扫描控制信号被提供到扫描驱动器110到113时，扫描驱动器110到113基于所述扫描控制信号来驱动所述扫描信号线。从而可以根据所述视频信号来在液晶显示面板上显示图像。与此同时，在数据驱动器102中，当来自定时控制器114的显示数据DATA、数据控制信号LOAD和时钟信号CLK被提供到相应的输入端子时，指针移位寄存器电路部分115利用相应的各级移位寄存器115-1到115-n对于在时钟输入端子122中输入的时钟信号CLK 进行移位，以便从每一级的移位寄存器输出锁存电路选择信号。总之，利用所述锁存电路选择信号，指针移位寄存器电路部分115相继选择构成锁存电路部分116的第一级锁存电路 116-1到第η级锁存电路116-η。在输入所述锁存电路选择信号之后，锁存电路部分116中的η个锁存电路116_1 到116-η改变到激活状态，这允许存储从显示数据输入端子123输入的显示数据DATA。在这一状态下，有可能在锁存电路116-1到116-η中存储具有不同值的数据。因此，当所述时钟信号的η个时钟被输入到指针移位寄存器电路部分115中时，所有的锁存电路116-1到 116-η都可以存储与相应的数据线对应的显示数据。当在每一个锁存电路都可以存储数据的状态下从显示数据输入端子123输入显示数据DATA时，对应于每一条数据线的显示数据 DATA的值被选择并且被存储在每一个对应的锁存电路116-1到116-η中。η个保持电路117-1到117_η在加载信号(数据控制信号)LOAD变为激活(例如H 电平)的定时下统一检索并保留存储在对应的锁存电路116-1到116-η中的数据。保留在保持电路117-1到117-η中的数据被改变成D/A转换器118-1到118_η中的数字数据输入。在这一阶段，数据控制信号LOAD被从定时控制器114输出并且通过信号线被输入到控制信号输入端子124，随后数据控制信号LOAD通过延迟电路120被输入到保持电路部分117中。因此，数据控制信号LOAD在延迟电路120中被延迟预定时间，并且随后被输入到保持电路部分117中。D/A转换器118-1到118_n基于上面所描述的数字数据选择并输出从参考电压校正电路121输入的ρ种类型的分级电压的其中之一。这种D/A转换器118-1到118_n的细节例如在日本特许公开公布No. 2003-130921中进行了描述，因此将省略对其的解释。输出缓冲器119-1到119-n对从相应的D/A转换器118-1到118_n输出的分级电压执行阻抗转换并且将其输出。从输出缓冲器119-1到119-n输出的分级电压被输出到液晶显示面板101的对应的数据信号线，以作为来自相应的信号输出端子130-1到130-n的分级数据(驱动数据)。虽然上面解释的操作是数据驱动器102的操作，但是剩余的数据驱动器103到109 按照与数据驱动器102相同的方式操作。接下来将详细描述根据实施例1的驱动电路(数据驱动器)102中的延迟电路120。图3是示出构成根据实施例1的驱动电路(数据驱动器)102的延迟电路的框图。延迟电路120包括连接到控制输入端子124的2比特计数器131，用于对计数器131的输出进行译码的4输出译码器132，连接到译码器132的四个开关133 (133-0到 133-3)，以及连接到各开关133的延迟元件De。更具体来说，延迟电路120包括第一到第四开关133-0到133_3，由串联连接的三个延迟元件构成的延迟部分IMa，由串联连接的两个延迟元件构成的延迟部分1Mb，以及由一个延迟元件构成的延迟部分13如。第四开关133-3与各延迟部分按照13 到13 的顺序从输入节点一侧串联连接，并且处在延迟电路120的输入节点(控制输入端子124) 与输出节点之间。在这里，第三开关133-2与第四开关133-3和延迟部分13 的串联连接体并联连接。第二开关133-1与第四开关133-3、延迟部分13 和延迟部分134b的串联连接体并联连接。第一开关133-0与第四开关133-3、延迟部分134a、延迟部分134b和延迟部分134c 的串联连接体并联连接。在如上所述的延迟电路120中，计数器131对作为脉冲信号从外部输入到控制输入端子124的控制信号LOAD (输入)(参见图4)的脉冲的数目进行计数。译码器132根据计数数目将其输出YO到TO相继变成激活状态。在这里，所述控制信号是与视频信号的水平同步信号同步的脉冲信号。因此，每当经过一个水平同步时间段时，第一到第四开关133-0 到133-3被相继接通，并且所述开关的切换对于每四个水平同步时间段被重复。总之，根据所述计数数目，对应于控制信号LOAD的路径被切换到以下路径的其中之一通过三个延迟部分13 到13 的路径，通过两个延迟部分134b和13 的路径，通过延迟部分13 的路径，以及不通过延迟部分的路径。根据所述计数数目通过这种路径， 控制信号LOAD随后被输入到保持电路117中。因此，经过第一开关133-0的控制信号被从输出节点输出而没有延迟。经过第二开关133-1的控制信号通过一个延迟元件De被输出。经过第三开关133-2的控制信号通过三个延迟元件De被输出。经过第四开关133-3的控制信号通过六个延迟元件De被输出。因此，通过把一个水平同步时间段定义为IH并且把一个延迟元件De的延迟时间段定义为α，关于以一个水平同步时间段为参考由固定周期确定的定时，在保持电路部分 117中被输入的控制信号LOAD的脉冲上升的定时对于每一个水平时间段被延迟的延迟时间段分别是ΙΗ+α、1Η+2α、1Η+3α或0。换句话说，所述控制信号中的每一个脉冲在从紧接在前的脉冲上升定时开始经过IH+α、1Η+2α、1Η+3α和1Η_6 α之后上升，并且可以说存在四种类型的周期，比如IH+α、1Η+2α、1Η+3α和1Η-6 α，如图4中所示。结果，所述数据驱动器电路中的控制信号的频率被分散，从而减少不必要的辐射。根据如上所述的实施例1，基于所述显示数据和控制信号来驱动液晶显示面板 101的数据驱动器(驱动电路)102到109包括用于延迟输入控制信号的延迟电路120以及作为数据加载部分的保持电路部分117、D/A转换器电路部分118和输出缓冲器部分119，所述数据加载部分用于在由所述经过延迟的控制信号生成的定时下将输入显示数据加载到液晶显示面板101。此外，延迟电路120延迟所述控制信号，从而使得将显示数据加载到液晶显示面板101的加载定时关于固定定时而发生改变，其中所述固定定时由恒定周期(一个水平同步时间段)确定。因此对于每一个水平同步时间段周期性地改变所述驱动电路加载数据的输出定时变得有可能。从而分散输出到所述液晶显示面板的显示数据的各频率分量并且减少不必要的辐射变得有可能。在实施例1中，对于每一个水平同步时间段周期性地改变所述驱动电路加载数据的输出定时；然而，也可以对于两个或更多个水平同步时间段当中的每一个周期性地改变所述驱动电路加载数据的输出定时。(实施例2)。图5是示出包括根据本发明的实施例2的定时控制器的液晶显示装置的配置的图。根据实施例2的液晶显示装置IOOa包括配备有延迟电路14b的定时控制器11 而不是根据实施例1的液晶显示装置100中的定时控制器114，其中延迟电路14b具有与实施例1中的延迟电路120相同的配置。在根据实施例2的液晶显示装置IOOa中，数据驱动器102a、103a和109a具有的配置与常规数据驱动器901的配置相同。根据实施例2的液晶显示装置IOOa中的配置的剩余部分与根据实施例1的液晶显示装置100配置的剩余部分相同。图6是示出根据本发明的实施例2的定时控制器的图。根据实施例2的定时控制器11 包括用于基于从液晶显示装置IOOa外部提供的视频信号生成显示数据、数据控制信号、时钟信号和扫描控制信号的控制部分14a，以及用于延迟从控制部分Ha输出的数据控制信号LOAD的延迟电路14b。延迟电路14b具有与包括在根据实施例1的数据驱动器102中的延迟电路120相同的配置。在具有如上所述的配置的根据实施例2的液晶显示装置IOOa中，定时控制器11 被配置成包括用于延迟数据控制信号的延迟电路14b。因此，从延迟电路14b提供到数据驱动器(驱动电路)102a到109a的控制信号被延迟，从而使得将所述显示数据加载到所述显示装置的加载定时根据由恒定周期(一个水平同步时间段)确定的固定定时发生改变。结果，对于每一个水平同步时间段周期性地改变所述驱动电路将数据加载到液晶显示面板的输出定时变得有可能。从而分散输出到所述液晶显示面板的显示数据的各频率分量并且减少不必要的辐射变得有可能。(实施例3)。图7是示出包括根据本发明的实施例3的驱动电路的液晶显示装置的配置的图。 图8是示出作为根据本发明的实施例3的驱动电路的数据驱动器的图。根据实施例3的液晶显示装置IOOb包括分别包括延迟电路120b的数据驱动器102b到109b，而不是根据实施例1的液晶显示装置100中的具有延迟电路120的数据驱动器102到109，其中延迟电路120b的电路配置不同于延迟电路120的电路配置。根据实施例3的液晶显示装置IOOb中的配置的剩余部分与根据实施例1的液晶显示装置100的配置的剩余部分相同。图9是示出构成根据本发明的实施例3的驱动电路(数据驱动器)的延迟电路120b 的框图。延迟电路120b包括移位寄存器13 以取代构成根据实施例1的数据驱动器102 的延迟电路120中的计数器131和译码器132。配置的剩余部分与实施例1中的延迟电路 120的配置的剩余部分相同。总之，根据实施例3的数据驱动器102b中的延迟电路120b包括用于基于从输入控制信号LOAD生成的固定定时来执行移位操作的移位寄存器13 ；串联连接的多个延迟元件De ；以及用于基于所述移位寄存器的输出来切换所述控制信号的信号路径的多个开关133-0到133-3，从而使得由所述多个延迟元件当中的预定数目的串联连接的延迟元件来延迟所述控制信号。所述延迟元件De和开关133-0到133-3与根据实施例1的延迟电路120中的那些完全相同。在具有如上所述的配置的延迟电路120b中，每当控制信号LOAD (输入)(参见图 4)的脉冲上升时，移位寄存器13 就将其输出YO到TO相继变成激活状态，其中控制信号 LOAD (输入)是从外部输入到控制输入端子124的脉冲信号。在这里，所述控制信号是与视频信号的水平同步信号同步的脉冲信号。因此，每当经过一个水平同步时间段时，第一到第四开关133-0到133-3被相继接通，并且所述开关的切换对于每四个水平同步时间段被重
Μ. ο因此，与根据实施例1的延迟电路120类似，经过第一开关133-0的控制信号被从输出节点输出而没有延迟。经过第二开关133-1的控制信号通过一个延迟元件De被输出。 经过第三开关133-2的控制信号通过三个延迟元件De被输出。经过第四开关133-3的控制信号通过六个延迟元件De被输出。因此，通过把一个水平同步时间段定义为IH并且把一个延迟元件De的延迟时间段定义为α，关于以一个水平同步时间段为参考由固定周期确定的定时，在保持电路部分 117中被输入的控制信号LOAD的脉冲上升的定时对于每一个水平时间段被延迟的延迟时间段分别是IH+ α、1Η+2 α、1Η+3 α或0。结果，所述数据驱动器电路中的控制信号的频率被分散，从而减少不必要的辐射。(实施例4)。图10是示出包括根据本发明的实施例4的驱动电路的显示装置的配置的图。根据实施例4的液晶显示装置200包括数据驱动器202到209而不是根据实施例 1的液晶显示装置100中的数据驱动器102到109，其中数据驱动器202到209的配置不同于数据驱动器102到109的配置。图11是示出作为根据本发明的实施例4的驱动电路的数据驱动器的框图，其示出数据驱动器202的配置。更具体来说，除了根据实施例1的数据驱动器102的配置之外，对于所有η条数据信号线当中的预定数目(这里是k)的数据信号线中的每一条数据信号线，根据实施例4的数据驱动器202还包括形成由m个组20al到20am构成的一个组的移位寄存器、锁存电路、 保持电路、D/A转换器电路和缓冲器电路。数据驱动器202还包括分别与相应的组对应的具有固定延迟时间段的延迟电路Mal到Mam，其中延迟电路Mal到Mam被提供在相应组的前一级。延迟电路Mal到Mam串联连接，从而使得来自延迟电路220的控制信号被相继延迟给定时间段。延迟电路220具有与根据实施例1的延迟电路120相同的配置，并且也能够改变延迟量。来自具有固定延迟量并且被提供在每一个组的前一级的延迟电路Mal 到Mam的输出被提供到每一个所述组20al到20am中的每一个保持电路。因此，根据实施例4的液晶显示装置200中的定时控制器214、扫描驱动器210到 213和液晶显示面板201与根据实施例1的液晶显示装置100中的定时控制器114、扫描驱动器110到113和液晶显示面板101完全相同。总之，数据驱动器202到209被连接到液晶显示面板201的数据信号线，并且驱动所述数据信号线。另外，数据驱动器202到209是通过将驱动器芯片实施为诸如由膜衬底上的半导体集成电路构成的COF (膜上芯片)之类的实施结构而形成的。扫描驱动器210到 213被连接到显示面板201的扫描信号线，并且驱动所述扫描信号线。扫描驱动器210到 213也是通过将驱动器芯片实施为诸如由膜衬底上的半导体集成电路构成的COF (膜上芯片)之类的实施结构而形成的。定时控制器214通过信号线被连接到数据驱动器202到209 中的至少一个和扫描驱动器210到213中的至少一个。通过控制数据驱动器202到209中的至少一个和扫描驱动器210到213中的至少一个，定时控制器214使得液晶显示面板201 显示视频数据。在下文中将描述数据驱动器202。数据驱动器203到209分别包括与数据驱动器202相同的配置，因此将省略对其的解释性描述。与根据实施例1的数据驱动器102类似，数据驱动器202包括指针移位寄存器电路部分215、锁存电路216、保持电路217、D/A转换器部分218和输出缓冲器部分219。然而，在数据驱动器202中，构成指针移位寄存器电路部分215的移位寄存器 215-1到215-n对于每k条数据信号线被分组成一个组。另外，构成锁存电路216的锁存电路216-1到216-n、构成保持电路部分217的保持电路217-1到217_n、构成D/A转换器部分218的D/A转换器218-1到218_n、以及构成输出缓冲器部分219的输出缓冲器219-1 到219-n按照类似的方式被分组。总之，相应的组20al到20am分别包括构成指针移位寄存器电路部分215的移位寄存器215-1到215-k，构成锁存电路216的锁存电路216-1到216_k，构成保持电路部分 217的保持电路217-1到217-k，构成D/A转换器部分218的D/A转换器218-1到218_k，以及构成输出缓冲器部分219的输出缓冲器219-1到219-k。数据驱动器202还包括具有可变延迟量的延迟电路220以及参考电压校正电路 221。至于输入端子，数据驱动器202还包括时钟输入端子222、显示数据输入端子223、控制信号输入端子2M和参考电压端子225到229。另外，至于为把信号输出到液晶显示面板 201而提供的输出端子，数据驱动器202还包括η个信号输出端子230-1到230_η。信号输出端子230-1到230-η被分别连接到前面提到的液晶显示面板201的数据信号线。
提供时钟输入端子222以便输入给到指针移位寄存器电路部分215的时钟信号 CLK。显示数据输入端子223包括对应于由多个比特构成的分级数据的相应比特的多个信号输入端子。控制信号输入端子2M通过具有可变延迟量的延迟电路220被连接到保持电路部分217，并且允许输入控制信号。所述控制信号被用作用于允许保持电路部分217保留锁存在锁存电路部分216处的显示数据的信号。参考电压端子225到2 分别被提供以用于输入给到参考电压校正电路221的参考电压VO到V4。信号输出端子230-1到230-n被提供以用于将从构成输出缓冲器部分219的输出缓冲器219-1到219-n输出的分级电压输出到液晶显示面板201。图12是示出构成根据实施例4的驱动电路(数据驱动器)的具有可变延迟量的延迟电路的框图。根据实施例4的具有可变延迟量的延迟电路220具有与如图3中所示的根据实施例1的延迟电路120相同的配置。延迟电路220由连接到控制输入端子2 的2比特计数器231、连接到计数器231 的4输出译码器232、连接到译码器232的四个开关233 (233-0到233-3)、以及连接到各开关233的延迟元件De形成。在这里，包括2比特计数器231、4输出译码器232、开关233 以及延迟元件De的延迟部分23 到23 与根据实施例1的延迟电路中的那些完全相同。接下来将描述上面所描述的装置的操作。在根据实施例4的液晶显示面板200中，在从外部输入视频信号之后，定时控制器214从所述视频信号生成显示数据DATA、数据控制信号LOAD、扫描控制信号和时钟信号 CLK0当显示数据DATA、数据控制信号LOAD和时钟信号CLK被提供到数据驱动器202到209 时，数据驱动器202到209基于所述显示数据和数据控制信号来驱动所述数据信号线。另外，当扫描控制信号被提供到扫描驱动器210到213时，扫描驱动器210到213基于所述扫描控制信号来驱动所述扫描信号线。从而可以根据所述视频信号在液晶显示面板上显示图像。与此同时，在数据驱动器202中，当来自定时控制器214的显示数据DATA、数据控制信号LOAD和时钟信号CLK被提供到相应的输入端子时，指针移位寄存器电路部分215利用相应的各级移位寄存器215-1到215-n对输入到时钟输入端子222的时钟信号CLK进行移位，以便从每一级的移位寄存器输出锁存电路选择信号。利用所述锁存电路选择信号，指针移位寄存器电路部分215相继选择构成锁存电路部分216的第一级锁存电路216-1到第 η级锁存电路216-n。在输入所述锁存电路选择信号之后，锁存电路216-1到216-n改变到激活状态，这允许存储从显示数据输入端子223输入的显示数据DATA。在这一状态下，有可能在锁存电路216-1到216-n中存储具有不同值的数据。因此，当所述时钟信号的η个时钟被输入到指针移位寄存器电路部分215中时，所有的锁存电路216-1到216-n都可以存储与相应的数据线对应的显示数据。当在这一状态下从显示数据输入端子223输入显示数据DATA时， 所述显示数据DATA被选择并且被存储在每一个对应的锁存电路216-1到216-n中。保持电路部分217由η个保持电路217-1到217-n构成，其被划分成多个组(m个)。 所述组的数目不特别受到限制；然而，具体来说可以有4个或8个组。另外，所划分的每一个组的各保持电路(其构成保持电路部分217)与具有固定延迟量的延迟电路Mal到Mam相连，从而使得输入控制信号所经过的具有固定延迟量的延迟电路Mal到Mam的数目根据每一个组而不同。结果，可以对于每一个组的每一个保持电路将所述控制信号延迟预定的延迟时间段。对于每一个组，构成保持电路部分217的保持电路217-1到217_n在所述控制信号被延迟了为每一个组设定的预定延迟时间段之后变为激活(例如H电平)的定时下检索并保留存储在对应的锁存电路216-1到216-n中的数据。保留在保持电路217-1到217_n中的数据被改变成D/A转换器218-1到218-n中的数字数据输入。所述控制信号被从定时控制器214输出并且通过信号线被输入到控制信号输入端子224，随后所述控制信号通过具有可变延迟量的延迟电路220和具有固定延迟量的延迟电路Mal到Mam被输入到每一个组的保持电路部分217 (保持电路217-1到217_k)。 因此，所述控制信号在延迟电路220和延迟电路Mal到Mam中被延迟预定时间，并且随后被输入到每一个组的保持电路部分217(保持电路217-1到217-k)。因此，关于从定时控制器214输出所述控制信号的定时，每一个组的保持电路部分217(保持电路217-1到217_k) 的数据检索定时被延迟的量是在具有可变延迟量的延迟电路220中被延迟的时间与在具有固定延迟量的延迟电路Mal到Mam当中的预定数目(该数目对应于每一个组)的延迟电路中被延迟的时间的总和。另外，D/A转换器218-1到218-n基于上面所描述的数字数据选择并输出从参考电压校正电路221输入的ρ种类型的分级电压的其中之一。这种D/A转换器218-1到218-n的细节例如在日本特许公开公布No. 2003-130921中进行了描述，因此将省略对其的解释。输出缓冲器219-1到219-n对从相应的D/A转换器218-1到218_n输出的分级电压执行阻抗转换。所述分级电压被从输出缓冲器219-1到219-n输出到液晶显示面板201， 以作为来自相应的信号输出端子230-1到230-n的分级数据(驱动数据)。另外，在具有可变延迟量的延迟电路220中，由计数器231对从外部输入到控制输入端子的信号进行计数，以及根据计数数目在延迟元件De处延迟所述控制信号并且将其输入到保持电路部分217。在这一阶段，经过开关233-0的控制信号被从输出节点输出而没有延迟。经过开关233-1的控制信号通过一个延迟元件De被输出。经过开关233-2的控制信号通过三个延迟元件De被输出。经过开关233-3的控制信号通过六个延迟元件De 被输出。因此，通过把一个水平同步时间段定义为IH并且把一个延迟元件De的延迟时间段定义为α，则有被输入到保持电路部分217的四种类型的信号周期，比如ΙΗ+α、1Η+2α、 1Η+3α和1Η_6α，如图4中所示。结果，所述控制信号的频率被分散，并且所述数据加载定时对于每一个组是不同的，从而进一步减少不必要的辐射。在实施例4中，由数据驱动器中的延迟电路延迟从定时控制器输出的控制信号， 以便利用多个周期生成定时以作为所述控制信号的加载定时，并且分散在驱动电路中生成的驱动信号的各频率分量。然而，如实施例2中所述，在延迟电路被提供于定时控制器中的情况下还可以使用一种其中在数据驱动器中没有延迟的方法，并且通过对控制信号LOAD (输入)进行延迟处理，可以生成其脉冲上升定时关于通过恒定周期确定的固定定时而发生改变的信号以作为控制信号LOAD (输出)，并且进一步从定时控制器输出经过这种延迟处理的控制信号。
在实施例4中描述了这样的配置所述数据驱动器中的锁存电路216-1到216_n、 保持电路217-1到217-n、D/A转换器218-1到218-n以及输出缓冲器219-1到219-n都被划分成组；然而，所述数据驱动器也可以具有其中仅保持电路217-1到217-n被划分成组的结构。(实施例5)。图13是示出根据本发明的实施例5的驱动电路(数据驱动器)的框图。根据实施例5的驱动电路是通过以下方式获得的利用图12中所示的基于所述控制信号的计数数目来改变延迟量的延迟电路来替代具有固定延迟量的延迟电路，其中所述固定延迟量对应于根据实施例4的数据驱动器中的每一个组。配置的剩余部分与根据实施例4的数据驱动器的配置的剩余部分完全相同。除了实施例4中的效果之外，具有这种配置的根据实施例5的数据驱动器还可以实现以下效果对于每一个组，更加精确地改变控制信号的延迟量。在实施例4和5中，在通过将一个数据驱动器中的各个电路进行分组而获得的多个组之间，用于将显示数据加载到液晶显示面板的定时是不同的。然而，也有可能在多个数据驱动器之间不同地设定用于将显示数据加载到液晶显示面板的定时。因此，在多个驱动电路(数据驱动器)之间偏移显示数据的加载定时从而减少不必要的辐射，因此可以进一步减少整个显示设备中不必要的辐射。在实施例5中描述了通过利用图12中所示的具有可变延迟量的延迟电路替代具有固定延迟量的延迟电路而获得的驱动电路，其中所述固定延迟量对应于根据实施例4的数据驱动器中的每一个组。然而，也可以通过利用如图9中所示的使用了移位寄存器的、具有可变延迟量的延迟电路来替代具有对应于根据实施例4的数据驱动器中的每一个组的固定延迟量的延迟电路。另外，包括如在实施例1到5中所描述的驱动电路的液晶显示装置可以被用作电子信息设备(比如蜂窝电话设备、个人计算机、以及电视机)的显示装置。如上所述，通过使用其优选实施例例示了本发明。然而，不应当仅仅基于上面描述的实施例来解释本发明。应当理解的是，应当仅仅基于权利要求书来解释本发明的范围。还应当理解的是，基于对本发明的描述以及来自本发明的详细优选实施例的描述的常识，本领域技术人员可以实施等效的技术范围。此外还应当理解的是，在本说明书中所引用的任何专利、任何专利申请以及任何参考文献应当按照与在其中内容被具体描述的相同方式通过引用被结合在本说明书中。工业适用性。本发明可以被应用在驱动电路、液晶显示装置和电子信息设备的领域内。根据本发明，有可能提供一种能够减少不必要的辐射的驱动电路，这是通过对于每一个水平同步时间段或者对于每多个水平同步时间段改变所述驱动电路的输出定时以分散频率而实现的；一种配备有这种驱动电路的液晶显示装置；以及一种包括这种液晶显示装置的电子信息设备。在不偏离本发明的范围和精神的情况下，各种其他修改对于本领域技术人员而言将是显而易见的，并且可以被本领域技术人员容易地作出。相应地，附于此的权利要求书的范围不打算限于在此所做的描述，而是应当广泛地解释权利要求书。
权利要求
1.一种用于基于显示数据和控制信号来驱动显示装置的驱动电路，包括 用于延迟输入控制信号的延迟电路；以及用于在由所述经过延迟的控制信号生成的定时下将输入显示数据加载到所述显示装置的数据加载部分，其中，所述延迟电路延迟所述控制信号，从而使得将所述显示数据加载到所述显示装置的加载定时根据由恒定周期确定的固定定时而发生改变。
2.根据权利要求1的驱动电路，其中，所述输入控制信号是用于在所述恒定周期下生成所述固定定时的信号，并且所述延迟电路重复对于所述控制信号的延迟处理，其中在所述加载定时的延迟时间段的极限内，每当经过所述恒定周期的整数倍，就把所述加载定时从所述固定定时延迟给定的延迟时间段。
3.根据权利要求2的驱动电路，其中，所述显示数据和所述控制信号被包括在提供给所述显示装置的视频信号中，并且所述恒定周期是基于所述视频信号的水平同步时间段。
4.根据权利要求1的驱动电路，其中，所述延迟电路包括用于对由所述输入控制信号生成的固定定时进行计数的计数电路；以及用于对所述计数电路的计数输出进行译码的译码器，其中，所述控制信号的延迟量是基于所述译码器的输出而确定的。
5.根据权利要求4的驱动电路，其中，所述延迟电路包括 串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述译码器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。
6.根据权利要求1的驱动电路，其中，所述延迟电路包括用于基于由所述输入控制信号生成的固定定时来执行移位操作的移位寄存器； 串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述移位寄存器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。
7.根据权利要求3的驱动电路，包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器； 用于驱动所述液晶显示面板的多条扫描线的扫描驱动器；以及用于基于输入视频信号生成被提供给所述数据驱动器的显示数据以及生成作为控制信号被提供给所述数据驱动器的数据控制信号和被提供给所述扫描驱动器的扫描控制信号的定时控制器， 其中所述延迟电路构成所述数据驱动器；并且所述延迟电路延迟输入到所述数据驱动器的控制信号，从而使得将所述显示数据从所述数据驱动器输出到所述液晶显示面板的数据线的定时根据固定定时对于每一条水平扫描线而发生改变，其中所述固定定时是基于水平同步信号而确定的。
8.根据权利要求3的驱动电路，包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器； 用于驱动所述液晶显示面板的多条扫描线的扫描驱动器；以及用于基于输入视频信号生成被提供给所述数据驱动器的显示数据以及生成作为控制信号被提供给所述数据驱动器的数据控制信号和被提供给所述扫描驱动器的扫描控制信号的定时控制器， 其中所述延迟电路构成所述定时控制器；并且所述延迟电路延迟由所述定时控制器基于所述视频信号而生成的控制信号，从而使得将所述显示数据从所述数据驱动器输出到所述液晶显示面板的数据线的定时根据固定定时对于每一条水平扫描线而发生改变，其中所述固定定时是基于水平同步信号而确定的。
9.根据权利要求1的驱动电路，包括用于驱动作为所述显示装置的液晶显示面板的多条数据线的数据驱动器，其中所述延迟电路构成所述数据驱动器，用于延迟在所述数据驱动器中输入的控制信号；并且所述数据驱动器包括为所述液晶显示面板的每一条数据线提供的多个组当中的多个驱动器电路，用于驱动对应的数据线，所述多个驱动器电路被分组成多个组；以及用于延迟被提供给每一个组中的各驱动器电路的控制信号的信号延迟部分，从而使得相同组中的驱动器电路在相同定时下将显示数据提供到数据线，并且不同组中的驱动器电路在不同定时下将显示数据提供到数据线。
10.根据权利要求9的驱动电路，其中所述信号延迟部分包括串联连接在多级上的多个延迟部分； 第一级中的延迟部分延迟从所述延迟电路输出的控制信号；并且第二级和后面各级中的延迟部分延迟从前一级中的延迟部分输出的控制信号。
11.根据权利要求10的驱动电路，其中，构成所述信号延迟部分的各延迟部分分别将输入控制信号延迟预定量。
12.根据权利要求10的驱动电路，其中，所述多个延迟部分包括用于对由所述输入控制信号生成的固定周期的定时进行计数的计数电路；以及用于对所述计数电路的计数输出进行译码的译码器， 以及所述控制信号的延迟量是基于所述译码器的输出而确定的。
13.根据权利要求12的驱动电路，其中，所述多个延迟部分包括 串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述译码器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。
14.根据权利要求10的驱动电路，其中，所述多个延迟部分包括用于基于由所述输入控制信号生成的固定周期定时来执行移位操作的移位寄存器； 串联连接的多个延迟元件；以及用于切换所述控制信号的信号路径的多个开关，从而基于所述移位寄存器的输出，由所述多个延迟元件当中的给定数目的串联连接的延迟元件来延迟所述控制信号。
15.一种包括液晶显示面板的液晶显示装置，用于基于视频信号来在所述液晶显示面板上显示图像，所述液晶显示装置还包括用于基于所述视频信号来驱动所述液晶显示面板的驱动装置，其中所述驱动装置包括根据权利要求1到14中的任一项所述的驱动电路。
16. 一种包括液晶显示装置的电子信息设备，其中所述液晶显示装置是根据权利要求 15所述的液晶显示装置。
全文摘要
本发明公开了驱动电路、液晶显示装置和电子信息设备。根据本发明的一种基于显示数据和控制信号来驱动显示装置的驱动电路包括用于延迟输入控制信号的延迟电路；以及用于在由所述经过延迟的控制信号生成的定时下将输入显示数据加载到所述显示装置的数据加载部分。其中，所述延迟电路延迟所述控制信号，从而使得将所述显示数据加载到所述显示装置的加载定时根据由恒定周期确定的固定定时而发生改变。
文档编号G09G3/36GK102298916SQ201110171248
公开日2011年12月28日 申请日期2011年6月23日 优先权日2010年6月23日
发明者小林胜敏, 铃木贵光 申请人:夏普株式会社