专利名称：使用低能离子注入形成半导体器件的浅阱的方法
技术领域：
本发明涉及制造半导体器件的方法，更具体涉及形成高度集成的半导体器件的阱的方法。
背景技术：
半导体器件的阱用来传送体电压到实际工作的金属氧化物半导体(MOS)器件和消除由于碰撞电离形成的载流子。为了让阱执行这些功能，应该通过在阱离子注入工序过程中注入大量杂质保持低电阻。具体，低阱电阻在如闭锁这种问题的测试可靠性中起着重要作用。因此，使用高能离子注入形成深阱，以便保持低电阻。但是，高能离子注入导致相邻阱之间的余量减小。
另一方面，当半导体器件变得高度集成时，栅极长度和有源区的宽度水平地按比例减小。但是，阱结构在垂直方向上的比例减小相对小于水平方向的比例减小。这些导致相邻阱之间的余量严重不足，因此限制芯片尺寸的进一步减小。
当使用常规的高能离子注入形成浅阱时，在器件驱动操作过程中，电阻的增加引起故障，例如闭锁。此外，众所周知单元阵列区中的阱的深度与软件错误率(SER)紧密相关。
发明内容
本发明提供一种形成具有低电阻的阱的方法，其中通过阱区的垂直比例缩小在相邻阱之间获得大的余量。
根据本发明的一个方面，提供一种使用低能离子注入形成具有低电阻的阱的方法。使用低能离子注入形成阱的方法可以使由杂质扩展引起的阱余量减小最小化和由厚光刻胶图形的收缩引起的阱余量减小最小化。
根据本发明的另一方面，为了形成一个理想的阱结构，阱应该尽可能的浅，且其电阻类似于高能、高剂量阱。由此，在半导体衬底中形成隔离沟槽。然后，通过执行低能、高剂量离子注入，在沟槽下或沟槽的底部形成高浓度阱。接下来，通过用绝缘层填充沟槽在高浓度阱上形成绝缘层。最后，通过在半导体衬底上执行低能离子注入，形成低浓度阱至与高浓度阱的上部部分地重叠的深度。
根据本发明的一个实施例，在半导体衬底上形成焊盘氮化物层图形，以及通过使用焊盘氮化物层图形作为刻蚀掩模刻蚀半导体衬底，在半导体衬底中形成隔离沟槽。接下来，在沟槽的内壁上形成隔片氮化物层，通过使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，执行低能、高剂量离子注入，在沟槽下或沟槽的底部形成高浓度阱。接下来，通过用绝缘材料覆盖高浓度阱形成填充沟槽的绝缘层，平面化绝缘材料的上表面，除去焊盘氮化物层图形。接着，通过在半导体衬底整个表面上执行低能离子注入，形成低浓度阱至与高浓度阱的上部部分地重叠的深度。包括高浓度阱和低浓度阱的整个阱的深度大约与沟槽绝缘层的深度相同，因此该阱可以称为浅阱。具体，高浓度阱形成在绝缘层之下。根据上述实施例，通过阱区的垂直比例减小可以在相邻的阱之间获得大的余量，可以减小阱电阻。
在本发明的另一个实施例中，形成互补金属氧化物半导体(CMOS)阱。为此，在分为PMOS和NMOS区的半导体衬底上形成焊盘氮化物层图形。然后，通过使用焊盘氮化物层图形作为刻蚀掩模，刻蚀半导体衬底，在第一和第二区中形成隔离沟槽。接下来，在沟槽的内壁上形成隔片氮化物层。然后，形成露出仅仅NMOS区的第一光刻胶图形，使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，执行低能、高剂量离子注入，由此在NMOS区的沟槽下或沟槽底部形成P+阱。然后，除去第一光刻胶图形，形成仅仅露出PMOS区的第二光刻胶图形，使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，执行低能、高剂量离子注入，由此在PMOS区的沟槽下或沟槽底部形成N+阱。然后，除去第二光刻胶图形，用绝缘材料覆盖P+阱和N+阱，平面化绝缘材料的上表面，除去焊盘氮化物层图形，由此形成填充沟槽的绝缘层。然后，形成仅仅露出NMOS区的第三光刻胶图形，在半导体衬底上执行低能离子注入，由此形成P阱至与P+阱的上部部分地重叠的深度。然后，除去第三光刻胶图形，形成仅仅露出PMOS区的第四光刻胶图形，在半导体衬底上执行低能离子注入，由此形成N阱至与P+阱的上部部分地重叠的深度。最后除去第四光刻胶图形。根据本实施例，执行低能离子注入，因此第一至第四光刻胶图形可以形成足够薄，以获得大的阱余量。
通过参考附图，详细描述其优选实施例，将使本发明的上述方面及其优点更清楚，其中图1至6是说明根据本发明形成浅阱的方法的实施例的剖面图；以及图7至13是说明根据本发明形成浅阱的方法的另一实施例的剖面图。
具体实施例方式
下面参考附图更完全地描述本发明，附图中示出了本发明的优选实施例。但是，本发明可以以许多不同的形式体现，不应该认为局限于在此阐述的实施例。相反，提供本实施例是为了使本公开是彻底的和完全的，且将本发明的范围完全表达给本领域的技术人员。在图中，为了清楚，放大了元件的形状。在整个附图中同样的参考数字指相同的元件。
图1至6是说明根据本发明形成浅阱的方法的实施例的剖面图。
参考图1，在半导体衬底100上形成焊盘氮化物层图形110。然后使用焊盘氮化物层图形110作为蚀刻掩模，蚀刻半导体衬底100至约2500至约3000的厚度，由此在其中形成浅隔离沟槽120。如果需要，可以使用热氧化在焊盘氮化物层图形110和半导体衬底100之间形成缓冲氧化物层(未示出)。
转向图2，在沟槽120的内壁和底部上形成约50至约100厚的里衬(liner)氧化物层130。通过热氧化半导体衬底100，形成里衬氧化物层130，半导体衬底100中形成沟槽120。通过热氧化，修复沟槽120的形成过程中对半导体衬底100的蚀刻损坏。接着，在沟槽120的内壁上形成隔片氮化物层140。具体，在形成里衬氧化物层130的半导体衬底100上淀积约50至约200厚的氮化物层，然后各向异性地蚀刻氮化物层，直到沟槽120的底部露出。
参考图3，通过在图2的所得结构上执行低能、高剂量离子注入150，在沟槽120下或在沟槽120的底部形成高浓度阱160。在此情况下，使用焊盘氮化物层图形110和隔片氮化物层140作为离子注入掩模，因此仅仅穿过沟槽120的底部执行离子注入。用能级约10至30keV和约1×1015至5×1015ions/cm2剂量的杂质执行低能、高剂量离子注入150。
参考图4，用绝缘材料165填充沟槽120。例如，使用中温氧化(MTO)形成的氧化物层、不掺杂的硅玻璃(USG)、或通过高密度等离子体化学气相淀积(HDP CVD)或其适当的结合可以用作绝缘材料165。
然后，如图5所示，平整图4的所得结构的顶面，由此露出焊盘氮化物层图形110。然后除去焊盘氮化物层图形110，由此露出半导体衬底100的顶面。因此，在隔离沟槽120中形成绝缘层170。可以使用化学机械抛光(CMP)工艺平整图4的所得结构的顶面，其中焊盘氮化物层图形110用作平面化终点。众所周知，可以使用磷酸剥离除去剩余的焊盘氮化物层图形110。如果在CMP工艺过程中除去大量的焊盘氮化物层图形110，则减小了绝缘层170和半导体衬底100之间的台阶。如果形成缓冲氧化物层，如参考图1所述，那么在除去焊盘氮化物层图形110之后，使用氢氟酸(HF)溶液也可以除去缓冲氧化物层。通常，绝缘层170相对于半导体衬底100略微地向上突出。但是，在图5中，为了简化起见，未图示出绝缘层170和半导体衬底100之间的台阶。
参考图6，在包括绝缘层170的半导体衬底100上执行低能离子、低剂量注入180，由此在半导体衬底100中形成低浓度阱190至与高浓度阱160的上部部分地重叠的深度D。换句话说，形成低浓度阱190至沟槽120的底部。根据低能、低剂量离子注入180，将具有约20至30keV能级、约1×1012至约1×1013ions/cm2剂量的杂质注入所得结构。为了形成低浓度阱190，杂质应该从半导体衬底100的表面基本上注入绝缘层170的深度。因此，优选以能级高于形成高浓度阱160的能级执行离子注入，以形成低浓度阱190。优选，包括高浓度阱160和低浓度阱190的整个阱的深度与绝缘层170的深度几乎相同。
在上述实施例中，使用低能、高剂量离子注入工艺形成阱区至沟槽绝缘层170的深度。结果，精确地控制具有低电阻的浅阱的形成。通过阱区的垂直比例减小，可以在相邻的阱之间获得大的余量，以及可以减小阱电阻。
图7至13说明根据本发明形成浅阱的方法的另一实施例的剖面图。在本实施例中，形成互补金属氧化物半导体(CMOS)阱。当半导体集成电路(IC)的工作速度增加和半导体IC变得高度集成时，每个芯片的功耗大大地增加。同样地，对低功耗CMOS器件的要求继续增加，因此几乎所有的IC都制成为CMOS器件。CMOS器件除低功耗之外还具有宽的工作范围和大的噪声余量的优点。
参考图7，首先，半导体衬底200分为NMOS区(a)和PMOS区(b)。使用形成在半导体衬底200上的焊盘氮化物层图形210作为刻蚀掩模，刻蚀半导体衬底200至约2500至约3000厚，由此在半导体衬底200的NMOS区(a)和PMOS区(b)中形成浅隔离沟槽220。然后，在沟槽220的内壁和底部上形成里衬(liner)氧化物层230，以及形成隔片氮化物层240，覆盖沟槽220的内壁。
参考图8，在包括焊盘氮化物层图形21O的衬底200上形成仅仅露出NMOS区(a)的第一光刻胶图形245，然后使用焊盘氮化物层图形210和隔片氮化物层240作为离子注入掩模，在其上执行低能、高剂量离子注入250。由此，在NMOS区(a)的沟槽220下或沟槽220的底部形成P+阱260。在此情况下，可以使用BF2作为杂质源。在本实施例中，低能意味着能级约10至约30keV，高剂量意味着约1×1015至5×1015ions/cm2的剂量。由于执行低能离子注入，因此可以很薄地形成第一光刻胶图形245，例如，约1至约1.5μm厚。考虑到常规光刻胶图形的厚度是约2.5至3μm，应当理解第一光刻胶图形245足够薄，以获得大的阱余量。
然后，除去第一光刻胶图形245，形成仅仅露出PMOS区(b)的第二光刻胶图形247，使用焊盘氮化物层图形210和隔片氮化物层240作为离子注入掩模，执行低能、高剂量离子注入252，在PMOS区(b)的沟槽220下或沟槽220的底部形成N+阱262，如图9所示。在此情况下，可以使用AsH3作为杂质源。也可以很薄地形成第二光刻胶图形247，例如，约1至约1.5μm厚。
参考图10，除去第二光刻胶图形247，用绝缘材料265覆盖P+阱260和N+阱262，平面化绝缘材料265的顶面，除去焊盘氮化物层图形210，由此形成填充沟槽220的绝缘层270。
然后，形成仅仅露出NMOS区(a)的第三光刻胶图形275，使用杂质源，例如BF2在包括绝缘层270的半导体衬底200上执行低能、低剂量离子注入280，由此在半导体衬底200的NMOS区(a)中形成P阱290至与P+阱260的上部部分重叠的深度，如图11所示。换句话说，P阱290形成至沟槽220的底部。在本实施例中，用能级20至30keV和约1×1012至1×1013ions/cm2剂量的杂质执行低能、低剂量离子注入280。因为执行低能离子注入，所以也可以很薄地形成第三光刻胶图形275，例如，约1至1.5μm的厚度。
参考图12，除去第三光刻胶图形275，形成仅仅露出PMOS区(b)的第四光刻胶图形277。接着，在包括绝缘层270的半导体衬底200的表面上执行低能离子注入282，由此在半导体衬底200的PMOS区(b)形成N阱292至与N+阱262的上部部分重叠的深度。换句话说，形成N阱292至沟槽220的深度。具有本实施例中，使用具有能级约20至30keV和约1×1012至1×1012ions/cm2剂量的杂质执行低能离子、低剂量离子注入282。由于执行低能离子注入，也可以很薄地形成第四光刻胶图形277，例如，约1至1.5μm厚。如图12所示，包括N+阱262和N阱292的浅N阱的深度与沟槽绝缘层270的深度几乎相同。同样，包括P+阱260和P阱290的浅P阱的深度与沟槽绝缘层270的深度几乎相同。
参考图13，通过除去第四光刻胶图形277完成形成阱的工艺。根据本实施例，在半导体衬底200上形成随后的CMOS器件，半导体衬底200上形成阱。例如，在各个NMOS区(a)和PMOS区(b)形成包括栅绝缘层310a和310b以及栅电极320a和320b的栅极，然后执行离子注入，形成源/漏区330a和330b。在源/漏区330a和330b上形成层间介质(ILD)膜(未示出)。然后形成穿过ILD膜并接触每个源/漏区330a和330b的接触栓塞340。
用本发明的实施例，可以精确控制具有低电阻浅阱的形成。根据本发明的实施例的浅阱具有以下效果。
首先，阱电阻减小为现有技术的阱电阻的70％至90％。触发电压增加和保持电压减小。由此，抑制闭锁。而且，随着阱电阻减小，易于减小用于阱偏置的接触数目。由此，可以稳定阱偏置。
第二，因为使用低能离子注入，因此可以减小离子注入工序过程中对半导体衬底的损坏。同样地，如果在根据本发明的阱中形成存储器件，例如DRAM，那么可以增强存储器件的数据保持时间性能，亦即，刷新时间性能。
第三，因为执行低能离子注入，因此如果需要掩模，那么光刻胶图形的厚度可以形成足够地薄。在现有技术中，掩模光刻胶图形是2.5至3μm厚，导致相邻阱之间的余量减小。相反，在本发明的一个方面中，可以很薄地形成光刻胶图形，例如，约1至1.5μm厚。因而，可以增加相邻阱之间的余量。因此，本发明可以有利地应用于器件的高集成度。
第四，包括高浓度阱和低浓度阱的整个浅阱的深度与绝缘层的深度几乎相同，形成为约2500至约3000的深度。由于阱的深度不大，因此可以提高SER性能。
尽管参考其优选实施例已经具体展示和描述了本发明，但是本领域的普通技术人员应当理解，在不脱离附加权利要求所限定的本发明的精神和范围的情况下，可以在形式上和细节上进行各种改变，。
权利要求
1.一种形成阱的方法，该方法包括在半导体衬底中形成隔离沟槽；有选择地执行低能、高剂量离子注入，穿过沟槽的底部，由此在沟槽下形成高浓度阱；用绝缘层填充沟槽，由此在高浓度阱中形成绝缘层；以及在包括绝缘层的半导体衬底上执行低能离子、低剂量注入，由此在半导体衬底中形成低浓度阱至与高浓度阱的上部部分地重叠的深度。
2.如权利要求1的方法，其中隔离沟槽具有约2500至约3000的深度。
3.如权利要求1的方法，其中以能级约10至30keV和约1×1015至5×1015ions/cm2的剂量执行低能、高剂量离子注入。
4.如权利要求1的方法，其中用能级约20至30keV和约1×1012至1×1013ions/cm2剂量的杂质执行低能、低剂量离子注入。
5.如权利要求1的方法，其中低浓度阱形成至沟槽的底部。
6.如权利要求1的方法，其中低浓度阱和高浓度阱的总深度与绝缘层的深度几乎相同。
7.一种形成阱的方法，该方法包括在半导体衬底上形成焊盘氮化物层图形；使用焊盘氮化物层图形作为刻蚀掩模，刻蚀半导体衬底，由此在半导体衬底中形成隔离沟槽；在沟槽的内壁上形成隔片氮化物层；使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，有选择地执行低能、高剂量离子注入，由此在沟槽下形成高浓度阱；用绝缘材料填充沟槽，由此覆盖高浓度阱；平面化绝缘材料，以在沟槽中形成绝缘层，并且除去焊盘氮化物层图形；以及在包括绝缘层的半导体衬底上执行低能离子、低剂量注入，由此在半导体衬底中形成低浓度阱至与高浓度阱的上部部分地重叠的深度。
8.如权利要求7的方法，其中隔离沟槽具有约2500至约3000的深度。
9.如权利要求7的方法，其中用能级约10至30keV和约1×1015至5×1015ions/cm2剂量的杂质执行低能、高剂量离子注入。
10.如权利要求7的方法，其中用能级为20至30keV和1×1012至1×1013ions/cm2剂量的杂质执行低能、低剂量离子注入。
11.如权利要求7的方法，在沟槽的内壁上形成隔片氮化物层之前，还包括在沟槽的内壁和底部上形成里衬氧化物层。
12.一种形成阱的方法，该方法包括在具有第一和第二区的半导体衬底上形成焊盘氮化物层图形；使用焊盘氮化物层图形作为刻蚀掩模，刻蚀半导体衬底，由此在第一和第二区中形成隔离沟槽；在沟槽的内壁上形成隔片氮化物层；在所得的结构上形成第一光刻胶图形，仅仅露出第二区，以及使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，执行低能、高剂量离子注入，由此在第二区中的沟槽底部形成第一导电类型的高浓度阱；除去第一光刻胶图形，形成仅仅露出第一区的第二光刻胶图形，使用焊盘氮化物层图形和隔片氮化物层作为离子注入掩模，执行低能、高剂量离子注入，由此在第一区中的沟槽底部形成第二导电类型的高浓度阱，第二导电类型不同于第一导电类型；除去第二光刻胶图形，用绝缘材料覆盖第一导电类型的高浓度阱和第二导电类型的高浓度阱，平面化绝缘材料的顶面，并且除去焊盘氮化物层图形，由此形成绝缘层以填充沟槽；形成仅仅露出第二区的第三光刻胶图形，在包括绝缘层的半导体衬底上执行低能、低剂量离子注入，由此在第二区中形成第一导电类型的低浓度阱至与第一导电类型的高浓度阱的上部部分地重叠的深度；除去第三光刻胶图形，形成仅仅露出第一区的第四光刻胶图形，在包括绝缘层的半导体衬底上执行低能、低剂量离子注入；以及除去第四光刻胶图形，由此在第一区中形成第二导电类型的低浓度阱至与第二导电类型的高浓度阱的上部部分地重叠的深度。
13.如权利要求12的方法，其中隔离沟槽具有约2500至约3000的深度。
14.如权利要求12的方法，其中用能级约为10至30keV和约1×1015至5×1015ions/cm2剂量的杂质执行低能、高剂量离子注入。
15.如权利要求12的方法，其中用能级约为20至30keV和约1×1012至1×1013ions/cm2剂量的杂质执行低能、低剂量离子注入。
16.如权利要求12的方法，在沟槽的内壁形成隔片氮化物层之前，还包括在沟槽的内壁和底部上形成里衬氧化物层。
17.如权利要求12的方法，其中第一至第四光刻胶图形形成至约1至1.5μm的厚度，以在相邻阱之间获得充分的余量。
全文摘要
提供一种使用低能离子注入形成半导体器件的浅阱的方法。在一个实施例中，使用低能、高剂量离子注入工艺形成阱区至沟槽隔离层的深度。
文档编号H01L21/761GK1485895SQ0313286
公开日2004年3月31日 申请日期2003年7月24日 优先权日2002年7月24日
发明者李宰圭 申请人:三星电子株式会社