专利名称：平衡双电阻器串数模转换器系统和方法
优先权本申请要求于2004年11月12日提交的美国临时专利申请No.60/627,577的优先权。
背景技术：
本发明一般涉及数模转换器(DAC)，尤其涉及适于集成电路制造的电阻器串DAC。
如本领域中所众所周知的，DAC已被用于各种各样的应用中以将N位数字字转换成相应的模拟信号。一个这样的DAC包括具有基本相同电阻、串联在基准电压两端的2N个电阻器的串。因此，该电阻器串将该基准电压分压到该串的电阻器中。提供了用于将电阻器之一上的电压耦合至输出以便产生经转换电压的开关网络。尽管这样的DAC适于N相对较小的应用，但当N较大时，例如N约为12，则需要4096个电阻器、4096个开关以及4096条控制线，从而导致要在集成电路芯片上制造相对较大数目的元件。
减少元件数目的一种技术是使用分段转换器。在分段转换器中，第一级使用用于转换N位数字字高位组的电阻器串，第二级对其余的低位组解码。Gryzbowski等人在Electronic Engineering 1971中第48-51页的题为“Non-linear Functions fromD/A Converter(来自D/A转换器的非线性函数)”一文中示出一种该一般类型的非线性转换器。本文中公开的转换器被设计成与继电器开关一起操作而不能容易地适于现代半导体技术。另一分段转换器在美国专利No.3,997,892中描述，它公开了包括用于第一和第二级两者的电阻器串、以及各级之间防止第二级电阻器串加载第一电阻器串的缓冲放大器的分段转换器。
在美国专利No.4,338,591中描述了另一类型的分段转换器，该文献公开了其中电阻器串用于第一级，R-2RDAC用于第二级，且缓冲放大器在第一与第二级之间使用以便减少第二级对第一级加载的影响。在第一电阻器串中电阻器的所选之一两端产生的电压通过缓冲放大器馈送到第二电阻器串两端。
在美国专利No.5,495,245中描述了第三种类型的分段DAC。其中所描述的DAC包括通过第一开关网络耦合至第二电阻器串的一对第一级电阻器串。一对基准电压被耦合至这一对电阻器串。第一开关网络操作使得这一对第一级电阻器串之一中电阻器的所选之一上产生的电压与这一对第一电阻器串的另一个电阻器串中电阻器的所选之一上产生的电压被耦合到第二级电阻器串两端。第二开关网络将第二电阻器串中电阻器的所选之一上的输出耦合至DAC的输出。缓冲放大器未被包括在这一对第一级电阻器串与第二级电阻器串之间。描述了两种配置。在一种配置中，第一开关网络对MSB作出响应，而第二开关网络对LSB作出响应。在另一种配置中，第一开关网络对LSB作出响应，而第二开关网络对MSB作出响应。在前一种配置中，这一对电阻器串中的每一电阻器都具有值2NR，其中R是第二电阻器串中2N/2个电阻器中每一个的电阻。在后一配置中，第二电阻器串中的每一电阻器都具有值2mR，其中R是这一对第一电阻器串中每一电阻器的电阻。在这两种配置中，在这一对基准电压之间流动的总电流流过电阻器。因此，尽管这样的配置在众多应用中有用，但第一和第二对电阻器串均需要相对较大数目的电阻器，从而对其制造需要相对较大的芯片表面积。
第四种技术涉及提供如美国专利No.5,696,657中所公开的一对电阻器串。电阻器串中的第一个适于耦合到电压源两端。第一电阻器串中的电阻器响应于从电压源向其馈送的电流产生电压。第二电阻器串具有在一对第二电阻器串输入端之间串联耦合、电阻基本上相等的m个电阻器，其中m是奇数。第一开关网络具有连接至第二电阻器串输入端的一对开关输出端。第一开关网络适于将第一串中电阻器的所选之一的端子耦合至这一对开关输出端。第二电阻器串中的电阻器响应于通过第一开关网络在第一电阻器串与第二电阻器串之间流过的电流产生电压。第二开关网络适于将第二电阻器串中电阻器的所选之一的端子上产生的电压的所选之一耦合至转换器的输出。第二电阻器串两端的电阻值大于第一电阻器串中电阻的所选之一的电阻值。当第一开关网络从将所选第一电阻器之一耦合至这一对输出端切换成将依次串联地耦合至所选第一电阻器的第一电阻器之一耦合至其输出端时，所述第二串的电阻值和第一开关网络的电阻值可被选择成在转换器输出处产生基本上一个LSP的步进变化，其中LSB是由转换器转换的数字字的最低有效位。
例如，
图1示出包括第一电阻器串14和第二电阻器串16的双电阻器串DAC。如图所示，第一电阻器串14被耦合至输入节点10和12，且包括电阻器20、22、24和26。第二电阻器串16包括电阻器28、30和32，它们可经由开关网络34切换成与电阻器20-26中的任一个并联连接。
然而，在某些应用中，需要提供接收相同数字输入信息、并响应于输入数字信号信息提供给定中等大小电压附近的平衡的正负DAC输出的DAC。此外，当如Shabra的CICC 2004会议中所述DAC用作其中使用了数字信号的符号大小编码的系统内的子DAC时，需要正确响应于符号位值中的改变和主DAC值中的改变的平衡DAC。
因此，需要一种经济且有效的方法，用来响应于输入数字信号产生平衡的正负DAC输出，使得它们可用于子DAC和主DAC配置。
发明概述本发明提供用于接收输入信号和指示输入信号的符号的符号位信号的数模转换器系统。该数模转换器系统包括第一和第二对电阻器串，以及第一和第二开关网络。第一对电阻器串中的第一串适于在第一电压电势与中间节点之间耦合。第一开关网络适于将在第一串中电阻器的所选之一两端产生的电压耦合到这些电阻器串中的第二串上。第二电阻器串中的电阻器响应于通过第一开关网络从第一电阻器串流向第二电阻器串的电流产生电压。第二对电阻器串中的第三串适于在第二电压电势与中间节点之间耦合。第二开关网络适于将第三串中电阻器的所选之一两端产生的电压耦合到这些电阻器串中的第四串上。第四电阻器串中的电阻器响应于通过第二开关网络从第三电阻器串流向第四电阻器串的电流产生电压。
附图简述参考附图可进一步地理解以下描述，在附图中图1示出根据现有技术的电阻器串DAC的说明性简图；图2示出根据本发明一实施例的平衡电阻器串DAC的说明性简图；图3示出根据本发明另一实施例的平衡电阻器串DAC的说明性简图；图4示出根据本发明又一实施例的平衡电阻器串DAC的说明性简图；以及图5示出图4的平衡电阻器串DAC的一部分的说明性简图。
附图仅为说明性目的示出。
所示实施例的详细描述如图2中所示，可根据本发明一实施例形成一平衡DAC，它包括第一电阻器串46以及位于串46的中心任一侧的两个分开的第二电阻器串48和50。第一电阻器串的第一部分被耦合至输入节点40和42，并包括电阻器52、54、56和58。电阻器串46的第二部分被耦合至输入节点42和44，且包括电阻器64、66、68和70。两个第二电阻器串中的第一串包括电阻器72、74和76，且可经由开关网络84与电阻器52、54、56和58中的任一个并联耦合。该两个第二电阻器串中的第二串包括电阻器78、80和82，且可经由开关网络86与电阻器64、66、68和70中的任一个并联耦合。
电路实际上允许两个电阻器串DAC彼此串联放置，且取决于符号位从中间向Vref或接地电位寻址。然而，可能产生的一个问题在于，由于电阻器76与60之间以及电阻器78与62之间的开关中所固有的电阻(Rsw)，0的编码可能有偏移量。开关也可包括固有电容(Csw)。另一问题在于，结束码比全标度小一个LSB。这些问题可能对某些应用提出限制。
具体地，如图3中所示，分两部分示出与图2中所示的类似电路，其中第一电阻器串的第一个一半包括电阻器90、92、94和96，而第一电阻器串的第二个一半包括电阻器98、100、102和104。两个第二电阻器串中的第一串包括电阻器106、108和110，且可经由开关118耦合至电阻器90、92、94或96中的任一个。两个第二电阻器串中的第二串包括电阻器112、114和116，且可经由开关120耦合至电阻器98、100、102或104中的任一个。约为Rsw的附加的小电阻122可置于第一电阻器串中的电阻器90与98之间。当进行对连接的改变以便将第二串中电阻器的任一个放置成与第一串中电阻器的任一个并联时电势改变，使得电压将下降约1LSB。这由如图3中124处的箭头概略地示出。在特定实现中，第一电阻器串的第一个一半可包括16个MSB电阻器，而每个第二电阻器串可包括7个LSB电阻器。
图4示出本发明的另一实施例，它包括包含电阻器130、132、134和136的第一电阻器串的第一个一半，而该第一电阻器串的第二个一半包括电阻器138、140、142和144。两个第二电阻器串中的第一串包括电阻器146、148和150，且可经由开关162耦合至电阻器130、132、134或136中的任一个。这两个第二电阻器串中的第二串包括电阻器152、154和156，且可经由开关164耦合至电阻器138、140、142或144中的任一个。该系统也包括在电阻器130与138之间的小电阻器168，以及在电阻器136与接地之间的电阻器158、和在电阻器144与正电压源之间的电阻器160。此外，该电路允许如166处所示在开关162和第一电阻器串的与这一对第二电阻器中的第二个相关联的部分的下端之间存在交叉。在开关164和第一电阻器串的与这一对第二电阻器中的第一个相关联的部分的上端之间也存在交义。
在图5中更清楚地示出了该交叉，其中电阻器(Rlsb)170被耦合至第一电阻器串的电阻器(Rmsb)174的一侧，而来自第二电阻器串的电阻器(Rlsb)176被耦合至第一电阻器串的电阻器(Rmsb)172。第一电阻器串也可包括如图所示的附加电阻器(Rmsb)178和(Rmsb)180，且可包括如图所示的中间电阻器(Rmid)184。根据一实施例，通过电阻器184(Rmid)的电流为Imid，Imid可被设置为Imsb/14。从电阻器(Rlsb)通过开关(RSW)的电流可为Ilsb，且通过相关联开关(RSW)流向电阻器176的电流也可为Ilsb。为了使电阻器(Rlsb)170的底部以及电阻器176的顶部之间的点处于相同电势，2RSWIlsb必须等于RmidImsb。这意味着Rmid必须等于RSW/7。电阻器Rmid可通过使用并联的61/2闭合开关的等效方式实现。这对编码0问题的偏移应是正确的。
对于最小进位问题，如果Rlsb＝2Rmsb，则RSW逼近0。在这种情况下，在给定MSB节点下的连接使得该节点的电压下降1.14LSB，因为Rmsb‖7Rmsb＝Rmsb‖14Rmsb＝Rmsb(1-1.14×1/16)。对于最大进位问题，如果电阻器158和160(Rend)中每一个的值各自约为1/2LSB，则Rend＝2Rlsb/14＝RSW/14。当Rmsb＝385Ω时，RSW＝165Ω，而Rend＝43Ω。这可使用并联的11个Rmsb单元来实现。
因此，本发明的系统可提供平衡的阻抗。因为它馈送开关电容器，电阻器DAC的每一端应对给定编码提供相同的阻抗。开关被定标(分为5组)成使RSW＝165Ω，且CSW＝50fF。尺寸从1.2v开关得到，为20/0.24。观察DAC输出，当对编码x连接以及全标度连接时，电阻器DAC体系结构本身提供相同的阻抗，只要接地与Vref阻抗也匹配。对于调整，观察单个输出8Rmsb＝3k.，可了解最大电阻，且采样开关电阻等于2k max)5/0.24)。当绝对最大电容为16ns/6/5k＝53fF时，单个电容器可以为额定117fF、最大140ff，且三个RDAC开关可为150fF，留下200fF以上用于路由和出错。
本领域的技术人员将理解可对上述实施例进行各种修改和变化，而不背离本发明的精神和范围。
权利要求
1.一种用于接收输入信号和指示所述输入信号的符号的符号位信号的数模转换器系统，所述数模转换器系统包括第一对电阻器串，所述第一对电阻器串中的第一串适于在第一电压电势与中间节点之间耦合；第一开关网络，适于将在所述第一串中电阻器的所选之一两端产生的电压耦合到所述这些电阻器串中的第二串上，所述第二电阻器串中的电阻器响应于通过所述第一开关网络从所述第一电阻器串流向所述第二电阻器串的电流产生电压；第二对电阻器串，所述第二对电阻器串中的第三串适于在第二电压电势与所述中间节点之间耦合；以及第二开关网络，适于将所述第三串中电阻器的所选之一两端产生的电压耦合到所述这些电阻器串中的第四串上，所述第四电阻器串中的电阻器响应于通过所述第二开关网络从所述第三电阻器串流向所述第四电阻器串的电流产生电压。
2.如权利要求1所述的数模转换器，其特征在于，所述第一和第二开关网络各自响应于所述数字输入的最高有效位。
3.如权利要求1所述的数模转换器，其特征在于，所述第一对电阻器串包括第三开关网络，适于将在所述第一串中所选的第二个电阻器两端产生的电压耦合到所述这些电阻器串中第二串上，所述第二电阻器串中的电阻器响应于通过所述第三开关网络从所述第一电阻器串流向所述第二电阻器串的电流产生电压。
4.如权利要求1所述的数模转换器，其特征在于，所述第二对电阻器串包括第四开关网络，适于将在所述第三串中所选的第二个电阻器两端产生的电压耦合到所述这些电阻器串中第四串上，所述第四电阻器串中的电阻器响应于通过所述第四开关网络从所述第三电阻器串流向所述第四电阻器串的电流产生电压。
5.如权利要求1所述的数模转换器，其特征在于，所述数模转换器对任何输入编码提供平衡的阻抗。
6.如权利要求1所述的数模转换器，其特征在于，所述中间节点为中心节点。
7.一种用于接收输入信号和指示所述输入信号的符号的符号位信号的数模转换器系统，所述数模转换器系统包括第一对电阻器串，所述第一对电阻器串中的第一串适于在第一电压电势与中心节点之间耦合，所述第一电阻器串中的电阻器响应于从电压源向其馈送的电流产生电压，且所述这些电阻器串中的第二串仅包括2n+1个电阻器，其中n是正整数，所述第二串中的每一电阻器具有一对端子；第一开关网络，适于将所述第一串中电阻器的所选之一两端产生的电压耦合到所述这些电阻器串中的第二串上，所述第二电阻器串中的电阻器响应于通过所述第一开关网络从所述第一电阻器串流向所述第二电阻器串的电流产生电压；第二对电阻器串，所述第二对电阻器串中的第三串适于在第二电压电势与中心节点之间耦合，所述第三电阻器串中的电阻器响应于从所述电压源向其馈送的电流产生电压，所述这些电阻器串中的第四串仅包括2n+1个电阻器，其中n是正整数，所述第四串中的每一电阻器具有一对端子；以及第二开关网络，适于将所述第三串中电阻器的所选之一两端产生的电压耦合到所述电阻器串中的第四串上，所述第四电阻器串中的电阻器响应于通过所述第二开关网络从所述第三电阻器串流向所述第四电阻器串的电流产生电压；其中所述第二电阻器串上的电阻值大于所述第一电阻器串中所选之一的电阻值，且所述第三电阻器串上的电阻值大于所述第三电阻器串中所选之一的电阻值。
8.如权利要求7所述的数模转换器，其特征在于，所述第一和第二开关网络各自响应于所述数字输入的最高有效位。
9.如权利要求7所述的数模转换器，其特征在于，所述第一对电阻器串包括第三开关网络，适于将所述第一串中所选的第二个电阻器两端产生的电压耦合到所述这些电阻器串中的第二串上，所述第二电阻器串中的电阻器响应于通过所述第三开关网络从所述第一电阻器串流向所述第二电阻器串的电流产生电压。
10.如权利要求7所述的数模转换器，其特征在于，所述第二对电阻器串包括第四开关网络，适于将在所述第三串中所选的第二个电阻器两端产生的电压耦合到所述这些电阻器串中的第四串上，所述第四电阻器串中的电阻器响应于通过所述第四开关网络从所述第三电阻器串流向所述第四电阻器串的电流产生电压。
11.如权利要求7所述的数模转换器，其特征在于，所述数模转换器对任何输入编码提供平衡的阻抗。
12.如权利要求7所述的数模转换器，其特征在于，所述中间节点为中心节点。
全文摘要
公开了一种用于接收输入信号以及指示该输入信号的符号的符号位信号的数模转换器系统。该数模转换器系统包括第一和第二对电阻器串，以及第一和第二开关网络。第一对电阻器串中的第一串适于在第一电压电势与中间节点之间耦合。第一开关网络适于将在第一串中电阻器的所选之一两端产生的电压耦合到这些电阻器串中的第二串上。第二电阻器串中的电阻器产生通过第一开关网络从第一电阻器串流向第二电阻器串的电流。第二对电阻器串中的第三串适于在第二电压电势与该中间节点之间耦合。第二开关网络适于将第三串中电阻器的所选之一两端产生的电压耦合到这些电阻器串中的第四串上。第四电阻器串中的电阻器响应于通过第二开关网络从第三电阻器串流向第四电阻器串的电流产生电压。
文档编号H03M1/62GK101057407SQ200580038736
公开日2007年10月17日 申请日期2005年11月10日 优先权日2004年11月12日
发明者X·奥雷尔, P·小弗格森 申请人:模拟设备股份有限公司