用于存取双向存储器的方法和装置的制作方法

专利名称：用于存取双向存储器的方法和装置的制作方法
技术领域：
本发明涉及存取双向存储器设备。
背景技术：
随着电子存储器接近一些极限，超出该极限其将不再能够产生如在摩尔定律中 著名地阐述的密度/成本/性能改善，大量的存储器技术正被研究作为常规硅互补金属氧 化物半导体(CMOS)集成电路存储器的潜在代替物。在被研究的存储器技术当中是许多双向存储器技术利用用于编程或读存储器 设备的材料的方向特性的存储器。即，常规存储器设备典型地例如将两个存储器状态 (memory state)之一与电荷的存在或不存在或者与高(high)或低(low)电压相关联。在诸 如这样的常规存储器中，存储器状态与单向特性相关联；电荷要么存在要么不存在(例 如，DRAM、FLASH (闪存))或者节点保持在高或低电压(例如，SRAM)。这种储存 机构的“方向”没有意义。相比而言，双向存储器采用其存储器材料的某种方向方面来 存储二进制信息。例如，可以通过在一个方向上强制电流通过双向存储器设备或者施加 一种极性的电压来写一个存储器状态，并且可以通过在相反方向上强制电流通过相同设 备或者施加相反极性的电压来写另一个存储器状态。然后，例如可以通过向存储器设备 施加任一电压以测量与存储器状态有关的电流或者强制电流通过并测量与存储器状态有 关的电压，来感测编程的存储器状态。双向存储器类型包括电阻(resistive)随机存取存储器和磁阻随机存取存储器(两 者都被称为RRAM)、可编程金属化单元、磷族元素化物(Pnictide)相变存储器、聚合物 存储器、铁电随机存取存储器(FeRAM)、离子存储器设备以及金属纳米颗粒存储单元 (memorycell)。RRAM单元可以通过向单元施加相反极性的电脉冲而被分别编程为高电阻和 低电阻值。单元的高和低电阻值被用来表示两个不同的存储器状态。RRAM存储 器是已知的并且例如被描述在由W.W.Zhuang等人在2002 International Electron Device Meeting (IEDM)上提出的题为 “Novell Colossal Magnetoresistive Thin Film Nonvolatile ResistanceRandomAccess Memory(RRAM)"的论文中，该论文由此并入以供参考。可编程金属化单元利用在固体电解质的薄膜中纳米级数量的金属的电化学控 制。经由通过固体电解质中金属的氧化和金属离子的还原所引起的电变化来存储信息。 这样的电变化可以通过对单元施加小电偏置来诱导。反向偏置(reverse bias)将使氧化 反转直到电沉积或电镀的金属已经被去除，从而使单元返回到原始的存储器状态。可编 程金属化单元是已知的并且例如被讨论在Michael N.Kozicki等人的题为‘‘Non-Volatile Memory Based on Solid Electrolytes,‘‘的论文中、在 Christina Schindler 等人在 IEEE Transactions on Electron Devices54 2762—2768 中的题为"Bipolar and Unipolar Resistive Switching inCu-Doped SiO2 〃 的文章中、以及在 Michael N.Kozicki 等人的〃 Programmable Metallization Cell Memory Based on Ag-Ge-S andCu—Ge—S Solid Electrolytes “中(可从Institute of Electrical andElectronics Engineers (电气和电子工程师协会)获得),这些论文
由此并入以供参考。聚合物存储器展现涉及当对单元施加足够幅度的偏置电压时导电率增加的电 双稳态。单元可以通过对设备施加相反极性的偏置电压而返回到低导电率状态。聚 合物存储器是已知的并且例如被描述在由American Institute of Physics在2006年公开 的 Ankita Prakash 等人的“Polymer Memory Device Based on Conjugated Polymer and GoldNanoparticles"中，该论文由此并入以供参考。铁电随机存取存储器(FeRAM)采用铁电电容器来存储数据。一种极性的 电压脉冲用来把单元编程为一个存储器状态并且可以采用相反极性的电压脉冲来把该 单元编程为另一个存储器状态。FeRAM是已知的并且例如被描述在The Proceedings ofthe IEEE, Vol.88, No.5, May 2000 中公开的 AliSheikholeslami 等人的〃 A Survey of CircuitInnovations in Ferroelectric Random-Access Memories“中，该论文由此并入以供参 考。双向存储单元可以被布置成矩形阵列，其中各个存储单元位于行(row)和列 (column)地址线的交点处，其中一条线放置在另一个条之上。通过断言(assert)唯一限 定阵列内单元位置的行地址线和列地址线，存取(即从中读取或写到)各个单元。或者， 对于更大的带宽，一个以上列可以被并行选择到一条行线上，其中每条列线具有单独的 读和写电路。尽管各个单元可以通过行和列地址线对的断言来唯一寻址——因为多个存 储单元共享行地址线并且多个单元共享列地址线(单元不共享行和列地址线)，但是多个 单元可以通过行或列地址线的断言而被“部分”选择。即，如果例如存储单元通过提高其列地址线的电压并降低其行地址线的电压来 选择，则共享所选择的列地址线的所有单元将使其列地址线的电压提高并且共享所选择 的行地址线的所有单元将使其行地址线的电压降低，并且在这种意义上这些非选择的单 元将被部分地选择。这样的部分选择造成无意存取除了目标存储单元之外的一个或多个存储单元的 风险。这样的无意存取可能通过非法的读或写操作(有时表征为误读或误写)而损害存 储器数据的有效性。电流泄露通路可能加重无意存取的风险。这样的部分选择、泄露通 路以及无意单元存取的伴随风险可以例如通过在每个单元位置处采用一对晶体管来唯一 存取每个存储单元而被基本消除。然而，在每个存储单元处这种选择晶体管的添加造成 以增加存储单元面积的形式的显著缺点。提供对阵列中唯一选择的存储单元的双向写存 取且还防止双向存储单元的无意存取而不显著提高这种存储单元的面积的方法和装置因 此是高度期望的。

发明内容
依据本发明原理的双向存储单元包括双向阈值设备(诸如双向阈值开关(ovonic threshold switch, OTS))和双向存储元件。与存储元件串联的双向阈值设备隔离双向存 储元件与周围电路，并从而对于读或写而言防止对存储元件的无意存取。可以与存储元 件串联插入一个以上OTS以诸如通过使用接近Vh的较低电压来获得更大的隔离电压或减 小的骤回(snap-back)并且通过使用串联的一个以上来获得充足的总电压。
双向存储元件包括利用用于形成存储器设备的材料的方向特性的存储元件。例 如，可以通过在一个方向上强制电流通过双向存储单元来写一个存储器状态并且可以通 过在相反方向上强制电流通过相同单元来写另一个存储器状态。可选地，例如，一个极 性的电压可以施加到存储单元以把单元编程为一个存储器状态，并且可以通过向相同单 元施加相反极性的电压来编程另一个存储器状态。然后，例如可以通过施加电压并感测 电流或者强制电流通过该单元并测量电压来感测编程的存储器状态。依据本发明的原 理，诸如OTS之类的双向阈值设备提供双向存储单元内的电路隔离，从而防止双向存储 器设备的无意存取。依据本发明的原理，包括双向存储器和OTS的双向存储单元可以布置成矩形阵 列，其中各个存储单元位于行和列地址线的交点处。通过断言唯一限定阵列内单元位置 的行地址线和列地址线，存取(即从中读取或写到)各个单元。这样的阵列可以包括双 极(在正向和反向施加的)电流和/或电压源，其被配置成施加为把双向单元编程为不同 存储器状态所需的电流和/或电压。依据本发明原理的双向存储器阵列也可以包括双向 开关，其实现任一极性的存取电压和/或电流到存储器阵列内的单元的施加。依据本发 明的原理，可以与每个双向存储单元串联插入诸如OTS之类的双向阈值设备。双向阈值 设备(OTS)可以被如此设置，并且偏置电压在幅度和序列上被布置，以确保不允许对未 选择的存储单元的无意存取。依据本发明原理的双向存储器可以尤其适合于各种电子设备中的操作，包括蜂 窝电话、射频识别设备(RFID)、计算机(便携式和其他)、定位设备(例如，全球定位系 统(GPS)设备、尤其那些存储和更新位置特定信息的设备)以及手持电子设备(包括个 人数字助理(PDA)和娱乐设备，例如诸如MP3播放器)。


图1是依据本发明原理的双向存储单元的概念性框图；图2是依据本发明原理的双向存储器阵列的概念性框图；图3是依据本发明原理的双向存储器阵列的更详细框图；图4A到4D是依据本发明原理的双向存储器的说明性操作的时序图；图5是依据本发明原理的说明性双向存储单元的透视图；以及图6是包括依据本发明原理的双向存储器阵列的电子系统的概念性框图。
具体实施例方式尽管将按照某些优选实施例来描述本发明，但是对本领域普通技术人员显而易 见的其他实施例(包括没有提供本文所阐述的所有优点和特征的实施例)也在本发明的范 围内。在不偏离本发明精神或范围的情况下可以进行各种结构、逻辑、过程步骤、化学 和电学变化。设备和电源(supply)的极性和类型可以以对本领域的一位合理技术人员会 显而易见的方式被替代。例如，场效应晶体管(FET)可以替代双极结型晶体管(BJT)， η沟道设备可以替代ρ沟道设备，ηρη设备可以替代ρηρ设备，例如所有都是利用电源电 压和偏置的适当调节。尽管本文将按照OTS给出说明性实施例的描述，但是其他电子双 向阈值设备被预期并且落入本发明的范围内。
为描述清楚和简明起见，以下详细描述中的示例说明性实施例可能关注于响应 于施加相反极性的信号而展现电阻变化的双向存储器，但是依据本发明原理的方法和设 备可以应用于采用其他属性来区分存储器状态的单向或双向存储器。因而，本发明的范 围仅参考所附的权利要求进行限定。一种双向存储单元选择设备即双向阈值开关(OTS)非常适合用作依据本发明 原理的单向或双向存储单元中的双向阈值设备。OTS设备利用硫族化物材料的特性 来提供电信号的切换。硫族化物设备的早期研究表明电切换行为，其中在施加处于或 大于活性(active)硫族化物材料的阈值电压的电压或者施加处于或大于活性硫族化物 材料的阈值电流的电流时诱导从“断开(off)”电阻状态到“导通(ση)”传导状态的 切换。这种效应是OTS的基础并且仍然是硫族化物材料的重要实际特征。OTS以快 速切换速度提供可重复切换。例如在美国专利号3,271,591 ； 5,543,737 ； 5,694,146和 5,757,446(其公开内容由此并入以供参考)中以及在包括S.R.Ovshinsky的“Reversible ElectricalSwitching Phenomena in Disordered Structures, ” Physical ReviewLetters，vol.21, p.1450—1453 (1969)、 S.R.Ovshinsky 禾口 H.Fritzsche 的"Amorphous Semiconductors for Switching, Memory, and ImagingAppiications, ” IEEE Transactions on Electron Devices, vol.ED-20, p.91-105(1973)(其由此并入以供参考)的若干期刊文章中提出OTS的基本 原理和操作特征。三端OTS设备例如被公开在美国专利号6,969,867和6,967,344中，其 由此并入以供参考。如本领域的一位合理技术人员将显而易见的，三端OTS设备可以被 用作2端OTS的可选方案进行单向或双向读和/或写(例如，连接到电源，其导通/断 开由连接到第三端子的行线确定，其中电源连接到较高电压以在一个方向上写而连接到 更负电源以在相反方向上写)。

被称为硫族化物或硫族化物材料的、周期表的第VI族元素(诸如Te、S或Se) 的合金可以被有利地用于阈值切换设备。研究了各种各样的硫族化物组分以企图优化硫族化物设备的性能特性。硫族化 物材料一般包括硫族元素以及一种或多种化学或结构改性元素(modifying element)。硫 族元素(例如Te、Se、S)从周期表的第VI列中进行选择而改性元素可以例如从周期 表的第III列(例如Ga、Al、In)、第IV列(例如Si、Ge、Sn)或第V列(例如P、 As、Sb)中进行选择。改性元素的作用包括提供在包括硫族元素的链之间的分支或交 联点。第IV列改性剂(modifier)可以用作四配位(tetracoordinate)改性剂，其包括硫族 链(chalcogenide chain)内的两个配位(coordinate)位置和允许远离硫族链的分支或交联 的两个配位位置。第III和V列改性剂可以用作三配位改性剂，其包括硫族链内的两个 配位位置和允许远离硫族链的分支或交联的一个配位位置。依据本发明原理的实施例可 以包括二元、三元、四元以及更高阶硫族化物合金。硫族化物材料的示例被描述在美国 专利号 5,166,758，5,296,716，5,414,271，5,359,205，5,341,328，5,536,947，5,534,712， 5,687,112和5,825,046中，所述专利的公开内容全部并入本文以供参考。硫族化物材料也 可以是反应溅射过程的产物例如硫族化物氮化物或氧化物，并且硫族化物可以通过离 子注入或其他过程进行改性。在图1的概念性框图中，依据本发明原理的双向写存储单元100包括与双向存储 元件104串联连接的OTS 102。针对单向写存储单元的使用对本领域的合理技术人员将是显而易见的。一个或多个OTS 102在第一端子106耦合到第一电源SUPPLY1而在第二端 子108耦合到双向存储元件104的第一端子110。这里，双向指的是存储元件的写；然 而，也可以在任一或两个方向上读某些存储器。双向存储元件通过第二端子112耦合到 第二电源SUPPLY2。依据本发明的原理，电源SUPPLY1和SUPPLY2可以通过诸如译码电路之类的 电路并且在电路的控制下耦合到存储单元100的相应端子，这将在与图2和3有关的讨论 中进行更详细的描述。电源SUPPLY1和SUPPLY2可以被配置为电流源或电压源并且可 以包括电流源和电压源两者。另外，为了满足双向存储元件104的需求，每个电源SUPPLY1和SUPPLY2是双
向的。即，每个电源可以有“正”或“负”电压(极性是常规问题)或者每个电源可 以供应或吸收电流。在不同的实施例中，可以通过把各种正元件(例如对应于正电压或 供应电流)和负元件(例如对应于负电压或吸收电流)切换到电源电路中或从电源电路中 切换出各种正元件来实施电源的双向方面。图2的概念性框图提供依据本发明原理的双向阵列的概览。例如使用对本领域 的合理技术人员已知的技术，这个阵列可以用作嵌入式存储器电路中的存储器阵列或者 现场可编程阵列。双向存储器阵列200包括以交叉点阵列布置的多个双向存储单元202。 每个单元202包括如在与图1有关的讨论中所描述的串联连接的双向存储元件和OTS。 两个电源SUPPLY1和SUPPLY2被配置为提供正负电压和/或电流到阵列200内的选择单 元202。如在与图3的讨论有关的描述中将更详细描述的，电源SUPPLY1和SUPPLY2 中的一者或两者可以包括针对特定存储器操作的部件。例如，电源可以包括用于从存储 单元读取和向存储单元写入的以不同水平设定的特定电流源。选择电路201和203操作 以在由电源SUPPLY1和SUPPLY2分别提供的不同电源极性之间进行选择。依据本发明的原理，在任何给定的存取操作(READ(读)操作、WRITE(写)0 操作或WRITE 1操作)期间，选择电路201和203典型地选择相反极性的电源。即，在 WRITE 1操作期间，例如选择电路203可以选择正电源而选择电路201选择负电源以便在 适于把逻辑“1”写到选择的存储单元的方向上使电流通过存储单元。在WRITEO操作 期间，选择电路203然后可以选择负电源而选择电路201选择正电源，从而在与WRITEl 操作所要求的方向相反的方向上提供通过选择的存储单元的电流流动。选择电路201和 203使其选择基于包括如下的输入信号ADDRESS (地址)，READ, WRITEO和WRITE 1信号。在说明性实施例中，选择电路包括双向开关，诸如开关204、206、208和210。 双向开关204、206、208和210用来选择行线和列线，其组合地选择阵列200内的各个存 储单元。采用双向开关来适应存储单元202内的存储元件的双向性质。图3的示意图提供依据本发明原理的双向存储器阵列的说明性实施例的更详细 视图。在这个说明性实施例中，交叉点存储器阵列300包括如先前所描述的由相应行线 和列线的断言所选择的双向存储单元(例如，单元2，2由第2列和第2行线的断言进行 选择)。在这个说明性实施例中，Supplyl包括READ、WRITE 1和WRITE 0电路。 READ电路包括一对串联连接的ρ沟道FET 302和304，其在302的源极连接到正电源电 压V+并且通过FET 304的漏极连接到共同电源输出，该共同电源输出选择性地耦合到馈 给阵列300的所有列线。在这个说明性实施例中，ρ沟道FET 304的栅极由带隙调整器(bandgap regulator)产生的被调整电压信号VREGP进行控制，其为ρ沟道FET 304供应稳
定的温度补偿的控制电压。ρ沟道FET 302的栅极由READ信号控制。当促使READ信 号相对于电源电压V+为低时，在ρ沟道FET 304的漏极和电源电压V+之间建立低电阻 通路。每当READ信号以此方式接通ρ沟道FET 302时，通过FET 304的电流由在FET 304的栅极处的电压VREGP控制。类似地，WRITE 1电路包括一对串联连接的ρ沟道FET 306和308，其在一端连 接到正电源电压V+并且在另一端通过FET 308的漏极连接到共同电源输出，该共同电源 输出选择性地耦合到馈给阵列300的所有列线。在这个说明性实施例中，ρ沟道FET 308的栅极由带隙调整器产生的被调整电压 信号VREGP进行控制，其为ρ沟道FET 308供应稳定的温度补偿的控制电压。ρ沟道 FET 306的栅极由WRITEl信号控制。当促使WRITEl相对于电源电压V+为低时，在ρ 沟道FET 308的漏极和电源电压V+之间建立低电阻通路。每当WRITEl信号以此方式接 通ρ沟道FET 306时，通过FET 308的电流由在FET 308的栅极处的电压VREGP控制。 因为对READ和WRITE 1操作的电流要求可能不同(例如，为把存储元件写成低电阻状 态所需的电流可能大于为读相同存储元件所需的电流)，所以用于产生WRITE脉冲的ρ 沟道FET 308可能大于用于产生READ脉冲的ρ沟道FET 304，从而在相同的VREGP栅 极电压下提供更大的电流。在这个说明性实施例中，WRITEO操作的极性与READ和WRITEl操作的极性相 反。即，在这个示例中，Read电流极性可以与Writel相同。于是，为了读阵列300中的 存储单元之一的内容或者把逻辑“1”写到这样的单元中，电流在一个方向上流动，而为 了把逻辑“0”写到这样的单元中，电流在相反方向上流动。在这个实施例中，WRITEO 电路包括一对串联连接的η沟道FET 310和312，其在一端通过FET 310的源极连接到负 电源电压V-，在另一端通过FET312的漏极连接到共同电源节点，该共同电源节点选择 性地耦合到从阵列300中选择的列线，从而耦合相反极性电流到选择的存储单元进行写 O0η沟道FET 312的栅极由带隙调整器产生的被调整电压信号VREGN进行控制， 其为η沟道FET 312供应稳定的温度补偿的控制电压。η沟道FET 310的栅极由WRITEO 信号控制。当促使WRITEO相对于电源电压V-为高时，在η沟道FET 312的源极和电 源电压V-之间建立低电阻通路。每当WRITEO信号以此方式接通η沟道FET 310时， 通过FET 312的电流振幅由施加到FET 312的栅极的电压VREG N控制。如先前指出的，在这个说明性实施例中，READ、WRITEl禾Π WRITEO电路的 输出可以联结到列线的共同节点；或者不止一组可以单独驱动列线之一或子集(因此 更多列线并行有效(active)，因而提高带宽)。除了确定要执行的功能以及由控制信号 READ、WRITEl和WRITEO实施的电源的选择，每个列线可以具有由地址译码电路支配 的控 制输入。即，列线由源自由地址线驱动的译码器的译码信号输入进行选择。在图3 的说明性实施例中，译码电路314接收地址线ADDRESS并且基于在地址线ADDRESS上 呈现的地址信号生成列选择控制信号CS1、CS2、…、CSn。列选择信号CS1、CS2、…、 CSn控制提供对对应列线的存取的相应双向开关BISW1、BISW2、…、BISWn。以此方 式，READ、WRITEl和WRITEO信号确定存取信号的幅度和极性并且地址线ADDRESS确定哪些列线将接收存取信号。在这个说明性实施例中，双向开关BISW1、BISW2、...BISWn被实施为CMOS
模拟开关。CMOS模拟开关在本领域中是已知的。因为它们采用ρ沟道和η沟道FET 二 者，所以CMOS模拟开关可以提供相对低电阻信号通路，而不管横跨它们强加的信号的 极性或电压。即，当“ON(导通)”时，ρ沟道和η沟道设备彼此补充以便在η沟道设 备的电阻由于横跨设备的信号电压的变化而增加时ρ沟道设备的电阻降低，反之亦然。 对于较低性能和更有限的电压范围，可以使用单个η或ρ沟道设备来代替并联的说明性ρ 沟道和η沟道设备。一个或多个读出放大器(sense amplifier) SENSEAMP可以耦合到列线的共同节
点。在信号(包括READ和CLOCK (时钟)信号)的控制下，读出放大器SENSEAMP 在读操作期间感测和调节所存取存储单元的内容。来自读出放大器SENSEAMP的输出可 以例如被暂时存储在缓冲器BUFFER中。在本发明的范围内预期其他读出放大器配置。在这个说明性实施例中，每个行线连接到ρ沟道316、328、332和η沟道318、 330、334FET，其根据是否选择相应行以及是否执行READ、WRITEO或WRITEl操作而 相应地耦合行线到正或负电源。对于η沟道330、334和ρ沟道328、332FET断开时，相 应的行线可能“漂浮(float) ”。依据本发明的原理，例如行线可以被预充电到诸如V+/2 之类的电压。在这个说明性实施例中，行线和列线在信号PRECHARGE(预充电)的控 制下通过η沟道FET耦合到V+/2。另外，行线每当未被选择时可以被强制到诸如V+/2 之类的中间电压。在说明性实施例中，可以给每行和每列添加进一步驱动器，该进一步驱动器在 每行和每列未被选择时将其强制到V/2。这样的驱动器可以是N-FET，其中漏极到诸如 V/2 (V++V-/2)之类的电压而源极到行(或列)。栅极从译码器进行控制并且每当行(或 列)相应未被选择时为高。在说明性实施例中，译码电路314接收包括如下的信号ADDRESS，DATA(数 据)，READ, WRITE, CLOCK和ENABLE (使能)。译码电路314采用这些信号来产 生控制信号，包括 READ，WRITEO, WRITEl, PRECHARGE, RPl...RPn, RNl...RNn 以及CSl...CSn，其如先前所描述的那样被采用和分发给阵列。S卩，例如信号RPl-n控制 ρ沟道FET的栅极，ρ沟道FET与在其栅极由信号RNl-n控制的η沟道FET组合产生行 选择信号Rowl-n。信号CSl-n控制产生列选择信号COLl-n的模拟穿透式多路复用器 开关(analog pass-through muxswitch)。PRECHARGE 信号控制串联连接的 FET，其通过 端子PRECOLl-n和PREROWl-n把行线和列线联结到预充电电压(在这个说明性实施例 中为V/2)。通过使用示例，可以更好地理解在这个说明性实施例中READ和WRITE操作的 双向性质。在这个说明性实施例中，当译码器314把WRITE、ADDRESS和DATA信号解 析为把“1”写到存储单元CELLl，1(即，由断言第1行和第1列两者的组合所唯一寻址 的存储单元)的指令时，WRITEl信号被断言(WRITE 1相对于V+被驱动到“低”)， CS 1被断言(相对于V+被驱动到“低”)以允许由WRITEl产生的脉冲(按照惯例在 本文中被称为“正”脉冲)把适当的写电流从V+传送到列线COL1。另外，ROWl信 号被断言(通过把Rnl和RPl 二者驱动到“高”，ROWl信号被驱动“低”至V_进行写1操作)。另一方面，为了把“O”写到存储单元CELL1，1中，WRITE O信号被断 言(WRITE O相对于V-被驱动到“高”)，CSl被断言(相对于V+被驱动到“低”) 以允许由WRITEO产生的负脉冲传送到列线COLl，并且ROWl信号被断言。S卩，通过 把Rnl和RPl 二者驱动到“低”，ROWl被驱动“高”至V+进行写O操作。

图4A-4D的时序图说明了存取(即读、写逻辑“1”和写逻辑“O” )依据本发 明原理的双向存储单元的过程。在这个说明性实施例中，储存器单元的双向性质表现在 如下要求使用正电流脉冲(如先前所指出的，术语“正”和“负”术语是常规问题) 来写逻辑“1”，导致相对高电阻值；使用负电流脉冲来写逻辑“O”，导致相对低电阻 值。读操作也采用正电流脉冲，但是根据与OTS选择设备一起使用的存储器技术以及其 在单元内相对于本文描述的示例电路的定向而可以是负电流脉冲。如在与图3有关的讨论中所描述的，且如在图4A-4D的时序图中所指示的，当 不存取相关存储单元时，把行和列选择信号维持在中间电压(在这个说明性实施例中为 V/2)以进一步防止对阵列300内的单元的无意存取。S卩，当在给定行ROWn上没有单元 要被选择时，相应行译码输出RPn和RNn两者可以是“断开”(如同其相应ρ沟道316 和η沟道318FET—样)并且可以由预充电电路使对应的行线ROWn处于中间值，诸如 V/2，如在与图3有关的描述中更详细描述的(例如，RPn、RNn和CSn断开，允许诸如 在终止循环的预充电期间由生成PRECOLn和PREROWn的预充电电路把行线和列线驱动 到V/2)。把行线和列线维持在中间电压也限制了操作期间电压摆动的幅度，从而允许更 快、噪声减小的操作以及减小的电流消耗——从而减小功耗并且在便携式应用中提高在 充电之间可以操作设备的时间。另外，对于处于相同电压的行和列，(未选择的)行和 列之间的泄露被减小，进一步改善电池寿命。在另一个说明性实施例中，未选择的行可 以处于V/3(当写O时)或者2V/3(当读或写1时)，从而导致裕度的改善以防假选择。图4A的时序图描绘了依据本发明原理的读操作，其中被读的双向存储单元(例 如CELL 1，1)处于高电阻、逻辑“O” RESET (复位)状态。在时间tO，行1选择信号ROWl和列1选择信号COLl两者如同阵列300内的所 有行信号和列信号一样都处于“预充电”电压V/2。在这个示例性示例中，在时间tl通 过把与存储单元CELL 1，1相关联的列线COLl驱动到高(用电流源朝V+驱动)并且把 与存储单元CELL 1，1相关联的行线ROWl驱动到低(到OV)，来启动读过程。在这个 示例性示例中，列线COLl被通过在时间tO断言READ信号和模拟开关控制信号CSl而 生成的电流脉冲充电到正电压。即，通过分别断言行1和列1选择信号ROWl和C0L1， 在时间tl存取阵列300内的存储单元CELLl，1。如在与图3有关的讨论中更详细描述的，读信号READ在这个说明性实施例中通 过把ρ沟道FET 302的栅极驱动到“低”电压(在这个说明性示例中为OV)而被断言， 从而给列存取电路提供正脉冲(其幅度由VREGP调整)。通过激活(或不激活)对应的 双向开关(例如，开关208)，由此产生的脉冲被门控——即被允许传送(或被阻挡)—— 到适当列。在这个说明性示例中，双向开关控制信号CSl通过把信号驱动到“低”电压 V-而被断言。列选择信号COLl因此在这个说明性实施例中是(通过激活READp沟道FET 302而生成的)电流脉冲，其被允许通过双向模拟开关208传送到列线，该列线连接到阵列300的列1中所有存储单元的列输入。行选择信号ROWl如在与图3有关的讨论中更 详细描述的那样由地址译码电路314生成，地址译码电路314采用ADDRESS，READ, WRITE和DATA输入来生成行(RPl和Rnl)控制信号。因为在这个说明性实施例中存 储单元的极性或双向性质通过要求在相反方向上驱动电流通过设备以写“1”或“0”来 表现，所以译码的行输出RPn和RNn生成行控制信号ROWn，其被配置为根据要执行的 存取(READ、WRITEO或WRITE1)操作的类型而吸收或供应电流。然后在时间Tl，通过驱动RNl到高并从而接通η沟道FET RNl (RPl维持高并 且ρ沟道FET 316 “断开”)，行线ROWl被驱动低至V-(在这个说明性实施例中为 OV)；列线COL被电流脉冲充电，该电流脉冲是通过驱动READ信号到低(接通ρ沟道 FET 302)并且通过驱动CSl到低来接通双向模拟开关208而生成的。在这个说明性实施 例中，用来驱动行线到低的η沟道FET (例如，η沟道FET 318)由低导通电阻(Ron)表 征并且因此能够快速驱动行线到0V。另一方面，列线由具有由栅极电压VREGP确定的 振幅的电流源充电，并因此列线COLn充电比行线ROWn放电更加缓慢，如分别由图4A 的渐升和陡降曲线所指示的。在这个说明性实施例中，ρ沟道FET 304的大小被选择成 确保对于施加的栅极电压VREGp，通过其的电流不能在READ操作期间干扰阵列300内 的任何存储单元的存储器状态。如本领域的技术人员将会明白的，如果用电压源更好地 读(或写)存储单元技术，则读或写电流源(具有电压顺从性(compliance))可以由电压 (具有电流顺从性或内部电阻)替代。横跨存储单元CELL 1，1的电压Vcell是列和行电压之间的差。如果如在这个 示例中那样存储元件处于高电阻状态，则通过“接地”行线ROWl和对列线COLl电流 受限充电的组合而施加到存储单元的电压Vcell将分布在串联连接的OTS 102和双向存储 元件104的两端。对于第一近似，电压的分布将与OTS 102和存储元件104的电阻成比 例。如果它们的电阻相等，电压将被相等地分布；如果例如设备之一(OTS或存储元件) 展现总串联电阻的三分之一，则三分之一电压将落在其两端，等等。在这个说明性实施 例中，存储器处于高电阻状态时，落在OTS两端的(在时间t2达到的)峰值读电压的比例 不足以触发OTS。依据本发明的原理，选择诸如峰值READ电压、存储元件和OTS的相 对电阻、以及OTS阈值电压之类的参数以便如果单元处于其低电阻状态则在READ操作 期间在β触发OTS但是如果单元处于其高电阻状态则在READ操作期间不触发OTS (例 如，2/3(峰值READ)大于或等于OTS的阈值电压，但是较小量——1/2(峰值READ) 小于OTS的阈值电压)。当触发OTS时，列上的电压降到甚至更低的电压，其中存储器 处于低电阻状态(具有横跨OTS的更小电压)。如果OTS的骤回就对存储器所需的要求 Vth而言过多，骤回可以被减小同时通过使用一个或多个串联的OTS (每个具有较低Vth) 诸如通过串联堆叠较薄OTS来保持较高Vth。阈值和骤回电压的调节例如在美国专利号 7,280,390中被讨论，该专利由此并入以供参考。在时间t3，锁存读输出。t2和t3之间的延迟为要存取的输出读出放大器以及为 在选择单元列处的电压平稳下来提供时间(例如，如果存储元件处于低电阻状态，则OTS 有时间触发列线并把列线下拉到将被认为低电阻状态(即“SET(设定)”或逻辑“1” 状态)的电平)。在这个说明性实施例中，READ信号的正向边缘可以用来锁存在这个 时间(t3)有效的数据。如由标记为DATA OUT的迹线所示，输出数据在t3之前未被定义(断面线)，在t3时刻DATA OUT有效(在这个说明性实施例中为逻辑“O”)并且 READ信号的上升沿锁存有效输出。在这个说明性实施例中，如断面线所指示的，输入 DATAIN未被定义，并且可以在与DATAOUT分离的信号线上。图4B的时序图描绘依据本发明原理的读操作，其中被读的双向存储单元(CELL 1，1)处于低电阻、逻辑“1” SET状态。在时间tO，行1选择信号ROWl和列1选择信号COLl两者如同阵列300内的 所有行信号和列信号一样都处于“预充电”电压V/2。如上面更详细描述的，在时间tl 通过把RNl驱动到高并从而接通η沟道FET RNl (RPl保持高并且ρ沟道FET 316 “断 开”)，把行线ROWl驱动到OV ；列线COLl被电流脉冲充电，该电流脉冲是通过驱动 READ信号到低(接通ρ沟道FET 302)并且通过驱动CSl到低来接通双向模拟开关208而 生成的。对于施加的栅极电压VREGp，调节通过ρ沟道FET 304的电流以避免在READ 操作期间干扰阵列300内的选择存储单元的存储器状态；如果必要的话辅以在过多电压 或电流在存储单元中流动之前但在足够信号产生以可靠读存储器之后关断脉冲并停止读 循环。横跨存储单元CELL 1，1的电压Vcell是列和行电压之间的差。通过“接地” 行线ROWl和对列线COLl电流受限充电的组合而施加到存储单元的电压Vcell将分布在 串联连接的OTS 102和双向存储元件104的两端。电压的分布将与OTS 102和存储元件 104的电阻成比例。在这个说明性实施例中，存储元件104展现低电阻并且大部分电压 Vcell落在OTS 102的两端。在时间t2，横跨OTS 102的电压达到OTS 102的阈值电压 并且作为响应OTS触发(即，进入低电阻状态)。因为OTS102和存储元件104两者现 在都处于低电阻状态，所以横跨存储单元的电压Vcell下降，如图4B的Vcell迹线所指示 的。在这个说明性实施例中，供应电流到列线COLl的ρ沟道FET的导通电阻大于给 行线ROWl放电的η沟道FET的导通电阻，因而列线电压COLl下降，同时行线电压基本 保持为0V。横跨存储单元的电压Vcell近似下降到OTS保持(holding)电压(Vh)(大约 IV)与存储单元的电阻和通过其的电流的乘积之和，如图4B中标记为Vcell的迹线所指示 的。这个较低电压可以在时间t3被感测并且被适当地解析为低电阻、“SET”、“1” 状态。如先前所描述的，可以调整设计参数以便OTS在存储元件处于低电阻状态时触发 但是在存储元件处于高电阻状态时不触发。在可选方案中，OTS可以针对任一存储器状 态进行触发，其中较高电阻存储器的电压成比例地较高。在时间t3，锁存读输出，如在 与图4A有关的讨论中更详细描述的。图4C的时序图描绘依据本发明原理的写“1”(低电阻)“SET”操作的序列。在这个说明性实施例中，通过在与先前描述的读电流被强制通过单元相同的方向上 使电流强制通过存储单元，完成把存储单元编程为低电阻状态(即，把逻辑“1”写到存 储器中)。如先前描述的，用于把单元编程为低电阻状态的脉冲发生电路可以例如使用比 用于读这样的单元更多的电流。在时间tO，行1选择信号ROWl和列1选择信号COLl两者都处于“预充电” 电压V/2。在可选方案中，V/3方法可以用来改善写裕度。在这个说明性实施例中，在 时间tl通过把与存储单元CELL 1，1相关联的列线COLl驱动到高(朝V+)并且把与存储单元CELL 1，1相关联的行线ROWl驱动到低(到OV)，来启动WRITE 1过程。在 这个示例性实施例中，列线COLl被通过在时间tl断言WRITE 1信号和模拟开关控制信 号CSl而生成的电流脉冲充电到正电压。如标记为COLl的迹线所指示的，被选择的存储单元CELL 1，1的列线开始充 电到比V/2更大的正电压。同时，由标记为ROWl的迹线所表示的行线从V/2快速放电 到0V。由标记为Vcell的迹线所表示的存储单元电压是列和行电压之间的差。如果存储元件104已经处于低电阻状态，则大部分单元电压Vcell将落在OTS 102的两端。结果，OTS将以相对低单元电压触发，如COLl和Vcell图中标记为LowR 的虚线迹线所指示的。如果另一方面存储元件104处于高电阻状态，单元电压Vcell将根 据OTS 102和存储元件104的相对电阻而分布在OTS 102和存储元件104的串联组合的两 端并且OTS 102将以较高单元电压触发，如COLl和Vcell迹线中标记为high-R的虚线迹 线所指示的。在这两种情况下，即在存储单元的现有状态是低电阻的情况下和在存储单 元的现有状态是高电阻的情况下，OTS102被触发并且在OTS触发之后充足的电流被传递 到存储元件104以将其编程为逻辑“1”低电阻状态。图4D的时序图描绘依据本发明原理的写“O”(高电阻)“RESET”操作的序 列。在这个说明性实施例中，通过在与先前描述的写“1”电流被强制通过单元相反的 方向上使电流强制通过存储单元，完成把存储单元编程为高电阻状态(即，把逻辑“O” 写到存储器中)。在时间tO，行1选择信号ROWl和列1选择信号COLl两者都处于“预充电” 电压V/2。在这个说明性示例中，在时间tl通过把与存储单元CELL 1，1相关联的列线 COLl驱动到低(朝V-，诸如OV)并且把与存储单元CELLl，1相关联的行线ROWl驱 动到高(到V+)，来启动WRITE O过程。这个偏置方案在与在READ或WRITE 1操作中 采用的方向相反的方向上产生通过存储元件104的电流。在这个示例性实施例中，列线 COLl被通过在时间tl断言WRITE O信号和模拟开关控制信号CSl而生成的电流脉冲从 V/2放电到0V。通过在时间tl断言(驱动低)信号RP1，电流通过ρ沟道晶体管316从 V+电源供应通过存储元件104。信号RNl保持“低”，因而η沟道FET 318保持“断 开”。如标记为COLl的迹线所指示的，被选择的存储单元CELL 1，1的列线开始从 V/2放电到0V。同时，由标记为ROWl的迹线所表示的行线从V/2快速充电到V+。 由标记为Vcell的迹线所表示的存储单元电压是列和行电压之间的差。如果存储元件104 已经处于低电阻状态，则大部分单元电压Vcell将落在OTS 102的两端。结果，OTS将 以相对低单元电压触发，如COLl和Vcell图中标记为LowR的虚线迹线所指示的。如果 另一方面存储元件104处于高电阻状态，单元电压Vcell将如先前所描述的那样根据OTS 102和存储元件104的相对电阻而分布在OTS 102和存储元件104的串联组合的两端并且 OTS 102将以较高单元电压触发，如COLl和Vcell迹线中标记为high-R的虚线迹线所指 示的。在这两种情况下，即在存储单元的现有状态是低电阻的情况下和在存储单元的现 有状态是高电阻的情况下，OTS 102被触发并且在OTS触发之后充足的电流被传递到存 储元件104以将其编程为逻辑“O”高电阻状态。如先前讨论的，可以调节诸如OTS触发电压的幅度之类的各种参数以适合特定存储器技术的要求。例如，与离子存储单元相关联的读和写电压是相对低电平，典型地 小于IV。在这样的离子存储单元的阵列中用作隔离设备的OTS设备可以例如被定制成 以2V触发。参考图5，单元500可以形成在衬底536之上，其中导电字线552耦合到设备556 和元件558。层间介质548可以分离集成电路部件546与双向存储器550。部件546可 以包括各种部件(例如诸如逻辑门、微处理器或存储器)中的任何部件。在这个说明性实施例中，选择设备556是由不可编程硫族化物材料形成的OTS。 OTS包括顶电极571、硫族化物材料572和底电极570。在一个实施例中选择设备556可 以永久地处于无定形状态。虽然说明了其中选择设备556位于双向存储元件558之上的 实施例，但是也可以使用相反的定向。带有对称电极的典型OTS具有相对对称的特性。 这些例如可以通过改变这些电极来调节。为了更好的耐久性，钨电极可以用于一者或两 者作为热沉。如先前指出的，双向存储元件558可以能够采取设定或复位状态。在本发明的 一个实施例中，双向存储元件558可以包括绝缘体562、双向存储器材料564、顶电极566 和阻挡膜568。在本发明的一个实施例中，下电极560可以被限定在绝缘体562中。双向材料564可以是由两个状态表征的适合于非易失性存储器数据储存的双向 材料。如先前描述的，材料可以通过在一个方向上施加电压或电流而被编程为一个状态 并且由在相反方向上施加的电流或电压被编程为另一个状态。例如可以在与写信号之一 的方向相同的方向上通过施加类似的电压或电流信号(或者较小幅度之一)来读取存储
ο可以通过对线552和554施加电压电位从而生成横跨存储器材料564的电压电 位，完成存储器材料的编程以更改材料的状态。响应于施加的电压电位，电流可以流过 部分存储器材料564。在说明性实施例中，通过对线552施加大约O伏特并且对上线554施加大约0.5 到3.0伏特的电源，可以横跨部分存储器材料施加大约0.5到1.5伏特的电压电位差。响 应于施加的电压电位而流过存储器材料564的电流可以用来读取或更改材料的状态。可以例如通过测量存储器材料的电阻来读取存储在存储器材料564中的信息。 作为示例，可以使用相对线554、552把读电流提供到存储器材料并且可以使用例如读出 放大器来对照参考电压比较横跨存储器材料的所得到的读电压。读电压可以与存储器储 存元件展现的电阻成比例。为了选择由列554和行552的交点所限定的单元550，可以触发所选择单元550 的OTS 556以便提供双向存取。选择设备556在被激活时允许电流在由横跨单元550施 加的偏压所确定的方向上流过存储元件558并且可以实现READ、WRITE 0或WRITE 1操作。当横跨OTS设备556施加低电压时，OTS设备556断开并且可以在一些实施例 中展现很高的电阻。不管所施加的场的方向如何，情况也如此。断开电阻可以例如在 一半阈值电压的偏压下从IO5欧姆变化到大于IO9欧姆。诸如阈值电压之类的OTS设备 特性可以例如通过调节硫族化物材料572的组分、调节硫族化物层572的厚度或者“堆 叠” OTS设备而针对各个应用进行定制。
OTS设备556可以保持其断开状态直到阈值电压Vth或阈值电流It把OTS设备 556切换到高导电、低电阻导通状态。在说明性实施例中，在接通后横跨设备556的电压 降到较低电压或动态电阻(被称作保持电压Vh)并且保持在那里，只要充足的电流Ih供 应到设备。阈值电压Vth和保持电压Vh之间的差通常被称为“骤回”电压，并且电流 /电压图的对应区域被称为骤回区域。对于低Vth，骤回可以为零。在操作中，施加到依据本发明原理的存储单元500的存取信号不会瞬时改变单 元电压。即，在存储器存取操作的时间尺度上，存取信号把单元500以及相关的行线和 列线逐渐地充电到目标存取电压。在充电过程期间，横跨单元500的部分电压横跨OTS 设备556提高。随着施加到单元500的电压提高，横跨OTS设备556的电压达到OTS设 备556的阈值电压，此时OTS设备556触发并且变成高导电，以低动态电阻(诸如小于 1000欧姆(根据电极的选择和电阻))骤回到Vh。 对于第一近似，在这个充电过程期间，落在OTS 556两端的单元电压的比例由 处于“断开”状态的OTS 556的电阻与存储元件558的电阻之比确定，其可能随着横跨 每个的变化电压而针对每个进行变化。如先前指出的，OTS 556的“断开”电阻的范围 可能高达IO9欧姆或更多，并且结果，分析通常假设只要OTS 556保持断开状态，则施加 到单元500的大部分电压落在OTS 556的两端，其中仅小部分单元电压被强加在存储元件 558两端。另外，分析通常假设对于第一近似，一旦OTS设备556触发，横跨OTS设备 556的电压基本保持在设备的保持电压Vh ；并且单元电压的其余部分(Vcell-VH)落在存 储元件558两端。如先前描述的，最小电流Ih必须被维持通过OTS以便横跨OTS设备 556的电压降到并保持在保持电压VH。如果通过OTS设备556的电流(例如由存储元件 558的电阻)受限于小于保持电流Ih的值，则OTS设备556将保持“断开”状态，其中 电压降大于Vh且小于Vth而不大约等于VH。因而，如果存储元件558处于高电阻状态并且在该高电阻状态下展现将通过OTS 556和存储元件558的串联连接的电流限制为小于OTS556的保持电流Ith的电阻，则OTS 556将保持断开并且横跨OTS 556的电压将保持在或小于设备的阈值电压VTH。TS。横跨存 储器设备的电压将是单元电压和OTS电压之间的差v。dl-v。ts。另一方面，如果存储器设备处于其高电阻状态但是其在该高电阻状态下展现的 电阻低得足以允许阈值电流Ith流动并且横跨OTS的电压超过Vth，则OTS 556将接通 并且横跨OTS 556的电压将降到设备的保持电压，近似Vh或更准确地是Vh+IXdv/ di(Vh+通过设备的电流乘上在触发状态下时的动态电阻)。单元电压的其余部分将落在 存储元件558两端。类似地，如果存储元件558是其低电阻状态但是该低电阻状态展现将通过OTS 556和存储元件558的串联连接的电流限制为小于OTS设备556的阈值电流电阻，贝Ij OTS设备556将保持断开并且横跨OTS设备556的电压将保持小于或处于OTS设备的阈 值电压Vthqts。横跨存储器设备的电压将是单元电压和OTS电压之间的差V。dl-VTHQTS。 如果存储器设备处于其低电阻状态并且其在该低电阻状态下展现的电阻低得足以允许阈 值电流InT流动，则OTS 556将接通并且横跨OTS 556的电压将降到设备的保持电压VH， 并且单元电压的其余部分将落在存储元件558两端。OTS将保持导通除非通过设备的电流降到其保持电流Ih之下。在其中OTS设备556展现骤回(即，Vth > Vh)并且在导通状态下通过骤回区 域之后存储元件558的电阻不如此大以防止OTS设备556阈值化的情况下，当通过设备的 电流被提高到相对高的电流水平时，OTS设备556电压降保持接近保持电压。在阈值电 流水平之上，设备触发导通并且只要多于保持电流流动，设备保持导通并且显示相对低 的有限微分电阻，其中电压降随电流的增加而增加并且截距零电流(intercept zero current) 投影在保持电压Vh上。OTS设备556可以保持导通直到通过OTS设备556的电流降到 与用于形成OTS设备556的大小和材料有关的特性保持电流值之下为止。在本发明的一些实施例中，OTS设备556不改变相位。其永久地保持无定形并 且其电流-电压特性可以在其整个操作寿命中保持相同的一般形状和特性。作为示例， 对于由具有相应原子百分比16/13/15/1/55的TeAsGeSSe形成的0.5微米直径设备556， 在一个实施例中保持电流可以大约为0.1到100微安。在这个保持电流之下，设备556在 低电压低场下关断并返回到高电阻状况(regime)。设备556的阈值电流一般可以有与保 持电流相同的量级。可以通过改变过程变量(诸如顶和底电极材料以及硫族化物材料) 来更改保持电流。与诸如金属氧化物半导体场效应晶体管或双极结型晶体管之类的常规 存取设备相比，设备556可以为给定的设备区提供高“导通电流密度”。在一些实施例中，在“导通”状态下OTS设备556的较高电流密度允许较高编 程电流可用于存储元件558。在存储元件558是双向存储器的情况下，这实现较大编程电 流双向存储器设备的使用，以减小对把更多的芯片区专用于排列的单元区的需要且具有 显著节约成本和改进存储器性能的潜力。一种用于寻址双向存储器阵列的技术使用施加到选择列的电压V和施加到选择 行的零电压。对于其中元件558是双向存储器的情况，电压V被选择为大于存取设备556 最大阈值电压加上存储元件558复位最大阈值电压，但小于两倍设备556最小阈值电压。 换言之，所有设备556的最大阈值电压加上阵列内元件558的最大复位阈值电压可以小于 V以确保可以选择和编程所有单元。并且在一些实施例中V可以小于设备556的最小阈 值电压(加上在阈值化OTS期间最小存储单元元件电压)的两倍以有助于防止去选择存 储单元的假选择。如先前描述的，所有未选择的行和列可以以V/2被偏置。利用这种方 法，在未选择行和未选择列之间没有偏置电压。这减小背景漏电流。在以此方式偏置阵列后，存储元件558可以用针对所涉及的特定存储器技术所 需的任何方式进行编程和读取。例如，使用双向材料的存储元件558可以通过强制为编 程双向存储元件所需的电流进行编程或者存储器阵列可以通过强制较低电流以确定元件 558电阻进行读取。依据本发明原理的双向存储器阵列可以采用外围导电线来互连存储元件并且使 用通孔来连接位于双向存储器阵列的不同层上的导电线和线段。另外，这样的存储器阵 列可以采用“共享的”地址线。地址线的共享和外围互连线的使用在本领域中是已知 的并且例如被公开在公开号2006/0120136、申请号11/202,428、题为“Shared Address LinesFor Crosspoint Memory”的公开美国专利申请中，该申请由此并入以供参考。依据本发明原理的双向存储器阵列也可以彼此层状堆叠。存储器设备的这样 堆叠在本领域中是已知的并且例如被公开在题为“MemoryHaving Access Devices UsingPhase Change Material Such AsChalcogenide” 的美国专利号 6,795,338 中，该申请由此并入
以供参考。 在与先前图有关的讨论中描述的双向存储器设备可以被特别有利地用于各种各 样的系统。图6的示意图将用来说明设备在若干这样的系统中的使用。图6的示意图包 括许多部件和设备，其中一些将被用于依据本发明原理的系统的具体实施例而其他未被 使用。在其他实施例中，可以采用其他类似的系统、部件和设备。一般而言，系统包括 被配置成连同存储器一起操作的逻辑电路。逻辑电路可以例如是分立的、可编程的、专 用的或者以微处理器的形式。并且本文的实施例也可以被用在芯片内或连接到这样的电 路。图6的示例性系统仅为了描述目的。尽管该描述可以引用通常在描述特定计算 机、通信、跟踪和娱乐系统中使用的术语，但是描述和概念等同地应用于包括具有不同 于图6所说明的架构的系统的其他系统。在各种实施例中，电子系统600可以被实施为 例如通用计算机、路由器、大规模数据储存系统、便携式计算机、个人数字助理、蜂窝 电话、电子娱乐设备(诸如音乐或视频回放设备或电子游戏机)、微处理器、微控制器或 射频识别设备。图6中所描绘的任何或所有部件可以例如采用具有双向硫族化物电子设 备选择开关(诸如基于硫族化物的阈值开关)的存储器。在说明性实施例中，系统600可以包括中央处理单元(CPU)605，其可以与微处 理器、用于临时储存信息的随机存取存储器(RAM)610、以及用于永久储存信息的只读 存储器(ROM) 515中的一些或所有一起实施。提供存储器控制器620来控制RAM 610。 依据本发明的原理，任何存储元件(例如RAM或ROM)的全部或任何部分可以被实施为 使用与双向存储器串联的OTS的存储器。依据本发明原理的电子系统600可以是用作CPU 605的微处理器与用作RAM 610和/或ROM615或者用作其部分的存储器组合。在该说明性示例中，微处理器/硫 族化物选择开关组合可以是独立的，或者可以与其他部件(例如图6中仍待描述的那些部 件)一起操作。在本发明范围内的实施方式中，总线630互连系统600的部件。提供总线控制 器625以控制总线630。中断控制器635可以或不可以用于从系统部件接收和处理各种 中断信号。例如，在依据本发明原理的系统的大规模实施方式(诸如独立计算机、路由 器、便携式计算机或数据储存系统的大规模实施方式)中可以采用诸如总线630、总线控 制器625以及中断控制器635之类的部件。大容量储存器可以由磁盘642、CD ROM 647或硬盘驱动器652提供。可以经 由可移动介质(例如磁盘642和CD ROM 647)与系统600交换数据和软件。磁盘642可 插入到磁盘驱动器641中，其又通过控制器640连接到总线630。类似地，CD ROM 647 可插入到CD ROM驱动器646，其又通过控制器645连接到总线630。硬盘652是由控 制器650连接到总线630的固定盘驱动器651的一部分。尽管在依据本发明原理的系统 的该描述中采用储存器设备的常规术语(例如磁盘)，但是任何或所有储存器设备可以使 用OTS作为与依据本发明原理的双向存储器串联的选择设备来实施。可移动储存器可以 由将具有依据本发明原理的双向存储器的OTS用作储存介质的非易失性储存器部件(诸 如拇指驱动器(thumb drive))来提供。例如将这样的存储器用作常规可移动存储器(例如盘或CD ROM或拇指驱动器)的“即插即用”代替物的储存系统可以模仿现有的控制 器以例如为诸如控制器640、645和650之类的控制器提供透明接口。可以由多个设备中的任一个来提供对系统600的用户输入。例如，由控制器655 将键盘656和鼠标657连接到总线630。如所示的那样，可以充当麦克风和扬声器的音 频换能器696由音频控制器697连接到总线630。诸如笔和/或小型报(tabloid)之类的 其他输入设备可以连接到总线630并且根据需要连接到适当的控制器和软件以用作输入 设备。提供DMA控制器660以执行对RAM 610的直接存储器存取，如先前所描述的那 样，RAM可以整体或部分使用依据本发明原理的所述存储器设备来实施。视觉显示由控 制显示器670的视频控制器665来产生。显示器670可以有适合于给定应用的任何尺寸 或技术。例如，在蜂窝电话或便携式娱乐系统实施例中，显示器670可以包括一个或多 个相对小(例如每一侧大约几英寸)的LCD显示器。在大型数据储存系统中，显示器 可以例如被实施为大型多屏液晶显示器(LCD)或包括量子点OLED的有机发光二极管 (OLED)。系统600还可以包括通信适配器690，其允许系统互连到局域网(LAN)或广域 网(WAN)，示意性地由总线691和网络695示出。输入接口 699结合输入设备693来操 作以准许用户将信息(无论是命令和控制、数据还是其他类型的信息)发送到系统600。 输入设备和接口可以是多个常见接口设备(例如操纵杆、触摸垫、触摸屏、语音识别设 备或其他已知的输入设备)中的任何一个。在依据本发明原理的系统的一些实施例中， 适配器690可以与收发器673和天线675 —起操作以例如在蜂窝电话、RFID和wifi计算 机实施方式中提供无线通信。系统600的操作一般由操作系统软件来控制和协调。该操作系统控制系统资源 的分配并且执行诸如处理调度、存储器管理、联网和I/O服务等等之类的任务。特别 地，存在于系统存储器中并且在CPU 605上运行的操作系统协调系统600的其他元件的操作。在依据本发明原理的系统600的说明性手持电子设备实施例中，诸如蜂窝电 话、个人数字助理、数字组织器、膝上型计算机、手持信息设备、手持娱乐设备(诸如 播放音乐和/或视频的设备)、小型输入设备(诸如键区、功能键和软键)(这些都是本领 域已知的)可以代替例如控制器655、键盘656和鼠标657。具有发射机、记录能力等等 的实施例也可以包括麦克风输入(未示出)。在依据本发明原理的系统600的说明性RFID发射机应答器实施方式中，天线 675可以被配置成以频率F1拦截来自基站的询问信号。所拦截的询问信号然后将被传导 到调谐电路(未示出)，其接受信号F1并且拒绝所有其他信号。然后该信号传到收发 器673，在所述收发器673中以已知的方式检测、放大并整形包括询问信号的载波F1W 调制。然后检测到的询问信号传到译码器和逻辑电路，其可以被实施为例如低功率应用 中的分立逻辑，或者被实施为如先前所描述的微处理器/存储器组合。询问信号调制可 以将代码定义成从依据本发明原理的OTS选择的存储器中读出数据或者将数据写入到其 中。在该说明性实施例中，以第二载波频率F2把从存储器读出的数据作为“应答”信号 在天线675上传送给收发器673。在无源RFID系统中，从询问信号导出功率并且依据本发明原理的存储器 特别适合于这种使用。
权利要求
1.一种装置，包括布置成矩形阵列的多个双向存储单元，其中行和列存取线提供对每个单元的存取， 每个双向存储单元包括双向阈值开关和双向存储元件，该双向阈值开关被配置成阻挡对 双向存储元件的无意存取；以及多个电源，其中的至少两个有相反的电流极性，所述电源被配置成通过耦合反指向 的电流到存储单元来存取双向存储单元。
2.权利要求1的装置，其中双向存储单元包括电阻随机存取存储器。
3.权利要求1的装置，其中双向存储单元包括磁阻随机存取存储器。
4.权利要求1的装置，其中双向存储器包括铁电随机存取存储器。
5.权利要求1的装置，其中双向存储器包括金属纳米颗粒存储器。
6.—种存取双向存储单元的方法，包括以下步骤横跨双向阈值开关施加第一极性的存取信号；横跨与双向阈值开关串联的双向存储元件施加相同极性的存取信号；以及横跨双向阈值开关和双向存储元件施加相反极性的存取信号。
7.权利要求6的方法，其中施加存取信号的步骤包括对电阻随机存取存储器施加存取 信号的步骤。
8.权利要求6的方法，其中施加存取信号的步骤包括对磁阻随机存取存储器施加存取 信号的步骤。
9.权利要求6的方法，其中施加存取信号的步骤包括对铁电随机存取存储器施加存取 信号的步骤。
10.权利要求6的方法，其中施加存取信号的步骤包括对金属纳米颗粒存储器施加存 取信号的步骤。
全文摘要
双向存储单元包括双向阈值开关(OTS)和双向存储元件。OTS被配置成选择双向存储元件并且阻挡对存储元件的无意存取。
文档编号G11C7/10GK102017003SQ200980113866
公开日2011年4月13日 申请日期2009年2月18日 优先权日2008年2月20日
发明者W·帕金森 申请人:奥翁尼克斯公司