一种阵列基板、制造方法及液晶显示面板的制作方法

一种阵列基板、制造方法及液晶显示面板的制作方法
【专利摘要】本发明描述了一种阵列基板，包含该阵列基板的液晶显示面板以及阵列基板的制造方法。本发明提供的阵列基板包括：基板，依次设置于所述基板一侧表面上的第一膜层、绝缘层、静电分散层和第二膜层；所述绝缘层和静电分散层具有过孔，所述第二膜层通过所述过孔与所述第一膜层电性连接；所述静电分散层与所述第二膜层的轮廓相同。本发明的阵列基板包含静电分散层，可降低阵列基板制程中基板上静电的积累，降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性，避免了TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura，提升了产品良率，提高显示品质。
【专利说明】一种阵列基板、制造方法及液晶显示面板

【技术领域】
[0001]本发明涉及显示【技术领域】，尤其涉及一种阵列基板及其制造方法。

【背景技术】
[0002]随着显示器制造技术的发展，薄膜场效应晶体管液晶显示器(Thin FilmTransistor-Liquid Crystal Display, TFT-1XD)因其具有体积小、功耗低、分辨率高等优点，在平板显示器市场中占据了主导地位。
[0003]TFT-1XD按照其液晶的工作模式，主要包括如下两种:一种是纵电场方式，在该方式中，利用与基板面大致垂直的方向的电场驱动液晶层，对入射到液晶层的光进行调制从而实现显示，该种显示模式主要有扭曲向列(Twisted Nematic, TN)模式、多畴垂直取向(Mult1-domain Vertical Alignment, MVA)模式等；另一种是横电场方式，在该方式中，利用与基板面大致平行的方向的电场驱动液晶层，对入射到液晶层的光进行调制从而实现显示，该种显示模式主要有平面转换(In-plane Switching, IPS)型、边缘场转换(FringeField Switching, FFS)型等。
[0004]阵列基板是TFT-LCD的主要构成部件之一，现有技术中制备阵列基板的工艺过程一般包括形成TFT器件，根据半导体材料的不同，TFT器件的制造工艺也稍有不同。当采用非晶硅为半导体材料时，一般采用底栅结构TFT，形成TFT器件的步骤为在基板上依次形成栅极、栅极绝缘层、半导体层、源漏极金属层。当采用低温多晶硅为半导体材料时，一般采用顶栅结构TFT，形成TFT器件的步骤为在基板上依次形成半导体层、栅极绝缘层、栅极金属层、内介质层、源漏极金属层。在形成TFT器件后，根据液晶工作模式不同，工艺略有不同。当采用纵电场方式时，通常在形成TFT器件后，在基板上再依次形成层间绝缘层、透明电极层。当采用横电场方式时，通常在形成TFT器件后，在基板上再依次形成钝化层、第一透明电极层、层间绝缘层和第二透明电极层。
[0005]不管采用纵电场方式或者横电场方式，通常需要在像素区域或者边缘区域通过在绝缘层上形成过孔以连接绝缘层两侧的导电层，形成过孔的工艺一般包括，在需要过孔的绝缘层上形成光刻胶层，图案化该光刻胶层，以使该光刻胶层具有待形成的过孔的图案，刻蚀绝缘层，以形成具有该过孔的绝缘层，去除剩余的光刻胶层。在阵列基板的制程中，由于摩擦起电、接触分离起电与感应起电等原因，基板上积累了较多的电荷，在绝缘层形成过孔至绝缘层上部导电层形成过程中，绝缘层下部的导电层裸露在外，在光刻胶剥离、清洗等制程中，容易导致静电释放，引起TFT器件被静电击打或者击伤以致电性漂移，从而导致像素电极充电过程比正常情况充电缓慢或者快速，以至于低于或者高于正常像素电位，从而出现明暗Mura (不均)区域。


【发明内容】

[0006]有鉴于此，本发明提供一种阵列基板、包含该阵列基板的液晶显示面板以及阵列基板的制造方法。
[0007]本发明提供一种阵列基板，包括:基板，依次设置于所述基板一侧表面上的第一膜层、绝缘层、静电分散层和第二膜层；所述绝缘层和静电分散层具有过孔，所述第二膜层通过所述过孔与所述第一膜层电性连接；所述静电分散层与所述第二膜层的轮廓相同。
[0008]本发明还提供了一种液晶显示面板，包括对向基板和阵列基板，以及夹持于所述阵列基板与所述对向基板之间的液晶层，所述阵列基板包括:基板，依次设置于所述基板一侧表面上的第一膜层、绝缘层、静电分散层和第二膜层；所述绝缘层和静电分散层具有过孔，所述第二膜层通过所述过孔与所述第一膜层电性连接；所述静电分散层与所述第二膜层的轮廓相同。
[0009]本发明还提供了一种阵列基板的制造方法，包括:提供基板，在所述基板一侧的表面上形成第一膜层；在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板；在所述绝缘层上形成静电分散层；在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层；在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接；图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0010]与现有技术相比，本发明至少具有如下突出的优点之一:
[0011]本发明的阵列基板包含静电分散层，可以降低阵列基板制程中基板上静电的积累，降低静电对TFT器件的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤而导致的电性漂移，消除各种静电Mura。改善了因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品的品质。降低了与静电分散层直接接触的第二膜层的电阻率，改善显示器信号在第二膜层构成的导线上的延迟衰减的情况，提高显示品质。

【专利附图】

【附图说明】
[0012]图1为本发明实施例提供的一种阵列基板的剖视结构示意图；
[0013]图2为图1中A区域的放大示意图；
[0014]图3为图1中提供的阵列基板的制造流程的剖视结构示意图；
[0015]图4为本发明实施例提供的另一种阵列基板的剖视结构示意图；
[0016]图5为图4中B区域的放大示意图；
[0017]图6为图4中提供的阵列基板的制造流程的剖视结构示意图；
[0018]图7为本发明实施例提供的又一种阵列基板的剖视结构示意图；
[0019]图8为图7中C区域的放大示意图；
[0020]图9为图7中提供的阵列基板的制造流程的剖视结构示意图；
[0021]图10为本发明实施例提供的又一种阵列基板的剖视结构示意图；
[0022]图11为图10中D区域的放大示意图；
[0023]图12为图10中提供的阵列基板的制造流程的剖视结构示意图；
[0024]图13为本发明实施例提供的又一种阵列基板的剖视结构示意图；
[0025]图14为图13中E区域的放大示意图；
[0026]图15为图13中提供的阵列基板的制造流程的剖视结构示意图；
[0027]图16为本发明实施例提供的一种液晶显示面板的剖视结构示意图。

【具体实施方式】
[0028]为使本发明的上述目的、特征和优点能够更为明显易懂，下面将结合附图和实施例对本发明做进一步说明。
[0029]需要说明的是，在以下描述中阐述了具体细节以便于充分理解本发明。但是本发明能够以多种不同于在此描述的其它方式来实施，本领域技术人员可以在不违背本发明内涵的情况下做类似推广。因此本发明不受下面公开的【具体实施方式】的限制。
[0030]图1为本发明实施例提供的一种阵列基板的剖视结构示意图，Pa为该阵列基板显示区域，Pb为该阵列基板周边区域。
[0031]参考图1，该阵列基板包括:基板100,依次设置于该基板100 —侧表面上的第一膜层、绝缘层、静电分散层120和第二膜层；绝缘层和静电分散层具有过孔130，第二膜层通过该过孔130与第一膜层电性连接；静电分散层120与第二膜层的轮廓相同。在本实施例中，第一膜层为半导体层103，绝缘层为栅极绝缘层104和内介质层106组成的多层绝缘层，第二膜层为源漏极金属层107。即，在本实施例中，在基板100上，依次形成有半导体层103、栅极绝缘层104、栅极金属层105、内介质层106、静电分散层120和源漏极金属层107 ;在由栅极绝缘层104合内介质层106组成的多层绝缘层和静电分散层120上具有过孔130，源漏极金属层107通过该过孔130与半导体层103电性连接；静电分散层120与源漏极金属层107的轮廓相同。
[0032]更具体地，请继续参考图1，在本实施例中，基板100可以是玻璃基板、石英基板等基于无机材料的衬底基板，也可以是米用有机材料的衬底基板。
[0033]在基板100上，为了防止基板100中的金属离子如铝离子、钡离子、钠离子等在热工艺中扩散到半导体层103的有源区，并且降低热传导，一般形成有缓冲层102。缓冲层102通常由氮化硅、氧化硅或者两者的混合材料构成。通常，为了防止背光对半导体有源区的影响，还可以在基板上与半导体有源区相对应的位置形成遮光层(图中未示出)，遮光层通常由一层很薄的金属材料构成。
[0034]在缓冲层102上，形成有半导体层103，半导体材料可以为非晶硅、氧化物半导体或者低温多晶硅，由于低温多晶硅电子迁移率高，因此本实施例中采用低温多晶硅作为半导体材料。半导体层103中进一步包含有源区和源漏极连接区(图中未示出)。
[0035]在半导体层103上，形成有栅极绝缘层104，栅极绝缘层104通常由氮化硅、氧化硅或者两者的混合材料构成。
[0036]在栅极绝缘层104上,形成有栅极金属层105。在显不区域Pa中，栅极金属层105构成TFT器件的栅极，在周边区域Pb中，栅极金属层105可构成周边电路如栅极驱动器等，栅极金属层通常采用钥、钥合金、铝、铝合金材料制成。
[0037]在栅极金属层105上，形成有内介质层106，内介质层可以是由氧化硅、氮化硅或者两者的混合材料构成的单层膜，也可以是由氧化硅、氮化硅多层膜层叠而成。
[0038]在内介质层106之上，形成有静电分散层120，该静电分散层120的材料为钥、钛、铁、锌、铝、镁中的至少一种或其组合，这一类材料的导电性较好，并且这些材料的氢标准电极比通常用作栅极材料的钥合金更低，在形成静电分散层120后至形成源漏极金属层107前，可以对位于静电分散层120下层的栅极金属层105和半导体层103起到静电保护作用，并且可以起到阴极保护作用，防止下层栅极金属层105的电化学腐蚀。并且该静电分散层120的膜厚d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0039]在静电分散层120上形成有源漏极金属层107。在显示区域Pa中，源漏极金属层107通过静电分散层120、内介质层106与栅极绝缘层104的过孔130，与半导体层103的源漏极接触区实现电连接；在周边区域Pb中，源漏极金属层107通过静电分散层120、内介质层106的过孔131，与栅极金属层105实现电连接。并且，静电分散层120与源漏极金属层107的轮廓相同，在制备过程中可以在同一道工序中形成静电分散层120与源漏极金属层107的轮廓，不增加工序。
[0040]在源漏极金属层107上形成有钝化层108，钝化层108可以是有机钝化层或者无机钝化层的单层膜，也可以是由一层氮化硅或者氧化硅膜与一层有机钝化层膜或者无机钝化层膜组成的多层膜。在本实施例中，在显示区域Pa中在钝化层108之上，还形成有第一透明电极层109、层间绝缘层110、第二透明电极层111，并且第二透明电极层111通过过孔132与源漏极金属层107电连接，作为像素电极，并且第二透明电极层111上可以形成有多个狭缝(图中未示出)。在实际实施过程中，也可以是第一透明电极与源漏极金属层电连接，作为像素电极。在实际实施过程中，还可以是钝化层108上只形成第一透明电极并与源漏极金属层电连接，在与阵列基板相对的对向基板上形成第二透明电极。
[0041]更具体地，请参考图2，图2为图1中A区域的放大示意图。结合图1与图2，在内介质层106上依次形成有静电分散层120、源漏极金属层107、钝化层108，并且静电分散层120与内介质层106具有过孔130。该静电分散层120在该过孔130处的倾斜角Θ满足0° < Θ <90°，优选30° <θ〈60°，此时由于静电分散层120存在倾斜角，积累在基板上的静电更容易通过表面漏电等方式在静电分散层120上进行静电释放，对静电保护效果更好。
[0042]本实施例的阵列基板包含静电分散层，可以降低阵列基板制程中基板上静电的积累，在显示区域中，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。在周边区域中，改善了因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品良率。并且静电分散层与源漏极金属层直接接触，可以降低源漏极金属层的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。
[0043]图3为图1中提供的阵列基板的制造流程的剖视结构示意图。
[0044]参考图3，进行步骤:提供基板，在所述基板一侧的表面上形成第一膜层。
[0045]具体地，请参考图3a，该步骤包括:在基板100上形成缓冲层102，在缓冲层102上形成半导体层103并图形化，该半导体层103为本实施例中所述的第一膜层。
[0046]本实施例中，采用等离子体增强化学气相沉积法沉积缓冲层102。在实际实施过程中，为了防止背光对半导体的影响，在形成缓冲层102前，还可以在基板100上与半导体有源区相对应的位置形成遮光层(图中未示出)，遮光层通常由一层很薄的金属材料构成，采用物理沉积法如溅射法来制备。
[0047]在缓冲层102上形成半导体层103，并图案化。需要说明的是，缓冲层102对于本发明来说并不是必须的，在实际实施过程中，也可在基板100上直接形成半导体层103。半导体材料可以为非晶硅、氧化物半导体或者多晶硅，由于多晶硅电子迁移率高，因此本实施例中采用多晶硅作为半导体材料。
[0048]更具体地，本实施例中形成多晶硅半导体层包括以下步骤:在基板100 —侧的表面沉积非晶硅材料，对该非晶硅材料进行晶化，将该非晶硅材料转化为多晶硅材料。其中，
沉积非晶硅材料通过等离子体增强化学气相沉积进行，沉积厚度为450 A0在沉积完成后，
加热使其去氢，加热温度500°C。完成去氢后，可对非晶硅材料进行晶化，晶化可以采用准分子激光晶化工艺、固相晶化工艺或快速热退火工艺。由于准分子激光晶化工艺过程中非晶硅薄膜的熔化结晶过程非常短，对衬底的热冲击很小，可以使用不耐高温的廉价玻璃基板，可以降低制造成本，因此在本实施例中，采用准分子激光晶化工艺对非晶硅材料进行晶化。
[0049]在完成上述非晶硅材料的晶化后，图案化该多晶硅材料，使多晶硅材料在显示区区域Pa处形成半导体层103，而在周边区域Pb处，在需要保留多晶硅材料的区域如栅极驱动器电路晶体管区域(图中未示出)形成半导体层，其他区域的多晶硅材料均需要刻蚀去除。具体图案化过程包括:在多晶硅材料层上涂布光刻胶层并烘干该光刻胶层；曝光显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；多晶硅材料刻蚀，具体为采用干刻法，使等离子体中的离子基吸附在多晶硅材料表面后，产生挥发性的反应物；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，半导体层103形成。在实际操作过程中，在涂布光刻胶、曝光显影、刻蚀、剥离等每一个步骤前后，需要对基板进行清洗干燥过程，以除去基板表面的杂质。
[0050]在半导体层形成后，进一步地还包括沟道掺杂，使半导体层103形成有源区和源漏极连接区(图中未示出)。
[0051]请继续参考图3，进行步骤:在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板。
[0052]具体地，请参考图3b?3d，该步骤包括:在半导体层103上形成栅极绝缘层104 ；在栅极绝缘层104上形成栅极金属层105并使之图案化；在栅极金属层105上形成内介质层106。该栅极绝缘层104和内介质层106为本实施例中所述的绝缘层，栅极绝缘层104和内介质层106覆盖半导体层103以及基板100。
[0053]更具体地，如图3b所示，在半导体层103上形成栅极绝缘层104，栅极绝缘层104通过等离子体增强化学气相沉积完成，栅极绝缘层104可以为单层的氧化硅膜或者单层的氮化硅膜，也可以是氧化硅/氮化硅双层结构。如图3b所示，在半导体层103区域，栅极绝缘层104覆盖该半导体层103，在其他区域，栅极绝缘层104覆盖缓冲层102。
[0054]如图3c所示，在栅极绝缘层104上形成栅极金属层105并使之图案化。具体包括:采用溅射法在栅极绝缘层105上形成栅极金属层材料；在栅极金属层材料上涂布光刻胶层并烘干该光刻胶层；曝光显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成具有预定图案的光刻胶图案；栅极金属材料刻蚀，具体为采用湿刻法，使栅极金属材料与栅极金属材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉栅极金属材料物质，直至没有被光刻胶覆盖区域的栅极金属材料被全部消耗；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，栅极金属层105形成，在显示区域Pa处，栅极金属层可作为TFT开关元件的栅极、公共电极(图中未示出)等，在周边区域Pb处，栅极金属层105可作为金属走线等。
[0055]如图3d所示，在栅极金属层105上形成内介质层106，内介质层106可以为单层的氧化硅膜或者单层的氮化硅膜，也可以是氧化硅/氮化硅双层结构，其形成方法与形成栅极绝缘层104的方法一致，即采用等离子体增强化学气相沉积，具体请参考栅极绝缘层104的形成步骤，在此不再赘述。在栅极金属层105区域，内介质层106覆盖该栅极金属层105，在其他区域，内介质106覆盖栅极绝缘层106。
[0056]本实施例所述的绝缘层即为该栅极绝缘层104和内介质层106组成的多层绝缘膜，在半导体层103区域，该绝缘层覆盖该半导体层103，在其他区域，该绝缘层覆盖基板100。
[0057]请继续参考图3，进行步骤:在所述绝缘层上形成静电分散层。
[0058]如图3e所示，在内介质层106上形成静电分散层120，使静电分散层120整面覆盖基板100。静电分散层110采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。该静电分散层120的材料为钥、钛、铁、锌、铝、镁中的至少一种或其组合，这一类材料的导电性较好，并且这些材料的氢标准电极比通常用作栅极材料的钥合金更低，在后续制程中，可以对位于静电分散层120下层的金属层和半导体层起到静电保护作用，并且可以起到阴极保护作用，防止下层金属的电化学腐蚀。本实施例中米用钛金属制备静电分散层120。静电分散层120的成膜厚度d满足5nm〈d〈500nm,可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0059]请继续参考图3，进行步骤:在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层。
[0060]请参考图3f，在显示区域Pa处，在静电分散层120、内介质层106、栅极绝缘层104中形成过孔130，使静电分散层120覆盖该过孔区域外的内介质层106 ;在周边区域Pb处，在静电分散层120、内介质层106中形成过孔131，使静电分散层120覆盖除过孔区域外的内介质层106。
[0061]具体地，在静电分散层120与绝缘层中形成过孔130、131的步骤包括:在静电分散层120的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光显影过程，曝光过程为使用紫外线透过具有预定图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成具有预定图案的光刻胶图案；刻蚀静电分散层120和绝缘层，以形成具有所述过孔的所述静电分散层与所述绝缘层；去除剩余的所述光刻胶层。
[0062]更具体地，上述刻蚀静电分散层120和绝缘层的步骤包括:刻蚀静电分散层120，使所述静电分散层120在所述过孔130边缘的倾斜角Θ (图中未示出)满足0° <θ<90°，优选30°〈 Θ〈60° ;刻蚀所述绝缘层。其中刻蚀静电分散层120采用湿刻法，具体刻蚀方法与刻蚀栅极金属层105方法一致，请参考刻蚀栅极金属层105步骤，在此不再赘述。刻蚀绝缘层包括在显示区域Pa处，刻蚀内介质层106与栅极绝缘层104，在周边区域Pb处，刻蚀内介质层106。刻蚀过程采用干刻法，具体过程与刻蚀半导体层103相同，请参考半导体层103的刻蚀步骤，在此不再赘述。
[0063]在光刻胶的剥离后，可以进一步进行清洗烘干，以去除基板100表面的杂质。
[0064]在过孔130、131形成过程中，以及过孔形130、131成后光刻胶的剥离过程中以及清洗、烘干过程中，以及基板的运输过程中，基板容易受到静电影响。静电的来源主要来自以下三个方面:摩擦起电，包括运输过程中与空气摩擦、玻璃基板与毛刷摩擦、玻璃基板与基台的摩擦、清洗过程中纯水的冲刷摩擦、风刀的空气摩擦等；接触分离起电，包括玻璃基板与基台接触后分离、等离子体轰击、离子轰击、药液接触等；感应起电比如接近带电的物体感应出静电。当静电积累到一定程度后，容易引起静电的释放。由于在整个过孔的形成过程中，基板表面一直覆盖有静电分散层120,累积在半导体层103与栅极金属层105上的静电可以通过空气大电阻等途径经过表面漏电释放到静电分散层120表面，不会对半导体层103以及栅极金属层105造成静电损伤。并且，由于钛金属的氢标准电极比通常用作栅极材料的钥合金更低，在形成过孔的过程中，可以对位于静电分散层120下层的栅极金属层105起到起到阴极保护作用，防止下层金属的电化学腐蚀。
[0065]请继续参考图3，进行步骤:在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接。
[0066]请参考图3g，在静电分散层120上形成源漏极金属层107，使源漏极金属层107整面覆盖基板100。在显示区域Pa中，该源漏极金属层107通过前述步骤中形成的过孔130与半导体层103电性连接；在周边区域Pb中，源漏极金属层107通过前述步骤中形成的过孔131与栅极金属层103电连接。本实施例中所述的第二膜层即为该源漏极金属层107。源漏极电极层107采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。
[0067]请继续参考图3，进行步骤:图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0068]请参考图3h，图案化该源漏极金属层107与静电分散层120，使该静电分散层120与该源漏极金属层107轮廓相同。
[0069]具体包括以下步骤:在第二膜层即源漏极金属层107的表面形成光刻胶层；图案化该光刻胶层，具体包括曝光与显影，曝光显影过程与前述步骤中光刻胶的曝光显影过程相同，在此不再赘述；刻蚀第二膜层即源漏极金属层107与静电分散层120以使该静电分散层120与源漏极金属层轮廓相同；去除剩余的所述光刻胶层。由于源漏极金属层107与静电分散层120均为金属材料层，所以源漏极金属层107与静电分散层120的刻蚀过程可以一步进行，采用湿刻法，使源漏极金属层107与静电分散层120未被光刻胶覆盖区域的材料与材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉金属材料物质，直至没有被光刻胶覆盖区域的源漏极金属材料与静电分散层材料被全部消耗，使得源漏极金属层107与静电分散层120具有相同的轮廓。
[0070]静电分散层120与源漏极金属层107直接接触，可以降低源漏极金属层107的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质
[0071]进一步地，请参考图3i，在图案化源漏极金属层107与静电分散层120后，可以在源漏极金属层107上形成钝化层108，钝化层108可以是有机钝化层或者无机钝化层的单层膜，也可以是由一层氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。在形成钝化层108后，进一步形成第一透明电极层109、层间绝缘层110、第二透明电极层111，并且第二透明电极层111通过过孔132与源漏极金属层107电连接，作为像素电极，并且可以进一步在第二透明电极层111上形成多个狭缝(图中未示出)。在实际实施过程中，也可以是第一透明电极与源漏极金属层通过过孔电连接，作为像素电极，还可以是钝化层108上只形成第一透明电极并与源漏极金属层电连接，在与阵列基板相对的基板上形成第二透明电极。
[0072]本实施例的阵列基板的制造方法，在制造过程中形成静电分散层，降低阵列基板制程中基板上静电的积累，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。，并可以改善因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品良率。并且静电分散层与源漏极金属层直接接触，可以降低源漏极金属层的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。并且，在静电分散层的图案化过程中，与源漏极金属层采用同一张掩膜板，不增加制造工序。
[0073]图4为本发明实施例提供的另一种阵列基板的剖视结构示意图，其中Pa为该阵列基板显示区域，Pb为该阵列基板周边区域。
[0074]参考图4,该阵列基板包括:基板200,依次设置于该基板200—侧表面上的第一膜层、绝缘层、静电分散层220和第二膜层；绝缘层和静电分散层具有过孔，第二膜层通过该过孔与第一膜层电性连接；静电分散层220与该第二膜层的轮廓相同。在本实施例中，第一膜层为栅极金属层205，绝缘层为栅极绝缘层204，第二膜层为源漏极金属层207。S卩，在本实施例中，在基板200上，依次形成有栅极金属层205、栅极绝缘层204、静电分散层220和源漏极金属层207 ;在栅极绝缘层204和静电分散层220上具有过孔230，源漏极金属层207通过该过孔230与栅极金属层205电连接；静电分散层220与源漏极金属层207的轮廓相同。
[0075]在本实施例中，基板200可以是玻璃基板、石英基板等基于无机材料的衬底基板，也可以是采用有机材料的衬底基板。
[0076]在基板200上，形成有栅极金属层205。在显示区域Pa中，栅极金属层205构成TFT器件的栅极以及公共电极走线(图中未示出)，在周边区域Pb中，栅极金属层205可构成周边电路如栅极驱动器等，栅极金属层205通常采用钥、钥合金、铝、铝合金材料制成。
[0077]在栅极金属层205上，形成有栅极绝缘层204，栅极绝缘层204通常由氮化硅、氧化硅或者两者的混合材料构成。该栅极绝缘层204覆盖栅极金属层205与基板200。
[0078]在栅极绝缘层204上，形成有半导体层203与第一透明电极层209。其中，半导体层203的半导体材料可以为非晶硅、氧化物半导体或者多晶硅，由于非晶硅简单易得，在本实施例中，采用非晶硅作为半导体材料，半导体层形成在TFT器件区域，并且与栅极金属层205构成的栅极相对。第一透明电极层209形成在像素开口区域。栅极绝缘层204被半导体层203以及第一透明电极层209部分覆盖。
[0079]在半导体层203、第一透明电极层209及栅极绝缘层204之上，形成有静电分散层220，在显示区域Pa中，静电分散层220部分覆盖半导体层203、第一透明电极层209及栅极绝缘层204，在周边区域Pb中，静电分散层220部分覆盖栅极绝缘层204。该静电分散层220的材料为钥、钛、铁、锌、铝、镁中的至少一种或其组合，这一类材料的导电性较好，并且这些材料的氢标准电极比通常用作栅极材料的钥合金更低，在形成静电分散层220后至形成源漏极金属层207前，可以对位于周边区域Pb中静电分散层220下层的栅极金属金属205起到静电保护作用，并且可以起到阴极保护作用，防止栅极金属层205的电化学腐蚀。并且该静电分散层220的膜厚d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0080]在静电分散层220上形成有源漏极金属层207。在显示区域Pa中，源漏极金属层207通过静电分散层220与半导体层203和第一透明电极层209实现电连接；在周边区域Pb中，源漏极金属层207通过静电分散层220、栅极绝缘层204的过孔230，与栅极金属层205实现电连接。并且，静电分散层220与源漏极金属层207的轮廓相同，在制备过程中可以在同一道工序中形成静电分散层220与源漏极金属层207的轮廓，不增加工序。
[0081]在源漏极金属层207上形成有钝化层208，钝化层208可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅或氧化硅膜与有机钝化层膜或钝化层膜组成的多层膜。在本实施例中，在显示区域Pa中在钝化层208之上，还形成有第二透明电极层211，并且第二透明电极层211上可以形成有多个狭缝(图中未示出)。
[0082]在本实施例中，第一透明电极209形成在钝化层208下层，通过静电分散层220与源漏极金属层207实现电连接，在实际实施过程中，第一透明电极层可以形成在第二透明电极层上层，并且在第一透明电极层与第二透明电极层之间进一步形成层间绝缘层以使得第一透明电极层与第二透明电极层相互绝缘，并且第一透明电极层或者第二透明电极层通过过孔与源漏极金属层实现电连接。还可以不在阵列基板上形成第一透明电极层，仅在钝化层108上形成第二透明电极并通过过孔与源漏极金属层电连接，而在与阵列基板相对的对向基板上形成第一透明电极层。
[0083]更具体地，请参考图5，图5为图4中B区域的放大示意图。结合图4与图5，在栅极绝缘层204上依次形成有静电分散层220、源漏极金属层207、钝化层208，并且静电分散层220与栅极绝缘层204具有过孔230。该静电分散层220在该过孔的倾斜角Θ满足0° <θ<90°，优选30° <θ〈60°，此时由于静电分散层存在倾斜角，积累在基板上的静电更容易通过表面漏电等方式在静电分散层220上进行静电释放，对静电保护效果更好。
[0084]本实施例的阵列基板包含静电分散层，可以降低阵列基板制程中基板上静电的积累，在周边区域中，改善了因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品良率。并且静电分散层与源漏极金属层直接接触，可以降低源漏极金属层的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。
[0085]图6为图4中提供的阵列基板的制造流程的剖视结构示意图。
[0086]参考图6，进行步骤:提供基板，在所述基板一侧的表面上形成第一膜层。
[0087]具体地，请参考图6a，该步骤包括:提供基板200，在基板200上形成栅极金属层205并使之图形化，该栅极金属层205为本实施例中所述的第一膜层。
[0088]形成栅极金属层205并使之图案化，具体包括如下步骤:采用物理沉积方法形成栅极金属材料层，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上；在栅极金属材料层上涂布光刻胶层并烘干该光刻胶层；曝光、显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；栅极金属材料刻蚀，具体为采用湿刻法，使栅极金属材料与栅极金属材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉栅极金属材料物质，直至未被光刻胶覆盖区域的栅极金属材料被全部消耗；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，栅极金属层205形成，在显示区域Pa处，栅极金属层可作为TFT开关元件的栅极、公共电极(图中未示出)等，在周边区域Pb处，栅极金属层205可作为金属走线等。
[0089]请继续参考图6，进行步骤:在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板。
[0090]具体地，请参考图6b，该步骤包括:在栅极金属层205上形成栅极绝缘层204，该栅极绝缘层覆盖该栅极金属层205及基板200，该栅极绝缘层204为本实施例中所述的绝缘层。
[0091]更具体地，栅极绝缘层204通过等离子体增强化学气相沉积完成，栅极绝缘层204可以为单层的氧化硅膜或者单层的氮化硅膜，也可以是氧化硅/氮化硅多层结构。如图6b所述，在栅极金属层205区域，栅极绝缘层204覆盖该栅极金属层205，在其他区域，栅极绝缘层204覆盖基板200。
[0092]请继续参考图6，进行步骤:在所述绝缘层上形成静电分散层。
[0093]如图6c所所示，在栅极绝缘层204上形成静电分散层220前，在栅极绝缘层204上形成半导体层203与第一透明电极层209。需要说明的是，本实施例中半导体层203可以形成在第一透明电极层209之前，也可以形成在第一透明电极层209之后。
[0094]更具体地，上述在栅极绝缘层204上形成半导体层203具体包括:在基板200 —侧的表面沉积非晶硅材料，并图案化所述非晶硅材料。其中，沉积非晶硅材料采用等离子体增强化学气相沉积法。完成非晶硅材料沉积后，图案化所述非晶硅材料，使非晶硅材料在显示区域Pa处形成半导体层203，而在周边区域Pb处，在需要保留非晶硅材料的区域如栅极驱动器电路晶体管区域(图中未示出)形成半导体层，其他区域的非晶硅材料均需要刻蚀去除。具体图案化过程包括:在非晶硅材料层上涂布光刻胶层并烘干该光刻胶层；曝光显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成具有预定图案的光刻胶图案；非晶硅材料刻蚀，具体为采用干刻法，使等离子体中的离子基吸附在非晶硅材料表面后，产生挥发性的反应物；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，半导体层203形成。在实际操作过程中，在涂布光刻胶、曝光显影、刻蚀、剥离等每一个步骤前后，需要对基板进行清洗干燥过程，以除去基板表面的杂质。
[0095]第一透明电极209的形成与图案化与栅极金属层205的形成过程相同，在此不再赘述，不同之处仅在于第一透明电极层209所采用的靶材为氧化铟锡或氧化铟锡等氧化物透明导电材料。
[0096]在完成上述步骤后，在栅极绝缘层204及半导体层203、第一透明电极层209上形成静电分散层220，使静电分散层220整面覆盖基板200。静电分散层220采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。该静电分散层220的材料为钥、钛、铁、锌、铝、镁中的至少一种或其组合，这一类材料的导电性较好，并且这些材料的氢标准电极比通常用作栅极材料的钥合金更低，在后续制程中，可以对位于静电分散层220下层的栅极金属层205起到静电保护作用，并且可以起到阴极保护作用，防止下层栅极金属层205的电化学腐蚀。本实施例中采用钛金属制备静电分散层220。静电分散层220的成膜厚度d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0097]请继续参考图6，进行步骤:在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层。
[0098]请参考图6d，在周边区域Pb处，在静电分散层220、栅极绝缘层204中形成过孔230，使静电分散层220覆盖除过孔230区域外的内介质层206 ;在显示区域Pa中，不形成过孔。
[0099]具体地，在静电分散层220与栅极绝缘层204中形成过孔230的步骤包括:在静电分散层220的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光、显影过程，曝光过程为使用紫外线透过具有预定图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；刻蚀静电分散层220和栅极绝缘层204，以形成具有所述过孔的静电分散层220与栅极绝缘层204 ;去除剩余的光刻胶层。
[0100]更具体地，上述刻蚀静电分散层220和栅极绝缘层204的步骤包括:刻蚀静电分散层220，使所述静电分散层220在所述过孔边缘的倾斜角Θ (图中未示出)满足0° < Θ <90°，优选30°〈 Θ〈60° ;刻蚀栅极绝缘层204。其中刻蚀静电分散层220采用湿刻法，具体刻蚀方法与刻蚀栅极金属层205方法一致，请参考刻蚀栅极金属层205步骤，在此不再赘述。刻蚀栅极绝缘层204采用干刻法，具体过程与刻蚀半导体层203相同，请参考半导体层203的刻蚀步骤，在此不再赘述。
[0101]在光刻胶的剥离后，可以进一步进行清洗烘干，以去除基板200表面的杂质。
[0102]在过孔230形成过程中，以及过孔形成后光刻胶的剥离过程中以及清洗、烘干过程中，以及基板的运输过程中，基板容易受到静电影响。静电的来源主要来自以下三个方面:摩擦起电，包括运输过程中与空气摩擦、玻璃基板与毛刷摩擦、玻璃基板与基台的摩擦、清洗过程中纯水的冲刷摩擦、风刀的空气摩擦等；接触分离起电，包括玻璃基板与基台接触后分离、等离子体轰击、离子轰击、药液接触等；感应起电如接近带电的物体感应出静电。当静电积累到一定程度后，容易引起静电的释放。由于在整个过孔230的形成过程中，基板表面一直覆盖有静电分散层220，累积在栅极金属层205上的静电可以通过空气大电阻等途径经过表面漏电释放到静电分散层220表面，不会对栅极金属层205造成静电损伤。并且，由于钛金属的氢标准电极比通常用作栅极材料的钥合金更低，在形成过孔的过程中，可以对位于静电分散层220下层的栅极金属层205起到阴极保护作用，防止下层金属的电化学腐蚀。
[0103]请继续参考图6，进行步骤:在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接。
[0104]请参考图6e，在静电分散层220上形成源漏极金属层207，使源漏极金属层整面覆盖基板200。在显示区域Pa中，该源漏极金属层207通过静电分散层220与半导体层203电性连接；在周边区域Pb中，该源漏极金属层207通过前述步骤中形成的过孔230与栅极金属层203电连接。本实施例中所述的第二膜层即为该源漏极金属层207。源漏极金属层207采用物理沉积法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。
[0105]请继续参考图6，进行步骤:图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0106]请参考图6f，图案化该源漏极金属层207与静电分散层220，使该静电分散层220与该源漏极金属层207轮廓相同。
[0107]具体包括以下步骤:在第二膜层即源漏极金属层207的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光与显影，曝光显影过程与前述步骤中光刻胶的曝光显影过程相同，在此不再赘述；刻蚀第二膜层即源漏极金属层207与静电分散层220以使该静电分散层220与源漏极金属层207轮廓相同；去除剩余的所述光刻胶层。由于源漏极金属层207与静电分散层220均为金属材料层，所以源漏极金属层207与静电分散层220的刻蚀过程可以一步进行，采用湿刻法，使源漏极金属层207与静电分散层220未被光刻胶覆盖区域的材料与材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉金属材料物质，直至未被光刻胶覆盖区域的源漏极金属材料与静电分散层材料被全部消耗，使得源漏极金属层207与静电分散层220具有相同的轮廓。
[0108]静电分散层220与源漏极金属层207直接接触，可以降低源漏极金属层207的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。
[0109]进一步地，请参考图6g，在图案化源漏极金属层207与静电分散层220后，在源漏极金属层207上形成钝化层208，钝化层208可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。在形成钝化层208后，进一步形成第二透明电极层211作为公共电极，并且进一步在第二透明电极层211上可以形成多个狭缝(图中未示出)。第二透明电极层211的形成方法与前述第一透明电极层209的形成方法相同，在此不再赘述。
[0110]本实施例的阵列基板的制造方法，在制造过程中形成静电分散层，降低阵列基板制程中基板上静电的积累，改善了因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品良率。并且静电分散层与源漏极金属层直接接触，可以降低源漏极金属层的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。并且，在静电分散层的图案化过程中，与源漏极金属层采用同一张掩膜板，不增加制造工序。
[0111]图7为本发明实施例提供的又一种阵列基板的剖视结构示意图，Pa为该阵列基板显示区，Pb为该阵列基板周边区域。
[0112]参考图7,该阵列基板包括:基板300,依次设置于该基板300 —侧表面上的第一膜层、绝缘层、静电分散层320和第二膜层；绝缘层和静电分散层具有过孔，第二膜层通过该过孔与第一膜层电性连接；静电分散层320与所述第二膜层的轮廓相同。在本实施例中，第一膜层为源漏极金属层307，绝缘层为钝化层308，第二膜层为第一透明电极层309。BP,在本实施例中，在基板300上，依次形成有源漏极金属层307、钝化层308、静电分散层320和第一透明电极层309 ;在钝化层308和静电分散层320上具有过孔332，第一透明电极层309通过该过孔332与源漏极金属层307电性连接；静电分散层320与第一透明电极层309的轮廓相同。
[0113]更具体地，请继续参考图7，本实施例中所述的阵列基板中，进一步包括基板300、缓冲层302、半导体层303、栅极绝缘层304、栅极金属层305、内介质层层306。
[0114]在本实施例中，基板300可以是玻璃基板、石英基板等基于无机材料的衬底基板，也可以是采用有机材料的衬底基板。
[0115]在基板300上，为了防止基板300中的金属离子如铝离子、钡离子、钠离子等在热工艺中扩散到半导体层303的有源区，并且为了降低热传导等，一般形成有缓冲层302。缓冲层302通常由氮化硅、氧化硅或者两者的混合材料构成。通常，为了防止背光对半导体的影响，还可以在基板上与半导体有源区相对应的位置形成遮光层(图中未示出)，遮光层通常由一层很薄的金属材料构成。
[0116]在缓冲层302上，形成有半导体层303，半导体材料可以为非晶硅、氧化物半导体或者多晶硅，由于多晶硅电子迁移率高，因此本实施例中采用多晶硅作为半导体材料。半导体层303中进一步包含有源区和源漏极连接区(图中未示出)。
[0117]在半导体层303上，形成有栅极绝缘层304，栅极绝缘层304通常由氮化硅、氧化硅或者两者的混合材料构成。
[0118]在栅极绝缘层304上，形成有栅极金属层305。在显示区域Pa中，栅极金属层305构成TFT器件的栅极、公共电极(图中未示出)等，在周边区域Pb中，栅极金属层305可构成周边电路如栅极驱动器等，栅极金属层通常采用钥、钥合金、铝、铝合金材料制成。
[0119]在栅极金属层305上,形成有内介质层306,内介质层306可以是由氧化娃、氮化娃或者两者的混合材料构成的单层膜，也可以是由氧化硅、氮化硅多层膜层叠而成。
[0120]在内介质层306上，形成有源漏极金属层307，即本实施例所述的第一膜层。在显示区域Pa中，源漏极金属307通过内介质层306中的过孔和栅极绝缘层304中的过孔330与半导体层303电连接；在周边区域Pb中，源漏极金属层307通过内介质层306的过孔331与栅极金属层305电连接。
[0121]需要说明的是，在本实施例中，是以顶栅结构的TFT器件作为说明，在实际实施过程中，也可以是底栅结构的TFT器件，即在基板上，依次形成有栅极、栅极绝缘层、半导体层以及源漏极金属层。
[0122]请继续参考图7，在源漏极金属层307上形成有钝化层308，钝化层308可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜和有机钝化层膜/无机钝化层膜组成的多层膜。
[0123]在钝化层308之上，形成有静电分散层320，该静电分散层320的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在形成静电分散层320后至形成第一透明电极层309前,该静电分散层320可以对位于静电分散层320下层的金属层和半导体层起到静电保护作用。并且该静电分散层320的膜厚d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0124]在静电分散层320上形成有第一透明电极层309。在显示区域Pa中，第一透明电极309通过钝化层308和静电分散层320的过孔332与源漏极金属层307实现电连接。并且，静电分散层320与第一透明电极层309的轮廓相同，在制备过程中可以在同一道工序中形成静电分散层320与第一透明电极层309的轮廓，不增加工序。
[0125]在第一透明电极层上，可以进一步形成层间绝缘层310与第二透明电极层311，层间绝缘层310由硅的氧化物、硅的氮化物、硅的氮氧化物中的一种或两种构成，优选材质为氮化硅。第二透明电极层311由氧化铟锡或者氧化铟锡构成。且第二透明电极层311上形成有多条狭缝(图中未示出)。
[0126]需要说明的是，本实施例是以横电场模式驱动液晶的显示面板为例说明的，并且以第一透明电极层309作为像素电极，在实际实施过程中，可以是第一透明电极层包含与连接部与电极部，并且第二透明电极层通过过孔与连接部电连接实现与源漏极金属层的电连接来作为像素电极。在实际实施过程中，还可以是在阵列基板上仅形成第一透明电极层，经图案化构造使其成为互相绝缘的两部分分别作为像素电极与公共电极，或者仅在阵列基板上形成第一透明电极层，而在与阵列基板对置的基板上形成第二透明电极层。
[0127]更具体地，请参考图8，图8为图7中C区域的放大示意图。结合图7与图8，在钝化层308上依次形成有静电分散层320、第一透明电极层309、层间绝缘层310，并且静电分散层320与钝化层308具有过孔332。该静电分散层320在该过孔332处的倾斜角倾斜角Θ满足0° <θ<90°，优选30° <θ〈60°，此时由于静电分散层存在倾斜角，积累在基板上的静电更容易通过表面漏电等方式在静电分散层320上进行静电释放，对静电保护效果更好。
[0128]本实施例的阵列基板包含静电分散层，可以降低阵列基板制程中基板上静电的积累，在显示区域中，源漏极金属层与半导体层电连接，半导体层以及源漏极金属层上积累的电荷可以通过表面漏电至静电分散层得到释放，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。并且静电分散层与第一透明电极直接接触，可以降低第一透明电极层的电阻，提高显示品质。
[0129]图9为图7中提供的阵列基板的制造流程的剖视结构示意图。
[0130]参考图9，进行步骤:提供基板，在所述基板一侧的表面上形成第一膜层。
[0131]具体地，请参考图9a，该步骤包括:在基板300上形成源漏极金属层307并使之图案化，该源漏极金属层307为本实施例中所述的第一膜层。
[0132]更具体地，形成源漏极金属层307并使之图案化包括以下步骤:提供基板300 ;在基板300上形成缓冲层302 ;在缓冲层302上形成半导体层303并图案化；在半导体层303上形成栅极绝缘层304 ;在栅极绝缘层304上形成栅极金属层305并图案化；在栅极金属层305上形成内介质层306并过孔；在内介质层306上形成源漏极金属层307并图案化。
[0133]提供基板300,本实施例中，基板300可以是玻璃基板、石英基板等基于无机材料的衬底基板，也可以是采用有机材料的衬底基板。
[0134]在基板300上形成缓冲层302。缓冲层302可防止基板300中的金属离子如铝离子、钡离子、钠离子等在热工艺中扩散到半导体层303的有源区，并且可以降低热传导。缓冲层302由氮化硅、氧化硅或者两者的混合材料构成。本实施例中，采用等离子体增强化学气相沉积法沉积缓冲层302。在实际实施过程中，为了防止背光对半导体的影响，在形成缓冲层302前，还可以在基板300上与半导体层有源区相对应的位置形成遮光层(图中未示出)，遮光层通常由一层很薄的金属材料构成，采用物理沉积法如溅射来制备。
[0135]在缓冲层302上形成半导体层303，并图案化。半导体材料可以为非晶硅、氧化物半导体或者多晶硅，由于多晶硅电子迁移率高，因此本实施例中采用低温硅作为半导体材料。
[0136]更具体地，本实施例中形成多晶硅半导体层303包括以下步骤:在基板300 —侧的表面沉积非晶硅材料，对该非晶硅材料进行晶化，将该非晶硅材料转化为多晶硅材料。其中，沉积非晶硅材料通过等离子体增强化学气相沉积进行，沉积厚度为450A。在沉积完成后，加热使其去氢，加热温度500°C。完成去氢后，可对非晶硅材料进行晶化，晶化可以采用准分子激光晶化工艺、固相晶化工艺或快速热退火工艺。由于准分子激光晶化工艺过程中非晶硅薄膜的熔化结晶过程非常短，对衬底的热冲击很小，可以使用不耐高温的廉价玻璃基板，可以降低制造成本，因此在本实施例中，采用准分子激光晶化工艺对非晶硅材料进行晶化。
[0137]在完成上述非晶硅材料的晶化后，图案化所述多晶硅材料，使多晶硅材料在显示区域Pa处形成半导体层303，而在周边区域Pb处，在需要保留多晶硅材料的区域如栅极驱动器晶体管区域(图中未示出)形成半导体层，其他区域的多晶硅材料均需要刻蚀去除。具体图案化过程包括:在多晶硅材料层上涂布光刻胶层并烘干该光刻胶层；曝光、显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成具有预定图案的光刻胶图案；多晶硅材料刻蚀，具体为采用干刻法，使等离子体中的离子基吸附在多晶硅材料表面后，产生挥发性的反应物；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，半导体层303形成。在实际操作过程中，在涂布光刻胶、曝光显影、刻蚀、剥离等每一个步骤前后，需要对基板进行清洗干燥过程，以除去表面的杂质。
[0138]在半导体层303形成后，进一步进行沟道掺杂，使半导体层303形成有源区和源漏极连接区(图中未示出)。
[0139]在半导体层303上形成栅极绝缘层304。栅极绝缘层304通过等离子体增强化学气相沉积完成，栅极绝缘层304可以为单层的氧化硅膜或者单层的氮化硅膜，也可以是氧化硅/氮化硅多层结构。在半导体层303区域，栅极绝缘层304覆盖该半导体层303，在其他区域，栅极绝缘层304覆盖缓冲层302。
[0140]在栅极绝缘层304上形成栅极金属层305并图案化。具体包括:采用溅射法在栅极绝缘层305上形成栅极金属材料层；在栅极金属材料层上涂布光刻胶层并烘干该光刻胶层；曝光显影，具体包括使用紫外线透过具有预定图案的掩膜板照射光刻胶层，曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；栅极金属材料刻蚀，具体为采用湿刻法，使栅极金属材料与栅极金属材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉栅极金属材料物质，直至没有被光刻胶覆盖区域的栅极金属材料被全部消耗；光刻胶剥离，即采用剥离液除去剩余的光刻胶。至此，栅极金属层305形成，在显示区域Pa处，栅极金属层可作为TFT开关元件的栅极、公共电极(图中未示出)等，在周边区域Pb处，栅极金属层305可作为金属走线等。
[0141]在栅极金属层305上形成内介质层306并过孔，在显示区域Pa中，形成过孔330，在周边区域Pb中形成过孔331。内介质层306可以为单层的氧化硅膜或者单层的氮化硅膜，也可以是氧化硅/氮化硅双层结构，其形成方法与形成栅极绝缘层304的方法一致，即采用等离子体增强化学气相沉积，具体请参考栅极绝缘层304的形成步骤，在此不再赘述。在内介质层306上过孔包括:在内介质层306的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光、显影过程，曝光过程为使用紫外线透过具有过孔图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成过孔图案的光刻胶图案；刻蚀内介质层306，以形成具有过孔的内介质层306 ;去除剩余的所述光刻胶层。
[0142]在内介质层306上形成源漏极金属层307并图案化。在内介质层306上沉积源漏极金属层材料，使源漏极电极层307整面覆盖基板300。源漏极电金属层307采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。在显示区域Pa中，该源漏极金属层307通过前述步骤中形成的过孔330与半导体层303电性连接；在周边区域Pb中，该源漏极金属层307通过前述步骤中形成的过孔331与栅极金属层305电连接。图案化源漏极金属层307的具体步骤与图案化栅极金属层305具体步骤相同，在此不再赘述。
[0143]请继续参考图9，进行步骤:在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板。
[0144]具体地，请参考图％，该步骤包括，在源漏极金属层307上形成钝化层308，该钝化层308覆盖源漏极金属层307及基板300，该钝化层308即本实施例所述的绝缘层。
[0145]钝化层308可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。采用等离子体增强化学气相沉积形成钝化层308。
[0146]请继续参考图9，进行步骤:在所述绝缘层上形成静电分散层。
[0147]请参考图9c，该步骤包括，在钝化层308上形成静电分散层320，使静电分散层320整面地覆盖基板300。静电分散层320采用物理沉积法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。该静电分散层320的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在后续制程中，该静电分散层320可以对位于静电分散层320下层的源漏极金属层307和半导体层303起到静电保护作用。本实施例中采用氧化铟锡制备静电分散层320。静电分散层320的成膜厚度d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0148]请继续参考图9，进行步骤:在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层。
[0149]请参考图9d，在显示区域Pa处，在静电分散层320、钝化层308中形成过孔332，使静电分散层320覆盖该过孔332区域外的钝化层308 ;在周边区域Pb处，无过孔形成。
[0150]具体地，在静电分散层320与绝缘层即钝化层308中形成过孔332的步骤包括:在静电分散层320的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光、显影过程，曝光过程为使用紫外线透过具有预定图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；刻蚀静电分散层320和绝缘层即钝化层308，以形成具有所述过孔332的所述静电分散层320与所述钝化层308 ;去除剩余的所述光刻胶层。
[0151]更具体地，上述刻蚀静电分散层320和钝化层308的步骤包括:刻蚀静电分散层320，使所述静电分散层320在所述过孔332边缘的倾斜角Θ (图中未示出)满足0° < Θ <90°，优选30° <θ〈60° ;刻蚀所述绝缘层。
[0152]在光刻胶的剥离后，可以进一步进行清洗烘干，以去除基板300表面的杂质。
[0153]在过孔形成过程中，以及过孔形成后光刻胶的剥离过程中以及清洗、烘干过程中，以及基板的运输过程中，基板容易受到静电影响。静电的来源主要来自以下三个方面:摩擦起电，包括运输过程中与空气摩擦、玻璃基板与毛刷摩擦、玻璃基板与基台的摩擦、清洗过程中纯水的冲刷摩擦、风刀的空气摩擦等；接触分离起电，包括玻璃基板与基台接触后分离、等离子体轰击、离子轰击、药液接触等；感应起电比如接近带电的物体感应出静电。当静电积累到一定程度后，容易引起静电的释放。由于在整个过孔的形成过程中，基板表面一直覆盖有静电分散层320，累积在半导体层303与源漏极金属层307上的静电可以通过空气大电阻等途径经过表面漏电释放到静电分散层320表面，不会对半导体层303以及源漏极金属层307造成静电损伤。
[0154]请继续参考图9，进行步骤:在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接。
[0155]请参考图9e，在静电分散层320上形成第一透明电极层309，使第一透明电极层309整面覆盖基板300。在显示区域Pa中，该第一透明电极层309通过前述步骤中形成的过孔332与源漏极金属层307电性连接。本实施例中所述的第二膜层即为该第一透明电极层309。第一透明电极层309采用物理沉积法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上，靶材可以为氧化铟锡或者氧化铟锌。
[0156]请继续参考图9，进行步骤:图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0157]请参考图9f，图案化该第一透明电极层309与静电分散层320，使该静电分散层320与该第一透明电极层309轮廓相同。
[0158]具体包括以下步骤:在第二膜层即第一透明电极层309的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光与显影，曝光显影过程与前述步骤中光刻胶的曝光显影过程相同，在此不再赘述；刻蚀第二膜层即第一透明电极层309与静电分散层320以使该静电分散层320与第一透明电极层309轮廓相同；去除剩余的所述光刻胶层。由于第一透明电极层309与静电分散层320均为氧化物透明导电材料，所以第一透明电极层309与静电分散层320的刻蚀过程可以一步进行，采用湿刻法，使第一透明电极层309与静电分散层320未被光刻胶覆盖区域的材料与材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉材料物质，直至未被光刻胶覆盖区域的第一透明电极材料与静电分散层材料被全部消耗，使得第一透明电极层309与静电分散层320具有相同的轮廓。
[0159]静电分散层320与第一透明电极层309直接接触，可以降低第一透明电极层309的电阻，改善显示器信号在第一透明电极上的延迟衰减的情况，提高显示品质。
[0160]进一步地，请参考图9g，在图案化第一透明电极层309与静电分散层320后，可以在第一透明电极层309上依次形成层间绝缘层310、第二透明电极层311。
[0161]本实施例的阵列基板的制造方法，在制造过程中形成静电分散层，降低阵列基板制程中基板上静电的积累，在显示区域中，源漏极金属层与半导体层电连接，半导体层以及源漏极金属层上积累的电荷可以通过表面漏电释放到静电分散层表面，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。并且静电分散层与第一透明电极层层直接接触，可以降低第一透明电极层的电阻，改善显示器信号在第一透明电极层上的延迟衰减的情况，提高显示品质。并且，在静电分散层的图案化过程中，与第一透明电极层采用同一张掩膜板，不增加制造工序。
[0162]图10为本发明实施例提供的又一种阵列基板的剖视结构示意图，Pa为该阵列基板显示区域，Pb为该阵列基板周边区域。
[0163]参考图10,该阵列基板包括:基板400,依次设置于该基板400 —侧表面上的第一膜层、绝缘层、静电分散层420和第二膜层；绝缘层和静电分散层具有过孔，第二膜层通过该过孔与第一膜层电性连接；静电分散层420与所述第二膜层的轮廓相同。在本实施例中，第一膜层为源漏极金属层407，绝缘层为层间绝缘层410，第二膜层为第二透明电极层410。即，在本实施例中，在基板400上，依次形成有源漏极金属层407、钝化层408、第一透明电极层409、层间绝缘层410、静电分散层420和第二透明电极层411 ;在层间绝缘层410和静电分散层420上具有过孔433，第二透明电极层411通过该过孔433与源漏极金属层407电性连接；静电分散层420与第二透明电极层411的轮廓相同。
[0164]更具体地，请继续参考图10，本实施例中所述的阵列基板中，进一步包括基板400、缓冲层402、半导体层403、栅极绝缘层404、栅极金属层405、内介质层406和源漏极金属层407。请结合参考图10与图7，本实施例中该基板400、缓冲层402、半导体层403、栅极绝缘层404、栅极金属层405、内介质层层406和源漏极金属层407与本发明另一实施例中基板300、缓冲层302、半导体层303、栅极绝缘层304、栅极金属层305、内介质层层306合源漏极金属层307的结构相同，具体结构请参考另一实施例，在此不再赘述，本实施例具体叙述与另一实施例不同之处。
[0165]请继续参考图10，在源漏极金属层407上形成有钝化层408，钝化层408可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。且该钝化层408在显示区域Pa中，在源漏极金属层407构成的漏极区域具有过孔432。
[0166]在钝化层408上，形成有第一透明电极层409，第一透明电极由氧化铟锡或者氧化铟锌构成，第一透明电极层409部分覆盖钝化层408。
[0167]在第一透明电极层409上，形成有层间绝缘层410。层间绝缘层410由硅的氧化物、硅的氮化物、硅的氮氧化物中的一种或两种构成，优选材质为氮化硅。该层间绝缘层410覆盖钝化层408的过孔432部分，以及基板400的其他区域。
[0168]在层间绝缘层410之上，形成有静电分散层420，该静电分散层420的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在形成静电分散层420后至形成第二透明电极层411前，该静电分散层420可以对位于静电分散层420下层的源漏极金属层407和半导体层403起到静电保护作用。并且该静电分散层420的膜厚d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。且静电分散层420与层间绝缘层410在显示区域Pa中在源漏极金属层407构成的漏极区域具有过孔433。
[0169]在静电分散层420上形成有第二透明电极层411。在显示区域Pa中，第二透明电极411通过层间绝缘层410和静电分散层420的过孔433与源漏极金属层407实现电连接。并且，静电分散层420与第二透明电极层411的轮廓相同，在制备过程中可以在同一道工序中形成静电分散层420与第二透明电极层411的轮廓，不增加工序。
[0170]更具体地，请参考图11，图11为图10中D区域的放大示意图。结合图10与图11，在层间绝缘层410上依次形成有静电分散层420、第二透明电极层411，并且静电分散层420与层间绝缘层410具有过孔433。该静电分散层420在该过孔433的倾斜角倾斜角Θ满足0° <θ<90°，优选30° <θ〈60°，此时由于静电分散层存在倾斜角，积累在基板上的静电更容易通过表面漏电等方式在静电分散层420上进行静电释放，对静电保护效果更好。
[0171]本实施例的阵列基板包含静电分散层，可以降低阵列基板制程中基板上静电的积累，在显示区域中，源漏极金属层与半导体层电连接，半导体层以及源漏极金属层上积累的电荷可以通过表面漏电释放至静电分散层表面，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura0并且静电分散层与第二透明电极直接接触，可以降低第二透明电极层的电阻，提高显不品质。
[0172]图12为图10中提供的阵列基板的制造流程的剖视结构示意图。
[0173]参考图12，进行步骤:提供基板，在所述基板一侧的表面上形成第一膜层。
[0174]具体地，请参考图12a，该步骤包括:在基板400上形成源漏极金属层407并图案化，该源漏极金属层407为本实施例中所述的第一膜层。
[0175]更具体地，请结合参考图12a与图9a，本实施例中的在所述基板一侧的表面上形成第一膜层的步骤与本发明另一实施例中形成第一膜层的步骤相同，具体请参考另一实施例中第一膜层的形成步骤，在此不再赘述。
[0176]请继续参考图12，进行步骤:在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板。
[0177]具体地，请参考图12b，该步骤包括:在源漏极金属层407上形成钝化层408并图案化；在钝化层408上形成第一透明电极层409并图案化；在第一透明电极层409上形成层间绝缘层410。该层间绝缘层410即本实施例所述的绝缘层。
[0178]在源漏极金属层407上形成钝化层408并图案化。钝化层408可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。采用等离子体增强化学气相沉积形成钝化层408。钝化层408的图案化即在钝化层在源漏极金属层407形成的漏极相对应位置形成过孔433，该形成过孔433的步骤包括:在钝化层408的表面形成光刻胶层；图案化该光刻胶层，具体包括曝光与显影；刻蚀该钝化层408，以形成预定的过孔；去除剩余的光刻胶层。
[0179]在钝化层408上形成第一透明电极层409并图案化。在钝化层408上通过物理沉积法形成第一透明电极层409，使第一透明电极层409整面覆盖基板400。具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上，采用的靶材为氧化铟锡或者氧化铟锌。图案化第一透明电极层409包括:在第一透明电极层409的表面形成光刻胶层；图案化该光刻胶层，具体包括曝光与显影；刻蚀该第一透明电极层409，以形成预定的图案；去除剩余的光刻胶层。
[0180]在第一透明电极层409上形成层间绝缘层410。层间绝缘层410可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。采用等离子体增强化学气相沉积形成钝化层410。
[0181]请继续参考图12，进行步骤:在所述绝缘层上形成静电分散层。
[0182]请参考图12c，该步骤包括，在层间绝缘层410上形成静电分散层420，使静电分散层420整面地覆盖基板400。静电分散层420采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。该静电分散层420的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在后续制程中，该静电分散层420可以对位于静电分散层420下层的源漏极金属层407和半导体层403起到静电保护作用。本实施例中采用氧化铟锡制备静电分散层420。静电分散层420的成膜厚度d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0183]请继续参考图12，进行步骤:在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层。
[0184]请参考图12d，在显示区域Pa处，在静电分散层420、层间绝缘层411中与源漏极金属层407形成的漏极处形成过孔433，使静电分散层420覆盖该过孔区域外的层间绝缘层410 ;在周边区域Pb处，无过孔形成。
[0185]具体地，在静电分散层420与绝缘层即层间绝缘层410中形成过孔433的步骤包括:在静电分散层420的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光、显影过程，曝光过程为使用紫外线透过具有预定图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；刻蚀静电分散层420和绝缘层即层间绝缘层410，以形成具有所述过孔的所述静电分散层420与所述绝缘层即层间绝缘层410 ;去除剩余的所述光刻胶层。
[0186]更具体地，上述刻蚀静电分散层420和层间绝缘层410的步骤包括:刻蚀静电分散层420，使所述静电分散层在所述过孔边缘的倾斜角Θ (图中未示出)满足0° < Θ <90°，优选30° <θ〈60° ;刻蚀所述层间绝缘层410。
[0187]在光刻胶的剥离后，可以进一步进行清洗烘干过程，以去除基板400表面的杂质。
[0188]在过孔433形成过程中，以及过孔433形成后光刻胶的剥离过程中以及清洗、烘干过程中，以及基板的运输过程中，基板容易受到静电影响。静电的来源主要来自以下三个方面:摩擦起电，包括运输过程中与空气摩擦、玻璃基板与毛刷摩擦、玻璃基板与基台的摩擦、清洗过程中纯水的冲刷摩擦、风刀的空气摩擦等；接触分离起电，包括玻璃基板与基台接触后分离、等离子体轰击、离子轰击、药液接触等；感应起电比如接近带电的物体感应出静电。当静电积累到一定程度后，容易引起静电的释放。由于在整个过孔的形成过程中，基板表面一直覆盖有静电分散层420，累积在半导体层403与源漏极金属层407上的静电可以通过空气大电阻等途径经过表面漏电释放到静电分散层420表面，不会对半导体层403以及源漏极金属层造成静电损伤。
[0189]请继续参考图12，进行步骤:在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接。
[0190]请参考图12e，在静电分散层420上形成第二透明电极层411，使第二透明电极层411整面覆盖基板400。在显示区域Pa中，该第二透明电极层411通过前述步骤中形成的过孔433与源漏极金属层407电性连接。本实施例中所述的第二膜层即为该第二透明电极层411。第二透明电极层411采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。
[0191]请继续参考图12，进行步骤:图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0192]请参考图12f，图案化该第二透明电极层411与静电分散层420，使该静电分散层420与该第二透明电极层411轮廓相同。
[0193]具体包括以下步骤:在第二膜层即第二透明电极层411的表面形成光刻胶层；图案化所述光刻胶层，图案化过程与前述步骤中图案化光刻胶相同，在此不再赘述；刻蚀第二膜层即第二透明电极层411与静电分散层420以使该静电分散层420与第二透明电极层411轮廓相同；去除剩余的所述光刻胶层。由于第二透明电极层411与静电分散层420均为氧化物透明导电材料，所以第二透明电极层411与静电分散层420的刻蚀过程可以一步进行，采用湿刻法，使第二透明电极层411与静电分散层420未被光刻胶覆盖区域的材料与材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉材料物质，直至未被光刻胶覆盖区域的第二透明电极材料与静电分散层材料被全部消耗，使得第二透明电极层411与静电分散层420具有相同的轮廓。
[0194]静电分散层420与第二透明电极层411直接接触，可以降低第二透明电极层411的电阻，改善显示器信号在第二透明电极上的延迟衰减的情况，提高显示品质。
[0195]本实施例的阵列基板的制造方法，在制造过程中形成静电分散层，可降低阵列基板制程中基板上静电的积累，在显示区域中，源漏极金属层与半导体层电连接，半导体层以及源漏极金属层上积累的电荷可以通过表面漏电释放至静电分散层表面，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。并且静电分散层与第二透明电极层直接接触，可以降低第二透明电极层的电阻，改善显示器信号在第二透明电极层上的延迟衰减的情况，提高显示品质。并且，在静电分散层的图案化过程中，与第二透明电极层采用同一张掩膜板，不增加制造工序。
[0196]图13为本发明实施例提供的又一种阵列基板的剖视结构示意图，Pa为该阵列基板显示区域，Pb为该阵列基板周边区域。
[0197]参考图13,该阵列基板包括:基板500,依次设置于该基板500 —侧表面上的第一膜层、绝缘层、静电分散层520和第二膜层；绝缘层和静电分散层具有过孔，第二膜层通过该过孔与第一膜层电性连接；静电分散层520与所述第二膜层的轮廓相同。在本实施例中，第一膜层为第一透明电极层509，绝缘层为层间绝缘层510，第二膜层为第二透明电极层511。即，在本实施例中，在基板500上，依次形成有第一透明电极层509、层间绝缘层510、静电分散层520和第二透明电极层511 ;在层间绝缘层510和静电分散层520上具有过孔533，第二透明电极层511通过该过孔533与第一透明电极层509电性连接；静电分散层520与第二透明电极层511的轮廓相同。
[0198]更具体地，请继续参考图13，本实施例中所述的阵列基板中，进一步包括基板500、缓冲层502、半导体层503、栅极绝缘层504、栅极金属层505、内介质层层506和源漏极金属层507。请结合参考图13与图7，本实施例中基板500、缓冲层502、半导体层503、栅极绝缘层504、栅极金属层505、内介质层层506和源漏极金属层507与本发明另一实施例中基板300、缓冲层302、半导体层303、栅极绝缘层304、栅极金属层305、内介质层层306和源漏极金属层307的结构相同，具体结构轻参考另一实施例，在此不再赘述，本实施例具体叙述与另一实施例不同之处。
[0199]请继续参考图13，在源漏极金属层507上形成有钝化层508，钝化层508可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。且该钝化层508在显示区域Pa中，在源漏极金属层507形成的漏极处具有过孔532。
[0200]在钝化层508上，形成有第一透明电极层509，即本实施例所述的第一膜层。第一透明电极层509由氧化铟锡或者氧化铟锌构成，第一透明电极层509部分覆盖钝化层508。并且第一透明电极层509进一步包含连接部509a和电极部509b，且连接部509a与电极部509b相互分离。该连接部509a通过前述钝化层508的过孔532与源漏极金属层507电连接。
[0201]在第一透明电极层509上，形成有层间绝缘层510，即本实施例所述的绝缘层。层间绝缘层510由硅的氧化物、硅的氮化物、硅的氮氧化物中的一种或两种构成，优选材质为氮化硅。该层间绝缘层510覆盖第一透明电极层509与基板500的其他区域。
[0202]在层间绝缘层510之上，形成有静电分散层520，该静电分散层520的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在形成静电分散层520后至形成第二透明电极层511前，该静电分散层520可以对位于静电分散层520下层的源漏极金属层507、半导体层503起到静电保护作用。并且该静电分散层520的膜厚d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。且静电分散层520与层间绝缘层510在显示区域Pa中在第一透明电极层509的连接部509a处具有过孔533。
[0203]在静电分散层520上形成有第二透明电极层511，即本实施例所述的第二膜层。在显示区域Pa中，第二透明电极511通过层间绝缘层510和静电分散层520的过孔533与第一透明电极层509的连接部509a电连接。并且，静电分散层520与第二透明电极层511的轮廓相同，在制备过程中可以在同一道工序中形成静电分散层520与第二透明电极层511的轮廓，不增加工序。
[0204]更具体地，请参考图14，图14为图13中E区域的放大示意图。结合图13与图14，在第一透明电极层509上依次形成有层间绝缘层510、静电分散层520、第二透明电极层511，并且静电分散层520与层间绝缘层510具有过孔533。该静电分散层520在该过孔533的倾斜角倾斜角Θ满足0° < Θ <90°，优选30°〈 Θ〈60°，此时由于静电分散层存在倾斜角，积累在基板上的静电更容易通过表面漏电等方式在静电分散层520上进行静电释放，对静电保护效果更好。
[0205]本实施例的阵列基板包含静电分散层，降低阵列基板制程中基板上静电的积累，在显示区域中，第一透明电极层的连接部、源漏极金属层与半导体层电连接，半导体层以及源漏极金属层上积累的电荷可以通过表面漏电至静电分散层从而得到释放，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。并且静电分散层与第二透明电极直接接触，可以降低第二透明电极层的电阻，提高显示品质。
[0206]图15为图13中提供的阵列基板的制造流程的剖视结构示意图。
[0207]参考图15，进行步骤:提供基板，在所述基板一侧的表面上形成第一膜层。
[0208]具体地，请参考图15a，该步骤包括:在基板500上形成第一透明电极层509并图案化，该第一透明电极层509为本实施例中所述的第一膜层。
[0209]更具体地，本实施中在所述基板一侧的表面上形成第一膜层的步骤进一步包括:提供基板500 ;在基板500上形成缓冲层502 ;在缓冲层502上形成半导体层503并图案化；在半导体层503上形成栅极绝缘层504 ;在栅极绝缘层504上形成栅极金属层505并图案化；在栅极金属层505上形成内介质层506并过孔；在内介质层506上形成源漏极金属层507并图案化；在源漏极金属层507上形成钝化层508并图案化；在钝化层508上形成第一透明电极层并图案化。
[0210]请结合参考图15a与图9a，本实施例中形成第一膜层的步骤中在形成钝化层508并图案化之前的步骤与本发明另一实施例中形成第一膜层的步骤相同，具体请参考另一实施例中第一膜层的形成步骤，在此不再赘述。
[0211]与另一实施例中形成第一膜层的步骤的不同之处将重点叙述。在形成源漏极金属层507后，在源漏极金属层507上形成钝化层508并图案化。钝化层508可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。采用等离子体增强化学气相沉积形成钝化层508。钝化层508的图案化即在钝化层在源漏极金属层507形成的漏极相对应位置形成过孔532，该形成过孔532的步骤包括:在钝化层508的表面形成光刻胶层；图案化该光刻胶层，具体包括曝光与显影；刻蚀该钝化层508，以形成预定的过孔；去除剩余的所述光刻胶层。
[0212]在钝化层508上形成第一透明电极层509并图案化。在钝化层508上通过物理沉积法形成第一透明电极层509，使第一透明电极层509整面覆盖基板500。具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。图案化第一透明电极层509包括:在第一透明电极层509的表面形成光刻胶层；图案化该光刻胶层，具体包括曝光与显影；刻蚀该第一透明电极层509，以形成预定的图案；去除剩余的所述光刻胶层。通过图案化过程，第一透明电极层509被形成为通过前述钝化层508的过孔532与源漏极金属层507电连接的连接部509a，与连接部相分离的电极部509b。
[0213]请继续参考图15，进行步骤:在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板。
[0214]具体地，请参考图15b，该步骤包括:在第一透明电极层509上形成层间绝缘层510。该层间绝缘层510即本实施例所述的绝缘层。
[0215]在第一透明电极层509上形成层间绝缘层510。层间绝缘层510可以是有机钝化层或者无机钝化层的单层膜，也可以是由氮化硅/氧化硅膜与有机钝化层膜/无机钝化层膜组成的多层膜。采用等离子体增强化学气相沉积形成钝化层510。
[0216]请继续参考图15，进行步骤:在所述绝缘层上形成静电分散层。
[0217]请参考图15c，该步骤包括，在层间绝缘层510上形成静电分散层520，使静电分散层520整面地覆盖基板500。静电分散层520采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。该静电分散层520的材料为氧化铟锡或氧化铟锌，这一类材料的导电性较好，并且不影响透过率。在后续制程中，该静电分散层520可以对位于静电分散层520下层的金属层和半导体层起到静电保护作用。本实施例中采用氧化铟锡制备静电分散层520。静电分散层520的成膜厚度d满足5nm〈d〈500nm，可以在控制成本的同时对静电起到较好的防护作用，并保持较低的电阻率。
[0218]请继续参考图15，进行步骤:在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层。
[0219]请参考图15d，在显示区域Pa处，在静电分散层520、层间绝缘层511中与第一透明电极层509的连接部509a处形成过孔533，使静电分散层520覆盖该过孔区域外的层间绝缘层510 ;在周边区域Pb处，无过孔形成。
[0220]具体地，在静电分散层520与绝缘层即层间绝缘层510中形成过孔533的步骤包括:在静电分散层520的表面形成光刻胶层；图案化所述光刻胶层，具体包括曝光、显影过程，曝光过程为使用紫外线透过具有预定图案的掩膜板照射光刻胶层，显影过程为在曝光处理后用碱性显影液除去光照部分的光刻胶图案，从而形成预定图案的光刻胶图案；刻蚀静电分散层520和绝缘层即层间绝缘层510，以形成具有所述过孔的所述静电分散层520与所述绝缘层即层间绝缘层510 ;去除剩余的所述光刻胶层。
[0221]更具体地，上述刻蚀静电分散层520和层间绝缘层510的步骤包括:刻蚀静电分散层520，使所述静电分散层在所述过孔533边缘的倾斜角Θ (图中未示出)满足0° < Θ <90°，优选30° <θ〈60° ;刻蚀所述层间绝缘层510。
[0222]在光刻胶的剥离后，可以进一步包括清洗烘干过程，以去除基板500表面的杂质。
[0223]在过孔533形成过程中，以及过孔533形成后光刻胶的剥离过程中以及清洗、烘干过程中，以及基板的运输过程中，基板容易受到静电影响。静电的来源主要来自以下三个方面:摩擦起电，包括运输过程中与空气摩擦、玻璃基板与毛刷摩擦、玻璃基板与基台的摩擦、清洗过程中纯水的冲刷摩擦、风刀的空气摩擦等；接触分离起电，包括玻璃基板与基台接触后分离、等离子体轰击、离子轰击、药液接触等；感应起电比如接近带电的物体感应出静电。当静电积累到一定程度后，容易引起静电的释放。由于在整个过孔的形成过程中，基板表面一直覆盖有静电分散层520，累积在半导体层503与源漏极金属层507上的静电通过互相之间的连接被释放到第一透明电极层509的连接部509a的表面，并通过空气大电阻等途径经过表面漏电释放到静电分散层520表面，不会对半导体层503以及源漏极金属层507造成静电损伤。
[0224]请继续参考图15，进行步骤:在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接。
[0225]请参考图15e，在静电分散层520上形成第二透明电极层511，使第二透明电极层511整面覆盖基板500。在显示区域Pa中，该第二透明电极层511通过前述步骤中形成的过孔533与第一透明电极层509的连接部509a电性连接。本实施例中所述的第二膜层即为该第二透明电极层511。第二透明电极层511采用物理沉积方法形成，具体采用溅射成膜，通过对靶材的轰击使成膜材料从靶材转移到基板上。
[0226]请继续参考图15，进行步骤:图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
[0227]请参考图15f，图案化该第二透明电极层511与静电分散层520，使该静电分散层520与该第二透明电极层511轮廓相同。
[0228]具体包括以下步骤:在第二膜层即第二透明电极层511的表面形成光刻胶层；图案化所述光刻胶层，图案化过程与前述步骤中图案化光刻胶相同，在此不再赘述；刻蚀第二膜层即第二透明电极层511与静电分散层520以使该静电分散层520与第二透明电极层511轮廓相同；去除剩余的所述光刻胶层。由于第二透明电极层511与静电分散层520均为氧化物透明导电材料，所以第二透明电极层511与静电分散层520的刻蚀过程可以一步进行，采用湿刻法，使第二透明电极层511与静电分散层520未被光刻胶覆盖区域的材料与材料表面的刻蚀液发生化学反应，随着化学反应的不断进行，逐步消耗掉材料物质，直至未被光刻胶覆盖区域的第二透明电极材料与静电分散层材料被全部消耗，使得第二透明电极层511与静电分散层520具有相同的轮廓。
[0229]本实施例的阵列基板的制造方法，在制造过程中形成静电分散层，降低阵列基板制程中基板上静电的积累，在显示区域中，第一透明电极层的连接部、源漏极金属层与半导体层通过过孔电连接，半导体层以及源漏极金属层上积累的电荷可以释放到第一透明电极层的连接部的表面，并进一步通过表面漏电释放到静电分散层，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。并且静电分散层与第二透明电极层直接接触，可以降低第二透明电极层的电阻，改善显示器信号在第二透明电极层上的延迟衰减的情况，提高显示品质。并且，在静电分散层的图案化过程中，与源漏极金属层采用同一张掩膜板，不增加制造工序。
[0230]图16为本发明实施例提供的一种液晶显示面板的剖视结构示意图。
[0231]参考图16，该液晶显示面板包括对向基板62和阵列基板61，以及夹持于所述阵列基板61与所述对向基板62之间的液晶层63。
[0232]具体地，该液晶显示面板包括显示区域Pa和周边区域Pb，在周边区域Pb中通过封框胶64连接阵列基板61和对向基板62。
[0233]更具体的，阵列基板61包括:基板600，依次设置于所述基板一侧表面上的第一膜层、绝缘层、静电分散层和第二膜层；所述绝缘层和静电分散层具有过孔，所述第二膜层通过所述过孔与所述第一膜层电性连接；所述静电分散层与所述第二膜层的轮廓相同。
[0234]在本实施例中，在基板600上，依次形成有半导体层603、栅极绝缘层604、内介质层606、静电分散层620和源漏极金属层607,该半导体层603即为本实施例中所述第一膜层，栅极绝缘层604和内介质层606即为本实施例中所述的绝缘层，源漏极金属层607即为本实施例中所述第二膜层，源漏极金属层607通过静电分散层620和内介质层606的过孔630与栅极金属层605电连接。且静电分散层620与源漏极金属层607的轮廓相同。
[0235]本实施例的液晶显示面板的阵列基板包含静电分散层，可降低阵列基板制程中基板上静电的积累，在显示区域中，可以降低静电对半导体层的损伤，改善TFT器件的稳定性、均一性。避免了 TFT器件被静电击打或者击伤以致电性漂移，消除各种静电Mura。在周边区域中，改善了因静电释放而引起的膜层腐蚀等导致的显示不良，提升了产品良率。并且静电分散层与源漏极金属层直接接触，可以降低源漏极金属层的电阻，改善显示器信号在源漏极金属层构成的导线上的延迟衰减的情况，提高显示品质。
[0236]以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明，不能认定本发明的具体实施只局限于这些说明。对于本发明所属【技术领域】的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干简单推演或替换，都应当视为属于本发明的保护范围。
【权利要求】
1.一种阵列基板,包括: 基板，依次设置于所述基板一侧表面上的第一膜层、绝缘层、静电分散层和第二膜层； 所述绝缘层和静电分散层具有过孔，所述第二膜层通过所述过孔与所述第一膜层电性连接； 所述静电分散层与所述第二膜层的轮廓相同。
2.如权利要求1所述的阵列基板，其特征在于，所述静电分散层在所述过孔边缘的倾斜角Θ满足30°〈 Θ〈60°。
3.如权利要求1所述的阵列基板，其特征在于，在所述基板上依次形成有半导体层、栅极绝缘层、栅极金属层、内介质层和源漏极金属层，所述第一膜层为所述半导体层，所述绝缘层为所述栅极绝缘层和/或所述内介质层，所述第二膜层为源漏极金属层。
4.如权利要求1所述的阵列基板，其特征在于，在所述基板上依次形成有栅极金属层、栅极绝缘层和源漏极金属层，所述第一膜层为栅极金属层，所述绝缘层为栅极绝缘层，所述第二膜层为源漏极金属层。
5.如权利要求3或4所述的阵列基板，其特征在于，所述静电分散层的材料为钥、钛、铁、锌、铝、镁中的至少一种或其组合。
6.如权利要求1所述的阵列基板，其特征在于，在所述基板上依次形成有源漏极金属层、钝化层、第一透明电极层，所述第一膜层为所述源漏极金属层，所述绝缘层为所述钝化层，所述第二膜层为所述第一透明电极层。
7.如权利要求1所述的阵列基板，其特征在于，在所述基板上依次形成有源漏极金属层、钝化层、第一透明电极层、层间绝缘层和第二透明电极层，所述第一膜层为所述源漏极金属层，所述绝缘层为所述层间绝缘层，所述第二膜层为所述第二透明电极层。
8.如权利要求1所述的阵列基板，其特征在于，在所述基板上依次形成第一透明电极层、层间绝缘层和第二透明电极层，所述第一膜层为所述第一透明电极层，所述绝缘层为所述层间绝缘层，所述第二膜层为所述第二透明电极层。
9.如权利要求6、7或8所述的阵列基板，其特征在于，所述静电分散层的材料为氧化铟锡或氧化铟锌。
10.如权利要求1所述的阵列基板，其特征在于，所述静电分散层的膜厚d满足5nm〈d〈500nmo
11.一种液晶显不面板，其特征在于，包括对向基板和如权利要求1?10任一项所述的阵列基板，以及夹持于所述阵列基板与所述对向基板之间的液晶层。
12.—种阵列基板的制造方法，包括: 提供基板，在所述基板一侧的表面上形成第一膜层； 在所述第一膜层上形成绝缘层，所述绝缘层覆盖所述第一膜层以及所述基板； 在所述绝缘层上形成静电分散层； 在所述绝缘层和所述静电分散层中形成过孔，使所述静电分散层覆盖除所述过孔区域外的所述绝缘层； 在所述静电分散层上形成第二膜层，所述第二膜层通过所述过孔与所述第一膜层电性连接； 图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同。
13.如权利要求12所述的阵列基板的制造方法，其特征在于，所述在所述绝缘层与所述静电分散层中形成过孔步骤包括: 在所述静电分散层的表面形成光刻胶层； 图案化所述光刻胶层； 刻蚀所述静电分散层和所述绝缘层，以形成具有所述过孔的所述静电分散层与所述绝缘层； 去除剩余的所述光刻胶层。
14.如权利要求13所述的阵列基板的制造方法，其特征在于，所述刻蚀所述静电分散层与所述绝缘层步骤包括: 刻蚀所述静电分散层，使所述静电分散层在所述过孔边缘的倾斜角Θ满足30。< Θ <60° ； 刻蚀所述绝缘层。
15.如权利要求12所述的阵列基板的制造方法，其特征在于，所述图案化所述第二膜层与所述静电分散层，使所述静电分散层与所述第二膜层轮廓相同步骤包括: 在所述第二膜层的表面形成光刻胶层； 图案化所述光刻胶层； 刻蚀所述第二膜层与所述静电分散层以使所述静电分散层与所述第二膜层轮廓相同； 去除剩余的所述光刻胶层。
16.如权利要求12所述的阵列基板的制造方法，其特征在于，所述第一膜层为半导体层，所述绝缘层为栅极绝缘层和/或内介质层，所述第二膜层为源漏极金属层，所述形成第一膜层包括: 在所述基板一侧的表面上沉积非晶娃材料； 对所述非晶硅材料进行晶化，将所述非晶硅材料转化为多晶硅材料。
17.如权利要求16所述的阵列基板的制造方法，其特征在于，所述晶化可以采用准分子激光晶化工艺、固相晶化工艺或快速热退火工艺。
18.如权利要求12所述的阵列基板的制造方法，其特征在于，所述形成静电分散层包括: 在所述基板一侧的表面上沉积静电分散层，沉积厚度d满足5nm〈d〈500nm。
【文档编号】G02F1/13GK104167418SQ201410309051
【公开日】2014年11月26日 申请日期:2014年6月30日 优先权日:2014年6月30日
【发明者】文亮 申请人:厦门天马微电子有限公司, 天马微电子股份有限公司