专利名称：沟槽型绝缘栅双极型晶体管及其制备方法
技术领域：
本发明属于绝缘栅双极型晶体管(InsulatedGate Bipolar Transistor, IGBT)技术领域，涉及一种栅电极下沉的、倾斜式离子注入形成发射极层的IGBT及其制备方法。
背景技术：
IGBT是一种常见的功率型器件，其是大电流开关主流器件之一，广泛应用于高压大电流情况下，例如，应用于工作电压在1200V的情况下。图1所述为现有技术的穿通(Punch Through, PT)沟槽型IGBT的单元结构示意图。在该实施例中，PT沟槽型IGBT 100是在N-衬底上形成，N-衬底部分地用于形成漂移层140 ;在N-衬底的背面掺杂形成集电极层120，从集电极(Collector)层120的一面引出金属电极，即集电极电极110 ;集电极层120之上依次形成了缓冲层130和漂移层140，该缓冲层130和漂移层140为低N (N-)掺杂；在漂移层140的主表面上，形成P型的基极层151，P型的基极层151之上形成相对高掺杂的P+型的基极层152，P型的基极层151和P+型的基极层152共同组成基极层150 ;沟槽190通过构图刻蚀形成，其从基极层152的主表面穿过基极层152到达漂移层140中，即沟槽190被刻蚀至漂移层140中；沟槽190中形成栅电极192以及栅介质层191 ;同时在基极层152的主表面构图掺杂形成发射极(Emitter)层160，发射极层160与栅介质层191相邻地形成；层间介质层170覆盖于栅电极192之上并部分地露出发射极层160 ;发射极电极180构图形成并与发射极层160电性接触。图1中仅示出了其中一个IGBT单元的结构，本领域技术人员理解的是，在漂移层140上可以形成多个沟槽190、基极层150以及发射极层160，也即在同一衬底上可以形成多个IGBT单元。PT沟槽型IGBT 100的沟道长度Ldl由基极层150的深度和发射极层160在栅介质层191相邻处的深度决定。通过IGBT的饱和区电流计算公式可知，Ldl越长，导通电阻越大,导通电流越小。因此，考虑到导通电流的要求，需要将Leh设置为较小的长度；例如，在基极层150的深度被设置为5微米或5微米以上(由于IGBT工作于高电压、结深要求至少达到5微米)的情况下、要想达到2微米的沟道长度，现有技术中，在构图掺杂形成发射极层160时，发射极层160在栅介质层191相邻处的深度需达到3微米左右。因此，只能采用扩散系数较高的杂质磷来离子注入掺杂形成发射极层160 ;同时由于扩散系数较高，在发射极层160的纵向深度达到3微米时，其横向宽度也会达到2.4微米左右。但是，在PT沟槽型IGBT 100中，为了避免闩锁(Latch-up)效应，还要为基极区152设置足够的面积，因此，发射极层160的横向宽度会导致发射极层160的面积大大增加，进而导致PT沟槽型IGBT 100的面积增加，并且，发射极层160的面积过大还会导致关断时的漏电流增加。另外，采用扩散系数较低的砷(As)掺杂形成发射极层160时，虽然发射极层160的面积足够小，但是其深度也比较短(例如0.5微米)，沟道长度Ldl至少达到4.5微米，IGBT 100的导通电阻因此会急剧增加
发明内容
本发明的目的在于，降低沟槽型IGBT的导通电阻并减小其发射极层的面积。为实现以上目的或者其他目的，本发明提供以下技术方案:
按照本发明的一方面，提供一种沟槽型IGBT，其包括集电极层、漂移层、发射极层、沟槽、以及形成于沟槽的栅介质层和栅电极，所述沟槽中的栅电极的上表面被回刻蚀至低于所述基极层的上表面、以使所述发射极层可操作地被倾角式离子注入形成。按照本发明提供的沟槽型IGBT的一实施例，其还包括:形成于所述沟槽中的、位于所述栅电极之上的层间介质层；
其中，所述层间介质层的上表面以及栅介质层的上表面被回刻蚀至低于所述集电极层的上表面，所述层间介质层用于实现所述栅电极和发射极电极之间的绝缘隔离。较佳地，所述栅介质层被回刻蚀的高度是所述栅电极被回刻蚀的高度的40%至60%。较佳地,所述层间介质层为硼磷娃玻璃(Boro-phospho-silicate-glass, BPSG)。所述沟槽型IGBT可以为N沟道的沟槽IGBT ;较佳地，发射极层中被离子注入的掺杂元素为砷。按照本发明提供的沟槽型IGBT的较佳实施例，所述倾角相对于垂直于基极层表面的方向偏向所述沟槽的中央，所述倾角的角度范围为5°至20°。具体地，所述栅电极为多晶硅栅电极。较佳地，所述发射极层的掺杂浓度范围为IX IO14离子/cm3至IX IO15离子/cm3。较佳地，所述栅介质层为通过干法氧化形成的氧化层。按照本发明提供的沟槽型IGBT的较佳实施例，所述沟槽中的栅电极的上表面低于所述基极层的上表面2.5-3微米。较佳地，发射极层的宽度范围为0.3微米至0.6微米。按照本发明的又一方面，提供一种沟槽型IGBT的制备方法，其包括以下步骤: 提供用于形成漂移层的半导体衬底；
在所述漂移层上形成基极层；
构图刻蚀形成穿过所述基极层至所述漂移层中的沟槽；
在所述沟槽中形成栅介质层；
在所述沟槽中填充形成栅电极，
回刻蚀所述栅电极；
以所述栅电极为掩膜倾角式离子注入形成发射极层；
形成层间介质层以及发射极电极；以及
对所述半导体衬底的背面掺杂形成集电极层，并形成集电极电极。较佳地，所述半导体衬底的掺杂浓度范围可以为I X IO14离子/cm3至2X IO14离子
/ 3
/cm o较佳地，所述基极层通过两次离子注入形成；其中，一次离子注入用于形成相对低掺杂浓度的第一部分基极层，另一次离子注入用于形成相对高掺杂浓度的第二部分基极层。较佳地，形成栅介质层的步骤中，包括以下步骤:
湿法氧化形成形成牺牲氧化层； 刻蚀去除该牺牲氧化层；以及 干法氧化形成所述栅介质层。较佳地，回刻蚀的所述栅电极的高度范围基本为2.5-3微米。按照本发明提供的制备方法的一实施例，所述倾角相对于垂直于基极层表面的方向偏向所述沟槽的中央，所述倾角的角度范围为5°至20°。所述倾角的角度可以为20°。较佳地，通过两次所述倾角式离子注入形成所述沟槽两旁的发射极层。较佳地，所述发射极层中被离子注入的掺杂元素为砷。较佳地，形成层间介质层的步骤包括:
沉积层间介质层；以及
回刻蚀所述层间介质层和栅介质层、以使所述发射极层的上表面全部暴露。较佳地，所述栅介质层被回刻蚀的高度是所述栅电极被回刻蚀的高度的40%至60%。本发明的技术效果是，该沟槽型IGBT的栅电极采用下沉式结构，并结合采用倾角式离子注入形成发射极层，因此，发射极层的深度可以根据沟道长度要求得到保证，并且发射极层的宽度小，也即其横向面积小。因此，采用该方法制备形成的沟槽型IGBT的导通电阻小，并能兼顾减低其芯片面积。
从结合附图的以下详细说明中，将会使本发明的上述和其他目的及优点更加完全清楚，其中，相同或相似的要素采用相同的标号表示。图1是现有技术的PT沟槽型IGBT的单元结构示意图。图2是按照本发明一实施例提供的制备沟槽型IGBT的方法流程示意图。图3至图13是对应于图2所示流程过程的结构变化示意图，其中，图13是按照图2所示方法形成的沟槽型IGBT 200的基本结构示意图。图14是图13所示沟槽型IGBT 200的输出特性示意图。
具体实施例方式下面介绍的是本发明的多个可能实施例中的一些，旨在提供对本发明的基本了解，并不旨在确认本发明的关键或决定性的要素或限定所要保护的范围。容易理解，根据本发明的技术方案，在不变更本发明的实质精神下，本领域的一般技术人员可以提出可相互替换的其他实现方式。因此，以下具体实施方式
以及附图仅是对本发明的技术方案的示例性说明，而不应当视为本发明的全部或者视为对本发明技术方案的限定或限制。在附图中，为了清楚起见，夸大了层和区域的厚度，并且，由于刻蚀引起的圆润等形状特征未在附图中示意出。以下以N沟道的沟槽型IGBT为例对本发明的沟槽型IGBT的制备方法及其结构进行说明。由于该IGBT通常应用于高压情况，因此对IGBT的基极层的深度(也反映结深)有着一定的厚度要求，例如，基极层的深度选择为5微米。图2所示为按照本发明一实施例提供的制备沟槽型IGBT的方法流程示意图。图3至图13所示为对应于图2所示流程过程的结构变化示意图，因此，通过图2所示的方法，最终地形成如图13所示的本发明实施例的沟槽型IGBT。以下图3至图13中，定义垂直于半导体衬底表面的方向为z坐标方向，并且z坐标的正方向为指向半导体衬底上用于形成发射极电极的一面的方向，并且z坐标的负方向为指向半导体衬底上用于形成集电极电极的一面(即半导体衬底的背面)的方向；定义平行于半导体衬底表面的方向为X坐标方向。需要说明的是，本发明中提到的“上”、“下”、“背面”、“横向”等方位术语是相对如图中所述的Z坐标方向或X坐标方向来定义的。以下结合图2至图13对制备图13所示实施例沟槽型IGBT的方法进行详细说明，并同时说明图13所示的沟槽型IGBT单元结构。首先，步骤S510，提供用于形成漂移层的半导体衬底。参阅图3，半导体衬底30可以选择采用N型低掺杂的晶圆(wafer)，也即N-单晶晶圆，其掺杂浓度为欲形成的IGBT的漂移层的掺杂浓度，因此，半导体衬底30的掺杂浓度范围选择为I X IO14离子/cm3至2X IO14离子/cm3，例如为5.43X IO13离子/cm3。最终地，半导体衬底30中的部分区域会被用来形成IGBT的漂移层，漂移层的具体结构将在其后说明。半导体衬底30厚度具体可以设置为210微米。进一步，步骤S520，在漂移层上形成基极层。参阅图4，在N-漂移层240上进行P型掺杂形成基极层250，具体地可以通过离子注入掺杂形成。优选地，采用两次离子注入的方式形成第一部分基极层251和第二部分基极层252 ;在该实例中，第一次离子注入的剂量为3X IO13离子/cm2、离子注入能量为150KeV,从而掺杂形成相对低掺杂的P-基极层251 ;第二次离子注入的剂量为I X IO15离子/cm2、离子注入能量为400KeV，从而掺杂形成相对高掺杂的P+基极层252。P-基极层251和P+基极层252共同形成基极层250，第二部分基极层252相对高掺杂，有利于防止二次击穿、降低接触电阻。进一步，步骤S530，构图刻蚀形成穿过基极层至漂移层中的沟槽。参阅图5，在半导体衬底上构图刻蚀沟槽290，沟槽290基本垂直地、通过刻蚀穿过基极层250并至漂移层240中的方式形成，因此，沟槽290底部部分伸入漂移层240中。沟槽290的具体形状大小不是限制性的，沟槽290在构图刻蚀的过程中，可以采用氮化硅层作为掩膜层(图中未示出)。进一步，步骤S540，在沟槽中形成栅介质层。参阅图6，在该实施例中，栅介质层291是通过氧化衬底形成的，因此栅介质层291在此也被称为栅氧化层。优选地，在该步骤中，首先通过氧化速率较快的湿法氧化形成厚度约1150埃的牺牲氧化层，然后，湿法刻蚀去除该牺牲氧化层；进一步通过干法氧化的方法形成栅介质层291。具体地，湿法氧化的条件可以设置为:850°C、80分钟，干法氧化的条件可以设置为:1000°C、81分钟；通过引入牺牲氧化层步骤，可以去除沟槽表面因刻蚀而形成的大量缺陷，提高干法氧化形成的栅介质层291的质量。并且，湿法氧化形成牺牲氧化层的温度的方法的热预算小，其能尽可能减小该过程对杂质分布的影响。栅介质层291的厚度范围可以为600埃至700埃，例如其可以为650埃。需要说明的是，步骤S520中离子注入后的高温推结步骤可以在以上去除牺牲氧化层后进行，具体地，在1150°C的高温条件下推结100分钟。进一步，步骤S550，填充沟槽形成栅电极。参阅图7，通过生长多晶硅、化学机械抛光工艺后，可以填充沟槽290形成栅电极292a。因此，在该实施例中，栅电极292a为高掺杂的多晶硅栅极。进一步，步骤S560，回刻蚀栅电极。参阅图8，通过回刻蚀栅电极292a，从而最终形成栅电极292，栅电极292的上表面的高度低于基极层250的上表面的高度h，也即，栅电极292相对于栅电极292a被回刻蚀了高度h，从而形成了下沉式结构的栅电极292。在本发明中，高度h影响其后离子注入形成的发射极260的深度，进而影响该IGBT的沟道长度k。因此，本领域技术人员可以根据沟槽长度Ldl的设置要求来选择h的尺寸大小。在该实例中，回刻蚀的高度h为2.5-3微米左右。 进一步，步骤S570，以栅电极为掩膜倾角式离子注入形成发射极层。参阅图9，与栅介质层291接触的半导体衬底区域将会在栅电极292的控制下形成沟道，不同于传统的垂直于基极层250表面的离子注入方式，该发明中采用倾角式离子注入形成发射极层260。具体地，离子注入时，如图9所示，离子注入的角度相对于z方向偏向沟槽的中央一定角度￠, ^的角度范围为5°至20°，例如，P大致为20°。离子注入的掺杂过程中，以被回刻的多晶硅栅电极292作为掩膜，在部分介质层被暴露并且倾角注入的情况下，掺杂离子可以注入比较深的深度(即使掺杂元素的扩散系数比较小)，并且不会增加发射极层260的宽度(也即不会增加其面积)，沟道长度Ldl可以得到有效保证。在该实施例中，发射极层260的深度达到3微米时，发射极层260的宽度W可以在0.3微米至0.6微米之间(在本发明中，发射极层260的宽度定义为栅介质层与发射极层260的边沿之间在X方向的距离)，沟道长度Ldl小于或等于2微米，IGBT的导通电阻小。因此，本发明中，通过栅电极292的下沉式结构设计，并结合倾角式离子注入，可以降低IGBT的导通电阻，同时，可以保证发射极层260的面积足够小，减小芯片的面积。优选地，可以选择扩散系数小的掺杂元素来离子注入掺杂，例如，在发射极层260为N+型掺杂层时，采用As作为掺杂元素，这样，发射极层260的横向面积更能得到保证。在发射极层260为P+型掺杂层时(即沟槽型IGBT为P型沟道时)，可以选择采用硼、二氟化硼(BF2),铟等扩散系数相对小的元素。需要说明的是，倾角式离子注入的过程中，沟槽两旁的两个发射极层260是各自分别通过一次倾角式离子注入形成，每次离子注入的倾角均相对于z方向偏向沟槽的中央。发射极层260的掺杂浓度范围为IX IO14离子/cm3至IX IO15离子/cm3，根据离子注入掺杂特性，发射极层260内杂质浓度分布并不是均匀的，例如，离栅介质层291越近，掺杂浓
度越高。进一步,步骤S580,在沟槽中形成层间介质层。参阅图10，在该实施例中，层间介质层270选择采用BPSG来形成。首先，沉积一定厚度的BPSG层，然后对BPSG层回刻蚀(例如采用湿法刻蚀)，控制回刻蚀时间，可以使一定厚度的BPSG层留于沟槽中，从而形成层间介质层270 ;在回刻蚀BPSG层的同时，暴露的部分的栅介质层291也回被刻蚀去除，例如，如图10所示，栅介质层291从基极层250的上表面刻蚀至层间介质层270的上表面,栅介质层291的上表面与层间介质层270的上表面基本在同一高度。这种层间介质层结构避免了发射极层260被层间介质层270覆盖，在发射极层260横向面积相对较小的情况下,发射极层260上表面和部分沟槽内侧表面(相对于沟槽290来定义)能暴露，从而，在其后步骤中能有效增加发射极电极与发射极层260的接触面积，降低接触电阻。并且，层间介质层270也能实现栅电极292与发射极电极之间的电性隔离。选择使用BPSG作为层间介质层270时，其中的P可以吸附金属可以移动离子，B可以降低其沉积时的回流温度，从而降低热预算。在该实施例中，优选地，层间介质层270的厚度范围是栅电极292a被回刻蚀的高度h的40%至60%，也即栅介质层291被回刻蚀的高度范围基本是栅电极292a被回刻蚀的高度h的40%至60%。进一步,步骤S590,形成发射极电极。参阅图11，沉积铝等金属层覆盖发射极层260、基极层250以及层间介质层270，从而形成发射极电极280，发射极电极280与发射极层260的上表面全部直接接触、并且与发射极层260在层间介质层270之上的沟槽内侧面直接接触。发射极电极280上偏置的电信号可以输入至发射极层260上。进一步，步骤S594，背面掺杂形成集电极层。参阅图12，在该实施例中，通过对半导体衬底30的背面进行P+高掺杂形成集电极层220，集电极层220与基极层250之间的半导体衬底区域主要地形成了漂移层240。具体地，还可以在漂移层240和集电极层220之间形成一层缓冲层230。进一步,步骤S599,形成集电极电极。参阅图13，图13所示为按照图2所示方法形成的沟槽型IGBT 200的基本结构示意图，沉积铝等金属层覆盖集电极层220，从而形成集电极电极210，集电极电极210与集电极层220之间为欧姆接触，集电极电极210上偏置的电信号可以输入至集电极层220上。至此，N沟道的沟槽型IGBT基本形成。继续参阅图13，沟槽型IGBT 200的具体结构在以上制备方法中已经进行了描述，在此不再——赘述。沟槽型IGBT 200工作的过程中:
导通状态时，可以对发射极电极280接地、集电极电极210偏置正电压，于是，漂移层240与基极层250之间的PN结反向偏置，但是，对于栅电极292偏置阈值电压以上的正电压时，在基极层251上沿着栅介质层291的部分被反型形成N型的沟道。因而，电子可以通过该沟道从发射极层260注入到漂移层240，由此，集电极层220与η型的漂移层240之间的PN结为正偏压，空穴将从集电极层220注入到漂移层240，于是，在漂移层240中产生电导调制。图14所示为图13所示沟槽型IGBT 200的输出特性示意图，其中，Vce为集电极电极和发射极电极之间的偏置电压，Ice为集电极电极和发射极电极之间的电流，Vg为偏置于栅电极之上的电压。截止状态时，栅电极292相对于发射极电极280所偏置的电压低于阈值电压，基极层250中不会形成沟道，于是，不会从发射极层260向漂移层240提供电子，与此同时，也不会从集电极层220向漂移层240注入空穴。因此，在导通状态时，由于发射极电极280的深度较大，在结深足够保证高压工作条件的情况下，沟道长度Ldl越短，因此导通电阻越低，并且，发射极电极280的横向面积较小，沟槽型IGBT 200的单元面积也更小。需要说明是，沟槽型IGBT 200中，各区域(例如发射电极层260、集电极层251和252、漂移层240、集电极层220)中的掺杂浓度并不一定均匀分布的，根据掺杂的浓度分布特性，其可以在一定范围内以一定的浓度分布曲线分布。以上实施例中尽管以N型沟道的沟槽型IGBT为例对其结构和制备方法进行了说明，本领域技术人员应当理解的是，P型沟道的沟槽型IGBT也具有基本相同的结构和制备方法过程。以上例子主要说明了本发明制备沟槽型IGBT的方法及通过该方法制备形成的沟槽型IGBT。尽管只对其中一些本发明的实施方式进行了描述，但是本领域普通技术人员应当了解，本发明可以在不偏离其主旨与范围内以许多其他的形式实施。因此，所展示的例子与实施方式被视为示意性的而非限制性的，在不脱离如所附各权利要求所定义的本发明精神及范围的情况下，本发明可能涵盖各种的修改与替换。
权利要求
1.种沟槽型绝缘栅双极型晶体管，包括集电极层、漂移层、发射极层、沟槽、以及形成于沟槽的栅介质层和栅电极，其特征在于，所述沟槽中的栅电极的上表面被回刻蚀至低于所述基极层的上表面、以使所述发射极层可操作地被倾角式离子注入形成。
2.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，还包括:形成于所述沟槽中的、位于所述栅电极之上的层间介质层； 其中，所述层间介质层的上表面以及栅介质层的上表面被回刻蚀至低于所述基极层的上表面，所述层间介质层用于实现所述栅电极和发射极电极之间的绝缘隔离。
3.按权利要求2所述的沟槽型绝缘栅双极型晶体管，所述栅介质层被回刻蚀的高度是所述栅电极被回刻蚀的高度的40%至60%。
4.按权利要求2所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述层间介质层为硼磷硅玻璃。
5.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述沟槽型绝缘栅双极型晶体管为N沟道的沟槽型绝缘栅双极型晶体管。
6.按权利要求5所述的沟槽型绝缘栅双极型晶体管，其特征在于，发射极层中被离子注入的掺杂元素为砷。
7.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述倾角相对于垂直于基极层表面的方向偏向所述沟槽的中央，所述倾角的角度范围为5°至20°。
8.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述栅电极为多晶娃栅电极。
9.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述发射极层的掺杂浓度范围为1 X 1O14离子/cm3至1 X 1O15离子/cm3。
10.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述栅介质层为通过干法氧化形成的氧化层。
11.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述沟槽中的栅电极的上表面低于所述基极层的上表面2.5-3微米。
12.按权利要求1所述的沟槽型绝缘栅双极型晶体管，其特征在于，所述发射极层的宽度范围为0.5微米至0.6微米。
13.一种沟槽型绝缘栅双极型晶体管的制备方法，其特征在于，包括以下步骤: 提供用于形成漂移层的半导体衬底； 在所述漂移层上形成基极层； 构图刻蚀形成穿过所述基极层至所述漂移层中的沟槽； 在所述沟槽中形成栅介质层； 在所述沟槽中填充形成栅电极； 回刻蚀所述栅电极； 以所述栅电极为掩膜倾角式离子注入形成发射极层； 形成层间介质层以及发射极电极；以及 对所述半导体衬底的背面掺杂形成集电极层，并形成集电极电极。
14.按权利要求13所述的制备方法，其特征在于，所述漂移层的掺杂浓度范围为I X IO14 离子 /cm3 至 2 X IO14 离子 /cm3。
15.按权利要求13所述的制备方法，其特征在于，所述基极层通过两次离子注入形成；其中，一次离子注入用于形成相对低掺杂浓度的第一部分基极层，另一次离子注入用于形成相对高掺杂浓度的第二部分基极层。
16.按权利要求13所述的制备方法，其特征在于，形成栅介质层的步骤中，包括以下步骤: 湿法氧化形成形成牺牲氧化层； 刻蚀去除该牺牲氧化层；以及 干法氧化形成所述栅介质层。
17.按权利要求13所述的制备方法，其特征在于，回刻蚀的所述栅电极的高度范围基本为2.5-3微米。
18.按权利要求13所述的制备方法，其特征在于，所述倾角相对于垂直于基极层表面的方向偏向所述沟槽的中央，所述倾角的角度范围为5°至20°。
19.按权利要求13或18所述的制备方法，其特征在于，通过两次所述倾角式离子注入形成所述沟槽两旁的发射极层。
20.按权利要求13所述的制备方法，其特征在于，所述发射极层中被离子注入的掺杂元素为砷。
21.按权利要求13所述的制备方法，其特征在于，形成层间介质层的步骤包括:沉积层间介质层；以及 回刻蚀所述层间介质层和栅介质层、以使所述发射极层的上表面和部分沟槽内侧面暴露。
22.按权利要求21所述的制备方法，其特征在于，所述栅介质层被回刻蚀的高度是所述栅电极被回刻蚀的高度的40%至60%。
全文摘要
本发明提供一种沟槽型绝缘栅双极型晶体管(InsulatedGateBipolarTransistor，IGBT)及其制备方法，属于IGBT技术领域。该沟槽型IGBT包括集电极层、漂移层、发射极层、沟槽、以及形成于沟槽的栅介质层和栅电极，该沟槽中的栅电极的上表面被回刻蚀至低于所述基极层的上表面、以使所述发射极层可操作地被倾角式离子注入形成。因此，该制备方法中包括栅电极的回刻蚀步骤以及以所述栅电极为掩膜倾角式离子注入形成发射极层的步骤。采用该方法制备形成的沟槽型IGBT的导通电阻小，并能兼顾减低其芯片面积。
文档编号H01L29/423GK103094324SQ20111034963
公开日2013年5月8日 申请日期2011年11月8日 优先权日2011年11月8日
发明者刘少鹏 申请人:无锡华润上华半导体有限公司