专利名称：半导体装置及其制造方法
技术领域：
本发明涉及一种半导体装置及其制造方法，特别涉及具有电容器的半导体装置及其制造方法。
背景技术：
近年来，随着半导体集成电路装置的高集成化、高性能化及高速化，提出了在DRAM(Dynamic Random Access Memory)等半导体装置中使用将高电介质膜用在电容绝缘膜中的MIM(Metal-Insulator-Metal)电容器的技术。
在谋求半导体装置的微细化及高密度化方面，必须要缩小芯片中的电容器占有面积。但是，为了使存储部稳定地工作，必须要一定以上的电容值。因此，正在进行开发将具有高介电常数的Hf氧化物(HfOx)或Zr氧化物(ZrOx)用在电容绝缘膜中的电容器。
但是，在将HfOx或ZrOx用在电容绝缘膜的电容器中，存在有漏电流随着工作温度变高而增大的问题。这是由于对于HfOx及ZrOx的各电极的带隙(band gap)较低而使由来自电极的电子的热放出而引起的漏电流随着温度变高而增大之故。
于是，提出了这样的技术通过在由HfOx或ZrOx构成的电容绝缘膜和电极的界面形成带隙较高的由Al氧化物(AlOx)构成的阻挡膜，来提高电极和电容绝缘膜之间的带隙，从而抑制由来自电极的电子的热放出而引起的漏电流(参照特开2002-222934号公报)。
图6(a)～图6(f)示出了公开在特开2002-222934号公报中的以往的使用了AlOx阻挡膜的MIM电容器的制造方法的各工序的剖面图。
首先，如图6(a)所示，在硅衬底60上形成第1层间绝缘膜61后，形成贯穿第1层间绝缘膜61的第1通孔62。接着，通过用钨、钛、或氮化钛等将第1通孔62埋住，来形成导体膜柱塞63后，再在第1层间绝缘膜61上及导体膜柱塞63上形成第2层间绝缘膜64。其次，贯穿第2层间绝缘膜64形成到达导体膜柱塞63的第2通孔65。
其次，如图6(b)所示，在整个含有第2通孔65内部的第2层间绝缘膜64上，形成氮化钛膜等下部电极材料膜66A。
其次，如图6(c)所示，通过进行CMP(chemical mechanical polishing)处理或全面回蚀处理，来在第2通孔65的外侧，将形成在第2层间绝缘膜64上的下部电极材料膜66A除去。从而，在第2通孔65内形成具有三次元结构的下部电极66。
其次，如图6(d)所示，利用原子层沉积法即ALD(Atomic LayerDeposition)法在下部电极66上形成AlOx膜67。
图7示出了利用原子层沉积法形成AlOx膜及后述的HfOx膜的序列(sequence)。
如图7所示，首先，将环境气体(N2)导入成膜室内，然后，让硅衬底(晶片)60升温。接着，将为Al供给源的TMA(三甲基铝)气体以脉冲波状导入室内，让TMA或其活性种化学吸附在第2层间绝缘膜64的表面及下部电极66的表面。其次，在切断TMA气体后，将清洗(purge)气体(N2)以脉冲波状导入室内，藉此方法，将残留在室内的TMA气体除去。其次，在切断清洗气体后，将臭氧(O3)气体以脉冲波状导入室内。此时，该臭氧气体、和吸附在第2层间绝缘膜64的表面及下部电极66的表面的上述TMA或其活性种产生热反应，因此，形成一个原子层厚度的AlOx。然后，再将清洗气体以脉冲状导入室内，藉此方法，将残留在室内的臭氧气体除去。能够通过多次反复上述成膜序列，在下部电极66上形成具有所希望的厚度的AlOx膜67。
其次，如图6(e)所示，利用原子层沉积法在AlOx膜67上形成HfOx膜68。
具体地说，如图7所示，首先，将为Hf供给源的TEMA-Hf(四乙基甲基氨基铪tetrakis ethylmethylamino hafnium)气体以脉冲波状导入室内，让TEMA-Hf或其活性种化学吸附在AlOx膜67的表面。其次，在切断TEMA-Hf气体后，将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的TEMA-Hf气体除去。其次，在切断清洗气体后，将臭氧气体以脉冲波状导入室内。此时，该臭氧气体、和吸附在AlOx膜67表面的上述TEMA-Hf或其活性种产生热反应，因此，形成一个原子层厚度的HfOx。然后，再将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的臭氧气体除去。能够通过多次反复上述成膜序列，来在AlOx膜67上形成具有所希望的厚度的HfOx膜68。
其次，如图6(f)所示，在HfOx膜68上形成氮化钛膜等上部电极材料膜69后，通过将该上部电极材料膜69加工成所希望的形状来形成上部电极，省略图示。
经由上述工序，来在硅衬底60上形成具有由AlOx膜67构成的阻挡膜的MIM电容器。
今后，如果电容器占有面积的缩小化进一步发展的话，则为了确保电容值，必须进行电容绝缘膜的薄膜化。但是，如果使用相对介电常数低于HfOx或ZrOx的AlOx阻挡膜的话，则难以通过电容绝缘膜的薄膜化来确保电容值。
例如，如果使AlOx阻挡膜的厚度为0.5nm的话，则为了满足Teq(Thickness Equivalent氧化膜换算膜厚)＝1.2nm的要求，必须要使HfOx膜的厚度为大约3.8nm(AlOx的相对介电常数大约为9，HfOx的相对介电常数大约为20)。此时，由于含AlOx阻挡膜的厚度的电容绝缘膜(HfOx膜)的厚度不满5nm，因此由沟道效果引起的漏电流增大。如上所述，在使用了AlOx阻挡膜的MIM电容器中，极难确保Teq＝1.2nm以下的电容值。
发明内容
如上所鉴，本发明的目的在于提供包括了MIM电容器的半导体装置及其制造方法，该MIM电容器能够抑制由来自电极的电子的热放出而引起的漏电流及由沟道效果而引起的漏电流，且能够维持较高的相对介电常数。
为了达到上述目的，本案发明者们发现了由含有Al或Si的Hf氧化物或Zr氧化物构成的阻挡膜作为代替AlOx阻挡膜的新的阻挡膜最合适，具体地说，作为对电极具有较高的带隙且由相对介电常数较高的材料构成的阻挡膜最合适，想到了下述发明。
具体地说，本发明所涉及的半导体装置，包括在衬底上依次叠层下部电极、电容绝缘膜及上部电极而形成的电容器。上述电容绝缘膜由Hf氧化物或Zr氧化物构成。在上述下部电极和上述电容绝缘膜之间形成有由含Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第1阻挡膜。
在本发明的半导体装置中，最好在上述上部电极和上述电容绝缘膜之间形成有由含Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第2阻挡膜。此时，最好上述第2阻挡膜为非晶体。并且，最好上述第2阻挡膜中的Al或Si的含有率大于或等于1atm％且不满25atm％。
在本发明的半导体装置中，最好上述第1阻挡膜为非晶体。
在本发明的半导体装置中，最好上述第1阻挡膜中的Al或Si的含有率大于或等于1atm％且不满25atm％。
在本发明的半导体装置中，最好上述下部电极及上述上部电极由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。
本发明所涉及的半导体装置的制造方法，包括工序a，在衬底上形成电容下部电极；工序b，在上述电容下部电极上形成由含有Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第1阻挡膜；工序c，在上述第1阻挡膜上形成由Hf氧化物或Zr氧化物构成的电容绝缘膜；以及工序d，在上述电容绝缘膜上形成电容上部电极。
在本发明的半导体装置的制造方法中，最好在上述工序c和上述工序d之间，还包括在上述电容绝缘膜上形成由含有Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第2阻挡膜的工序e。此时，最好在上述工序e中，上述第2阻挡膜是用原子层沉积法形成的。
在本发明的半导体装置的制造方法中，最好在上述工序b中，上述第1阻挡膜是用原子层沉积法形成的。
在本发明的半导体装置的制造方法中，最好在上述工序c中，上述电容绝缘膜是用原子层沉积法形成的。
在本发明的半导体装置的制造方法中，最好在上述工序c之后，还包括对上述电容绝缘膜进行等离子体氧化处理的工序f。
在本发明的半导体装置的制造方法中，最好上述下部电极及上述上部电极由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。
(发明的效果)根据本发明，在构成电容绝缘膜的HfOx或ZrOx、和电极的界面设置由含有Al或Si的至少一方的Hf氧化物或Zr氧化物构成的阻挡膜。这样一来，由于能够提高电容绝缘膜和电极之间的带隙，因此能够抑制由来自电极的电子的热放出而引起的漏电流。并且，由于即使在阻挡膜中也能够获得与HfOx或ZrOx匹敌的较高的相对介电常数，因此能够在确保电容值的同时，在某种程度上保持物理的厚度，从而，能够抑制由沟道效果而引起的漏电流。
附图的简单说明
图1(a)～图1(g)示出了本发明的第1实施例所涉及的半导体装置的制造方法的各工序的剖面图。
图2为示出了本发明的第1实施例所涉及的半导体装置的制造方法中的、利用原子层沉积法形成HfxAlyOz膜的工序中的导入反应气体的序列图。
图3为示出了在使用HfOx电容绝缘膜的同时，将HfxAlyOz阻挡膜使用在下部电极和电容绝缘膜之间的本发明所涉及的MIM结构电容器的电特性图。
图4为示出了本发明的HfxAlyOz阻挡膜中的Al含有率和相对介电常数的相关关系图。
图5为示出了本发明的第2实施例所涉及的半导体装置的制造方法中的、利用原子层沉积法形成ZrxAlyOz膜的工序中的导入反应气体的序列图。
图6(a)～图6(f)为示出了以往的MIM电容器的制造方法的各工序的剖面图。
图7为示出了以往的MIM电容器的制造方法中的、利用原子层沉积法形成AlOx膜及HfOx膜的序列图。
(符号的说明)
10-半导体衬底；11-第1层间绝缘膜；12-第1通孔；13-导体膜柱塞；14-第2层间绝缘膜；15-第2通孔；16-下部电极；16A-下部电极材料膜；17-第1阻挡膜；18-电容绝缘膜；19-第2阻挡膜；20-上部电极材料膜。
具体实施例方式
(第1实施例)以下，参照附图对本发明的第1实施例所涉及的半导体装置及其制造方法加以说明。
图1(a)～图1(g)为示出了第1实施例所涉及的半导体装置的制造方法的各工序的剖面图。
首先，如图1(a)所示，例如，在由硅构成的半导体衬底10上沉积例如厚度为300nm的第1层间绝缘膜11。然后，贯穿第1层间绝缘膜11形成到达半导体衬底10的例如口径为150nm的第1通孔12，接着，将例如钨、钛或氮化钛等导体埋入第1通孔12内来形成导体膜柱塞13。其次，在第1层间绝缘膜11上沉积例如厚度为500nm的第2层间绝缘膜14后，贯穿第2层间绝缘膜14形成到达导体膜柱塞13的例如口径为400nm的第2通孔15。
其次，如图1(b)所示，在整个含有第2通孔15内部的第2层间绝缘膜14上沉积例如氮化钛膜等下部电极材料膜16A。
其次，例如，一边利用抗蚀(省略图示)埋入第2通孔15来保护第2通孔15内的下部电极材料膜16A，一边进行全面回蚀处理，藉此方法，在第2通孔15的外侧中除去形成在第2层间绝缘膜14上的下部电极材料膜16A，如图1(c)所示。从而，在第2通孔15内形成例如由氮化钛膜构成的下部电极16。
其次，如图1(d)所示，在下部电极16的表面上及第2层间绝缘膜14的表面上沉积第1阻挡膜17。第1阻挡膜17由例如含有Al的非晶体的Hf氧化物(HfxAlyOz)构成，其膜的厚度例如大约为0.5nm。并且，使用例如原子层沉积法(ALDAtomic Layer Deposition)法来形成第1阻挡膜17。在利用原子层沉积法的成膜中，以脉冲波状、断续地将反应气体导入室(反应室)内。图2示出了本实施例的利用原子层沉积法形成HfxAlyOz膜的工序中的导入反应气体的序列。
具体地说，如图2所示，首先，在将环境气体(例如，氮(N2)气体)导入室内后，使半导体衬底10升温到例如200～400℃左右。此时，将室内的气体压力设定为100Pa左右。并且，作为环境气体，除了氮气体以外，还能够使用氩等惰性气体。接着，以脉冲波状将为Hf供给源的例如TEMA-Hf(四乙基甲基氨基铪)气体导入室内，让TEMA-Hf或其活性种化学吸附在第2层间绝缘膜14的表面及下部电极16的表面。其次，在切断TEMA-Hf气体后，将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的TEMA-Hf气体除去。这里，作为清洗气体，能够使用例如氮气体、氩气体或氦气体等。其次，在切断清洗气体后，将臭氧(O3)气体以脉冲波状导入室内。此时，该臭氧气体、和吸附在第2层间绝缘膜14的表面及下部电极16的表面的上述TEMA-Hf或其活性种产生热反应，因此，形成一个原子层厚度的HfOx。然后，再将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的臭氧气体除去。
在本实施例中，通过将上述HfOx的成膜序列反复例如2、3次，形成例如2～3个原子层厚度的HfOx膜后，如下所述，进行将Al添加在HfOx膜中的序列。
即，在形成HfOx膜后，如图2所示，以脉冲波状将为Al供给源的TMA(三甲基铝)气体导入室内，让TMA或其活性种化学吸附在HfOx膜的表面。其次，在切断了TMA气体后，以脉冲波状将清洗气体(例如，氮气体)导入室内，藉此方法，将残留在室内的TMA气体除去。其次，在切断清洗气体后，以脉冲波状将臭氧气体导入室内。此时，在该臭氧气体、吸附在HfOx膜的表面的上述TMA或其活性种、和底层HfOx三者之间进行热反应，结果形成非晶体的HfxAlyOz膜。然后，再以脉冲波状将清洗气体导入室内，藉此方法，将残留在室内的臭氧气体除去。
在本实施例中，通过对由2～3次上述HfOx的成膜序列、和1次把Al添加在上述HfOx中的序列来形成非晶体的HfxAlyOz膜的工序进行两次，形成由例如厚度为0.5nm左右的非晶体HfxAlyOz膜构成的第1阻挡膜17。此时，第1阻挡膜17的Al含有率为例如大约15％，其相对介电常数为大约15。另外，在本实施例中，能够通过改变上述HfOx的成膜序列的次数、和将Al添加在上述HfOx中的序列的次数比，来任意设定第1阻挡膜17的Al含有率。
其次，如图1(e)所示，利用例如原子层沉积法，在第1阻挡膜17的表面上形成例如由HfOx构成的电容绝缘膜18。具体地说，通过将图2所示的HfOx的成膜序列进行例如30次左右，来形成由例如厚度为4.8nm左右的HfOx膜构成的电容绝缘膜18。
其次，如图1(f)所示，在电容绝缘膜18的表面上沉积第2阻挡膜19。在本实施例中，第2阻挡膜19与第1阻挡膜17一样，由例如含有Al的非晶体Hf氧化物(HfxAlyOz)构成，其膜厚例如大约为0.5nm。并且，第2阻挡膜19的形成方法与例如图2所示的第1阻挡膜17的形成方法相同。
另外，在本实施例中，第1阻挡膜17即厚度为0.5nm的HfxAlyOz膜、电容绝缘膜18即厚度为4.8nm的HfOx膜和第2阻挡膜19即厚度为0.5nm的HfxAlyOz膜的叠层体能够满足Teq＝1.2nm的要求。
其次，对第1阻挡膜17、电容绝缘膜18及第2阻挡膜19进行等离子体氧化处理，藉此方法，将氧提供给第1阻挡膜17、电容绝缘膜18及第2阻挡膜19的各个膜中的氧欠缺部分。
其次，如图1(g)所示，在第2阻挡膜19上形成例如由氮化钛膜等构成的厚度为50nm左右的上部电极材料膜20后，通过将该上部电极材料膜20加工成所希望的形状来形成上部电极。
经由上述工序，在半导体衬底10上形成具有由HfxAlyOz膜构成的阻挡膜的本实施例的MIM电容器。
根据本实施例，在构成电容绝缘膜18的HfOx和下部电极16的界面设置由HfxAlyOz膜即含有Al的Hf氧化物构成的第1阻挡膜17，同时，在构成电容绝缘膜18的HfOx和上部电极的界面设置由HfxAlyOz膜(含有Al的Hf氧化物)构成的第2阻挡膜19。这样一来，由于能够提高电容绝缘膜18和各电极之间的带隙，因此能够抑制由来自各电极的电子的热放出而引起的漏电流。并且，由于即使在阻挡膜17及19中，也能够获得与HfOx匹敌的较高的相对介电常数，因此能够在确保电容值的同时，在某种程度上保持物理的厚度，从而，能够抑制由沟道效果引起的漏电流。
图3对本发明所涉及的MIM结构电容器的电特性和以往的MIM结构电容器的电特性加以比较，所述本发明所涉及的MIM结构电容器使用HfOx电容绝缘膜，同时，在下部电极和电容绝缘膜之间使用了HfxAlyOz阻挡膜(AHO阻挡膜)，所述以往的MIM结构电容器使用HfOx电容绝缘膜，同时，在下部电极和电容绝缘膜之间使用了AlOx阻挡膜。在图3中，横轴示出了电容器的Teq(氧化膜换算膜厚)，纵轴示出了每个存储器单元的漏电流。
如图3所示，在使用了AlOx阻挡膜的以往的MIM结构电容器中，由于在Teq变为大约1.4nm或1.4nm以下之后，漏电流明显增大，因此不能够满足Teq＝1.2nm的要求。
而在使用了HfxAlyOz阻挡膜的本发明的MIM结构电容器中，由于抑制了Teq到大约1.0nm为止的漏电流的增加，因此能够充分地满足Teq＝1.2nm的要求。也就是说，本发明的HfxAlyOz阻挡膜具有用以抑制由来自电极的电子的热放出而引起的漏电流的足够的带隙。
并且，根据本实施例，由于电容绝缘膜18的底层即第1阻挡膜17是非晶体(非结晶)，能够以非结晶或类似非结晶状态形成电容绝缘膜18，因此能够更进一步减少电容器的漏电流。
并且，根据本实施例，由于在第1阻挡膜17及第2阻挡膜19的成膜中使用原子层沉积法，能够在下部电极16的表面确实地形成成为第1阻挡膜17的非晶体HfxAlyOz膜，同时，能够在电容绝缘膜18的表面确实地形成成为第2阻挡膜19的非晶体HfxAlyOz膜，因此能够确实地获得上述效果。
另外，在本实施例中，有关用作第1阻挡膜17及第2阻挡膜19的HfxAlyOz膜的组成，最好是x+y+z＝1、0.115＜x≤0.32、0.01≤y＜0.25、0.635≤z≤0.67。也就是说，最好第1阻挡膜17或第2阻挡膜19中的Al含有率大于或等于1atm％且不满25atm％。这样一来，能够在防止各阻挡膜的相对介电常数下降的同时，使各阻挡膜对电极的带隙高于HfOx。
图4示出了本发明的HfxAlyOz阻挡膜中的Al含有率和相对介电常数的相关关系。另外，在图4中，横轴示出了HfxAlyOz阻挡膜中的Al含有率，纵轴示出了相对介电常数。如图4所示，若Al含有率不满25atm％的话，则能够获得12～13或12～13以上的实用值作为HfxAlyOz阻挡膜的相对介电常数。
并且，在本实施例中，也可以代替HfxAlyOz膜，使用HfxSiyOz膜(含有Si的Hf氧化物)、或含Al及Si两方的Hf氧化物作为第1阻挡膜17或第2阻挡膜19。当使用HfxSiyOz膜时，关于其组成，最好是x+y+z＝1、0.115＜x≤0.32、0.01≤y＜0.25、0.635≤z≤0.67。也就是说，最好第1阻挡膜17或第2阻挡膜19中的Si含有率大于或等于1atm％且不满25atm％。这样一来，能够在防止各阻挡膜的相对介电常数下降的同时，使各阻挡膜对电极的带隙高于HfOx。
并且，在本实施例中，第1阻挡膜17和第2阻挡膜19也可以由不同的材料构成。并且，也可以不设置第1阻挡膜17或第2阻挡膜19中的任意一方。
并且，在本实施例中，成为电容绝缘膜18的HfOx膜中的Al或Si的含有率，从防止相对介电常数下降的观点出发，最好不满1atm％。另外，也可以使用ZrOx膜来代替HfOx膜作为电容绝缘膜18。
并且，在本实施例中，以在衬底上的绝缘膜中设置的凹部形成的MIM电容器作为了对象，但是也可以代替它，以其它类型的MIM电容器为对象。
并且，在本实施例中，将氮化钛(TiN)膜用作了下部电极16及上部电极，但是并不限定于此，下部电极16及上部电极也可以由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。并且，下部电极16和上部电极也可以由不同的材料构成。
并且，在本实施例中，在利用原子层沉积法形成第1阻挡膜17、电容绝缘膜18及第2阻挡膜19时，每次以一个原子层厚度进行了成膜，但是也可以代替它，每次以2～3个原子层厚度进行成膜。
(第2实施例)以下，参照附图对本发明的第2实施例所涉及的半导体装置及其制造方法加以说明。
第2实施例与第1实施例的最大不同在于使用ZrOx代替HfOx作为电容绝缘膜，同时，使用ZrxAlyOz代替HfxAlyOz膜作为阻挡膜。
在第2实施例所涉及的半导体装置的制造方法中，首先，进行与图1(a)～图1(c)所示的第1实施例一样的工序，即进行在半导体衬底10上形成电容器的下部电极16为止的工序。
其次，如图1(d)所示，在下部电极16的表面上及第2层间绝缘膜14的表面上沉积第1阻挡膜17。在本实施例中，第1阻挡膜17由例如含有Al的非晶体的Zr氧化物(ZrxAlyOz)构成，其膜厚例如大约为0.5nm。并且，在第1阻挡膜17的形成中使用例如原子层沉积法。在利用原子层沉积法的成膜中，以脉冲波状、断续地将反应气体导入室内(反应室内)。图5示出了本实施例的利用原子层沉积法来形成ZrxAlyOz膜的工序中的导入反应气体的序列。
具体地说，如图5所示，首先，在将环境气体(例如，氮气体)导入室内后，使半导体衬底10升温到例如200～400℃左右。此时，将室内的气体压力设定为100Pa左右。并且，作为环境气体，除了氮气体以外，还能够使用氩等惰性气体。接着，以脉冲波状将为Zr供给源的例如ZrCl4(四氯化锆)气体导入室内，让ZrCl4或其活性种化学吸附在第2层间绝缘膜14的表面及下部电极16的表面。其次，在切断ZrCl4气体后，将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的ZrCl4气体除去。这里，作为清洗气体，能够使用例如氮气体、氩气体或氦气体等。其次，在切断清洗气体后，将H2O(气体)以脉冲波状导入室内。此时，该H2O、和吸附在第2层间绝缘膜14的表面及下部电极16的表面的上述ZrCl4或其活性种产生热反应，因此，形成一个原子层厚度的ZrOx。然后，再将清洗气体以脉冲波状导入室内，藉此方法，将残留在室内的H2O除去。
在本实施例中，例如，将上述ZrOx的成膜序列反复2、3次，来形成例如2～3个原子层厚度的ZrOx膜，然后，如下所述，进行将Al添加在ZrOx膜中的序列。
即，在形成ZrOx膜后，如图5所示，以脉冲波状将为Al供给源的TMA(三甲基铝)气体导入室内，让TMA或其活性种化学吸附在ZrOx膜的表面。其次，在切断了TMA气体后，以脉冲波状将清洗气体(例如，氮气体)导入室内，藉此方法，将残留在室内的TMA气体除去。其次，在切断清洗气体后，以脉冲波状将H2O(气体)导入室内。此时，在该H2O、吸附在ZrOx膜的表面的上述TMA或其活性种、和底层ZrOx三者之间进行热反应，结果形成非晶体的ZrxAlyOz膜。然后，再以脉冲波状将清洗气体导入室内，藉此方法，将残留在室内的H2O除去。
在本实施例中，通过对由2～3次上述ZrOx的成膜序列、和1次将Al添加在上述ZrOx中的序列而形成非晶体的ZrxAlyOz膜的工序进行例如两次，来形成由例如厚度为0.5nm左右的非晶体ZrxAlyOz膜构成的第1阻挡膜17。此时，第1阻挡膜17的Al含有率例如大约为15％，其相对介电常数大约为15。另外，在本实施例中，能够通过改变上述ZrOx的成膜序列的次数、和将Al添加在上述ZrOx中的序列的次数比，来任意设定第1阻挡膜17的Al含有率。
其次，如图1(e)所示，利用例如原子层沉积法，在第1阻挡膜17的表面上形成例如由ZrOx构成的电容绝缘膜18。具体地说，通过将图5所示的ZrOx的成膜序列进行例如30次左右，来形成由例如厚度为4.8nm左右的ZrOx膜构成的电容绝缘膜18。
其次，如图1(f)所示，在电容绝缘膜18的表面上沉积第2阻挡膜19。在本实施例中，第2阻挡膜19与第1阻挡膜17一样，由例如含有Al的非晶体Zr氧化物(ZrxAlyOz)构成，其膜厚例如大约为0.5nm。并且，第2阻挡膜19的形成方法与例如图5所示的第1阻挡膜17的形成方法相同。
另外，在本实施例中，第1阻挡膜17即厚度为0.5nm的ZrxAlyOz膜、电容绝缘膜18即厚度为4.8nm的ZrOx膜和第2阻挡膜19即厚度为0.5nm的ZrxAlyOz膜的叠层体能够满足Teq＝1.2nm的要求。
其次，对第1阻挡膜17、电容绝缘膜18及第2阻挡膜19进行等离子体氧化处理，藉此方法，将氧提供给第1阻挡膜17、电容绝缘膜18及第2阻挡膜19的各个膜中的氧欠缺部分。
其次，如图1(g)所示，在第2阻挡膜19上形成例如由氮化钛膜等构成的厚度为50nm左右的上部电极材料膜20后，通过将该上部电极材料膜20加工成所希望的形状来形成上部电极，省略图示。
经由上述工序，在半导体衬底10上形成具有由ZrxAlyOz膜构成的阻挡膜的本实施例的MIM电容器。
根据本实施例，在构成电容绝缘膜18的ZrOx和下部电极16的界面设置ZrxAlyOz膜即由含有Al的Zr氧化物构成的第1阻挡膜17，同时，在构成电容绝缘膜18的ZrOx和上部电极的界面设置由ZrxAlyOz膜(含有Al的Zr氧化物)构成的第2阻挡膜19。这样一来，由于能够提高电容绝缘膜18和各电极之间的带隙，因此能够抑制由来自各电极的电子的热放出而引起的漏电流。并且，由于即使在阻挡膜17及19中，也能够获得与ZrOx匹敌的较高的相对介电常数，因此能够在确保电容值的同时，在某种程度上保持物理的厚度，从而，能够抑制由沟道效果引起的漏电流。
并且，根据本实施例，由于电容绝缘膜18的底层即第1阻挡膜17是非晶体(非结晶)，能够以非结晶或类似非结晶状态形成电容绝缘膜18，因此能够更进一步减少电容器的漏电流。
并且，根据本实施例，由于在第1阻挡膜17及第2阻挡膜19的成膜中使用原子层沉积法，因此能够在下部电极16的表面确实地形成成为第1阻挡膜17的非晶体ZrxAlyOz膜，同时，能够在电容绝缘膜18的表面确实地形成成为第2阻挡膜19的非晶体ZrxAlyOz膜，因此能够确实地获得上述效果。
另外，在本实施例中，关于用作第1阻挡膜17及第2阻挡膜19的ZrxAlyOz膜的组成，最好是x+y+z＝1、0.115＜x≤0.32、0.01≤y＜0.25、0.635≤z≤0.67。也就是说，最好第1阻挡膜17或第2阻挡膜19中的Al含有率大于或等于1atm％且不满25atm％。这样一来，能够在防止各阻挡膜的相对介电常数下降的同时，使各阻挡膜对电极的带隙高于ZrOx。
并且，在本实施例中，也可以代替ZrxAlyOz膜，使用ZrxSiyOz膜(含有Si的Zr氧化物)、或含Al及Si两方的Zr氧化物作为第1阻挡膜17或第2阻挡膜19。当使用ZrxSiyOz膜时，关于其组成，最好是x+y+z＝1、0.115＜x≤0.32、0.01≤y＜0.25、0.635≤z≤0.67。也就是说，第1阻挡膜17或第2阻挡膜19中的Si含有率大于或等于1atm％且不满25atm％。这样一来，能够在防止各阻挡膜的相对介电常数下降的同时，使各阻挡膜对电极的带隙高于ZrOx。
并且，在本实施例中，第1阻挡膜17和第2阻挡膜19也可以由不同的材料构成。并且，也可以不设置第1阻挡膜17或第2阻挡膜19中的任意一方。
并且，在本实施例中，成为电容绝缘膜18的ZrOx膜中的Al或Si的含有率，从防止相对介电常数下降的观点出发，最好不满1atm％。另外，也可以使用HfOx膜来代替ZrOx膜作为电容绝缘膜18。
并且，在本实施例中，以在衬底上的绝缘膜中设置的凹部形成的MIM电容器作为了对象，但是也可以代替它，以其它类型的MIM电容器为对象。
并且，在本实施例中，使用了氮化钛(TiN)膜作为下部电极16及上部电极，但是并不限定于此，下部电极16及上部电极也可以由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。并且，下部电极16和上部电极也可以由不同的材料构成。
并且，在本实施例中，在使用原子层沉积法形成第1阻挡膜17、电容绝缘膜18及第2阻挡膜19时，每次以1个原子层厚度进行了成膜，但是也可以代替它，每次以2～3个原子层厚度进行成膜。
(实用性)本发明涉及具有电容器的半导体装置及其制造方法，能够通过在构成电容绝缘膜的HfOx或ZrOx和电极的界面，设置可提高电容绝缘膜和电极之间的带隙且可抑制相对介电常数下降的阻挡膜，来获得能够抑制由来自电极的电子的热放出而引起的漏电流的效果，以及能够通过在确保电容值的同时、在某种程度上保持物理的厚度来抑制由沟道效果而引起的漏电流的效果，非常有用。
权利要求
1.一种半导体装置，包括在衬底上依次叠层下部电极、电容绝缘膜及上部电极而形成的电容器，其特征在于上述电容绝缘膜由Hf氧化物或Zr氧化物构成；在上述下部电极和上述电容绝缘膜之间形成有由含Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第1阻挡膜。
2.根据权利要求1所述的半导体装置，其特征在于在上述上部电极和上述电容绝缘膜之间形成有由含Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第2阻挡膜。
3.根据权利要求2所述的半导体装置，其特征在于上述第2阻挡膜为非晶体。
4.根据权利要求2所述的半导体装置，其特征在于上述第2阻挡膜中的Al或Si的含有率大于或等于1atm％且不满25atm％。
5.根据权利要求1所述的半导体装置，其特征在于上述第1阻挡膜为非晶体。
6.根据权利要求1所述的半导体装置，其特征在于上述第1阻挡膜中的Al或Si的含有率大于或等于1atm％且不满25atm％。
7.根据权利要求1所述的半导体装置，其特征在于上述下部电极及上述上部电极由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。
8.一种半导体装置的制造方法，其特征在于包括工序a，在衬底上形成电容下部电极；工序b，在上述电容下部电极上形成由含有Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第1阻挡膜；工序c，在上述第1阻挡膜上形成由Hf氧化物或Zr氧化物构成的电容绝缘膜；以及工序d，在上述电容绝缘膜上形成电容上部电极。
9.根据权利要求8所述的半导体装置的制造方法，其特征在于在上述工序c和上述工序d之间，还包括在上述电容绝缘膜上形成由含有Al或Si的至少一方的Hf氧化物或Zr氧化物构成的第2阻挡膜的工序e。
10.根据权利要求9所述的半导体装置的制造方法，其特征在于在上述工序e中，上述第2阻挡膜是用原子层沉积法形成的。
11.根据权利要求8所述的半导体装置的制造方法，其特征在于在上述工序b中，上述第1阻挡膜是用原子层沉积法形成的。
12.根据权利要求8所述的半导体装置的制造方法，其特征在于在上述工序c中，上述电容绝缘膜是用原子层沉积法形成的。
13.根据权利要求8所述的半导体装置的制造方法，其特征在于在上述工序c之后，还包括对上述电容绝缘膜进行等离子体氧化处理的工序f。
14.根据权利要求8所述的半导体装置的制造方法，其特征在于上述下部电极及上述上部电极由TiN、Ti、Al、W、WN、Pt、Ir及Ru中的至少一种构成。
全文摘要
本发明公开了一种半导体装置及其制造方法。目的在于提供一种包括了MIM电容器的半导体装置及其制造方法，该MIM电容器能够抑制由来自电极的电子的热放出而引起的漏电流及由沟道效果而引起的漏电流，且能够维持较高的相对介电常数。在包括了依次叠层下部电极16、电容绝缘膜18及上部电极20而形成的电容器的半导体装置中，电容绝缘膜18由Hf氧化物或Zr氧化物构成，在下部电极16和电容绝缘膜18之间形成有由含Al或Si的至少一方的Hf氧化物或Zr氧化物构成的阻挡膜17。
文档编号H01L21/8222GK1933161SQ200610091228
公开日2007年3月21日 申请日期2006年6月7日 优先权日2005年9月16日
发明者大塚隆史, 中林隆 申请人:松下电器产业株式会社