一种栅极驱动装置和显示装置制造方法

一种栅极驱动装置和显示装置制造方法
【专利摘要】本发明实施例提供了一种栅极驱动装置和显示装置，用以解决现有的栅极驱动装置由于需要10根信号线来驱动，从而导致采用该栅极驱动装置的显示装置的边框较宽，使得在制造包括该栅极驱动装置的显示装置时原材料消耗较大，进而导致显示装置的成本较高的问题。该栅极驱动装置通过改变采用时钟信号替代正向扫描信号、和/或采用时钟信号替代反向扫描信号、和/或采用复位信号和第一初始触发信号（或第二初始触发信号）替代低电平信号、和/或第一初始触发信号和第二初始触发信号采用相同的信号来减少用于驱动该栅极驱动装置的信号的传输线。
【专利说明】一种栅极驱动装置和显示装置【技术领域】
[0001]本发明涉及显示【技术领域】，尤其涉及一种栅极驱动装置和显示装置。
【背景技术】
[0002]液晶显示器(liquidcrystal display, IXD)或有机发光二极管(OrganicLight-Emitting Diode, OLED)具有低福射、体积小及低耗能等优点，已逐渐在部分应用中取代传统的阴极射线管显示器(Cathode Ray Tube display,CRT),因而被广泛地应用在笔记本电脑、个人数字助理(Personal Digital Assistant,PDA)、平面电视,或移动电话等信息产品上。传统液晶显示器的方式是利用外部驱动芯片来驱动面板上的芯片以显示图像，但为了减少元件数目并降低制造成本，近年来逐渐发展成将驱动电路结构直接制作于显示面板上，例如采用将栅极驱动电路(gate driver)整合于液晶面板(Gate On Array, GOA)的技术。
[0003]目前常用的由多个移位寄存单元连接而成的栅极驱动装置需要10根信号线来驱动，如图1所示，栅极驱动装置包含偶数个移位寄存单元，且N不能被4整除，N为图1所示的栅极驱动装置中包含的移位寄存单元的个数。在栅极驱动装置中，除前两个移位寄存单元以外的每个移位寄存单元的正向选择信号端GN-1接收该移位寄存单元之前的第二个移位寄存单元输出的信号；除最后两个移位寄存单元以外的每个移位寄存单元的反向选择信号端GN+1接收该移位寄存单元之后的第二个移位寄存单元输出的信号。栅极驱动装置中的第一个移位寄存单元的正向选择信号端GN-1接收第一初始触发信号STV1，栅极驱动装置中的第二个移位寄存单元的正向选择信号端口 GN-1接收第二初始触发信号STV2 ;若栅极驱动装置中包含偶数个移位寄存单元，则栅极驱动装置中的倒数第一个移位寄存单元的反向选择信号端口 GN+1接收第二初始触发信号STV2，栅极驱动装置装置中的倒数第二个移位寄存单元的反向选择信号端口 GN+1接收第一初始触发信号STVl ;若栅极驱动装置中包含奇数个移位寄存单元，则栅极驱动装置中的倒数第一个移位寄存单元的反向选择信号端口 GN+1接收第一初始触发信号STV1，栅极驱动装置装置中的倒数第二个移位寄存单元的反向选择信号端口 GN+1接收第二初始触发信号STV2。栅极驱动装置中的每个移位寄存单元的正向扫描信号FW端接收正向扫描信号FW，每个移位寄存单元的反向扫描信号BW端接收反向扫描信号BW,当正向扫描信号FW为高电平,反向扫描信号BW为低电平时,栅极驱动装置正向扫描栅极线，当正向扫描信号FW为低电平，反向扫描信号BW为高电平时，栅极驱动装置反向扫描栅极线。栅极驱动装置中的每个移位寄存单元的复位信号RST端接收复位信号RST，每个移位寄存单元的低电平信号VGL端接收低电平信号。
[0004] 在图1所示的栅极驱动装置中，每个移位寄存单元的时钟阻碍信号CLKB端接收第mod ((N-1)/4)时钟信号，每个移位寄存单元的时钟信号CLK端接收第mod ((mod ((N-1) /4) +2) /4)时钟信号，例如，对于第一个移位寄存单元，N=I，则该移位寄存单元的时钟阻碍信号CLKB端接收第零时钟信号CLK0，该移位寄存单元的时钟信号CLK端接收第二时钟信号CLK2 ;对于第二个移位寄存单元，N=2，则该移位寄存单元的时钟阻碍信号CLKB端接收第一时钟信号CLK1，该移位寄存单元的时钟信号CLK端接收第三时钟信号CLK3 ;对于第三个移位寄存单元，N=3，则该移位寄存单元的时钟阻碍信号CLKB端接收第二时钟信号CLK1，该移位寄存单元的时钟信号CLK端接收第零时钟信号CLKO ;对于第四个移位寄存单元，N=4，则该移位寄存单元的时钟阻碍信号CLKB端接收第三时钟信号CLK3，该移位寄存单元的时钟信号CLK端接收第一时钟信号CLK1。其中，第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；复位信号RST可以控制栅极驱动装置中的各个移位寄存单元复位，输出低电平信号。
[0005]综上，由于目前常用的栅极驱动装置需要10根信号线来驱动，包括正向扫描信号FW、反向扫描信号BW、第一初始触发信号STV1、第二初始触发信号STV2、第O时钟信号CLKO、第I时钟信号CLKl、第2时钟信号CLK2、第3时钟信号CLK3、低电平信号VGL、复位信号RST，在显示面板中约占0.3mm的宽度，这会导致采用该栅极驱动装置的显示面板的边框较宽，导致在制造包括该栅极驱动装置的显示装置时原材料消耗较大，从而使得显示装置的成本较高。

【发明内容】

[0006]本发明实施例提供了一种栅极驱动装置和显示装置，用以解决现有的栅极驱动装置由于需要10根信号线来驱动，从而导致采用该栅极驱动装置的显示装置的边框较宽，使得在制造包括该栅极驱动装置的显示装置时原材料消耗较大，进而导致显示装置的成本较高的问题。
[0007]基于上述问题，本发明实施例提供的一种栅极驱动装置，包括N个移位寄存单元；
[0008]第P个移位寄存单元的正向选择信号端接收第p-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则倒数第二个移位寄存单元的反向选择信号端接收第一初始触发信号，倒数第一个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则倒数第一个移位寄存单元的反向选择信号端接收第一初始触发信号，倒数第二个移位寄存单元的反向选择信号端接收第二初始触发信号；每个移位寄存单元的低电平信号端接收低电平信号；每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前中贞扫描时为低电平；
[0009]第k个移位寄存单元的时钟阻碍信号端接收第mod((k-l)/4)时钟信号，k=l, 2...，N ;除前两个移位寄存单元以外的每个移位寄存单元的正向扫描信号端接收的信号与该移位寄存单元的前一个移位寄存单元的时钟阻碍信号端接收的信号相同，第一个移位寄存单元的正向扫描信号端接收第2时钟信号，第二个移位寄存单元的正向扫描信号端接收第3时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；第η时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第一预设时长，其中，11=0，1，2，3，当11+1>3时，第n+1时钟信号为第mod ((n+1)/4)时钟信号；
[0010]在正向扫描时,第一初始触发信号为高电平的时间段与第2时钟信号一次为高电平的时间段交叠，交叠时长不小于第一个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第2时钟信号的一个周期，第二初始触发信号为高电平的时间段与第3时钟信号一次为高电平的时间段交叠，交叠时长不小于第二个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第3时钟信号的一个周期。
[0011]本发明实施例提供的一种栅极驱动装置，包括N个移位寄存单元； [0012]第P个移位寄存单元的正向选择信号端接收第p-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则第N-1个移位寄存单元的反向选择信号端接收第一初始触发信号，第N个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则第N个移位寄存单元的反向选择信号端接收第一初始触发信号，第N-1个移位寄存单元的反向选择信号端接收第二初始触发信号；每个移位寄存单元的低电平信号端接收低电平信号；每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平;
[0013]第k个移位寄存单元的时钟阻碍信号端接收第mod((k-1)/4)时钟信号，k=l，2...，N ;除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端接收的信号相同，倒数第二个移位寄存单元的反向扫描信号端接收第mod ((mod ((N-2) /4) +2) /4)时钟信号，倒数第一个移位寄存单元的反向扫描信号端接收第m0d((m0d((N-l)/4)+2)/4)时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平;第η时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第二预设时长，其中，n=0，1，2，3，当n+l>3时，第n+1时钟信号为第mod ((n+1)/4)时钟信号；
[0014]在反向扫描时，若N为奇数，第一初始触发信号为高电平的时间段与第mod((mod((N-1) /4) +2) /4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-1)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第mod ((mod ((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠,交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-2) /4) +2) /4)时钟信号的一个周期；若N为偶数，第一初始触发信号为高电平的时间段与第m0d((m0d((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-2)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第m0d((m0d((N-l)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-l)/4)+2)/4)时钟信号的一个周期。
[0015]本发明实施例提供的一种栅极驱动装置，包括N个移位寄存单元；
[0016]第P个移位寄存单元的正向选择信号端接收第p-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则第N-1个移位寄存单元的反向选择信号端接收第一初始触发信号，第N个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则第N个移位寄存单元的反向选择信号端接收第一初始触发信号，第N-1个移位寄存单元的反向选择信号端接收第二初始触发信号；第k个移位寄存单元的时钟阻碍信号端接收第mod ((k-1)/4)时钟信号，k=l, 2...，N ；
[0017]每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平；所述栅极驱动装置中的每个移位寄存单元的初始触发信号端接收第一初始触发信号或者第二初始触发信号；复位信号为高电平时，第一初始触发信号和第二初始触发信号均为低电平，第一初始触发信号为高电平时，复位信号为低电平，第二初始触发信号为高电平时，复位信号为低电平；
[0018]各个移位寄存单元，用于在正/反向选择信号端接收到高电平信号，且正/反向扫描信号端接收到高电平信号时，用正/反向扫描信号端接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号端接收到的信号输出；在反/正向选择信号端接收到高电平信号，且反/正向扫描信号端接收到低电平信号时，用反/正向扫描信号端接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管关闭；以及在复位信号端为高电平时，用初始触发信号端接收到的信号对自身中驱动栅极线的晶体管的栅极的电位进行下拉，并将初始触发信号端接收到的信号输出。
[0019]本发明实施例提供的显示装置，包括本发明实施例提供的栅极驱动装置。
[0020]本发明实施例的有益效果包括:
[0021]本发明实施例提供的栅极驱动装置和显示装置，由于每个移位寄存单元可以将时钟信号作为正向扫描信号使用，因此，在驱动该栅极驱动装置的信号线中可以不包含正向扫描信号线，或者，由于每个移位寄存单元可以将时钟信号作为反向扫描信号使用，因此，在驱动该栅极驱动装置的信号线中可以不包含反向扫描信号线，或者，由于每个移位寄存单元可以将复位信号和初始触发信号作为低电平信号使用，因此驱动该栅极驱动装置的信号线中可以不包含低电平信号线，这使得驱动本发明实施例提供的栅极驱动装置的信号线较少，减少了制造包括本发明实施例提供的栅极驱动装置的显示面板时原材料消耗，降低了包括本发明实施例提供的栅极驱动装置的显示装置的成本。
【专利附图】

【附图说明】
[0022] 图1为现有技术中的栅极驱动装置的结构示意图；
[0023]图2a为图1所示的栅极驱动装置正向扫描时的时序图；[0024]图2b为图1所示的栅极驱动装置反向扫描时的时序图；
[0025]图3为本发明实施例提供的栅极驱动装置的结构示意图之一；
[0026]图4为本发明实施例提供的栅极驱动装置中的移位寄存单元的结构示意图之一；
[0027]图5为本发明实施例提供的栅极驱动装置中的移位寄存单元的电路图之一；
[0028]图6a为图3所示的栅极驱动装置正向扫描时的时序图；
[0029]图6b为图3所示的栅极驱动装置反向扫描时的时序图；
[0030]图7为本发明实施例提供的栅极驱动装置的结构示意图之二 ；
[0031]图8a为图7所示的栅极驱动装置正向扫描时的时序图；
[0032]图8b为图7所示的栅极驱动装置反向扫描时的时序图；
[0033]图9为本发明实施例提供的栅极驱动装置的结构示意图之三；
[0034]图1Oa为图9所示的栅极驱动装置正向扫描时的时序图；
[0035]图1Ob为图9所示的栅极驱动装置反向扫描时的时序图； [0036]图11为本发明实施例提供的栅极驱动装置中的移位寄存单元的结构示意图之-* ;
[0037]图12为本发明实施例提供的栅极驱动装置中的移位寄存单元的电路图之二 ；
[0038]图13为本发明实施例提供的栅极驱动装置的结构示意图之四；
[0039]图14a为图13所示的栅极驱动装置正向扫描时的时序图；
[0040]图14b为图13所示的栅极驱动装置反向扫描时的时序图；
[0041]图15为本发明实施例提供的栅极驱动装置的结构示意图之五；
[0042]图16a为图15所示的栅极驱动装置正向扫描时的时序图；
[0043]图16b为图15所示的栅极驱动装置反向扫描时的时序图；
[0044]图17为本发明实施例提供的栅极驱动装置的结构示意图之六；
[0045]图18为本发明实施例提供的栅极驱动装置中的移位寄存单元的结构示意图之
[0046]图19为本发明实施例提供的栅极驱动装置中的移位寄存单元的电路图之三；
[0047]图20a为图17所示的栅极驱动装置正向扫描时的时序图；
[0048]图20b为图17所示的栅极驱动装置反向扫描时的时序图；
[0049]图21为本发明实施例提供的栅极驱动装置的结构示意图之七；
[0050]图22a为图21所示的栅极驱动装置正向扫描时的时序图；
[0051]图22b为图21所示的栅极驱动装置反向扫描时的时序图；
[0052]图23为本发明实施例提供的栅极驱动装置的结构示意图之七；
[0053]图24a为图23所示的栅极驱动装置正向扫描时的时序图；
[0054]图24b为图23所示的栅极驱动装置反向扫描时的时序图；
[0055]图25为本发明实施例提供的栅极驱动装置的结构示意图之八；
[0056]图26a为图25所示的栅极驱动装置正向扫描时的时序图；
[0057]图26b为图25所示的栅极驱动装置反向扫描时的时序图；
[0058]图27为本发明实施例提供的栅极驱动装置的结构示意图之九；
[0059]图28a为图27所示的栅极驱动装置正向扫描时的时序图；
[0060]图28b为图27所示的栅极驱动装置反向扫描时的时序图；[0061]图29为本发明实施例提供的栅极驱动装置中的移位寄存单元的结构示意图之四；
[0062]图30为本发明实施例提供的栅极驱动装置中的移位寄存单元的电路图之四。【具体实施方式】
[0063]当栅极驱动装置采用10根信号线驱动时，其正向扫描时的时序图如图2a所示，反向扫描时的时序图如图2b所示，其中，10根信号线上传输的信号分别为:正向扫描信号FW、反向扫描信号BW、第一初始触发信号STVl、第二初始触发信号STV2、第O时钟信号CLKO、第I时钟信号CLK1、第2时钟信号CLK2、第3时钟信号CLK3、低电平信号VGL、复位信号RST，第O时钟信号为高电平的时间段与第I时钟信号为高电平的时间段可以交叠，也可以不交叠；第2时钟信号为高电平的时间段与第3时钟信号为高电平的时间段可以交叠，也可以不交叠。
[0064]在图2a中，Pl表示图1所示的栅极驱动装置中的第一个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，GOUTl表示第一个移位寄存单元输出的信号；P2表示图1所示的栅极驱动装置中的第二个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UT2表示第二个移位寄存单元输出的信号；P3表示图1所示的栅极驱动装置中的第三个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UT3表示第三个移位寄存单元输出的信号；P4表示图1所示的栅极驱动装置中的第四个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UT4表示第四个移位寄存单元输出的信号。如图2a所示，每个移位寄存单元，在正向选择信号端GN-1接收到高电平信号时，用正向扫描信号端FW接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号CLKB端接收到的信号CLKB输出；在反向选择信号端GN+1接收到高电平信号时，用反向扫描信号端BW接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管稳定关闭；在复位信号RST为高电平时，用低电平信号VGL端接收到的信号对自身中驱动栅极线的晶体管的栅极的电位进行下拉，并将低电平信号VGL端接收到的信号VGL输出。图2a中仅给出了采用10根信号线驱动的栅极驱动装置中的前4个移位寄存单元工作的时序图。
[0065]在图2b中，PN表示图1所示的栅极驱动装置中的最后一个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，GOUTN表示最后一个移位寄存单元输出的信号；PN-1表示图1所示的栅极驱动装置中的倒数第二个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UTN-1表不倒数第二个移位寄存单兀输出的信号；PN-2表不图1所不的栅极驱动装置中的倒数第三个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UTN-2表示倒数第三个移位寄存单元输出的信号；PN-3表示图1所示的栅极驱动装置中的倒数第四个移位寄存单元中的驱动栅极线的晶体管的栅极的信号，G0UTN-3表示倒数第四个移位寄存单元输出的信号。如图2b所示，在反向选择信号端GN+1接收到高电平信号时，用反向扫描信号端BW接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号CLKB端接收到的信号CLKB输出；在正向选择信号端GN-1接收到高电平信号时，用正向扫描信号端FW接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管稳定关闭；在复位信号RST为高电平时，用低电平信号VGL端接收到的信号对自身中驱动栅极线的晶体管的栅极的电位进行下拉，并将低电平信号VGL端接收到的信号VGL输出。图2b中仅给出了采用10根信号线驱动的栅极驱动装置中的最后4个移位寄存单元工作的时序图。
[0066]本发明实施例提供的栅极驱动装置和显示装置，由于其中的每个移位寄存单元可以将时钟信号作为正向扫描信号使用，因此，在驱动该栅极驱动装置的信号线中可以不包含正向扫描信号线，或者，由于其中的每个移位寄存单元可以将时钟信号作为反向扫描信号使用，因此，在驱动该栅极驱动装置的信号线中可以不包含反向扫描信号线，或者，由于其中的每个移位寄存单元可以将复位信号和初始触发信号作为低电平信号使用，因此驱动该栅极驱动装置的信号线中可以不包含低电平信号线，这使得驱动本发明实施例提供的栅极驱动装置的信号线较少，减少了制造包括本发明实施例提供的栅极驱动装置的显示面板时原材料消耗，降低了包括本发明实施例提供的栅极驱动装置的显示装置的成本。
[0067]下面结合说明书附图，对本发明实施例提供的一种栅极驱动装置及显示装置的【具体实施方式】进行说明。下面仅以本发明实施例提供的栅极驱动装置中的移位寄存单元为非晶娃半导体移位寄存单元(ASG, alpha silica gate)为例,说明本发明实施例提供的栅极驱动装置的连接结构以及工作时序。当然，本发明实施例提供的栅极驱动装置中的移位寄存单元还可以是氧化物半导体移位寄存单元、低温多晶硅移位寄存单元等，其连接结构和工作时序分别与本发明实施例提供的栅极驱动装置中的移位寄存单元为非晶硅半导体移位寄存单元时的连接结构和工作时序相同，在此不再赘述。
[0068]本发明实施例提供的一种栅极驱动装置，如图3所示，包括N个移位寄存单元；
[0069]第P个移位寄存单元ASGp的正向选择信号端GN-1接收第p_2个移位寄存ASGp_2单元输出的信号G0UTp-2，p=3，4，....N，第r个移位寄存单元ASGr的反向选择信号端GN+1接收第r+2个移位寄存单元ASGr+2输出的信号G0UTr+2，r=l，2，…N_2 ;第一个移位寄存单元ASGl的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2的正向选择信号端GN-1接收第二初始触发信号STV2 ;若N为偶数，则倒数第二个移位寄存单元ASGN-1的反向选择信号端GN+1接收第一初始触发信号STV1，倒数第一个移位寄存单元ASGN的反向选择信号端GN+1接收第二初始触发信号STV2 ;若N为奇数，则倒数第一个移位寄存单元ASGN的反向选择信号端GN+1接收第一初始触发信号STVl，倒数第二个移位寄存单元ASGN-1的反向选择信号端GN+1接收第二初始触发信号STV2 ;每个移位寄存单元的低电平信号端VGLIN接收低电平信号VGL ;每个移位寄存单元的复位信号RSTIN端接收复位信号RST，复位信号RST在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平；
[0070]第k个移位寄存单元ASGk的时钟阻碍信号端CLKBIN接收第mod ((k-1)/4)时钟信号CLK mod ((k-1)/4)，k=l，2...，N，例如，第一个移位寄存单元ASGl的时钟阻碍信号端CLKBIN接收第O时钟信号CLKO ;除前两个移位寄存单元，即第一个移位寄存单元ASGl和第二个移位寄存单元AS G2以外的每个移位寄存单元的正向扫描信号端FWIN接收的信号与该移位寄存单元的前一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，也就是说，第I个移位寄存单元ASGl的正向扫描信号端FWIN接收第mod ((1-2)/4)时钟信号CLKmod ((1-2)/4)，1=3，4...，N，第一个移位寄存单元ASGl的正向扫描信号端FWIN接收第2时钟信号CLK2，第二个移位寄存单元ASG2的正向扫描信号端FWIN接收第3时钟信号CLK3 ；第O时钟信号CLKO为高电平时，第2时钟信号CLK2为低电平，第2时钟信号CLK2为高电平时，第O时钟信号CLKO为低电平；第I时钟信号CLKl为高电平时，第3时钟信号CLK3为低电平，第3时钟信号CLK3为高电平时，第I时钟信号CLKl为低电平；第η时钟信号CLKn为高电平的时间段与第η+1时钟信号CLKn+Ι为高电平的时间段交叠，每次交叠的时长不小于第一预设时长，其中，n=0，1，2，3，当n+l>3时，第η+1时钟信号CLKn+1为第mod ((n+1) /4)时钟信号 CLK mod ((n+1)/4)；
[0071]在正向扫描时，第一初始触发信号STVl为高电平的时间段与第2时钟信号CLK2一次为高电平的时间段交叠，交叠时长不小于第一个移位寄存单元ASGl中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第2时钟信号CLK2的一个周期，第二初始触发信号STV2为高电平的时间段与第3时钟信号CLK3 —次为高电平的时间段交叠，交叠时长不小于第二个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第3时钟信号CLK3的一个周期；
[0072]图3所示的栅极驱动装置中的各个移位寄存单元可以采用图4所示的移位寄存单元的结构，当然，也可以采用其他结构的移位寄存单元，只要采用图3所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。图4所示的移位寄存单元包括第一驱动模块41、第一输出模块42和第一复位模块43 ；
[0073]第一驱动模块41的第一端为所述移位寄存单兀的正向扫描信号端FWIN,第一驱动模块41的第二端为所述移位寄存单元的正向选择信号端GN-1，第一驱动模块41的第三端为所述移位寄存单元的反向扫描信号端BWIN，第一驱动模块41的第四端为所述移位寄存单元的反向选择信号端GN+1，第一驱动模块41的第五端连接第一输出模块42的第二端，第一输出模块42的第一端为所述移位寄存单元的时钟阻碍信号端CLKBIN，第一输出模块42的第三端为所述移位寄存单元的输出端GOUT ;第一复位模块43的第一端连接第一输出模块42的第二端，第一复位模块43的第二端为所述移位寄存单元的复位信号端RSTIN，第一复位模块43的第三端为所述移位寄存单元的低电平信号端VGLIN，第一复位模块43的第四端连接第一输出模块42的第三端；
[0074]第一驱动模块41,用于在正向选择信号信号端GN-1接收到高电平信号时,将正向扫描信号端FWIN接收到的信号通过自身第五端输出；并在反向选择信号端GN+1接收到高电平信号时，将反向扫描信号端BWIN接收到的信号端通过自身第五端输出；
[0075]第一复位模块43，用于在复位信号端RSTIN接收到高电平信号时，将低电平信号端VGLIN接收到的信号分别通过自身的第一端和第四端输出；
[0076]第一输出模块42，用于在通过自身第二端接收到高电平信号时，存储该高电平信号，并将时钟阻碍信号端CLKBIN接收到的信号从所述移位寄存单元的输出端GOUT输出；并在通过自身第二端接收到低电平信号时，存储该低电平信号，并不再将时钟阻碍信号端CLKBIN接收到的信号从所述移位寄存单元的输出端GOUT输出。
[0077]图4中第一驱动模块41、第一输出模块42和第一复位模块43三者相连的节点为上拉结点P。
[0078]进一步地，图4中的第一驱动模块可以采用图5所示的结构，在图5中第一驱动模块41包括第一晶体管Tl和第二晶体管T2 ;第一晶体管Tl的第一极为第一驱动模块41的第一端，第一晶体管Tl的栅极为第一驱动模块41的第二端，第一晶体管Tl的第二极为第一驱动模块41的第五端；第二晶体管T2的第一极为第一驱动模块41的第五端，第二晶体管T2的栅极为第一驱动模块41的第四端，第二晶体管T2的第二极为第一驱动模块41的第三端；第一晶体管Tl,用于在正向选择信号端GN-1接收到高电平信号时开启，将正向扫描信号端FWIN接收到的信号传输到第一驱动模块41的第五端；并在正向选择信号端GN-1接收到低电平信号时关断，不再将正向扫描信号端FWIN接收到的信号传输到第一驱动模块41的第五端；第二晶体管T2，用于在反向选择信号端GN+1接收到高电平信号时开启，将反向扫描信号端BWIN接收到的信号传输到第一驱动模块41的第五端；并在反向选择信号端GN+1接收到低电平信号时关断，不再将反向扫描信号端BWIN接收到的信号传输到第一驱动模块41的第五端。
[0079]进一步地，图4中的第一复位模块可以采用图5所示的结构，在图5中第一复位模块42包括第三晶体管T3和第四晶体管T4 ;第三晶体管Tl的第一极为第一复位模块42的第一端，第三晶体管T3的栅极为第一复位模块42的第二端，第三晶体管T3的第二极为第一复位模块42的第三端，第四晶体管T4的第一极为第一复位模块42的第三端，第四晶体管T4的栅极为第一复位模块42的第二端，第四晶体管T4的第二极为第一复位模块42的第四端；第三晶体管T3，用于在复位信号端RSTIN为高电平时开启，将低电平信号端VGLIN接收到的信号传输到第一复位模块42的第一端，并在复位信号端RSTIN为低电平时关断；第四晶体管T4，用于在复位信号端RSTIN为高电平时开启，将低电平信号端VGLIN接收到的信号传输到第一复位模块42的第四端，并在复位信号端RSTIN为低电平时关断。
[0080]进一步地，图4中的第一输出模块可以采用图5所示的结构，在图5中第一输出模块43包括第五晶体管T5和第一电容Cl ;第五晶体管T5的第一极为第一输出模块43的第一端，第五晶体管T5的栅极连接第一电容Cl的一端,第五晶体管T5的栅极为第一输出模块43的第二端，第五晶体管T5的第二极为第一输出模块43的第三端，第一电容Cl的另一端连第五晶体管T5的第二极；第五晶体管T5，用于在自身的栅极为高电平时开启，将时钟阻碍信号端CLKBIN接收到的信号传输至所述移位寄存单元的输出端G0UT，并在自身的栅极为高电平时关断；第一电容Cl,用于存储第五晶体T5的栅极的信号。
[0081]下面以图3所示的栅极驱动装置中的各个移位寄存单元采用图5所示的移位单元的结构为例，说明图3所示的栅极驱动装置在正向扫描和反向扫描时工作情况。在正向扫描时，图3所示的栅极驱动装置工作的时序图如图6a所示。在反向扫描时，图3所示的栅极驱动装置工作的时序图如图6b所示，其中，图6a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图6b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。假设图3所示的栅极驱动装置中包含N个移位寄存单元，，下面仅以N为4的整数倍为例说明栅极驱动装置的工作原理。当N为除4的整数倍以外的整数时栅极驱动装置的工作原理与N为4的整数倍时栅极驱动装置的工作原理类似，在此不再赘述。
[0082]在图6a中，在第一个移位寄存单元ASGl的第I时段，其正向选择信号端GN-1接收到的第一初始触发信号STVl为高电平，第一个移位寄存单元ASGl中的第一晶体管Tl开启，同时其正向扫描信号端FWIN接收到的第2时钟信号CLK2为高电平，因此，第一个移位寄存单元ASGl中的第一电容Cl开始充电，当第一电容Cl充电至第一个移位寄存单元ASGl中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第一个移位寄存单元ASGl的时钟阻碍信号端CLKBIN接收到的信号，即第O时钟信号CLKO会通过第五晶体管T5从第一个移位寄存单元ASGl的输出端GOUTl输出，在第一个移位寄存单元ASGl的第I时段，第O时钟信号CLKO为低电平，因此，第一个移位寄存单元ASGl的输出端GOUTl输出低电平信号；当第O时钟信号CLKO由低电平变为高电平时，第一个移位寄存单元ASGO由第I时段进入第2时段。在第一个移位寄存单兀ASGl的第2时段,第一初始触发信号STVl为低电平，因此，第一个移位寄存单元ASGl中的第一晶体管Tl关断，但由于第一电容Cl将第一个移位寄存单元ASGl中的上拉结点Pl的电压信号存储下来，因此，第一个移位寄存单元ASGl中的第五晶体管Τ5仍然开启，由于此时段第O时钟信号CLKO为高电平，第一个移位寄存单元ASGl的输出端GOUTl输出高电平信号，第一电容Cl的自举效应会使得第一个移位寄存单元ASGl的上拉结点Pl的电位进一步上升；第O时钟信号CLKO由高电平变为低电平时，第一个移位寄存单元ASGl由第2时段进入第3时段。在第一个移位寄存单元ASGl的第3时段，第一初始触发信号STVl为低电平，因此，第一个移位寄存单元ASGl中的第一晶体管Tl关断，由于第一个移位寄存单元ASGl中的第一电容Cl的存储作用，第一个移位寄存单元ASGl中的第五晶体管Τ5仍然开启，由于此时段第O时钟信号CLKO为低电平，因此，第一个移位寄存单元ASGl的输出端GOUTl输出低电平信号，当第一个移位寄存单元ASGl的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号(当第2时钟信号CLK2为高电平时，第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号)、且反向扫描信号Bff为低电平(在图6a中，反向扫描信号BW —直为低电平)时,第一个移位寄存单兀ASGl中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第一个移位寄存单元ASGl中的第五晶体管T5关断，第一个移位寄存单元ASGl的第3时段结束；其中，第一个移位寄存单元ASGl的第I时段、第2时段和第3时段为该第一个移位寄存单元ASGl连接的栅极线被选通的时间段。
[0083]由于第一个移位寄存单兀ASGl中的第一电容Cl在第一初始触发信号STVl为高电平，且第2时钟信号CLK2为高电平时充电，为了保证第一移位寄存单元ASGl中的第五晶体管T5能够稳定开启，因此，第一初始信号STVl为高电平的时间段和第2时钟信号CLK2为高电平的时间段相互交叠的时长，要不小于第一个移位寄存单元ASGl中的第一电容Cl充电至第一个移位寄存单兀ASGl中的第五晶体管T5能够稳定开启所需的电压的时长。
[0084]在图6a中，在第二个移位寄存单元ASG2的第I时段，其正向选择信号端GN-1接收到的第二初始触发信号STV2为高电平，第二个移位寄存单元ASG2中的第一晶体管Tl开启，同时其正向扫描信号端FWIN接收到的第3时钟信号CLK3为高电平，因此，第二个移位寄存单元ASG2中的第一电容Cl开始充电，当第一电容Cl充电至第二个移位寄存单元ASG2中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第二个移位寄存单元ASG2的时钟阻碍信号端CLKBIN接收到的信号，即第I时钟信号CLKl会通过第五晶体管T5从第二个移位寄存单元ASG2的输出端G0UT2输出，在第二个移位寄存单元ASG2的第I时段，第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端G0UT2输出低电平信号；当第I时钟信号CLKl由低电平变为高电平时，第二个移位寄存单元ASG2由第I时段进入第2时段。在第二个移位寄存单元ASG2的第2时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第一晶体管Tl关断，但由于第一电容Cl将第二个移位寄存单元ASG2中的上拉结点P2的电压信号存储下来，因此，第二个移位寄存单元ASG2中的第五晶体管T5仍然开启，由于此时段第I时钟信号CLKl为高电平，第二个移位寄存单元ASG2的输出端G0UT2输出高电平信号，第一电容Cl的自举效应会使得第二个移位寄存单元ASG2的上拉结点Ρ2的电位进一步上升；当第I时钟信号CLKl由高电平变为低电平时，第二个移位寄存单元ASG2由第2时段进入第3时段。在第二个移位寄存单元ASG2的第3时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第一晶体管Tl关断，但由于第二个移位寄存单元ASG2中的第一电容Cl的存储作用，第二个移位寄存单元ASG2中的第五晶体管Τ5仍然开启，由于此时段第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端G0UT2输出低电平信号，当第二个移位寄存单元ASG2的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号(当第3时钟信号CLK3为高电平时，第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号)、且反向扫描信号BW为低电平(在图6a中，反向扫描信号BW —直为低电平)时，第二个移位寄存单元ASG2中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第二个移位寄存单元ASG2中的第五晶体管T5关断，第二个移位寄存单元ASG2的第3时段结束；其中，第二移位寄存单元ASG2的第I时段、第2时段和第3时段为该第二移位寄存单元ASG2连接的栅极线被选通的时间段。
[0085]由于第二个移位寄存单元ASG2中的第一电容Cl在第二初始触发信号STV2为高电平，且第3时钟信号CLK3为高电平时充电，为了保证第二个移位寄存单元ASG2中的第五晶体管T5能够稳定开启，因此，第二初始信号STV2为高电平的时间段和第3时钟信号CLK3为高电平的时间段相互交叠的时长，要不小于第二个移位寄存单元ASG2中的第一电容Cl充电至第二个移位寄存单元ASG2中的第五晶体管T5能够稳定开启所需的电压的时长。
[0086]在图6a中，在第q (q=3, 4, -,N)个移位寄存单元ASGq的第I时段，其正向选择信号端GN-1接收到的第q_2个移位寄存单元ASGq-2的输出端G0UTq-2为高电平(当第mod((q-3)/4)时钟信号CLK mod((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号)，第q个移位寄存单元ASGq中的第一晶体管Tl开启，同时其正向扫描信号端FWIN接收到的第mod ((q-2)/4)时钟信号CLK mod((q-2)/4)为高电平，因此，第q个移位寄存单元ASGq中的第一电容Cl开始充电，当第一电容Cl充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod((q-l)/4)时钟信号CLK mod((q-l)/4)会通过第五晶体管T5从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q_l)/4)时钟信号CLK mod((q-l)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第q个移位寄存单元ASGq的第I时段，只有在第mod ((q_3)/4)时钟信号CLKmod ((q-3)/4)为高电平、且第mod ((q_2)/4)时钟信号CLK mod ((q-2)/4)为高电平时，第q个移位寄存单元ASGq中的第一电容Cl才能够充电，因此，要保证第q个移位寄存单元ASGq中的第五晶体管T5能够稳定开启，第mod((q_3)/4)时钟信号CLK mod ((q-3)/4)为闻电平的时间段，与第mod((q_2)/4)时钟/[目号CLKmod((q_2)/4)为闻电平的时间段需要交叠，并且交叠的时长要不小于第一预设时长，其中，第一预设时长为第q个移位寄存单元ASGq中的第一电容Cl充电到其中的第五晶体管T5能够稳定开启所需的时长；其中，第q个移位寄存单元ASGq中的第一电容Cl可以充电的时间段为图6a中虚线圆所示的时间段；在第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)由高电平变为低电平后，即使第mod ((q-2)/4)时钟信号CLK mod ((q-2)/4)为高电平，第q个移位寄存单元ASGq中的第一电容Cl也不会再充电，只能起到存储作用，在第mod ((q-1) /4)时钟信号CLK mod ((q_l) /4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。在第q个移位寄存单元ASGq的第2时段，第mod ((q-3) /4)时钟信号CLK mod ((q-3)/4)为低电平，第q个移位寄存单元ASGq中的第一晶体管Tl关断，不论第mod ((q-2) /4)时钟/[目号CLK mod ((q-2) /4)为闻电平还是为低电平，第q个移位寄存单兀ASGq中的上拉结点Pq的信号只能是第q个移位寄存单元ASGq中的第一电容上Cl存储的信号，该信号能使得第q个移位寄存单元ASGq中的第五晶体管T5开启，由于在此时段，第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为高电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出高电平信号，第一电容Cl的自举效应会使得第q个移位寄存单元ASGq的上拉结点Pq的电位进一步上升。在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由高电平变为低电平后，第q个移位寄存单元ASGq的第2时段结束，第q个移位寄存单元ASGq进入第3时段。在第q个移位寄存单元ASGq的第3时段，第mod ((q-3) /4)时钟信号CLKmod ((q-3) /4)为低电平，第q个移位寄存单元ASGq中的第一晶体管Tl关断，但由于第q个移位寄存单元ASGq中的第一电容Cl的存储作用，第q个移位寄存单元ASGq中的第五晶体管T5仍然开启，由于此时段第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第q+2个移位寄存单元ASGq+2的输出端GOUTq+2输出高电平信号(当第mod ((q+1) /4)时钟信号CLKmod((q+l)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端GOUT q+2输出高电平信号)、且反向扫描信号BW为低电平(在图6a中，反向扫描信号BW —直为低电平)时，第q个移位寄存单元ASGq中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第q个移位寄存单元ASGq中的第五晶体管T5关断，第q个移位寄存单元ASGq的第3时段结束。
[0087]在图6a中，由于第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1只有在一巾贞开始扫描时为高电平,而在其他时间均为低电平，因此，第N-1个移位寄存单元ASGN-1中的第二晶体管T2不能开启，这使得第N-1个移位寄存单元ASGN-1中的第一电容Cl不能通过第二晶体管T2放电，从而使得第N-1个移位寄存单元ASGN-1中的第五晶体管T5不能关断；第N-1个移位寄存单元ASGN-1中的第五晶体管T5要在，第N-1个移位寄存单元ASGN-1中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N-1个移位寄存单元ASGN-1中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第N-1个移位寄存单元ASGN-1中的第四晶体管T4开启，使得第N-1个移位寄存单元ASGN-1连接的栅极线接收低电平信号。因此，第N-1个移位寄存单元ASGN-1的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0088]在图6a中，由于第N个移位寄存单元ASGN的反向选择信号端GN+1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N个移位寄存单元ASGN的反向选择信号端GN+1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第N个移位寄存单元ASGN中的第二晶体管T2不能开启，这使得第N个移位寄存单元ASGN中的第一电容Cl不能通过第二晶体管T2放电，从而使得第N个移位寄存单元ASGN中的第五晶体管T5不能关断；第N个移位寄存单元ASGN中的第五晶体管T5要在，第N个移位寄存单元ASGN中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前,复位信号RST为高电平)时，才能通过第N个移位寄存单元ASGN中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第N个移位寄存单元ASGN中的第四晶体管T4开启，使得第N个移位寄存单元ASGN连接的栅极线接收低电平信号。因此，第N个移位寄存单元ASGN的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0089]在图6a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管T5的栅极都会接收低电平信号，使得第五晶体管T5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0090]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0091]在图6b中，在第N (N为4的整数倍)个移位寄存单元ASGN的第I时段，其反向选择信号端GN+1接收到的第二初始触发信号STV2为高电平，第N个移位寄存单元ASGN中的第二晶体管T2开启，同时其反向扫描信号端BWIN接收到的反向扫描信号BW为高电平(在图6b中，反向扫描信号BW —直为高电平)，因此，第N个移位寄存单元ASGN中的第一电容Cl开始充电，当第一电容Cl充电至第N个移位寄存单元ASGN中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第N个移位寄存单元ASGN的时钟阻碍信号端CLKBIN接收到的信号，即第3时钟信号CLK3会通过第五晶体管T5从第N个移位寄存单元ASGN的输出端GOUTN输出，在第N个移位寄存单元ASGN的第I时段，第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号；当第3时钟信号CLK3由低电平变为高电平时，第N个移位寄存单元ASGN由第I时段进入第2时段。在第N个移位寄存单元ASGN的第2时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第二晶体管T2关断，但由于第一电容Cl将第N个移位寄存单元ASGN中的上拉结点PN的电压信号存储下来，因此，第N个移位寄存单元ASGN中的第五晶体管T5仍然开启，由于此时段第3时钟信号CLK3为高电平，第N个移位寄存单元ASGN的输出端GOUTN输出高电平信号，第一电容Cl的自举效应会使得第N个移位寄存单元ASGN的上拉结点PN的电位进一步上升；第3时钟信号CLK3由高电平变为低电平时，第N个移位寄存单元ASGN由第2时段进入第3时段。在第N个移位寄存单元ASGN的第3时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第二晶体管T2关断，但由于第N个移位寄存单元ASGN中的第一电容Cl的存储作用，第N个移位寄存单元ASGN中的第五晶体管T5仍然开启，由于此时段第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号，当第N个移位寄存单元ASGN的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号(当第I时钟信号CLKl为高电平时，第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号)、且第2时钟信号CLK2为低电平时，第N个移位寄存单元ASGN中的第一电容Cl放电，在放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第N个移位寄存单元ASGN中的第五晶体管T5关断，第N个移位寄存单元ASGN的第3时段结束；其中，第N个移位寄存单元ASGN的第I时段、第2时段和第3时段为该第N个移位寄存单元ASGN连接的栅极线被选通的时间段。
[0092]由于第N个移位寄存单元ASGN中的第一电容Cl在第I时钟信号CLKl为高电平，且第2时钟信号CLK2为低电平时放电，为了保证第N移位寄存单元ASGN中的第五晶体管T5能够关断，因此，第I时钟信号CLKl为高电平的时间段和第2时钟信号CLK2为低电平的时间段相互交叠的时长，要不小于第N个移位寄存单元ASGN中的第一电容Cl放电至第N个移位寄存单元ASGN中的第五晶体管T5关断所需的电压的时长。
[0093]在图6b中，在第N-1个移位寄存单元ASGN-1的第I时段，其反向选择信号端GN+1接收到的第一初始触发信号STVl为高电平，第N-1个移位寄存单元ASGN-1中的第二晶体管T2开启，同时其反向扫描信号端BWIN接收到反向扫描信号BW为高电平(在图6b中，反向扫描信号BW—直为高电平)，因此，第N-1个移位寄存单元ASGN-1中的第一电容Cl开始充电，当第一电容Cl充电至第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第N-1个移位寄存单元ASGN-1的时钟阻碍信号端CLKBIN接收到的信号，即第2时钟信号CLK2会通过第五晶体管T5从第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出，在第N-1个移位寄存单元ASGN-1的第I时段，第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号；当第2时钟信号CLK2由低电平变为高电平时，第N-1个移位寄存单元ASGN-1由第
I时段进入第2时段。在第N-1个移位寄存单元ASGN-1的第2时段，由于第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第二晶体管T2关断，但由于第一电容Cl的存储作用，第N-1个移位寄存单元ASGN-1中的第五晶体管T5仍然开启，由于此时段第2时钟信号CLK2为高电平，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出高电平信号，第一电容Cl的自举效应会使得第N-1个移位寄存单元ASGN-1的上拉结点PN-1的电位进一步上升；当第2时钟信号CLK2由高电平变为低电平时，第N-1个移位寄存单元ASGN-1由第2时段进入第3时段。在第N-1个移位寄存单元ASGN-1的第3时段，第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第二晶体管T2关断，但由于第N-1个移位寄存单元ASGN-1中的第一电容Cl的存储作用，第N-1个移位寄存单元ASGN-1中的第五晶体管T5仍然开启，由于此时段第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号，当第N-1个移位寄存单元ASGN-1的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号(当第O时钟信号CLKO为高电平时，第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号)、且第I时钟信号CLKl为低电平(图6b中虚线圆中的时间段)时，第N-1个移位寄存单兀ASGN-1中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第N-1个移位寄存单元ASGN-1中的第五晶体管T5关断，第N-1个移位寄存单元ASGN-1的第3时段结束；其中，第N-1移位寄存单元ASGN-1的第I时段、第
2时段和第3时段为该第N-1移位寄存单元ASGN-1连接的栅极线被选通的时间段。
[0094]由于第N-1个移位寄存单元ASGN-1中的第一电容Cl在第O时钟信号CLKO为高电平，且第I时钟信号CLKl为低电平时放电，为了保证第N-1移位寄存单元ASGN-1中的第五晶体管T5能够关断，因此，第O时钟信号CLKO为高电平的时间段和第I时钟信号CLKl为低电平的时间段相互交叠的时长，要不小于第N-1个移位寄存单元ASGN-1中的第一电容Cl放电至第N-1个移位寄存单元ASGN-1中的第五晶体管T5关断所需的电压的时长。
[0095]在图6b中，在第q (q=l,2, 3,4, - ,N-2)个移位寄存单元ASGq的第I时段，其反向选择信号端GN+1接收到的第q+2个移位寄存单元ASGq+2的输出端G0UTq+2为高电平(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号)、且其反向扫描信号端BWIN接收到的反向扫描信号BW为高电平，第q个移位寄存单元ASGq中的第一电容Cl充电，当第一电容Cl充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)会通过第五晶体管T5从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q_l)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)由高电平变为低电平后，即使反向扫描信号BW为高电平，第q个移位寄存单元ASGq中的第一电容Cl也不会再充电，只能起到存储作用，在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。在第q个移位寄存单元ASGq的第2时段，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第二晶体管T2关断，第q个移位寄存单元ASGq中的上拉结点Pq的信号只能是第q个移位寄存单元ASGq中的第一电容上Cl存储的信号，该信号能使得第q个移位寄存单元ASGq中的第五晶体管T5开启，由于在此时段，第mod ((q-1) /4)时钟信号CLK mod ((q-1)/4)为高电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出高电平信号，第一电容Cl的自举效应会使得第q个移位寄存单元ASGq的上拉结点Pq的电位进一步上升。在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由高电平变为低电平后，第q个移位寄存单元ASGq的第2时段结束，第q个移位寄存单元ASGq进入第3时段。在第q个移位寄存单元ASGq的第3时段，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第二晶体管T2关断，由于第q个移位寄存单元ASGq中的第一电容Cl的存储作用，第q个移位寄存单元ASGq中的第五晶体管T5仍然开启，由于此时段第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的正向选择信号端GN_1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第q-2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号(当第mod ((q-3) /4)时钟信号CLK mod ((q-3) /4)为高电平时，第q-2个移位寄存单元ASGq-2的输出端GOUT q_2输出高电平信号)、且第q_l个移位寄存单元ASGq-1的时钟阻碍信号端CLKBIN接收到的第mod( (q_2) /4)时钟信号CLKmod ((q-2)/4)为低电平时，第q个移位寄存单元ASGq中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第q个移位寄存单元ASGq中的第五晶体管T5关断，第q个移位寄存单元ASGq的第3时段结束。
[0096]在图6b中，由于在第q个移位寄存单元ASGq的第3时段，只有在第mod ((q_3)/4)时钟信号CLK mod ((q-3)/4)为高电平、且第mod ((q_2)/4)时钟信号CLK mod ((q-2)/4)为低电平时，第q个移位寄存单元ASGq中的第一电容Cl才能够放电，因此，要保证第q个移位寄存单元ASGq中的第五晶体管T5能够关断，第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平的时间段，与第mod((q-2)/4)时钟信号CLK mod ((q-2)/4)为低电平的时间段需要交叠，并且每次交叠的时长要不小于，第q个移位寄存单元ASGq中的第一电容Cl放电到其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压所需的时长；其中，第q个移位寄存单元ASGq中的第一电容Cl可以放电的时间段为图6b中虚线椭圆所示的时间段。
[0097]在图6b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第一晶体管Tl不能开启，这使得第I个移位寄存单元ASGl中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第I个移位寄存单元ASGl中的第五晶体管T5不能关断；第I个移位寄存单元ASGl中的第五晶体管T5要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前，复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第四晶体管T4开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0098]在图6b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第一晶体管Tl不能开启，这使得第2个移位寄存单元ASG2中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第2个移位寄存单元ASG2中的第五晶体管T5不能关断；第2个移位寄存单元ASG2中的第五晶体管T5要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前,复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第四晶体管T4开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0099]在图6b中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管T5的栅极都会接收低电平信号，使得第五晶体管T5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0100]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0101]进一步地，本发明实施例提供的栅极驱动装置中的反向扫描信号BW还可以复用各个时钟信号，该栅极驱动装置的具体结构如图7所示，图7所示的栅极驱动装置中的移位寄存单元的个数N为4的整数倍。图7中的栅极驱动装置与图3中的栅极驱动装置的区别在于:图3所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号需要专门设置一条传输线来传输，而图7所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号可以复用时钟信号。图7所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号复用时钟信号具体为:除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端BWIN接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，第N-1个移位寄存单元ASGN-1的反向扫描信号端接收第O时钟信号CLK0，第N个移位寄存单元ASGN的反向扫描信号端BWIN接收第I时钟信号CLKl ；
[0102]在反向扫描时，第一初始触发信号STVl为高电平的时间段与第O时钟信号CLKO一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第O时钟信号CLKO的一个周期，第二初始触发信号STV2为高电平的时间段与第I时钟信号CLKl 一次为高电平的时间段交叠，交叠时长不小于，第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第I时钟信号CLKl的一个周期。
[0103]图7所示的栅极驱动装置中的移位寄存单元的个数N为4的整数倍，这样可以保证栅极驱动装置在正向扫描时，从第一个移位寄存单元ASGl扫描到第N个移位寄存单元ASGN，在反向扫描时，从第N个移位寄存单元扫描到第一个移位寄存单元ASG1，避免出现从第一个移位寄存单元ASGl和第N-1个移位寄存单元ASGN-1同时开始扫描，和/或出现从第二个移位寄存单元ASG2和第N个移位寄存单元ASGN同时开始扫描。
[0104]图7所示的栅极驱动装置中的各个移位寄存单元可以采用图5所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图7所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0105]下面以图7中的栅极驱动装置中的各个移位寄存单元采用图5所示的移位寄存单元的结构为例说明图7所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图8a为图7所示的栅极驱动装置在正向扫描时的时序图，图Sb为图7所示的栅极驱动装置在反向扫描时的时序图，其中，图8a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图8b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。
[0106]图8a中的第一个移位寄存单元ASGl在第I时段的工作原理与图6a中的第一个移位寄存单元ASGl在第I时段的工作原理相同，图8a中的第一个移位寄存单元ASGl在第
2时段的工作原理与图6a中的第一个移位寄存单元ASGl在第2时段的工作原理相同。[0107]如图8a所示，在第一个移位寄存单元ASGl的第3时段，第一初始触发信号STVl为低电平，因此，第一个移位寄存单兀ASGl中的第一晶体管Tl关断，由于第一个移位寄存单元ASGl中的第一电容Cl的存储作用，第一个移位寄存单元ASGl中的第五晶体管T5仍然开启，由于此时段第O时钟信号CLKO为低电平，因此,第一个移位寄存单兀ASGl的输出端GOUTl输出低电平信号，当第一个移位寄存单元ASGl的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号(当第2时钟信号CLK2为高电平时，第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号)、且第I时钟信号CLKl为低电平时，第一个移位寄存单元ASGl中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第一个移位寄存单元ASGl中的第五晶体管T5关断，第一个移位寄存单元ASGl的第3时段结束；其中，第一个移位寄存单元ASGl的第I时段、第2时段和第3时段为该第一个移位寄存单元ASGl连接的栅极线被选通的时间段。
[0108]在图8a中，由于第一个移位寄存单元ASGl中的第一电容Cl在第2时钟信号CLK2为高电平，且第I时钟信号CLKl为低电平时放电，为了保证第一移位寄存单元ASGl中的第五晶体管T5能够关断，因此，第2时钟信号CLK2为高电平的时间段和第I时钟信号CLKl为低电平的时间段相互交叠的时长，要不小于第一个移位寄存单元ASGl中的第一电容Cl放电至第一个移位寄存单元ASGl中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压所需的时长。
[0109]图8a中的第二个移位寄存单元ASG2在第I时段的工作原理与图6a中的第二个移位寄存单元ASG2在第I时段的工作原理相同，图8a中的第二个移位寄存单元ASG2在第
2时段的工作原理与图6a中的第二个移位寄存单元ASG2在第2时段的工作原理相同。
[0110]如图8a所示，在第二个移位寄存单元ASG2的第3时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第一晶体管Tl关断，但由于第二个移位寄存单元ASG2中的第一电容Cl的存储作用，第二个移位寄存单元ASG2中的第五晶体管T5仍然开启，由于此时段第I时钟信号CLKl为低电平，因此,第二个移位寄存单兀ASG2的输出端G0UT2输出低电平信号，当第二个移位寄存单元ASG2的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号(当第3时钟信号CLK3为高电平时，第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号)、且第2时钟信号CLK2为低电平时，第二个移位寄存单元ASG2中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第二个移位寄存单元ASG2中的第五晶体管T5关断，第二个移位寄存单元ASG2的第3时段结束；其中，第二移位寄存单元ASG2的第I时段、第2时段和第3时段为该第二移位寄存单元ASG2连接的栅极线被选通的时间段。
[0111]由于第二个移位寄存单元ASG2中的第一电容Cl在第3时钟信号CLK3为高电平，且第2时钟信号CLK2为低电平时放电，为了保证第二个移位寄存单元ASG2中的第五晶体管T5能够关断，因此，第3时钟信号CLK3为高电平的时间段和第2时钟信号CLK2为低电平的时间段相互交叠的时长，要不小于第二个移位寄存单元ASG2中的第一电容Cl放电至第二个移位寄存单兀ASG2中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压所需的时长。[0112]图8a中的第q ( q=3，4，…，N)个移位寄存单元ASGq在第I时段的工作原理与图6a中的第q个移位寄存单元ASG2在第I时段的工作原理相同，图8a中的第q个移位寄存单元ASG2在第2时段的工作原理与图6a中的第q个移位寄存单元ASG2在第2时段的工作原理相同。
[0113]如图8a所示，在第q个移位寄存单元ASGq的第3时段，第mod ((q_3)/4)时钟信号CLK mod ((q-3)/4)为低电平，第q个移位寄存单元ASGq中的第一晶体管Tl关断，但由于第q个移位寄存单元ASGq中的第一电容Cl的存储作用，第q个移位寄存单元ASGq中的第五晶体管T5仍然开启，由于此时段第mod((q_l)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端GOUT q+2输出高电平信号)、且第mod(q/4)时钟信号CLK mod(q/4)为低电平时，第q个移位寄存单元ASGq中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第q个移位寄存单元ASGq中的第五晶体管T5关断，第q个移位寄存单元ASGq的第3时段结束。
[0114]图8a中第N-1个移位寄存单元ASGN-1在第3时段的工作原理与图6a中第N_1个移位寄存单元ASGN-1在第3时段的工作原理相同；图8a中第N个移位寄存单元ASGN在第3时段的工作原理与图6a中第N个移位寄存单元ASGN在第3时段的工作原理相同。
[0115]在图8a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管T5的栅极都会接收低电平信号，使得第五晶体管T5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0116]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0117]由于图8a中的第q个移位寄存单元ASGq中的第一电容Cl在第mod((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平，且第mod(q/4)时钟信号CLKmod (q/4)为低电平时放电，为了保证第q个移位寄存单元ASGq中的第五晶体管T5能够关断，因此，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平的时间段和第mod (q/4)时钟信号CLKmod (q/4)为低电平的时间段相互交叠的时长(图8a中实线椭圆中的时间段为第q个移位寄存单元ASGq中的第一电容Cl可以放电的时间段)，要不小于第q个移位寄存单元ASGq中的第一电容Cl放电至第q个移位寄存单元ASGq中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压所需的时长。
[0118]在图8b中，在第N (N为4的整数倍)个移位寄存单元ASGN的第I时段，其反向选择信号端GN+1接收到的第二初始触发信号STV2为高电平，第N个移位寄存单元ASGN中的第二晶体管T2开启，同时其反向扫描信号端BWIN接收到的反向扫描信号BW,即第I时钟信号CLKl为高电平，因此，第N个移位寄存单元ASGN中的第一电容Cl开始充电，当第一电容Cl充电至第N个移位寄存单元ASGN中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第N个移位寄存单元ASGN的时钟阻碍信号端CLKBIN接收到的信号，即第3时钟信号CLK3会通过第五晶体管T5从第N个移位寄存单元ASGN的输出端GOUTN输出，在第N个移位寄存单元ASGN的第I时段，第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号；当第3时钟信号CLK3由低电平变为高电平时，第N个移位寄存单元ASGN由第I时段进入第2时段。
[0119]在图8b中，由于第N个移位寄存单元ASGN中的第一电容Cl在第二初始触发信号STV2为高电平，且第I时钟信号CLKl为高电平时充电，为了保证第N移位寄存单元ASGN中的第五晶体管T5能够稳定开启，因此，第二初始触发信号STV2为高电平的时间段和第I时钟信号CLKl为高电平的时间段相互交叠的时长，要不小于第N个移位寄存单元ASGN中的第一电容Cl充电至第N个移位寄存单元ASGN中的第五晶体管T5稳定开启所需的电压的时长。
[0120]图8b中的第N个移位寄存单元ASGN在第2时段的工作原理与图6b中的第N个移位寄存单元ASGN在第2时段的工作原理相同，图8b中的第N个移位寄存单元ASGN在第
3时段的工作原理与图6b中的第N个移位寄存单元ASGN在第3时段的工作原理相同。
[0121]在图8b中，在第N-1个移位寄存单元ASGN-1的第I时段，其反向选择信号端GN+1接收到的第一初始触发信号STVl为高电平，第N-1个移位寄存单元ASGN-1中的第二晶体管T2开启，同时其反向扫描信号端BWIN接收到反向扫描信号BW，即第O时钟信号CLKO为高电平，因此，第N-1个移位寄存单元ASGN-1中的第一电容Cl开始充电，当第一电容Cl充电至第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第N-1个移位寄存单元ASGN-1的时钟阻碍信号端CLKBIN接收到的信号，即第2时钟信号CLK2会通过第五晶体管T5从第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出，在第N-1个移位寄存单元ASGN-1的第I时段，第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号；当第2时钟信号CLK2由低电平变为高电平时，第N-1个移位寄存单元ASGN-1由第I时段进入第2时段。
[0122]在图8b中，由于第N-1个移位寄存单元ASGN-1中的第一电容Cl在第一初始触发信号STVl为高电平，且第O时钟信号CLKO为高电平时充电，为了保证第N-1移位寄存单元ASGN-1中的第五晶体管T5能够稳定开启，因此，第一初始触发信号STVl为高电平的时间段和第O时钟信号CLKO为高电平的时间段相互交叠的时长，要不小于第N-1个移位寄存单元ASGN-1中的第一电容Cl充电至第N-1个移位寄存单元ASGN-1中的第五晶体管T5稳定开启所需的电压的时长。
[0123]图8b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理与图6b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理相同，图8b中的第N-1个移位寄存单元ASGN-1在第3时段的工作原理与图6b中的第N-1个移位寄存单元ASGN-1在第3时段的工作原理相同。
[0124]在图Sb中，在第q (q=l，2，3，4，...，N-2)个移位寄存单元ASGq的第I时段，其反向选择信号端GN+1接收到的第q+2个移位寄存单元ASGq+2的输出端G0UTq+2为高电平(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号)、且其反向扫描信号端BWIN接收到的第mod (q/4)时钟信号CLK mod (q/4)为高电平，第q个移位寄存单元ASGq中的第一电容Cl充电，当第一电容Cl充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)会通过第五晶体管T5从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1) /4)时钟信号CLKmod ((q-1) /4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)由高电平变为低电平后，即使第mod(q/4)时钟信号CLK mod (q/4)为高电平，第q个移位寄存单元ASGq中的第一电容Cl也不会再充电，只能起到存储作用，在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。
[0125]在图8b中，由于在第q个移位寄存单元ASGq的第I时段，只有在第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平、且第mod (q/4)时钟信号CLKmod (q/4)为高电平时，第q个移位寄存单元ASGq中的第一电容Cl才能够充电，因此，要保证第q个移位寄存单元ASGq中的第五晶体管T5能够稳定开启，第mod((q+l)/4)时钟信号CLK mod ((q+1)/4)为高电平的时间段，与第mod(q/4)时钟信号CLK mod (q/4)为高电平的时间段需要交叠，并且每次交叠的时长要不小于，第q个移位寄存单元ASGq中的第一电容Cl充电到其中的第五晶体管T5能够稳定开启的电压所需的时长；其中，第q个移位寄存单元ASGq中的第一电容Cl可以充电的时间段为图Sb中虚线圆所示的时间段。
[0126]图8b中的第q个移位寄存单元ASGq在第2时段的工作原理与图6b中的第q个移位寄存单元ASGq在第2时段的工作原理相同，图8b中的第q个移位寄存单元ASGq在第
3时段的工作原理与图6b中的第q个移位寄存单元ASGql在第3时段的工作原理相同。
[0127]在图8b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第一晶体管Tl不能开启，这使得第I个移位寄存单元ASGl中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第I个移位寄存单元ASGl中的第五晶体管T5不能关断；第I个移位寄存单元ASGl中的第五晶体管T5要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前,复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第四晶体管T4开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0128]在图8b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第一晶体管Tl不能开启，这使得第2个移位寄存单元ASG2中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第2个移位寄存单元ASG2中的第五晶体管T5不能关断；第2个移位寄存单元ASG2中的第五晶体管Τ5要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第三晶体管Τ3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第四晶体管Τ4开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0129]在图Sb中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管Τ5的栅极都会接收低电平信号，使得第五晶体管Τ5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0130]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0131]进一步地，图7所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号可以采用相同的信号，此时，该栅极驱动装置的结构如图9所示。图9所示的栅极驱动装置的结构与图7所示的栅极驱动装置的区别仅在于:图7所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2中的正向选择信号端GN-1接收第二初始触发信号STV2，第N-1个移位寄存单元的反向选择信号端GN+1接收第一初始触发信号STVl，第N个移位寄存单元的反向选择信号端GN+1接收第二初始触发信号STV2 ;图9所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1、第二个移位寄存单元ASG2中的正向选择信号端GN-1、第N-1个移位寄存单元的反向选择 信号端GN+1和第N个移位寄存单元的反向选择信号端GN+1均接收相同的信号，即初始触发信号STV。
[0132]图9所示的栅极驱动装置中的移位寄存单元的个数N也为4的整数倍，这样可以保证栅极驱动装置在正向扫描时，从第一个移位寄存单元ASGl扫描到第N个移位寄存单元ASGN，在反向扫描时，从第N个移位寄存单元扫描到第一个移位寄存单元ASG1，避免出现从第一个移位寄存单元ASGl和第N-1个移位寄存单元ASGN-1同时开始扫描，和/或出现从第二个移位寄存单元ASG2和第N个移位寄存单元ASGN同时开始扫描。
[0133]图9所示的栅极驱动装置中的各个移位寄存单元可以采用图5所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图9所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0134]下面以图9中的栅极驱动装置中的各个移位寄存单元采用图5所示的移位寄存单元的结构为例说明图9所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图1Oa为图9所示的栅极驱动装置在正向扫描时的时序图，图1Ob为图9所示的栅极驱动装置在反向扫描时的时序图。
[0135]图9所示的栅极驱动装置在正向扫描时(即图1Oa的时序图)，其中的第m(m=l，2，…，N)个移位寄存单元的工作原理与图8a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。图9所示的栅极驱动装置在反向扫描时(即图1Ob的时序图)，其中的第m个移位寄存单元的工作原理与图Sb所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。
[0136]进一步地，在图4所示的移位寄存单元的结构的基础上还可以增加第一下拉模块，增加第一下拉模块后的移位寄存单元的结构如图11所示，在增加第一下拉模块后，每个移位寄存单元中增加了时钟信号端。如图11所示，第一下拉模块44的第一端为一个移位寄存单兀的时钟阻碍信号端CLKBIN,第一下拉模块44的第二端连接第一输出模块43的第二端，第一下拉模块44的第三端连接第一输出模块43的第三端，第一下拉模块44的第四端为该移位寄存单元的低电平信号端VGLIN，第一下拉模块44的第五端为该移位寄存单元的时钟信号端CLKIN ;第一下拉模块44，用于在自身的第二端为低电平，且时钟阻碍信号CLKB为高电平时，将通过自身的第四端接收到的低电平信号VGL分别从自身的第二端和自身的第三端输出；以及在时钟信号端CLKIN为高电平时，将通过自身的第四端接收到的低电平信号VGL从自身的第三端输出。
[0137]在栅极驱动装置中的各个移位寄存单元采用图11所示的移位寄存单元的结构时，栅极驱动装置中的第k α=1，2，...，Ν)个移位寄存单元的时钟信号端接收第mod ((mod ((k-1) /4) +2) /4)时钟信号。
[0138]进一步地，图11所示的移位寄存单元的结构可以采用图12所示的电路结构。如图12所示第一下拉模块44包括第二电容C2、第六晶体管T6、第七晶体管T7、第八晶体管T8和第九晶体管T9 ;第六晶体管T6的第一极为第一下拉模块44的第二端，第六晶体管T6的栅极连接第二电容C2，第六晶体管T6的第二极为第一下拉模块44的第四端，第二电容C2中未与第六晶体管T6的栅极相连的一端为第一下拉模块44的第一端；第七晶体管T7的第一极连接第六晶体管T6的栅极，第七晶体管T7的栅极为第一下拉模块44的第二端，第七晶体管T7的第二极为第一下拉模块44的第四端；第八晶体管T8的第一极为第一下拉模块44的第三端，第八晶体管T8的栅极连接第六晶体管T6的栅极，第八晶体管T8的第二极为第一下拉模块44的第四端；第九晶体管T9的第一极为第一下拉模块44的第三端，第九晶体管T9的栅极为第一下拉模块44的第五端,第九晶体管T9的第二极为第一下拉模块44的第四端；第六晶体管T6，用于在自身的栅极为高电平时开启，将第一下拉模块44的第二端，即上拉结点P的电平下拉至低电平，在自身的栅极为低电平时关断；第七晶体管T7，用于在第一下拉模块44的第二端，即上拉结点P为高电平时开启，将第六晶体管T6的栅极的电平下拉至低电平，并在第一下拉模块44的第二端为低电平时关断；第八晶体管T8，用于在自身的栅极为高电平时开启，将所述移位寄存单元的输出端GOUT下拉至低电平，并在自身的栅极为低电平时关断；第九晶体管T9，用于在时钟信号端CLKIN为高电平时开启，将所述移位寄存单元的输出端GOUT下拉至低电平，并在时钟信号端CLKIN为低电平时关断。
[0139]其中，只有在上拉结点P为低电平，且时钟阻碍端CLKBIN为高电平时，第六晶体管T6的栅极和第八晶体管T8的栅极才能为高电平。
[0140]图12中除第一下拉模块44以外的电路与图5中的电路结构相同，在此不再赘述。
[0141]在正向扫描时，若栅极驱动装置中的各个移位寄存单元中均包含第一下拉模块，则该栅极驱动装置中除最后两个移位寄存单元以外的各个以外寄存单元在其连接的栅极线未被选通的时间段，其栅极线上的低电平信号不会受到高电平的时钟信号的影响。在反向扫描时，若栅极驱动装置中的各个移位寄存单元中均包含第一下拉模块，则该栅极驱动装置中除第一个移位寄存单元和第二个移位寄存单元以外的各个以外寄存单元在其连接的栅极线未被选通的时间段，其栅极线上的低电平信号不会受到高电平的时钟信号的影响。
[0142]当图3所示的栅极驱动装置中的各个移位寄存单元采用图12所示的结构时，其正向扫描的时序图依然如图6a所示，其反向扫描的时序图依然如图6b所示。当图7所示的栅极驱动装置中的各个移位寄存单元采用图12所示的结构时，其正向扫描的时序图依然如图8a所示,其反向扫描的时序图依然如图8b所示。当图9所示的栅极驱动装置中的各个移位寄存单元采用图12所示的结构时，其正向扫描的时序图依然如图1Oa所示，其反向扫描的时序图依然如图1Ob所示。
[0143]本发明实施例提供的一种栅极驱动装置，如图13所示，包括N个移位寄存单元；
[0144]第P个移位寄存单元ASGp的正向选择信号端GN-1接收第p_2个移位寄存单元ASGp-2输出的信号，p=3，4，....N，第r个移位寄存单元ASGr的反向选择信号端GN+1接收第r+2个移位寄存单元ASGr+2输出的信号，r=l, 2，…N_2，第一个移位寄存单元ASGl的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2的正向选择信号端GN-1接收第二初始触发信号STV2，若N为偶数，则第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收第一初始触发信号STV1，第N个移位寄存单元ASGN的反向选择信号端GN+1接收第二初始触发信号STV2，若N为奇数，则第N个移位寄存单元ASGN的反向选择信号端GN+1接收第一初始触发信号STV1，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收第二初始触发信号STV2 ;每个移位寄存单元的低电平信号端VGLIN接收低电平信号VGL ;每个移位寄存单元的复位信号端RSTIN接收复位信号RST，复位信号RST在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平；
[0145]第k个移位寄存单元ASGk的时钟阻碍信号端CLKBIN接收第mod((k_l)/4)时钟信号CLK mod ((k-1) /4), k=l，2...，N;除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端BWIN接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，第N-1个移位寄存单元ASGN-1的反向扫描信号端BffIN 接收第 mod ((mod ((N-2) /4) +2) /4)时钟信号 CLK mod ((mod ((N-2) /4) +2) /4)，第 N 个移位寄存单元ASGN的反向扫描信号端BWIN接收第mod((mod((N-1) /4) +2) /4)时钟信号mod ((mod ((N-1) /4) +2) /4) ?’第O时钟信号CLKO为高电平时，第2时钟信号CLK2为低电平，第2时钟信号CLK2为高电平时，第O时钟信号CLKO为低电平；第I时钟信号CLKl为高电平时，第3时钟信号CLK3为低电平，第3时钟信号CLK3为高电平时，第I时钟信号CLkl为低电平；第η时钟信号CLKn为高电平的时间段与第η+1时钟信号CLKn+Ι为高电平的时间段交叠，每次交叠的时长不小于第二预设时长，其中，n=0，1，2，3，当n+l>3时，第n+1时钟信号为第mod ((n+1)/4)时钟信号；
[0146]在反向扫描时，若N为奇数,第一初始触发信号STVl为高电平的时间段与第mod ((mod ((N-1)/4) +2)/4)时钟信号 CLK mod ((mod ((N-1)/4) +2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-l)/4)+2)/4)时钟信号CLK mod ((mod ((N-1)/4)+2)/4)的一个周期，第二初始触发信号STV2为高电平的时间段与第 mod ((mod ((N-2)/4)+2)/4)时钟信号 CLK mod ((mod ((N-2)/4) +2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-2)/4)+2)/4)时钟信号CLKmod((mod((N-2)/4)+2)/4)的一个周期；若N为偶数，第一初始触发信号STVl为高电平的时间段与第 mod ((mod ((N-2) /4) +2) /4)时钟信号 CLKmod ((mod ((N-2) /4) +2) /4)一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-2) /4) +2) /4)时钟信号 CLKmod ((mod ((N-2) /4) +2) /4)的一个周期，第二初始触发信号STV2为高电平的时间段与第mod ((mod ((N-1) /4) +2) /4)时钟信号CLKmod ((mod ((N-1)/4)+2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第 mod ((mod ((N-1)/4)+2)/4)时钟信号 CLK mod ((mod ((N-1)/4) +2)/4)的一个周期。
[0147]图13所示的栅极驱动装置中的各个移位寄存单元可以采用图5所示的移位寄存单元的结构，也可以采用图12所示的移位寄存单元的结构。当图13所示的栅极驱动装置中的移位寄存单元采用图12所示的移位寄存单元结构时，各个移位寄存单元中还包括时钟信号端。无论图13所示的栅极驱动装置中的各个移位寄存单元采用图5所示的移位寄存单元的结构，还是采用图12所示的移位寄存单元的结构，正向扫描时的时序图都是相同的，反向扫描时的时序图也是相同的。
[0148]下面以图13所示的栅极驱动装置中的各个移位寄存单元采用图5所示的移位单元的结构为例，说明图13所示的栅极驱动装置在正向扫描和反向扫描时工作情况。在正向扫描时，图13所示的栅极驱动装置工作的时序图如图14a所示，其中，图14a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图14b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。在反向扫描时，图13所示的栅极驱动装置工作的时序图如图14b所示。假设图13所示的栅极驱动装置中包含N个移位寄存单元，下面仅以N为4的整数倍为例说明栅极驱动装置的工作原理。当N为除4的整数倍以外的整数时栅极驱动装置的工作原理与N为4的整数倍时栅极驱动装置的工作原理类似，在此不再赘述。
[0149]在图14a中，在第一个移位寄存单元ASGl的第I时段，其正向选择信号端GN-1接收到的第一初始触发信号STVl为高电平，第一个移位寄存单元ASGl中的第一晶体管Tl开启，同时其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(在图14a中，正向扫描信号FW—直为高电平)，因此第一个移位寄存单元ASGl中的第一电容Cl开始充电，当第一电容Cl充电至第一个移位寄存单元ASGl中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第一个移位寄存单元ASGl的时钟阻碍信号端CLKBIN接收到的信号，即第O时钟信号CLKO会通过第五晶体管T5从第一个移位寄存单元ASGl的输出端GOUTl输出，在第一个移位寄存单元ASGl的第I时段，第O时钟信号CLKO为低电平，因此，第一个移位寄存单元ASGl的输出端G0UT1输出低电平信号；当第O时钟信号CLKO由低电平变为高电平时，第一个移位寄存单元ASGO由第I时段进入第2时段。
[0150]图14a中的第一个移位寄存单元ASGl在第2时段的工作原理与图8a中的第一个移位寄存单元ASGl在第2时段的工作原理相同，图14a中的第一个移位寄存单元ASGl在第3时段的工作原理与图8a中的第一个移位寄存单元ASGl在第3时段的工作原理相同。
[0151]在图14a中，在第二个移位寄存单元ASG2的第I时段，其正向选择信号端GN-1接收到的第二初始触发信号STV2为高电平，第二个移位寄存单元ASG2中的第一晶体管Tl开启，同时其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(在图14a中，正向扫描信号FW—直为高电平)，因此，第二个移位寄存单元ASG2中的第一电容Cl开始充电，当第一电容Cl充电至第二个移位寄存单元ASG2中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第二个移位寄存单元ASG2的时钟阻碍信号端CLKBIN接收到的信号，即第I时钟信号CLKl会通过第五晶体管T5从第二个移位寄存单元ASG2的输出端G0UT2输出，在第二个移位寄存单元ASG2的第I时段，第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端G0UT2输出低电平信号；当第I时钟信号CLKl由低电平变为高电平时，第二个移位寄存单元ASG2由第I时段进入第2时段。
[0152]图14a中的第二个移位寄存单元ASG2在第2时段的工作原理与图8a中的第二个移位寄存单元ASG2在第2时段的工作原理相同，图14a中的第二个移位寄存单元ASG2在第3时段的工作原理与图8a中的第二个移位寄存单元ASG2在第3时段的工作原理相同。
[0153]在图14a中，在第q (q=3, 4, -,N)个移位寄存单元ASGq的第I时段，其正向选择信号端GN-1接收到的第q-2个移位寄存单元ASGq-2的输出端G0UTq-2为高电平(当第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号)、且其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(在图14a中，正向扫描信号FW —直为高电平)时，第q个移位寄存单元ASGq中的第一电容Cl充电，当第一电容Cl充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第五晶体管T5能够开启时，该第五晶体管T5开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的 信号，即第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)会通过第五晶体管T5从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号。
[0154]图14a中的第q (q=3, 4,…，N)个移位寄存单元ASGq在第2时段的工作原理与图8a中的第q个移位寄存单元ASGq在第2时段的工作原理相同，图14a中的第q个移位寄存单元ASGq在第3时段的工作原理与图8a中的第q个移位寄存单元ASGq在第3时段的工作原理相同。
[0155]在图14a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管T5的栅极都会接收低电平信号，使得第五晶体管T5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0156]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0157]图14b中的第N (N为4的整数倍)个移位寄存单元ASGN在第I时段的工作原理与图8b中的第N个移位寄存单元ASGN在第I时段的工作原理相同，图14b中的第N个移位寄存单元ASGN在第2时段的工作原理与图8b中的第N个移位寄存单元ASGN在第2时段的工作原理相同。
[0158]在图14b中，在第N个移位寄存单元ASGN的第3时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第二晶体管T2关断，但由于第N个移位寄存单元ASGN中的第一电容Cl的存储作用，第N个移位寄存单元ASGN中的第五晶体管T5仍然开启，由于此时段第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号，当第N个移位寄存单元ASGN的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号(当第I时钟信号CLKl为高电平时，第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号)、且正向选择信号FW为低电平(在图14b中正向选择信号FW—直为低电平)时，第N个移位寄存单元ASGN中的第一电容Cl放电，在放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后,第N个移位寄存单元ASGN中的第五晶体管T5关断，第N个移位寄存单元ASGN的第3时段结束；其中，第N个移位寄存单元ASGN的第I时段、第2时段和第3时段为该第N个移位寄存单元ASGN连接的栅极线被选通的时间段。
[0159]图14b中的第N-1 (N为4的整数倍)个移位寄存单元ASGN-1在第I时段的工作原理与图8b中的第N-1个移位寄存单元ASGN-1在第I时段的工作原理相同，图14b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理与图8b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理相同。
[0160]在图14b中，在第N-1个移位寄存单元ASGN-1的第3时段，第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第二晶体管T2关断，但由于第N-1个移位寄存单元ASGN-1中的第一电容Cl的存储作用，第N-1个移位寄存单元ASGN-1中的第五晶体管T5仍然开启，由于此时段第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号，当第N-1个移位寄存单元ASGN-1的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号(当第O时钟信号CLKO为高电平时，第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号)、且正向选择信号FW为低电平(在图14b中正向选择信号FW—直为低电平)时，第N-1个移位寄存单元ASGN-1中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第N-1个移位寄存单元ASGN-1中的第五晶体管T5关断，第N-1个移位寄存单元ASGN-1的第3时段结束；其中，第N-1移位寄存单元ASGN-1的第I时段、第2时段和第3时段为该第N-1移位寄存单元ASGN-1连接的栅极线被选通的时间段。
[0161]图14b中的第q (q=l，2，3，4，"、N_2，N为4的整数倍)个移位寄存单元ASGq在第I时段的工作原理与图8b中的第q个移位寄存单元ASGq在第I时段的工作原理相同，图14b中的第q个移位寄存单元ASGq在第2时段的工作原理与图8b中的第q个移位寄存单元ASGq在第2时段的工作原理相同。
[0162]在图14b中，在第q个移位寄存单元ASGq的第3时段，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第二晶体管T2关断，由于第q个移位寄存单元ASGq中的第一电容Cl的存储作用，第q个移位寄存单元ASGq中的第五晶体管T5仍然开启，由于此时段第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第q-2个移位寄存单元ASGq-2的输出端G0UTq_2输出高电平信号(当第mod ((q-3) /4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端GOUT q-2输出高电平信号)、且正向选择信号FW为低电平(在图14b中正向选择信号FW —直为低电平)时，第q个移位寄存单元ASGq中的第一电容Cl放电，当放电至其中的第五晶体管T5的栅极电压低于该第五晶体管T5的开启电压后，第q个移位寄存单元ASGq中的第五晶体管T5关断，第q个移位寄存单元ASGq的第3时段结束。
[0163]在图14b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第一晶体管Tl不能开启，这使得第I个移位寄存单元ASGl中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第I个移位寄存单元ASGl中的第五晶体管T5不能关断；第I个移位寄存单元ASGl中的第五晶体管T5要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前，复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第四晶体管T4开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0164]在图14b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第一晶体管Tl不能开启，这使得第2个移位寄存单元ASG2中的第一电容Cl不能通过第一晶体管Tl放电，从而使得第2个移位寄存单元ASG2中的第五晶体管T5不能关断；第2个移位寄存单元ASG2中的第五晶体管T5要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一巾贞扫描结束后、下一巾贞扫描开始之前，复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第三晶体管T3将其栅极的信号(即第一电容Cl上存储的信号)释放掉，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第四晶体管T4开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0165]在图14b中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第五晶体管T5的栅极都会接收低电平信号，使得第五晶体管T5关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一帧扫描结束后残余信号对后一帧的影响。
[0166]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0167]进一步地，图13所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号可以采用相同的信号，此时，该栅极驱动装置的结构如图15所示。图15所示的栅极驱动装置的结构与图13所示的栅极驱动装置的区别仅在于:图13所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2中的正向选择信号端GN-1接收第二初始触发信号STV2，第N-1个移位寄存单元的反向选择信号端GN+1接收第一初始触发信号STV1，第N个移位寄存单元的反向选择信号端GN+1接收第二初始触发信号STV2 ;图15所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1、第二个移位寄存单元ASG2中的正向选择信号端GN-1、第N-1个移位寄存单元的反向选择信号端GN+1和第N个移位寄存单元的反向选择信号端GN+1均接收相同的信号，即初始触发信号STV。
[0168]图15所示的栅极驱动装置中的移位寄存单元的个数N也为4的整数倍，这样可以保证栅极驱动装置在正向扫描时，从第一个移位寄存单元ASGl扫描到第N个移位寄存单元ASGN，在反向扫描时，从第N个移位寄存单元扫描到第一个移位寄存单元ASG1，避免出现从第一个移位寄存单元ASGl和第N-1个移位寄存单元ASGN-1同时开始扫描，和/或出现从第二个移位寄存单元ASG2和第N个移位寄存单元ASGN同时开始扫描。
[0169]图15所示的栅极驱动装置中的各个移位寄存单元可以采用图5所示的移位寄存单元的结构，也可以采用图12所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图15所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0170]下面以图15中的栅极驱动装置中的各个移位寄存单元采用图5所示的移位寄存单元的结构为例说明图15所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图16a为图15所示的栅极驱动装置在正向扫描时的时序图，图16b为图15所示的栅极驱动装置在反向扫描时的时序图。
[0171]图15所示的栅极驱动装置在正向扫描时(即图6a的时序图)，其中的第m(m=l, 2，…，N)个移位寄存单元的工作原理与图14a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。图15所示的栅极驱动装置在反向扫描时(即图16b的时序图)，其中的第m个移位寄存单元的工作原理与图14b所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。
[0172]本发明实施例提供的一种栅极驱动装置，如图17所示，包括N个移位寄存单元；
[0173]第P个移位寄存单元ASGp的正向选择信号端GN-1接收第p_2个移位寄存单元ASGp-2输出的信号，p=3，4，....N，第r个移位寄存单元ASGr的反向选择信号端GN+1接收第r+2个移位寄存单元ASGr+2输出的信号，r=l, 2，…N_2，第一个移位寄存单元ASGl的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2的正向选择信号端GN-1接收第二初始触发信号STV2，若N为偶数，则第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收第一初始触发信号STV1，第N个移位寄存单元ASGN的反向选择信号端GN+1接收第二初始触发信号STV2，若N为奇数，则第N个移位寄存单元ASGN的反向选择信号端GN+1接收第一初始触发信号STVl，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收第二初始触发信号STV2 ;第k个移位寄存单元ASGk的时钟阻碍信号端CLKBIN 接收第 mod ((k-1) /4)时钟信号 CLK mod ((k-1) /4)，k=l, 2...，N ；
[0174] 每个移位寄存单元的复位信号端RSTIN接收复位信号RST，复位信号RST在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平；所述栅极驱动装置中的每个移位寄存单元的初始触发信号端STVIN接收第一初始触发信号STVl或者第二初始触发信号STV2 ;复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，第一初始触发信号STVl为高电平时，复位信号RST为低电平，第二初始触发信号STV2为高电平时，复位信号RST为低电平；图17所示的栅极驱动装置中，各个移位寄存单元的初始触发信号端STVIN接收第一初始触发信号STVl ；
[0175]在图17所示的栅极驱动装置正向扫描时，各个移位寄存单元，用于在正向选择信号端GN-1接收到高电平信号，且正向扫描信号端FWIN接收到高电平信号时，用正向扫描信号端FWIN接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号端CLKBIN接收到的信号输出；在反向选择信号端GN+1接收到高电平信号，且反向扫描信号端BWIN接收到低电平信号时，用反向扫描信号端BWIN接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管稳定关闭；
[0176]在图17所示的栅极驱动装置反向扫描时，各个移位寄存单元，用于在反向选择信号端GN+1接收到高电平信号，且反向扫描信号端BWIN接收到高电平信号时，用反向扫描信号端BWIN接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号端CLKBIN接收到的信号输出；在正向选择信号端GN-1接收到高电平信号，且正向扫描信号端FWIN接收到低电平信号时，用正向扫描信号端FWIN接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管关闭；
[0177]图17所示的栅极驱动装置中的各个移位寄存单元还用于在复位信号端RSTIN为高电平时，用初始触发信号端STVIN接收到的信号对自身中驱动栅极线的晶体管的栅极的电位进行下拉，并将初始触发信号端STVIN接收到的信号输出。
[0178]图17所示的栅极驱动装置中的各个移位寄存单元可以采用图18所示的移位寄存单元的结构，当然，也可以采用其他结构的移位寄存单元，只要采用图17所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。图18所示的移位寄存单元包括第二驱动模块181、第二输出模块182和第二复位模块183 ；
[0179]第二驱动模块181的第一端为所述移位寄存单元的正向扫描信号端FWIN，第二驱动模块181的第二端为所述移位寄存单元的正向选择信号端GN-1，第二驱动模块181的第三端为所述移位寄存单元的反向扫描信号端BWIN，第二驱动模块181的第四端为所述移位寄存单元的反向选择信号端GN+1，第二驱动模块181的第五端连接第二输出模块182的第二端，第二输出模块182的第一端为所述移位寄存单元的时钟阻碍信号端CLKBIN，第二输出模块182的第三端为所述移位寄存单元的输出端GOUT ;第二复位模块183的第一端连接第二输出模块182的第二端，第二复位模块183的第二端为移位寄存单元的复位信号端RSTIN，第二复位模块183的第三端为所述移位寄存单元的初始触发信号端STVIN，第二复位模块183的第四端连接第二输出模块182的第三端；其中，第二驱动模块181的第五端、第二输出模块182的第二端和第二复位模块183的第一端三端相连的连接点为上拉结点P ；
[0180]第二驱动模块181,用于在正向选择信号端GN-1为高电平时,将正向扫描信号端FWIN接收到的信号通过自身第五端输出；并在反向选择信号端GN+1为高电平时，将反向扫描信号端BWIN接收到的信号通过自身第五端输出；
[0181]第二复位模块183，用于在复位信号端RSTIN为高电平时，将通过所述移位寄存单元的初始触发信号端STVIN接收到的信号分别通过自身的第一端和第四端输出；
[0182]第二输出模块182，用于在通过自身第二端接收到高电平信号时，存储该高电平信号，并将时钟阻碍信号端CLKBIN接收到的信号从所述移位寄存单元的输出端GOUT输出；并在通过自身第二端接收到低电平信号时，存储该低电平信号，并不再将时钟阻碍信号端CLKBIN接收到的信号从所述移位寄存单元的输出端GOUT输出。
[0183]进一步地，图18中的第二驱动模块可以采用图19所示的结构，在图19中第二驱动模块181包括第十晶体管TlO和第十一晶体管Tll ;第十晶体管TlO的第一极为第二驱动模块181的第一端，第十晶体管TlO的栅极为第二驱动模块181的第二端，第十晶体管TlO的第二极为第二驱动模块181的第五端；第十一晶体管Tll的第一极为第二驱动模块181的第五端，第十一晶体管Tll的栅极为第二驱动模块181的第四端，第十一晶体管Tll的第二极为第二驱动模块181的第三端；第十晶体管T10，用于在正向选择信号端GN-1为高电平时开启，将正向扫描信号端FWIN接收到的信号传输到第二驱动模块181的第五端；并在正向选择信号端GN-1为低电平时关断，不再将正向扫描信号端FWIN接收到的信号传输到第二驱动模块181的第五端；所述第十一晶体管，用于在反向选择信号端GN+1为高电平时开启，将反向扫描信号端BWIN接收到的信号传输到第二驱动模块181的第五端；并在反向选择信号端GN+1为低电平时关断，不再将反向扫描信号端BWIN接收到的信号传输到第二驱动模块181的第五端。[0184]进一步地，图18中的第二复位模块可以采用图19所示的结构，在图19中第二复位模块182包括第十二晶体管T12和第十三晶体管T13 ;第十二晶体管T12的第一极为第二复位模块182的第一端，第十二晶体管T12的栅极为第二复位模块182的第二端，第十二晶体管T12的第二极为第二复位模块182的第三端，第十三晶体管T13的第一极为第二复位模块182的第三端，第十三晶体管T13的栅极为第二复位模块182的第二端，第十三晶体管T13的第二极为第二复位模块182的第四端；第十二晶体管T12，用于在复位信号端RSTIN为高电平时开启，将通过所述移位寄存单元的初始触发信号端STVIN接收到的信号传输到第二复位模块182的第一端，并在复位信号端RSTIN为低电平时关断；第十三晶体管T13，用于在复位信号端RSTIN为高电平时开启，将通过所述移位寄存单元的初始触发信号端STVIN接收到的信号传输到第二复位模块182的第四端，并在复位信号端RSTIN为低电平时关断。
[0185]进一步地，图18中的第二输出模块可以采用图19所示的结构，在图19中第二输出模块183包括第十四晶体管T14和第三电容C3 ;第十四晶体管T14的第一极为第二输出模块183的第一端，第十四晶体管T14的栅极连接第三电容C3，第十四晶体管T14的栅极为第二输出模块183的第二端，第十四晶体管T14的第二极为第二输出模块183的第三端，第三电容C3中未与第十四晶体管T14的栅极相连的一端为第二输出模块183的第三端；第十四晶体管T14，用于在自身的栅极为高电平时开启，将时钟阻碍信号端CLKBIN接收到的信号传输至所述移位寄存单元的输出端G0UT，并在自身的栅极为高电平时关断；第三电容C3，用于存储第十四晶体T14的栅极的信号。[0186]下面以图17所示的栅极驱动装置中的各个移位寄存单元采用图19所示的移位单元的结构为例，说明图17所示的栅极驱动装置在正向扫描和反向扫描时工作情况。在正向扫描时，图17所示的栅极驱动装置工作的时序图如图20a所示。在反向扫描时，图17所示的栅极驱动装置工作的时序图如图20b所示，其中，图20a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图20b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。假设图17所示的栅极驱动装置中包含N个移位寄存单元，，下面仅以N为4的整数倍为例说明栅极驱动装置的工作原理。当N为除4的整数倍以外的整数时栅极驱动装置的工作原理与N为4的整数倍时栅极驱动装置的工作原理类似，在此不再赘述。
[0187]在图20a中，在第一个移位寄存单元ASGl的第I时段，其正向选择信号端GN-1接收到的第一初始触发信号STVl为高电平，第一个移位寄存单元ASGl中的第十晶体管TlO开启，同时其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(在图20a中，正向扫描信号FW —直为高电平)，因此，第一个移位寄存单元ASGl中的第三电容C3开始充电，当第三电容C3充电至第一个移位寄存单元ASGl中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第一个移位寄存单元ASGl的时钟阻碍信号端CLKBIN接收到的信号，即第O时钟信号CLKO会通过第十四晶体管T14从第一个移位寄存单元ASGl的输出端GOUTl输出，在第一个移位寄存单元ASGl的第I时段，第O时钟信号CLKO为低电平，因此，第一个移位寄存单元ASGl的输出端GOUTl输出低电平信号；当第O时钟信号CLKO由低电平变为高电平时，第一个移位寄存单元ASGO由第I时段进入第2时段。在第一个移位寄存单兀ASGl的第2时段,第一初始触发信号STVl为低电平，因此,第一个移位寄存单元ASGl中的第十晶体管TlO关断，但由于第三电容C3将第一个移位寄存单元ASGl中的上拉结点Pl的电压信号存储下来，因此，第一个移位寄存单元ASGl中的第十四晶体管T14仍然开启，由于此时段第O时钟信号CLKO为高电平，第一个移位寄存单元ASGl的输出端GOUTl输出高电平信号，第三电容C3的自举效应会使得第一个移位寄存单元ASGl的上拉结点Pl的电位进一步上升；第O时钟信号CLKO由高电平变为低电平时，第一个移位寄存单元ASGl由第2时段进入第3时段。在第一个移位寄存单元ASGl的第3时段，第一初始触发信号STVl为低电平，因此，第一个移位寄存单元ASGl中的第十晶体管TlO关断，由于第一个移位寄存单元ASGl中的第三电容C3的存储作用，第一个移位寄存单元ASGl中的第十四晶体管T14仍然开启，由于此时段第O时钟信号CLKO为低电平，因此，第一个移位寄存单兀ASGl的输出端GOUTl输出低电平信号，当第一个移位寄存单兀ASGl的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号(当第2时钟信号CLK2为高电平时，第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号)、且反向扫描信号BW为低电平(在图20a中，反向扫描信号BW —直为低电平)时，第一个移位寄存单兀ASGl中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第一个移位寄存单元ASGl中的第十四晶体管T14关断，第一个移位寄存单元ASGl的第3时段结束；其中，第一个移位寄存单元ASGl的第I时段、第2时段和第3时段为该第一个移位寄存单元ASGl连接的栅极线被选通的时间段。
[0188]在图20a中，在第二个移位寄存单元ASG2的第I时段，其正向选择信号端GN-1接收到的第二初始触发信号STV2为高电平，第二个移位寄存单元ASG2中的第十晶体管TlO开启，同时其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(在图20a中，正向扫描信号FW—直为高电平)，因此，第二个移位寄存单元ASG2中的第三电容C3开始充电，当第三电容C3充电至第二个移位寄存单元ASG2中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第二个移位寄存单元ASG2的时钟阻碍信号端CLKBIN接收到的信号，即第I时钟信号CLKl会通过第十四晶体管T14从第二个移位寄存单元ASG2的输出端GOUT2输出，在第二个移位寄存单元ASG2的第I时段，第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端GOUT2输出低电平信号；当第I时钟信号CLKl由低电平变为高电平时，第二个移位寄存单元ASG2由第I时段进入第2时段。在第二个移位寄存单元ASG2的第2时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第十晶体管TlO关断，但由于第三电容C3将第二个移位寄存单元ASG2中的上拉结点P2的电压信号存储下来，因此，第二个移位寄存单元ASG2中的第十四晶体管T14仍然开启，由于此时段第I时钟信号CLKl为高电平，第二个移位寄存单元ASG2的输出端GOUT2输出高电平信号，第三电容C3的自举效应会使得第二个移位寄存单元ASG2的上拉结点P2的电位进一步上升；当第I时钟信号CLKl由高电平变为低电平时，第二个移位寄存单元ASG2由第2时段进入第3时段。在第二个移位寄存单元ASG2的第3时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第十晶体管TlO关断，但由于第二个移位寄存单元ASG2中的第三电容C3的存储作用，第二个移位寄存单元ASG2中的第十四晶体管T14仍然开启，由于此时段第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端GOUT2输出低电平信号，当第二个移位寄存单元ASG2的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号(当第3时钟信号CLK3为高电平时，第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号)、且反向扫描信号BW为低电平(在图20a中，反向扫描信号BW —直为低电平)时，第二个移位寄存单兀ASG2中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第二个移位寄存单元ASG2中的第十四晶体管T14关断，第二个移位寄存单元ASG2的第3时段结束；其中，第二移位寄存单元ASG2的第I时段、第2时段和第3时段为该第二移位寄存单元ASG2连接的栅极线被选通的时间段。
[0189]在图20a中，在第q (q=3, 4, -,N)个移位寄存单元ASGq的第I时段，其正向选择信号端GN-1接收到的第q-2个移位寄存单元ASGq-2的输出端G0UTq-2为高电平(当第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号)、且其正向扫描信号端FWIN接收到的正向扫描信号FW为高电平(图20a中，正向扫描信号FW—直为高电平)时，第q个移位寄存单元ASGq中的第三电容C3充电，当第三电容C3充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)会通过第十四晶体管T14从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q_l)/4)时钟信号CLKmod((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。在第q个移位寄存单元ASGq的第2时段，第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为低电平，第q个移位寄存单元ASGq中的第十晶体管TlO关断，第q个移位寄存单元ASGq中的上拉结点Pq的信号只能是第q个移位寄存单元ASGq中的第三电容上C3存储的信号，该信号能使得第q个移位寄存单元ASGq中的第十四晶体管T14开启，由于在此时段，第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为高电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出高电平信号，第三电容C3的自举效应会使得第q个移位寄存单元ASGq的上拉结点Pq的电位进一步上升。在第mod((q_l)/4)时钟信号CLK mod ((q-1)/4)由高电平变为低电平后，第q个移位寄存单元ASGq的第2时段结束，第q个移位寄存单元ASGq进入第3时段。在第q个移位寄存单元ASGq的第3时段，第mod ((q-3)/4)时钟信号CLKmod ((q_3)/4)为低电平，第q个移位寄存单元ASGq中的第十晶体管TlO关断，但由于第q个移位寄存单元ASGq中的第三电容C3的存储作用，第q个移位寄存单元ASGq中的第十四晶体管T14仍然开启，由于此时段第mod ((q-1) /4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号(当第mod((q+l)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端GOUT q+2输出高电平信号)、且反向扫描信号BW为低电平(在图20a中，反向扫描信号BW —直为低电平)时,第q个移位寄存单兀ASGq中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第q个移位寄存单元ASGq中的第十四晶体管T14关断，第q个移位寄存单元ASGq的第3时段结束。
[0190]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0191]在图20a中，由于第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1只有在一帧开始扫描时为高电平,而在其他时间均为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll不能开启，这使得第N-1个移位寄存单元ASGN-1中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N-1个移位寄存单元ASGN-1中的第十四晶体管T14不能关断；第N-1个移位寄存单元ASGN-1中的第十四晶体管T14要在，第N-1个移位寄存单元ASGN-1中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N-1个移位寄存单元ASGN-1中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N-1个移位寄存单元ASGN-1中的第十三晶体管T13开启，使得第N-1个移位寄存单元ASGN-1连接的栅极线接收低电平信号。因此，第N-1个移位寄存单元ASGN-1的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0192]在图20a中，由于第N个移位寄存单元ASGN的反向选择信号端GN+1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N个移位寄存单元ASGN的反向选择信号端GN+1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第N个移位寄存单元ASGN中的第十一晶体管Tll不能开启，这使得第N个移位寄存单元ASGN中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N个移位寄存单元ASGN中的第十四晶体管T14不能关断；第N个移位寄存单元ASGN中的第十四晶体管T14要在，第N个移位寄存单元ASGN中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N个移位寄存单元ASGN中的第十二晶体管T12将其栅极的信号(即第一电容Cl上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N个移位寄存单元ASGN中的第十三晶体管T13开启，使得第N个移位寄存单元ASGN连接的栅极线接收低电平信号。因此，第N个移位寄存单元ASGN的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0193]在图20a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会为低电平，从而消除前一帧扫描结束后残余信号对后一帧的影响。因此，低电平信号能够采用复位信号、第一初始触发信号和第二初始触发信号替代。[0194]在图20b中，在第N (N为4的整数倍)个移位寄存单元ASGN的第I时段，其反向选择信号端GN+1接收到的第二初始触发信号STV2为高电平，第N个移位寄存单元ASGN中的第i 晶体管Tll开启，同时其反向扫描信号端BWIN接收到的反向扫描信号BW为高电平(在图20b中，反向扫描信号BW —直为高电平)，因此，第N个移位寄存单元ASGN中的第三电容C3开始充电，当第三电容C3充电至第N个移位寄存单元ASGN中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第N个移位寄存单元ASGN的时钟阻碍信号端CLKBIN接收到的信号，即第3时钟信号CLK3会通过第十四晶体管T14从第N个移位寄存单元ASGN的输出端GOUTN输出，在第N个移位寄存单元ASGN的第I时段，第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号；当第3时钟信号CLK3由低电平变为高电平时，第N个移位寄存单元ASGN由第I时段进入第2时段。在第N个移位寄存单元ASGN的第2时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第十一晶体管Tll关断，但由于第三电容C3将第N个移位寄存单元ASGN中的上拉结点PN的电压信号存储下来，因此，第N个移位寄存单元ASGN中的第十四晶体管T14仍然开启，由于此时段第3时钟信号CLK3为高电平，第N个移位寄存单元ASGN的输出端GOUTN输出高电平信号，第三电容C3的自举效应会使得第N个移位寄存单元ASGN的上拉结点PN的电位进一步上升；第3时钟信号CLK3由高电平变为低电平时，第N个移位寄存单元ASGN由第2时段进入第3时段。在第N个移位寄存单元ASGN的第3时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第H^一晶体管Tll关断，但由于第N个移位寄存单元ASGN中的第三电容C3的存储作用，第N个移位寄存单元ASGN中的第十四晶体管T14仍然开启，由于此时段第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号，当第N个移位寄存单元ASGN的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号(当第I时钟信号CLKl为高电平时，第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号)、且正向扫描信号FW为低电平(在图20b中，正向扫描信号FW —直为低电平)时,第N个移位寄存单元ASGN中的第三电容C3放电，在放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第N个移位寄存单元ASGN中的第十四晶体管T14关断，第N个移位寄存单元ASGN的第3时段结束；其中，第N个移位寄存单元ASGN的第I时段、第2时段和第3时段为该第N个移位寄存单元ASGN连接的栅极线被选通的时间段。
[0195]在图20b中，在第N-1个移位寄存单元ASGN-1的第I时段，其反向选择信号端GN+1接收到的第一初始触发信号STVl为高电平，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll开启，同时其反向扫描信号端BWIN接收到反向扫描信号BW为高电平(在图20b中，反向扫描信号BW—直为高电平)，因此，第N-1个移位寄存单元ASGN-1中的第三电容C3开始充电，当第三电容C3充电至第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第N-1个移位寄存单元ASGN-1的时钟阻碍信号端CLKBIN接收到的信号，即第2时钟信号CLK2会通过第十四晶体管T14从第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出，在第N-1个移位寄存单元ASGN-1的第I时段，第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号；当第2时钟信号CLK2由低电平变为高电平时，第N-1个移位寄存单元ASGN-1由第I时段进入第2时段。在第N-1个移位寄存单元ASGN-1的第2时段，由于第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll关断，但由于第三电容C3的存储作用，第N-1个移位寄存单元ASGN-1中的第十四晶体管T14仍然开启，由于此时段第2时钟信号CLK2为高电平，第N-1个移位寄存单元ASGN-1的输出端G0UTN- 1输出高电平信号，第三电容C3的自举效应会使得第N-1个移位寄存单元ASGN-1的上拉结点PN-1的电位进一步上升；当第2时钟信号CLK2由高电平变为低电平时，第N-1个移位寄存单元ASGN-1由第2时段进入第3时段。在第N-1个移位寄存单元ASGN-1的第3时段，第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll关断，但由于第N-1个移位寄存单元ASGN-1中的第三电容C3的存储作用，第N-1个移位寄存单元ASGN-1中的第十四晶体管T14仍然开启，由于此时段第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号，当第N-1个移位寄存单元ASGN-1的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号(当第O时钟信号CLKO为高电平时，第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号)、且正向扫描信号FW为低电平(图20b中，正向扫描信号FW —直为低电平)时，第N-1个移位寄存单元ASGN-1中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第N-1个移位寄存单元ASGN-1中的第十四晶体管T14关断，第N-1个移位寄存单元ASGN-1的第3时段结束；其中，第N-1移位寄存单元ASGN-1的第I时段、第2时段和第3时段为该第N-1移位寄存单元ASGN-1连接的栅极线被选通的时间段。
[0196]在图20b中，在第q (q=l，2，3，4，…，N_2)个移位寄存单元ASGq的第I时段，其反向选择信号端GN+1接收到的第q+2个移位寄存单元ASGq+2的输出端G0UTq+2为高电平(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号)、且其反向扫描信号端BWIN接收到的反向扫描信号BW为高电平，第q个移位寄存单元ASGq中的第三电容C3充电，当第三电容C3充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)会通过第十四晶体管T14从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1) /4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)由高电平变为低电平后，即使反向扫描信号BW为高电平，第q个移位寄存单元ASGq中的第三电容C3也不会再充电，只能起到存储作用，在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。在第q个移位寄存单元ASGq的第2时段，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第十一晶体管Tl I关断，第q个移位寄存单元ASGq中的上拉结点Pq的信号只能是第q个移位寄存单元ASGq中的第三电容上C3存储的信号，该信号能使得第q个移位寄存单元ASGq中的第十四晶体管T14开启，由于在此时段，第mod ((q-1) /4)时钟信号CLK mod ((q-1)/4)为高电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出高电平信号，第三电容C3的自举效应会使得第q个移位寄存单元ASGq的上拉结点Pq的电位进一步上升。在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由高电平变为低电平后，第q个移位寄存单元ASGq的第2时段结束，第q个移位寄存单元ASGq进入第3时段。在第q个移位寄存单元ASGq的第3时段，第mod ((q+1)/4)时钟信号CLKmod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第十一晶体管Tll关断，由于第q个移位寄存单元ASGq中的第三电容C3的存储作用，第q个移位寄存单元ASGq中的第十四晶体管T14仍然开启，由于此时段第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此,第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第q-2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号(当第mod((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端GOUT q_2输出高电平信号)、且正向扫描信号FW为低电平时，第q个移位寄存单元ASGq中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第q个移位寄存单元ASGq中的第十四晶体管T14关断，第q个移位寄存单元ASGq的第3时段结束。 [0197]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0198]在图20b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第十晶体管TlO不能开启，这使得第I个移位寄存单元ASGl中的第三电容C3不能通过第十晶体管TlO放电，从而使得第I个移位寄存单元ASGl中的第十四晶体管T14不能关断；第I个移位寄存单元ASGl中的第十四晶体管T14要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第十三晶体管T13开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0199]在图20b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第十晶体管TlO不能开启，这使得第2个移位寄存单元ASG2中的第三电容C3不能通过第十晶体管TlO放电，从而使得第2个移位寄存单元ASG2中的第十四晶体管T14不能关断；第2个移位寄存单元ASG2中的第十四晶体管T14要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第十三晶体管T13开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0200]在图20b中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一巾贞扫描结束后残余信号对后一巾贞的影响。
[0201]进一步地，本发明实施例提供的栅极驱动装置中的正向扫描信号FW还可以复用各个时钟信号，该栅极驱动装置的具体结构如图21所示。图21中的栅极驱动装置与图17中的栅极驱动装置的区别在于:图17所示的栅极驱动装置中的各个移位寄存单元接收到的正向扫描信号需要专门设置一条传输线来传输，而图21所示的栅极驱动装置中的各个移位寄存单元接收到的正向扫描信号可以复用时钟信号。图21所示的栅极驱动装置中的各个移位寄存单元接收到的正向扫描信号复用时钟信号具体为:除前两个移位寄存单元以外的每个移位寄存单元的正向扫描信号端FWIN接收的信号，与该移位寄存单元的前一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，第一个移位寄存单元ASGl的正向扫描信号端FWIN接收第2时钟信号CLK2，第二个移位寄存单元ASG2的正向扫描信号端FWIN接收第3时钟信号CLK3 ;第O时钟信号CLKO为高电平时，第2时钟信号CLK2为低电平，第2时钟信号CLK2为高电平时，第O时钟信号CLKO为低电平；第I时钟信号CLKl为高电平时，第3时钟信号CLK3为低电平，第3时钟信号CLK3为高电平时，第I时钟信号CLKl为低电平?’第η时钟信号CLKn为高电平的时间段与第η+1时钟信号CLKn+Ι为高电平的时间段交叠，每次交叠的时长不小于第三预设时长，其中，n=0，1，2，3，当n+l>3时,第n+1时钟信号 CLKn+Ι 为第 mod ((n+1)/4)时钟信号 CLK mod ((n+1)/4)；
[0202]在正向扫描时，第一初始触发信号STVl为高电平的时间段与第2时钟信号CLK2一次为高电平的时间段交叠，交叠时长不小于，第一个移位寄存单元ASGl中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第2时钟信号CLK2的一个周期，第二初始触发信号STV2为高电平的时间段与第3时钟信号CLK3 一次为高电平的时间段交叠，交叠时长不小于，第二个移位寄存单元ASG2中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第3时钟信号CLK3的一个周期。
[0203]图21所示的栅极驱动装置中的各个移位寄存单元可以采用图19所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图21所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0204]下面以图21中的栅极驱动装置中的各个移位寄存单元采用图19所示的移位寄存单元的结构为例说明图21所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图22a为图21所示的栅极驱动装置在正向扫描时的时序图，图22b为图21所示的栅极驱动装置在反向扫描时的时序图，其中，图22a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图22b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。
[0205]在图22a中，在第一个移位寄存单元ASGl的第I时段，其正向选择信号端GN-1接收到的第一初始触发信号STVl为高电平，第一个移位寄存单元ASGl中的第十晶体管TlO开启，同时其正向扫描信号端FWIN接收到的第二时钟信号CLK2为高电平，因此，第一个移位寄存单元ASGl中的第三电容C3开始充电，当第三电容C3充电至第一个移位寄存单元ASGl中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第一个移位寄存单元ASGl的时钟阻碍信号端CLKBIN接收到的信号，即第O时钟信号CLKO会通过第十四晶体管T14从第一个移位寄存单元ASGl的输出端GOUTl输出，在第一个移位寄存单元ASGl的第I时段，第O时钟信号CLKO为低电平，因此，第一个移位寄存单元ASGl的输出端GOUTl输出低电平信号；当第O时钟信号CLKO由低电平变为高电平时，第一个移位寄存单元ASGO由第I时段进入第2时段。
[0206] 图22a中的第一个移位寄存单元ASGl在第2时段的工作原理与图20a中的第一个移位寄存单元ASGl在第2时段的工作原理相同，图22a中的第一个移位寄存单元ASGl在第3时段的工作原理与图20a中的第一个移位寄存单元ASGl在第3时段的工作原理相同。其中，第一个移位寄存单元ASGl的第I时段、第2时段和第3时段为该第一个移位寄存单元ASGl连接的栅极线被选通的时间段。
[0207]由于第一个移位寄存单元ASGl中的第三电容C3在第一初始触发信号STVl为高电平，且第2时钟信号CLK2为高电平时充电，为了保证第一移位寄存单元ASGl中的第十四晶体管T14能够稳定开启，因此，第一初始信号STVl为高电平的时间段和第2时钟信号CLK2为高电平的时间段相互交叠的时长，要不小于第一个移位寄存单元ASGl中的第三电容C3充电至第一个移位寄存单元ASGl中的第十四晶体管T14能够稳定开启所需的电压的时长。
[0208]在图22a中，在第二个移位寄存单元ASG2的第I时段，其正向选择信号端GN-1接收到的第二初始触发信号STV2为高电平，第二个移位寄存单元ASG2中的第十晶体管TlO开启，同时其正向扫描信号端FWIN接收到的第3时钟信号CLK3为高电平，因此，第二个移位寄存单元ASG2中的第三电容C3开始充电，当第三电容C3充电至第二个移位寄存单元ASG2中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第二个移位寄存单元ASG2的时钟阻碍信号端CLKBIN接收到的信号，即第I时钟信号CLKl会通过第十四晶体管T14从第二个移位寄存单元ASG2的输出端G0UT2输出，在第二个移位寄存单元ASG2的第I时段，第I时钟信号CLKl为低电平，因此，第二个移位寄存单元ASG2的输出端G0UT2输出低电平信号；当第I时钟信号CLKl由低电平变为高电平时，第二个移位寄存单元ASG2由第I时段进入第2时段。
[0209]图22a中的第二个移位寄存单元ASG2在第2时段的工作原理与图20a中的第二个移位寄存单元ASG2在第2时段的工作原理相同，图22a中的第二个移位寄存单元ASG2在第3时段的工作原 理与图20a中的第二个移位寄存单元ASG2在第3时段的工作原理相同。其中，第二个移位寄存单元ASG2的第I时段、第2时段和第3时段为该第二个移位寄存单元ASG2连接的栅极线被选通的时间段。
[0210]由于第二个移位寄存单元ASG2中的第三电容C3在第二初始触发信号STV2为高电平，且第3时钟信号CLK3为高电平时充电，为了保证第二个移位寄存单元ASG2中的第十四晶体管T14能够稳定开启，因此，第二初始信号STV2为高电平的时间段和第3时钟信号CLK3为高电平的时间段相互交叠的时长，要不小于第二个移位寄存单元ASG2中的第三电容C3充电至第二个移位寄存单元ASG2中的第十四晶体管T14能够稳定开启所需的电压的时长。
[0211]在图22a中，在第q (q=3，4，…，N)个移位寄存单元ASGq的第I时段，其正向选择信号端GN-1接收到的第q-2个移位寄存单元ASGq-2的输出端G0UTq-2为高电平(当第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号)、且其正向扫描信号端FWIN接收到的第mod((q-2)/4)时钟信号CLK mod ((q-2)/4)为高电平时，第q个移位寄存单元ASGq中的第三电容C3充电，当第三电容C3充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)会通过第十四晶体管T14从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1)/4)时钟信号CLKmod ((q_l)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。[0212]图22a中的第q个移位寄存单元ASGq在第2时段的工作原理与图20a中的第q个移位寄存单元ASGq在第2时段的工作原理相同，图22a中的第q个移位寄存单元ASGq在第3时段的工作原理与图20a中的第q个移位寄存单元ASGq在第3时段的工作原理相同。其中，第q个移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q个移位寄存单元ASGq连接的栅极线被选通的时间段。
[0213]由于在第mod((q_3)/4)时钟/[目号CLK mod((q-3)/4)由闻电平变为低电平后，第q个移位寄存单元ASGq中的第十晶体管TlO关断，因此，即使第mod((q-2)/4)时钟信号CLK mod ((q-2)/4)为高电平，第q个移位寄存单元ASGq中的第三电容C3也不会再充电，只能起到存储作用。也就是说，只有在第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平、且第mod ((q-2)/4)时钟信号CLKmod ((q_2)/4)为高电平时，第q个移位寄存单元ASGq中的第三电容C3才能够充电，因此，要保证第q个移位寄存单元ASGq中的第十四晶体管T14能够稳定开启，第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平的时间段，与第mod((q-2)/4)时钟信号CLK mod ((q-2)/4)为高电平的时间段需要交叠，并且交叠的时长要不小于第三预设时长，其中，第三预设时长为第q个移位寄存单元ASGq中的第三电容C3充电到其中的第十四晶体管T14能够稳定开启所需的时长；其中，第q个移位寄存单元ASGq中的第三电容C3可以充电的时间段为图22a中虚线圆所示的时间段。
[0214]在图22a中，由于第N_1个移位寄存单元ASGN-1的反向选择信号端GN+1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1只有在一帧开始扫描时为高电平,而在其他时间均为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll不能开启，这使得第N-1个移位寄存单元ASGN-1中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N-1个移位寄存单元ASGN-1中的第十四晶体管T14不能关断；第N-1个移位寄存单元ASGN-1中的第十四晶体管T14要在，第N-1个移位寄存单元ASGN-1中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N-1个移位寄存单元ASGN-1中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N-1个移位寄存单元ASGN-1中的第十三晶体管T13开启，使得第N-1个移位寄存单元ASGN-1连接的栅极线接收低电平信号。因此，第N-1个移位寄存单元ASGN-1的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0215]在图22a中，由于第N个移位寄存单元ASGN的反向选择信号端GN+1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N个移位寄存单元ASGN的反向选择信号端GN+1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第N个移位寄存单元ASGN中的第十一晶体管Tll不能开启，这使得第N个移位寄存单元ASGN中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N个移位寄存单元ASGN中的第十四晶体管T14不能关断；第N个移位寄存单元ASGN中的第十四晶体管T14要在，第N个移位寄存单元ASGN中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N个移位寄存单元ASGN中的第十二晶体管T12将其栅极的信号(即第一电容Cl上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N个移位寄存单元ASGN中的第十三晶体管T13开启，使得第N个移位寄存单元ASGN连接的栅极线接收低电平信号。因此，第N个移位寄存单元ASGN的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0216]在图22a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会为低电平，从而消除前一帧扫描结束后残余信号对后一帧的影响。因此，低电平信号能够采用复位信号、第一初始触发信号和第二初始触发信号替代。
[0217]图22b中的第N个移位寄存单元ASGN在第I时段的工作原理与图20b中的第N个移位寄存单元ASGN在第I时段的工作原理相同，图22b中的第N个移位寄存单元ASGN在第2时段的工作原理与图20b中的第N个移位寄存单元ASGN在第2时段的工作原理相同。
[0218]在图22b中，在第N个移位寄存单元ASGN的第3时段，第二初始触发信号STV2为低电平，因此，第N个移位寄存单元ASGN中的第十一晶体管Tl I关断，但由于第N个移位寄存单元ASGN中的第三电容C3的存储作用，第N个移位寄存单元ASGN中的第十四晶体管T14仍然开启，由于此时段第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号，当第N个移位寄存单元ASGN的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端F WIN接收到低电平信号，即第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号(当第I时钟信号CLKl为高电平时，第N-2个移位寄存单元ASGN-2的输出端G0UTN-2输出高电平信号)、且第2时钟信号CLK2为低电平时，第N个移位寄存单元ASGN中的第三电容C3放电，在放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第N个移位寄存单元ASGN中的第十四晶体管T14关断，第N个移位寄存单元ASGN的第3时段结束；其中，第N个移位寄存单元ASGN的第I时段、第2时段和第3时段为该第N个移位寄存单元ASGN连接的栅极线被选通的时间段。
[0219]由于第N个移位寄存单元ASGN中的第三电容C3在第I时钟信号CLKl为高电平，且第2时钟信号CLK2为低电平时放电，为了保证第N个移位寄存单元ASGN中的第十四晶体管T14能够关断，因此，第I时钟信号CLKl为高电平的时间段和第2时钟信号CLK2为低电平的时间段相互交叠的时长，要不小于第N个移位寄存单元ASGN中的第三电容C3放电至电压低于第N个移位寄存单元ASGN中的第十四晶体管T14开启所需的电压的时长。
[0220]图22b中的第N-1个移位寄存单元ASGN-1在第I时段的工作原理与图20b中的第N-1个移位寄存单元ASGN-1在第I时段的工作原理相同，图22b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理与图20b中的第N-1个移位寄存单元ASGN-1在第2时段的工作原理相同。
[0221 ] 在图22b中，在第N-1个移位寄存单元ASGN-1的第3时段，第一初始触发信号STVl为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll关断，但由于第N-1个移位寄存单元ASGN-1中的第三电容C3的存储作用，第N-1个移位寄存单元ASGN-1中的第十四晶体管T14仍然开启，由于此时段第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端GOUTN-1输出低电平信号，当第N-1个移位寄存单元ASGN-1的正向选择信号端GN-1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，SP第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号(当第O时钟信号CLKO为高电平时，第N-3个移位寄存单元ASGN-3的输出端G0UTN-3输出高电平信号)、且第I时钟信号CLKl为低电平时，第N-1个移位寄存单元ASGN-1中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第N-1个移位寄存单元ASGN-1中的第十四晶体管T14关断，第N-1个移位寄存单元ASGN-1的第3时段结束；其中，第N-1移位寄存单元ASGN-1的第I时段、第2时段和第3时段为该第N-1移位寄存单元ASGN-1连接的栅极线被选通的时间段。
[0222]由于第N-1个移位寄存单元ASGN-1中的第三电容C3在第O时钟信号CLKO为高电平，且第I时钟信号CLKl为低电平时放电，为了保证第N-1移位寄存单元ASGN-1中的第十四晶体管T14能够关断，因此，第O时钟信号CLKO为高电平的时间段和第I时钟信号CLKl为低电平的时间段相互交叠的时长，要不小于第N-1个移位寄存单元ASGN-1中的第三电容C3放电电压低于至第N-1个移位寄存单元ASGN-1中的第十四晶体管T14开启所需的电压的时长。
[0223]图22b中的第q个移位寄存单元ASGq在第I时段的工作原理与图20b中的第q个移位寄存单元ASGq在第I时段的工作原理相同，图22b中的第q个移位寄存单元ASGq在第2时段的工作原理与图20b中的第q个移位寄存单元ASGq在第2时段的工作原理相同。
[0224]在图22b中，在第q (q=l，2，3，4，…，N_2)个移位寄存单元ASGq的的第3时段，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为低电平，第q个移位寄存单元ASGq中的第十一晶体管Tll关断，由 于第q个移位寄存单元ASGq中的第三电容C3的存储作用，第q个移位寄存单元ASGq中的第十四晶体管T14仍然开启，由于此时段第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的正向选择信号端GN_1接收到高电平信号，且其正向扫描信号端FWIN接收到低电平信号，即第q-2个移位寄存单元ASGq-2的输出端G0UTq-2输出高电平信号(当第mod((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平时，第q_2个移位寄存单元ASGq-2的输出端GOUT q_2输出高电平信号)、且第mod((q-2)/4)时钟信号CLKmod ((q-2) /4)为低电平时，第q个移位寄存单元ASGq中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第q个移位寄存单元ASGq中的第十四晶体管T14关断，第q个移位寄存单元ASGq的第3时段结束。其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0225]由于在第q个移位寄存单元ASGq的第3时段，只有在第mod((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平、且第mod ((q_2)/4)时钟信号CLK mod ((q-2)/4)为低电平时，第q个移位寄存单元ASGq中的第三电容C3才能够放电，因此，要保证第q个移位寄存单元ASGq中的第十四晶体管T14能够关断，第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为高电平的时间段，与第mod ((q-2)/4)时钟信号CLK mod ((q-2)/4)为低电平的时间段需要交叠，并且每次交叠的时长要不小于，第q个移位寄存单元ASGq中的第三电容C3放电到其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压所需的时长；其中，第q个移位寄存单元ASGq中的第三电容Cl可以放电的时间段为图22b中虚线椭圆所示的时间段。
[0226]在图22b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第十晶体管TlO不能开启，这使得第I个移位寄存单元ASGl中的第三电容C3不能通过第十晶体管TlO放电，从而使得第I个移位寄存单元ASGl中的第十四晶体管T14不能关断；第I个移位寄存单元ASGl中的第十四晶体管T14要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第十三晶体管T13开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0227]在图22b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第十晶体管TlO不能开启，这使得第2个移位寄存单元ASG2中的第三电容C3不能通过第十晶体管TlO放电，从而使得第2个移位寄存单元ASG2中的第十四晶体管T14不能关断；第2个移位寄存单元ASG2中的第十四晶体管T14要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第十三晶体管T13开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0228]在图22b中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一巾贞扫描结束后残余信号对后一巾贞的影响。[0229]进一步地，本发明实施例提供的栅极驱动装置中的反向扫描信号BW还可以复用各个时钟信号，该栅极驱动装置的具体结构如图23所示。图23中的栅极驱动装置与图17中的栅极驱动装置的区别在于:图17所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号需要专门设置一条传输线来传输，而图23所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号可以复用时钟信号。图23所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号复用时钟信号具体为:除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端BWIN接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，第N-1个移位寄存单元ASGN-1的反向扫描信号端BWIN接收第m0d((m0d((N-2)/4)+2)/4)时钟信号CLKmod ((mod ((N-2) /4) +2) /4)，第N个移位寄存单元ASGN的反向扫描信号端BWIN接收第mod ((mod ((N-1)/4) +2)/4)时钟信号 CLK mod ((mod ((N-1)/4) +2)/4);第 O 时钟信号 CLKO为高电平时，第2时钟信号CLK2为低电平，第2时钟信号CLK2为高电平时，第O时钟信号CLKO为低电平；第I时钟信号CLKl为高电平时，第3时钟信号CLK3为低电平，第3时钟信号CLK3为高电平时，第I时钟信号CLKl为低电平；第η时钟信号CLKn为高电平的时间段与第η+1时钟信号CLKn+Ι为高电平的时间段交叠，每次交叠的时长不小于第四预设时长，其中，n=0，l，2，3，当n+l>3时，第n+1时钟信号CLKn+1为第mod((n+1)/4)时钟信号CLKmod((n+1)/4)；
[0230]在反向扫描时，若N为奇数,第一初始触发信号STVl为高电平的时间段与第mod ((mod ((N-1)/4) +2)/4)时钟信号 CLK mod ((mod ((N-1)/4) +2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-l)/4)+2)/4)时钟信号CLK mod ((mod ((N-1)/4)+2)/4)的一个周期，第二初始触发信号STV2为高电平的时间段与第 mod ((mod ((N-2)/4)+2)/4)时钟信号 CLK mod ((mod ((N-2)/4) +2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-2)/4)+2)/4)时钟信号CLK mod((mod((N-2)/4)+2)/4)的一个周期；若N为偶数，第一初始触发信号STVl为高电平的时间段与第 mod ((mod ((N-2) /4) +2) /4)时钟信号 CLK mod ((mod ((N-2) /4) +2) /4)一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-2) /4) +2) /4)时钟信号 CLK mod ((mod ((N-2) /4) +2) /4)的一个周期，第二初始触发信号STV2为高电平的时间段与第mod ((mod ((N-1) /4) +2) /4)时钟信号CLKmod ((mod ((N-1)/4)+2)/4) 一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第 mod ((mod ((N-1)/4)+2)/4)时钟信号 CLK mod ((mod ((N-1)/4) +2)/4)的一个周期。
[0231]图23所示的栅极驱动装置中的各个移位寄存单元可以采用图19所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图23所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0232]下面以图23中的栅极驱动装置中的各个移位寄存单元采用图19所示的移位寄存单元的结构为例说明图23所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图24a为图23所示的栅极驱动装置在正向扫描时的时序图，图24b为图23所示的栅极驱动装置在反向扫描时的时序图，其中，图24a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图24b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。
[0233]图24a中的第一个移位寄存单元ASGl在第I时段的工作原理与图20a中的第一个移位寄存单元ASGl在第I时段的工作原理相同，图24a中的第一个移位寄存单元ASGl在第2时段的工作原理与图20a中的第一个移位寄存单元ASGl在第2时段的工作原理相同。
[0234]在图24a中，在第一个移位寄存单元ASGl的第3时段，第一初始触发信号STVl为低电平，因此，第一个移位寄存单元ASGl中的第十晶体管TlO关断，由于第一个移位寄存单元ASGl中的第三电容C3的存储作用，第一个移位寄存单元ASGl中的第十四晶体管T14仍然开启，由于此时段第O时钟信号CLKO为低电平，因此,第一个移位寄存单兀ASGl的输出端GOUTl输出低电平信号，当第一个移位寄存单元ASGl的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号(当第2时钟信号CLK2为高电平时，第三个移位寄存单元ASG3的输出端G0UT3输出高电平信号)、且第I时钟信号CLKl为低电平时，第一个移位寄存单元ASGl中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第一个移位寄存单元ASGl中的第十四晶体管T14关断，第一个移位寄存单元ASGl的第3时段结束；其中，第一个移位寄存单元ASGl的第I时段、第2时段和第3时段为该第一个移位寄存单元ASGl连接的栅极线被选通的时间段。
[0235]由于第一个移位寄存单元ASGl中的第三电容C3在第2时钟信号CLK2为高电平，且第I时钟信号CLKl为低电平时放电，为了保证第一个移位寄存单元ASGl中的第十四晶体管T14能够关断，因此，第2时钟信号CLK2为高电平的时间段和第I时钟信号CLKl为低电平的时间段相互交叠的时长，要不小于第一个移位寄存单元ASGl中的第三电容C3放电至电压低于第一个移位寄存单元ASGl中的第十四晶体管T14开启所需的电压的时长。
[0236]图24a中的第二个移位寄存单元ASG2在第I时段的工作原理与图20a中的第二个移位寄存单元ASG2在第I时段的工作原理相同，图24a中的第二个移位寄存单元ASG2在第2时段的工作原理与图20a中的第二个移位寄存单元ASG2在第2时段的工作原理相同。
[0237]在图24a中，在第二个移位寄存单元ASG2的第3时段，第二初始触发信号STV2为低电平，第二个移位寄存单元ASG2中的第十晶体管TlO关断，但由于第二个移位寄存单元ASG2中的第三电容C3的存储作用，第二个移位寄存单元ASG2中的第十四晶体管T14仍然开启，由于此时段第I时钟信号CLKl为低电平，因此,第二个移位寄存单兀ASG2的输出端G0UT2输出低电平信号，当第二个移位寄存单元ASG2的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号(当第3时钟信号CLK3为高电平时，第四个移位寄存单元ASG4的输出端G0UT4输出高电平信号)、且第2时钟信号CLK2为低电平时，第二个移位寄存单元ASG2中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体管T14的开启电压后，第二个移位寄存单元ASG2中的第十四晶体管T14关断，第二个移位寄存单元ASG2的第3时段结束；其中，第二移位寄存单元ASG2的第I时段、第2时段和第3时段为该第二移位寄存单元ASG2连接的栅极线被选通的时间段。
[0238]由于第二个移位寄存单元ASG2中的第三电容C3在第3时钟信号CLK3为高电平，且第2时钟信号CLK2为低电平时放电，为了保证第二个移位寄存单元ASG2中的第十四晶体管T14能够关断，因此，第3时钟信号CLK3为高电平的时间段和第2时钟信号CLK2为低电平的时间段相互交叠的时长，要不小于第二个移位寄存单元ASG2中的第三电容C3放电至电压低于第二个移位寄存单元ASG2中的第十四晶体管T14开启所需的电压的时长。
[0239]图24a中的第q (q=3, 4,…，N)个移位寄存单元ASGq在第I时段的工作原理与图20a中的第q个移位寄存单元ASGq在第I时段的工作原理相同，图24a中的第q个移位寄存单元ASGq在第2时段的工作原理与图20a中的第q个移位寄存单元ASGq在第2时段的工作原理相同。
[0240]在图24a中，在第q个移位寄存单元ASGq的第3时段，第mod ((q-3)/4)时钟信号CLK mod ((q-3)/4)为低电平，第q个移位寄存单元ASGq中的第十晶体管TlO关断，但由于第q个移位寄存单元ASGq中的第三电容C3的存储作用，第q个移位寄存单元ASGq中的第十四晶体管T14仍然开启，由于此时段第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号，当第q个移位寄存单元ASGq的反向选择信号端GN+1接收到高电平信号，且其反向扫描信号端BWIN接收到低电平信号，即第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端GOUT q+2输出高电平信号)、且第mod (q/4)时钟信号CLK mod (q/4)为低电平时，第q个移位寄存单元ASGq中的第三电容C3放电，当放电至其中的第十四晶体管T14的栅极电压低于该第十四晶体 管T14的开启电压后，第q个移位寄存单元ASGq中的第十四晶体管T14关断，第q个移位寄存单元ASGq的第3时段结束。
[0241]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0242]在图24a中，由于第q个移位寄存单元ASGq中的第三电容C3在第mod ((q+1) /4)时钟信号CLK mod ((q+1)/4)为高电平，且第mod (q/4)时钟信号CLKmod (q/4)为低电平时放电，为了保证第q个移位寄存单元ASGq中的第十四晶体管T14能够关断，因此，第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平的时间段和第mod (q/4)时钟信号CLKmod (q/4)为低电平的时间段相互交叠的时长，要不小于第q个移位寄存单元ASGq中的第三电容C3放电至电压低于第q个移位寄存单元ASGq中的第十四晶体管T14开启所需的电压的时长。其中，第q个移位寄存单元ASGq中的第三电容Cl可以放电的时间段为图24a中虚线椭圆所示的时间段。
[0243]在图24a中，由于第N_1个移位寄存单元ASGN-1的反向选择信号端GN+1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N-1个移位寄存单元ASGN-1的反向选择信号端GN+1只有在一帧开始扫描时为高电平,而在其他时间均为低电平，因此，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll不能开启，这使得第N-1个移位寄存单元ASGN-1中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N-1个移位寄存单元ASGN-1中的第十四晶体管T14不能关断；第N-1个移位寄存单元ASGN-1中的第十四晶体管T14要在，第N-1个移位寄存单元ASGN-1中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第N-1个移位寄存单元ASGN-1中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N-1个移位寄存单元ASGN-1中的第十三晶体管T13开启，使得第N-1个移位寄存单元ASGN-1连接的栅极线接收低电平信号。因此，第N-1个移位寄存单元ASGN-1的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0244]在图24a中，由于第N个移位寄存单元ASGN的反向选择信号端GN+1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第N个移位寄存单元ASGN的反向选择信号端GN+1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第N个移位寄存单元ASGN中的第十一晶体管Tll不能开启，这使得第N个移位寄存单元ASGN中的第三电容C3不能通过第十一晶体管Tll放电，从而使得第N个移位寄存单元ASGN中的第十四晶体管T14不能关断；第N个移位寄存单元ASGN中的第十四晶体管T14要在，第N个移位寄存单元ASGN中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才 能通过第N个移位寄存单元ASGN中的第十二晶体管T12将其栅极的信号(即第一电容Cl上存储的信号)释放掉(此时，第N-1个移位寄存单元ASGN-1中的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第N个移位寄存单元ASGN中的第十三晶体管T13开启，使得第N个移位寄存单元ASGN连接的栅极线接收低电平信号。因此，第N个移位寄存单元ASGN的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0245]在图24a中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会为低电平，从而消除前一帧扫描结束后残余信号对后一帧的影响。因此，低电平信号能够采用复位信号、第一初始触发信号和第二初始触发信号替代。
[0246]在图24b中，在第N (N为4的整数倍)个移位寄存单元ASGN的第I时段，其反向选择信号端GN+1接收到的第二初始触发信号STV2为高电平，第N个移位寄存单元ASGN中的第十一晶体管Tll开启，同时其反向扫描信号端BWIN接收到的第I时钟信号CLKl为高电平，因此，第N个移位寄存单元ASGN中的第三电容C3开始充电，当第三电容C3充电至第N个移位寄存单元ASGN中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第N个移位寄存单元ASGN的时钟阻碍信号端CLKBIN接收到的信号，即第
3时钟信号CLK3会通过第十四晶体管T14从第N个移位寄存单元ASGN的输出端GOUTN输出，在第N个移位寄存单元ASGN的第I时段，第3时钟信号CLK3为低电平，因此，第N个移位寄存单元ASGN的输出端GOUTN输出低电平信号；当第3时钟信号CLK3由低电平变为高电平时，第N个移位寄存单元ASGN由第I时段进入第2时段。[0247]图24b中第N个移位寄存单元ASGN在第2时段的工作原理与图20b中第N个移位寄存单元ASGN在第2时段的工作原理相同，图24b中第N个移位寄存单元ASGN在第3时段的工作原理与图20b中第N个移位寄存单元ASGN在第3时段的工作原理相同。
[0248]由于第N个移位寄存单元ASGN中的第三电容C3在第二初始触发信号STV2为高电平、且第I时钟信号CLKl为高电平时充电，为了保证第N个移位寄存单元ASGN中的第十四晶体管T14能够稳定开启，因此，第二初始触发信号STV2为高电平的时间段和第I时钟信号CLKl为高电平的时间段相互交叠的时长，要不小于第N个移位寄存单元ASGN中的第三电容C3充电至第N个移位寄存单元ASGN中的第十四晶体管T14稳定开启所需的电压的时长。
[0249]在图24b中，在第N-1个移位寄存单元ASGN-1的第I时段，其反向选择信号端GN+1接收到的第一初始触发信号STVl为高电平，第N-1个移位寄存单元ASGN-1中的第十一晶体管Tll开启，同时其反向扫描信号端BWIN接收到第O时钟信号CLKO为高电平，因此，第N-1个移位寄存单元ASGN-1中的第三电容C3开始充电，当第三电容C3充电至第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第N-1个移位寄存单元ASGN-1的时钟阻碍信号端CLKBIN接收到的信号，即第2时钟信号CLK2会通过第十四晶体管T14从第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出，在第N-1个移位寄存单元ASGN-1的第I时段，第2时钟信号CLK2为低电平，因此，第N-1个移位寄存单元ASGN-1的输出端G0UTN-1输出低电平信号；当第2时钟信号CLK2由低电平变为高电平时，第N-1个移位寄存单元ASGN-1由第I时段进入第2时段。 [0250]图24b中第N-1个移位寄存单元ASGN-1在第2时段的工作原理与图20b中第N-1个移位寄存单元ASGN-1在第2时段的工作原理相同，图24b中第N-1个移位寄存单元ASGN-1在第3时段的工作原理与图20b中第N-1个移位寄存单元ASGN-1在第3时段的工作原理相同。
[0251]在图24b中，由于第N-1个移位寄存单元ASGN-1中的第三电容C3在第一初始触发信号STVl为高电平、且第O时钟信号CLKO为高电平时充电，为了保证第N-1个移位寄存单元ASGN-1中的第十四晶体管T14能够稳定开启，因此，第一初始触发信号STVl为高电平的时间段和第O时钟信号CLKO为高电平的时间段相互交叠的时长，要不小于第N个移位寄存单元ASGN中的第三电容C3充电至第N个移位寄存单元ASGN中的第十四晶体管T14稳定开启所需的电压的时长。
[0252]其中，第N-1移位寄存单元ASGN-1的第I时段、第2时段和第3时段为该第N_1移位寄存单元ASGN-1连接的栅极线被选通的时间段。
[0253]在图24b中，在第q (q=l，2，3，4，…，N_2)个移位寄存单元ASGq的第I时段，其反向选择信号端GN+1接收到的第q+2个移位寄存单元ASGq+2的输出端G0UTq+2为高电平(当第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)为高电平时，第q+2个移位寄存单元ASGq+2的输出端G0UTq+2输出高电平信号)、且其反向扫描信号端BWIN接收到的第mod (q/4)时钟信号CLK mod (q/4)为高电平，第q个移位寄存单元ASGq中的第三电容C3充电，当第三电容C3充电至第q个移位寄存单元ASGq中驱动栅极线的晶体管，即第十四晶体管T14能够开启时，该第十四晶体管T14开启，第q个移位寄存单元ASGq的时钟阻碍信号端CLKBIN接收到的信号，即第mod((q-l)/4)时钟信号CLK mod ((q-1)/4)会通过第十四晶体管T14从第q个移位寄存单元ASGq的输出端GOUTq输出，在第q个移位寄存单元ASGq的第I时段，第mod ((q-1)/4)时钟信号CLKmod ((q_l)/4)为低电平，因此，第q个移位寄存单元ASGq的输出端GOUTq输出低电平信号；在第mod ((q+1)/4)时钟信号CLK mod ((q+1)/4)由高电平变为低电平后，第q个移位寄存单元ASGq中的第三电容C3不会再充电，只能起到存储作用，在第mod ((q-1)/4)时钟信号CLK mod ((q-1)/4)由低电平变为高电平后，第q个移位寄存单元ASGq的第I时段结束，第q个移位寄存单元ASGq进入第2时段。
[0254]图24b中第q个移位寄存单元ASGq在第2时段的工作原理与图20b中第q个移位寄存单元ASGq在第2时段的工作原理相同，图24b中第q个移位寄存单元ASGq在第3时段的工作原理与图20b中第q个移位寄存单元ASGq在第3时段的工作原理相同。
[0255]由于第q个移位寄存单元ASGq中的第三电容C3在第mod ((q+1)/4)时钟信号CLKmod ((q+1)/4)为高电平、且第mod (q/4)时钟信号CLK mod (q/4)为高电平时充电，为了保证第q个移位寄存单元ASGq中的第十四晶体管T14能够稳定开启，因此，第mod ((q+1) /4)时钟信号CLK mod ((q+1)/4)为高电平的时间段和第mod (q/4)时钟信号CLK mod (q/4)为高电平的时间段相互交叠的时长不小于第四预设时长，即不小于第q个移位寄存单元ASGq中的第三电容C3充电至第q个移位寄存单元ASGq中的第十四晶体管T14稳定开启所需的电压的时长。第q个移位寄存单元ASGq中的第三电容C3可以充电的时间段为图24b中虚线圆中的时间段。
[0256]其中，第q移位寄存单元ASGq的第I时段、第2时段和第3时段为该第q移位寄存单元ASGq连接的栅极线被选通的时间段。
[0257]在图24b中，由于第I个移位寄存单元ASGl的正向选择信号端GN-1接收到信号为第一初始触发信号STV1，而第一初始触发信号STVl只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第I个移位寄存单元ASGl的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第I个移位寄存单元ASGl中的第十晶体管TlO不能开启，这使得第I个移位寄存单元ASGl中的第三电容C3不能通过第十晶体管TlO放电，从而使得第I个移位寄存单元ASGl中的第十四晶体管T14不能关断；第I个移位寄存单元ASGl中的第十四晶体管T14要在，第I个移位寄存单元ASGl中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第I个移位寄存单元ASGl中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第I个移位寄存单元ASGl中的第十三晶体管T13开启，使得第I个移位寄存单元ASGl连接的栅极线接收低电平信号。因此，第I个移位寄存单元ASGl的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0258]在图24b中，由于第2个移位寄存单元ASG2的正向选择信号端GN-1接收到信号为第二初始触发信号STV2，而第二初始触发信号STV2只有在一帧开始扫描时才会为高电平从而触发扫描开始，而在其余时间都会为低电平，因此，第2个移位寄存单元ASG2的正向选择信号端GN-1只有在一帧开始扫描时为高电平，而在其他时间均为低电平，因此，第2个移位寄存单元ASG2中的第十晶体管TlO不能开启，这使得第2个移位寄存单元ASG2中的第三电容C3不能通过第十晶体管TlO放电，从而使得第2个移位寄存单元ASG2中的第十四晶体管T14不能关断；第2个移位寄存单元ASG2中的第十四晶体管T14要在，第2个移位寄存单元ASG2中的复位信号端RSTIN接收到高电平信号(即前一帧扫描结束后、下一帧扫描开始之前，复位信号RST为高电平)时，才能通过第2个移位寄存单元ASG2中的第十二晶体管T12将其栅极的信号(即第三电容C3上存储的信号)释放掉(此时，第I个移位寄存单元ASGl的初始触发信号端STVIN为低电平)，以实现自身的关断；在复位信号RST为高电平时，第2个移位寄存单元ASG2中的第十三晶体管T13开启，使得第2个移位寄存单元ASG2连接的栅极线接收低电平信号。因此，第2个移位寄存单元ASG2的第3时段要在其复位信号端RSTIN接收到高电平信号(即复位信号RST由低电平信号变为高电平信号)时才能结束。
[0259]在图24b中，每个移位寄存单元在其复位信号端RSTIN接收到高电平信号(即复位信号RST为高电平)时，其中的第十四晶体管T14的栅极都会与初始触发信号端STVIN相连，由于复位信号RST为高电平时，第一初始触发信号STVl和第二初始触发信号STV2均为低电平，因此，第十四晶体管T14关断，每个移位寄存单元连接的栅极线也会接收低电平信号，从而消除前一巾贞扫描结束后残余信号对后一巾贞的影响。
[0260]进一步地，图21所示的栅极驱动装置中的反向扫描信号BW也可以复用各个时钟信号，该栅极驱动装置的具体结构如图25所示。图25中的栅极驱动装置与图21中的栅极驱动装置的区别在于:图21所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号分别需要专门设置一条传输线来传输，而图25所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号均可以复用时钟信号。图25所示的栅极驱动装置中的各个移位寄存单元接收到的反向扫描信号均复用时钟信号具体为:
[0261]栅极驱动装置中的移位寄存单元的个数N为4的整数倍；除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端BWIN接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端CLKBIN接收的信号相同，第N-1个移位寄存单元ASGN-1的反向扫描信号端BWIN接收第O时钟信号CLK0，第N个移位寄存单元ASGN的反向扫描信号端BWIN接收第I时钟信号CLKl ；
[0262]在反向扫描时，第一初始触发信号STVl为高电平的时间段与第O时钟信号CLKO一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元ASGN-1中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第O时钟信号CLKO的一个周期，第二初始触发信号STV2为高电平的时间段与I时钟信号CLKl 一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元ASGN中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第I时钟信号CLKl的一个周期。
[0263]图25所示的栅极驱动装置中的各个移位寄存单元可以采用图19所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图25所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0264]下面以图25中的栅极驱动装置中的各个移位寄存单元采用图19所示的移位寄存单元的结构为例说明图25所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图26a为图25所示的栅极驱动装置在正向扫描时的时序图，图26b为图25所示的栅极驱动装置在反向扫描时的时序图，其中，图26a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图26b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。
[0265]图26a中的第I (1=1，2，3，…，N)个移位寄存单元在第I时段的工作原理与图22a中的第I个移位寄存单元在第I时段的工作原理相同，图26a中的第I个移位寄存单元在第2时段的工作原理与图22a中的第I个移位寄存单元在第2时段的工作原理相同，图26a中的第I个移位寄存单元在第3时段的工作原理与图24a中的第I个移位寄存单元在第3时段的工作原理相同。图26a中的移位寄存单元中的第三电容C3可以充电的时间段为图26a中虚线圆中的时间段，图26a中的移位寄存单元中的第三电容C3可以放电的时间段为图26a中实线椭圆中的时间段。
[0266]图26b中的第1(1=1，2，3，…，N)个移位寄存单元在第I时段的工作原理与图24b中的第I个移位寄存单元在第I时段的工作原理相同，图26b中的第I个移位寄存单元在第2时段的工作原理与图24b中的第I个移位寄存单元在第2时段的工作原理相同，图26b中的第I个移位寄存单元在第3时段的工作原理与图22b中的第I个移位寄存单元在第3时段的工作原理相同。图26b中的移位寄存单元中的第三电容C3可以充电的时间段为图26b中实线圆中的时间段，图26b中的移位寄存单元中的第三电容C3可以放电的时间段为图26b中虚线椭圆中的时间段。
[0267]进一步地，图17、图21、图23和图25所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号均可以采用相同的信号，此时，第一初始触发信号和第二初始触发信号合并为一个信号，即初始触发信号。
[0268]当图25所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置的结构如图27所示。图27所示的栅极驱动装置的结构与图25所示的栅极驱动装置的区别仅在于:图25所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1接收第一初始触发信号STVl，第二个移位寄存单元ASG2中的正向选择信号端GN-1接收第二初始触发信号STV2，第N-1个移位寄存单元的反向选择信号端GN+1接收第一初始触发信号STV1，第N个移位寄存单元的反向选择信号端GN+1接收第二初始触发信号STV2 ;图27所示的栅极驱动装置中的第一个移位寄存单元ASGl中的正向选择信号端GN-1、第二个移位寄存单元ASG2中的正向选择信号端GN-1、第N-1个移位寄存单元的反向选择信号端GN+1和第N个移位寄存单元的反向选择信号端GN+1均接收相同的信号，即初始触发信号STV。
[0269]当图17所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置的结构和图17所示的栅极驱动装置结构的区别，与图25所示的栅极驱动装置的结构和图27所示的栅极驱动装置的结构的区别相同；当图21所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置的结构和图21所示的栅极驱动装置结构的区别，与图25所示的栅极驱动装置的结构和图27所示的栅极驱动装置的结构的区别相同；当图23所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置的结构和图23所示的栅极驱动装置结构的区别，与图25所示的栅极驱动装置的结构和图27所示的栅极驱动装置的结构的区别相同。
[0270] 图27所示的栅极驱动装置中的移位寄存单元的个数N也为4的整数倍，这样可以保证栅极驱动装置在正向扫描时，从第一个移位寄存单元ASGl扫描到第N个移位寄存单元ASGN，在反向扫描时，从第N个移位寄存单元扫描到第一个移位寄存单元ASG1，避免出现从第一个移位寄存单元ASGl和第N-1个移位寄存单元ASGN-1同时开始扫描，和/或出现从第二个移位寄存单元ASG2和第N个移位寄存单元ASGN同时开始扫描。
[0271]图27所示的栅极驱动装置中的各个移位寄存单元可以采用图19所示的移位寄存单元的结构，还可以采用其他结构的移位寄存单元。只要采用图27所示的连接方式时，栅极驱动装置能够进行扫描，其中的移位寄存单元的结构不限。
[0272]下面以图27中的栅极驱动装置中的各个移位寄存单元采用图19所示的移位寄存单元的结构为例说明图27所示的栅极驱动装置在正向扫描和反向扫描时的工作时序。图28a为图27所示的栅极驱动装置在正向扫描时的时序图，图28b为图27所示的栅极驱动装置在反向扫描时的时序图，其中，图28a中仅给出了栅极驱动装置中的前4个移位寄存单元的工作时序图，图28b中仅给出了栅极驱动装置中的最后4个移位寄存单元的工作时序图。
[0273]图27所示的栅极驱动装置在正向扫描时(即图28a的时序图)，其中的第m(m=l, 2，…，N)个移位寄存单元的工作原理与图26a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。图27所示的栅极驱动装置在反向扫描时(即图28b的时序图)，其中的第m个移位寄存单元的工作原理与图26b所示的栅极驱动装置中的第m个移位寄存单元的 工作原理相同，在此不再赘述。
[0274]当图17所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在正向扫描时，其中的第m (m=l，2，...，N)个移位寄存单元的工作原理与图20a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述；当图17所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在反向扫描时，其中的第m (πι=1，2，...，Ν)个移位寄存单元的工作原理与图20b所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。
[0275]当图21所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在正向扫描时，其中的第m (m=l，2，...，N)个移位寄存单元的工作原理与图22a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述；当图21所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在反向扫描时，其中的第m (πι=1，2，...，Ν)个移位寄存单元的工作原理与图22b所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。
[0276]当图23所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在正向扫描时，其中的第m (m=l，2，...，N)个移位寄存单元的工作原理与图24a所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述；当图23所示的栅极驱动装置使用的第一初始触发信号和第二初始触发信号采用相同的信号时，该栅极驱动装置在反向扫描时，其中的第m (πι=1，2，...，Ν)个移位寄存单元的工作原理与图24b所示的栅极驱动装置中的第m个移位寄存单元的工作原理相同，在此不再赘述。
[0277]进一步地，在图18所示的移位寄存单元的结构的基础上还可以增加第二下拉模块，增加第二下拉模块后的移位寄存单元的结构如图29所示，在增加第二下拉模块后，每个移位寄存单元中增加了时钟信号端。如图29所示，第二下拉模块184的第一端为一个移位寄存单元的时钟阻碍信号端CLKBIN，第二下拉模块184的第二端连接第二输出模块183的第二端，第二下拉模块184的第三端连接第二输出模块183的第三端，第二下拉模块184的第四端为该移位寄存单元的复位信号端RSTIN，第二下拉模块184的第五端为该移位寄存单元的时钟信号端CLKIN ;第二下拉模块184，用于在自身的第二端为低电平，且时钟阻碍信号端CLKINB为高电平时，将通过自身的第四端接收到的复位信号RST分别从自身的第二端和自身的第三端输出；以及在时钟信号端CLKIN为高电平时，将通过自身的第四端接收到的复位信号RST从自身的第三端输出。
[0278]在栅极驱动装置中的各个移位寄存单元采用图29所示的移位寄存单元的结构时，栅极驱动装置中的第k α=1，2，...，Ν)个移位寄存单元的时钟信号端接收第mod ((mod ((k-1) /4) +2) /4)时钟信号。
[0279]进一步地，图29所示的移位寄存单元的结构可以采用图30所示的电路结构。如图30所示第一下拉模块184包括第四电容C4、第十五晶体管T15、第十六晶体管T16、第十七晶体管T17和第十八晶体管T18 ;第十五晶体管T15的第一极为第二下拉模块184的第二端，第十五晶体管T15的栅极连接第四电容C4，第十五晶体管T15的第二极为第二下拉模块184的第四端,第四电容C4中未与第十五晶体管T15的栅极相连的一端为第二下拉模块184的第一端；第十六晶体管T16的第一极连接第十五晶体管T15的栅极，第十六晶体管T16的栅极为第二下拉模块184的第二端，第十六晶体管T16的第二极为第二下拉模块184的第四端；第十七晶体管T17的第一极为第二下拉模块184的第三端，第十七晶体管T17的栅极连接第十五晶体管T15的栅极，第十七晶体管T17的第二极为第二下拉模块184的第四端；第十八晶体管T18的第一极为第二下拉模块184的第三端，第十八晶体管T18的栅极为第二下拉模块184的第五端，第十八晶体管T18的第二极为第二下拉模块184的第四端；第十五晶体管T15，用于在自身的栅极为高电平时开启，将第二下拉模块184的第二端，即上拉结点P的电平下拉至低电平，在自身的栅极为低电平时关断；第十六晶体管T16，用于在第二下拉模块184的第二端，即上拉结点P为高电平时开启，将复位信号端RSTIN接收到的信号传输至第十五晶体管T15的栅极，即将第十五晶体管T15的栅极的电平下拉至低电平，并在第二下拉模块184的第二端为低电平时关断；第十七晶体管T17，用于在自身的栅极为高电平时开启，将复位信号端RSTIN接收到的信号传输至所述移位寄存单元的输出端G0UT，即将所述移位寄存单元的输出端GOUT下拉至低电平，并在自身的栅极为低电平时关断；第十八晶体管T18，用于在时钟信号端CLKIN为高电平时开启，将复位信号端RSTIN接收到的信号传输至所述移位寄存单元的输出端G0UT，即将所述移位寄存单元的输出端GOUT下拉至低电平，并在时钟信号端CLKIN为低电平时关断。
[0280]由于在当前帧扫描的过程中，复位信号一直为低电平，因此，在当前帧扫描的过程中，可以采用复位信号替代低电平信号。
[0281]其中，只有在上拉结点P为低电平，且时钟阻碍端CLKBIN为高电平时，第十五晶体管T15的栅极和第十七晶体管T17的栅极才能为高电平。
[0282]图30中除第二下拉模块184以外的电路与图19中的电路结构相同，在此不再赘述。
[0283]图17、图21、图23和图25所示的栅极驱动装置中的移位寄存单元均可以采用图30所示的移位寄存单元的结构。当栅极驱动装置中的移位寄存单元采用图30所示的移位寄存单元的结构时，在第1、2、3时段的工作原理与分别与采用图19所示的移位寄存单元的结构时在第1、2、3时段的工作原理相同。
[0284]在正向扫描时，若栅极驱动装置中的各个移位寄存单元中均包含第一下拉模块，则该栅极驱动装置中除最后两个移位寄存单元以外的各个以外寄存单元在其连接的栅极线未被选通的时间段，其栅极线上的低电平信号不会受到高电平的时钟信号的影响。在反向扫描时，若栅极驱动装置中的各个移位寄存单元中均包含第一下拉模块，则该栅极驱动装置中除第一个移位寄存单元和第二个移位寄存单元以外的各个以外寄存单元在其连接的栅极线未被选通的时间段，其栅极线上的低电平信号不会受到高电平的时钟信号的影响。
[0285]当图17所示的栅极驱动装置中的各个移位寄存单元采用图30所示的结构时，其正向扫描的时序图依然如图20a所示，其反向扫描的时序图依然如图20b所示。当图21所示的栅极驱动装置中的各个移位寄存单元采用图30所示的结构时，其正向扫描的时序图依然如图22a所示，其反向扫描的时序图依然如图22b所示。当图23所示的栅极驱动装置中的各个移位寄存单元采用图30所示的结构时，其正向扫描的时序图依然如图24a所示，其反向扫描的时序图依然如图24b所示。当图25所示的栅极驱动装置中的各个移位寄存单元采用图30所示的结构时，其正向扫描的时序图依然如图26a所示，其反向扫描的时序图依然如图26b所示。当图27所示的栅极驱动装置中的各个移位寄存单元采用图30所示的结构时，其正向扫描的时序图依然如图28a所示，其反向扫描的时序图依然如图28b所示。
[0286]对于液晶显示领域的晶体管来说，漏极和源极没有明确的区别，因此本发明实施例中所提到的晶体管的第一极可以为晶体管的源极(或漏极)，晶体管的第二极可以为晶体管的漏极(或源极)。如果晶体管的源极为第一极，那么该晶体管的漏极为第二极；如果晶体管的漏极为第一极，那么晶体管的源极为第二极。
[0287]本发明实施例提供的显示装置，包括本发明实施例提供的栅极驱动装置。
[0288]本领域技术人员可以理解附图只是一个优选实施例的示意图，附图中的模块或流程并不一定是实施本发明所必须的。
[0289]本领域技术人员可以理解实施例中的装置中的模块可以按照实施例描述进行分布于实施例的装置中，也可以进行相应变化位于不同于本实施例的一个或多个装置中。上述实施例的模块可以合并为一个模块，也可以进一步拆分成多个子模块。
[0290]上述本发明实施例序号仅仅为了描述，不代表实施例的优劣。
[0291]显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
【权利要求】
1.一种栅极驱动装置，其特征在于，包括N个移位寄存单元； 第P个移位寄存单元的正向选择信号端接收第P-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则倒数第二个移位寄存单元的反向选择信号端接收第一初始触发信号，倒数第一个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则倒数第一个移位寄存单元的反向选择信号端接收第一初始触发信号，倒数第二个移位寄存单元的反向选择信号端接收第二初始触发信号；每个移位寄存单元的低电平信号端接收低电平信号；每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前中贞扫描时为低电平； 第k个移位寄存单元的时钟阻碍信号端接收第mod((k-l)/4)时钟信号，k=l，2…，N;除前两个移位寄存单元以外的每个移位寄存单元的正向扫描信号端接收的信号与该移位寄存单元的前一个移位寄存单元的时钟阻碍信号端接收的信号相同，第一个移位寄存单元的正向扫描信号端接收第2时钟信号，第二个移位寄存单元的正向扫描信号端接收第3时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；第η时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第一预设时长，其中，n=0，1，2，3，当n+l>3时，第n+1时钟信号为第mod((n+l)/4)时钟信号； 在正向扫描时，第一初始触发信号为高电平的时间段与第2时钟信号一次为高电平的时间段交叠，交叠时长不小于第一个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第2时钟信号的一个周期，第二初始触发信号为高电平的时间段与第3时钟信号一次为高电平的时间段交叠，交叠时长不小于第二个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第3时钟信号的一个周期。
2.如权利要求1所述的栅极驱动装置，其特征在于，N=4m,m为正整数；除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端接收的信号相同，倒数第N-1个移位寄存单元的反向扫描信号端接收第O时钟信号，第N个移位寄存单元的反向扫描信号端接收第I时钟信号; 在反向扫描时，第一初始触发信号为高电平的时间段与第O时钟信号一次为高电平的时间段交叠，交叠时长不小于，第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第O时钟信号的一个周期，第二初始触发信号为高电平的时间段与第I时钟信号一次为高电平的时间段交叠，交叠时长不小于，第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第I时钟信号的一个周期。
3.如权利要求1或2所述的栅极驱动装置，其特征在于，第一初始触发信号与第二初始触发信号相同。
4.如权利要求1所述的栅极驱动装置，其特征在于，所述栅极驱动装置中的每个移位寄存单兀包括第一驱动模块、第一输出模块和第一复位模块； 所述第一驱动模块的第一端为所述移位寄存单元的正向扫描信号端，所述第一驱动模块的第二端为所述移位寄存单元的正向选择信号端，所述第一驱动模块的第三端为所述移位寄存单元的反向扫描信号端，所述第一驱动模块的第四端为所述移位寄存单元的反向选择信号端，所述第一驱动模块的第五端连接所述第一输出模块的第二端，所述第一输出模块的第一端为所述移位寄存单元的时钟阻碍信号端，所述第一输出模块的第三端为所述移位寄存单元的输出端；所述第一复位模块的第一端连接所述第一输出模块的第二端，所述第一复位模块的第二端为所述移位寄存单元的复位信号端，所述第一复位模块的第三端为所述移位寄存单元的低电平信号端，所述第一复位模块的第四端连接所述第一输出模块的第三端； 所述第一驱动模块，用于在正向选择信号端为高电平时，将正向扫描信号端接收到的信号通过自身第五端输出；并在反向选择信号端为高电平时，将反向扫描信号端接收到的信号通过自身第五端输出； 所述第一复位模块，用于在复位信号端接收到高电平信号时，将低电平信号端接收到信号分别通过自身的第一端和第四端输出； 所述第一输出模块，用于在通过自身第二端接收到高电平信号时，存储该高电平信号，并将时钟阻碍信号端接收到的信号从所述移位寄存单元的输出端输出；并在通过自身第二端接收到低电平信号时，存储该低电平信号，并不再将时钟阻碍信号端接收到的信号从所述移位寄存单元的输出端输出。
5.如权利要求4所述的栅极驱动装置，其特征在于，所述栅极驱动装置中的第k个移位寄存单元的时钟信号端接收第mod((mod((k-l)/4)+2)/4)时钟信号，k=l, 2...，N ;所述栅极驱动装置中的各个移位寄存单元还包括第一下拉模块； 所述第一下拉模块的第一端为所述移位寄存单元的时钟阻碍信号端，所述第一下拉模块的第二端连接所述第一输出模块的第二端，所述第一下拉模块的第三端连接所述第一输出模块的第三端，所述第一下拉模块的第四端为所述移位寄存单元的低电平信号端，所述第一下拉模块的第五端为所述移位寄存单元的时钟信号端； 所述第一下拉模块，用于在自身的第二端为低电平，且时钟阻碍信号端为高电平时，将通过自身的第四端接收到的低电平信号分别从自身的第二端和自身的第三端输出；以及在时钟信号端为高电平时，将通过自身的第四端接收到的低电平信号从自身的第三端输出。
6.如权利要求4所述的栅极驱动装置，其特征在于，所述第一驱动模块包括第一晶体管和第二晶体管； 所述第一晶体管的第一极为所述第一驱动模块的第一端，所述第一晶体管的栅极为所述第一驱动模块的第二端，所述第一晶体管的第二极为所述第一驱动模块的第五端；所述第二晶体管的第一极为所述第一驱动模块的第五端，所述第二晶体管的栅极为所述第一驱动模块的第四端，所述第二晶体管的第二极为所述第一驱动模块的第三端； 所述第一晶体管，用于在正向选择信号端接收到高电平信号时开启，将正向扫描信号端接收到的信号传输到所述第一驱动模块的第五端；并在正向选择信号端接收到低电平信号时关断，不再将正向扫描信号端接收到的信号传输到所述第一驱动模块的第五端；所述第二晶体管，用于在反向选择信号端接收到高电平信号时开启，将反向扫描信号端接收到的信号传输到所述第一驱动模块的第五端；并在反向选择信号端接收到低电平信号时关断，不再将反向扫描信号端接收到的信号传输到所述第一驱动模块的第五端。
7.如权利要求4所述的栅极驱动装置，其特征在于，所述第一复位模块包括第三晶体管和第四晶体管； 所述第三晶体管的第一极为所述第一复位模块的第一端，所述第三晶体管的栅极为所述第一复位模块的第二端，所述第三晶体管的第二极为所述第一复位模块的第三端，所述第四晶体管的第一极为所述第一复位模块的第三端，所述第四晶体管的栅极为所述第一复位模块的第二端，所述第四晶体管的第二极为所述第一复位模块的第四端； 所述第三晶体管，用于在复位信号端为高电平时开启，将低电平信号端接收到的信号传输到所述第一复位模块的第一端，并在复位信号端为低电平时关断； 所述第四晶体管，用于在复位信号端为高电平时开启，将低电平信号端接收到的信号传输到所述第一复位模块的第四端，并在复位信号端为低电平时关断。
8.如权利要求4所述的栅极驱动装置，其特征在于，所述第一输出模块包括第五晶体管和第一电容； 所述第五晶体管的第一极为所述第一输出模块的第一端，所述第五晶体管的栅极连接所述第一电容的一端，所述第五晶体管的栅极为所述第一输出模块的第二端，所述第五晶体管的第二极为所述第一输出模块的第三端，所述第一电容的另一端连接所述第五晶体管的第二极； 所述第五晶体管，用于在自身的栅极为高电平时开启，将时钟阻碍信号端接收到的信号传输至所述移位寄存单元的输出端，并在自身的栅极为高电平时关断； 所述第一电容，用于存储所述第五晶体的栅极的信号。
9.如权利要求5所述的栅极驱动装置，其特征在于，所述第一下拉模块包括第二电容、第六晶体管、第七晶体管、第八晶体管和第九晶体管； 所述第六晶体管的第一极为所述第一下拉模块的第二端，所述第六晶体管的栅极连接所述第二电容，所述第六晶体管的第二极为所述第一下拉模块的第四端，所述第二电容中未与所述第六晶体管的栅极相连的一端为所述第一下拉模块的第一端；所述第七晶体管的第一极连接所述第六晶体管的栅极，所述第七晶体管的栅极为所述第一下拉模块的第二端，所述第七晶体管的第二极为所述第一下拉模块的第四端；所述第八晶体管的第一极为所述第一下拉模块的第三端，所述第八晶体管的栅极连接所述第六晶体管的栅极，所述第八晶体管的第二极为所述第一下拉模块的第四端；所述第九晶体管的第一极为所述第一下拉模块的第三端，所述第九晶体管的栅极为所述第一下拉模块的第五端，所述第九晶体管的第二极为所述第一下拉模块的第四端； 所述第六晶体管，用于在自身的栅极为高电平时开启，将所述第一下拉模块的第二端下拉至低电平，在自身的栅极为低电平时关断； 所述第七晶体管，用于在所述第一下拉模块的第二端为高电平时开启，将所述第六晶体管的栅极下拉至低电平，并在所述第一下拉模块的第二端为低电平时关断； 所述第八晶体管，用于在自身的栅极为高电平时开启，将所述移位寄存单元的输出端下拉至低电平，并在自身的栅极为低电平时关断；所述第九晶体管，用于在时钟信号端为高电平时开启，将所述移位寄存单元的输出端下拉至低电平，并在时钟信号端为低电平时关断。
10.一种栅极驱动装置，其特征在于，包括N个移位寄存单元； 第P个移位寄存单元的正向选择信号端接收第P-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则第N-1个移位寄存单元的反向选择信号端接收第一初始触发信号，第N个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则第N个移位寄存单元的反向选择信号端接收第一初始触发信号，第N-1个移位寄存单元的反向选择信号端接收第二初始触发信号；每个移位寄存单元的低电平信号端接收低电平信号；每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平; 第k个移位寄存单元的时钟阻碍信号端接收第mod((k-l)/4)时钟信号，k=l，2…，N;除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端接收的信号相同，倒数第二个移位寄存单元的反向扫描信号端接收第mod ((mod ((N-2) /4) +2) /4)时钟信号，倒数第一个移位寄存单元的反向扫描信号端接收第mod ((mod ((N-1)/4)+2)/4)时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；第η时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第二预设时长，其中，11=0，1，2，3，当11+1>3时，第11+1时钟信号为第mod ((n+1)/4)时钟信号； 在反向扫描时，若N为奇数，第一初始触发信号为高电平的时间段与第mod ((mod ((N-1)/4) +2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-1)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第mod((mod((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠,交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-2) /4) +2) /4)时钟信号的一个周期；若N为偶数，第一初始触发信号为高电平的时间段与第m0d((m0d((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-2)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第m0d((m0d((N-l)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-l)/4)+2)/4)时钟信号的一个周期。
11.如权利要求10所述的栅极驱动装置，其特征在于，第一初始触发信号与第二初始触发信号相同。
12.—种栅极驱动装置，其特征在于，包括N个移位寄存单元； 第P个移位寄存单元的正向选择信号端接收第P-2个移位寄存单元输出的信号，P=3, 4，....N，第r个移位寄存单元的反向选择信号端接收第r+2个移位寄存单元输出的信号，r=l，2，…N-2，第一个移位寄存单元的正向选择信号端接收第一初始触发信号，第二个移位寄存单元的正向选择信号端接收第二初始触发信号，若N为偶数，则第N-1个移位寄存单元的反向选择信号端接收第一初始触发信号，第N个移位寄存单元的反向选择信号端接收第二初始触发信号，若N为奇数，则第N个移位寄存单元的反向选择信号端接收第一初始触发信号，第N-1个移位寄存单元的反向选择信号端接收第二初始触发信号；第k个移位寄存单元的时钟阻碍信号端接收第mod((k-l)/4)时钟信号，k=l, 2...，N ； 每个移位寄存单元的复位信号端接收复位信号，所述复位信号在前一帧扫描结束后，当前帧扫描开始前为高电平，在当前帧扫描时为低电平；所述栅极驱动装置中的每个移位寄存单元的初始触发信号端接收第一初始触发信号或者第二初始触发信号；复位信号为高电平时，第一初始触发信号和第二初始触发信号均为低电平，第一初始触发信号为高电平时，复位信号为低电平，第二初始触发信号为高电平时，复位信号为低电平； 各个移位寄存单元，用于在正/反向选择信号端接收到高电平信号，且正/反向扫描信号端接收到高电平信号时，用正/反向扫描信号端接收到的高电平信号对自身中驱动栅极线的晶体管的栅极进行充电至该晶体管稳定开启；在该晶体管稳定开启后，将通过时钟阻碍信号端接收到的信号输出；在反/正向选择信号端接收到高电平信号，且反/正向扫描信号端接收到低电平信号时，用反/正向扫描信号端接收到的低电平信号对自身中驱动栅极线的晶体管的栅极进行放电至该晶体管关闭；以及在复位信号端为高电平时，用初始触发信号端接收到的信号对自身中驱动栅极线的晶体管的栅极的电位进行下拉，并将初始触发信号端接收到的信号输出。
13.如权利要求12所述的栅极驱动装置，其特征在于，所述栅极驱动装置中除前两个移位寄存单元以外的每个移位寄存单元的正向扫描信号端接收的信号，与该移位寄存单元的前一个移位寄存单元的时钟阻碍信号端接收的信号相同，第一个移位寄存单元的正向扫描信号端接收第2时钟信号，第二个移位寄存单元的正向扫描信号端接收第3时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；第η时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第三预设时长，其中，n=0，1，2，3，当n+l>3时，第n+1时钟信号为第mod ((n+1)/4)时钟信号； 在正向扫描时，第一初始触发信号为高电平的时间段与第2时钟信号一次为高电平的时间段交叠，交叠时长不小于，第一个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电 压的时长，且不大于第2时钟信号的一个周期，第二初始触发信号为高电平的时间段与第3时钟信号一次为高电平的时间段交叠，交叠时长不小于，第二个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第3时钟信号的一个周期。
14.如权利要求12所述的栅极驱动装置，其特征在于，所述栅极驱动装置中除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端接收的信号与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端接收的信号相同，第N-1个移位寄存单元的反向扫描信号端接收第mod ((mod ((N-2) /4) +2) /4)时钟信号，第N个移位寄存单元的反向扫描信号端接收第mod ((mod ((N-1)/4)+2)/4)时钟信号；第O时钟信号为高电平时，第2时钟信号为低电平，第2时钟信号为高电平时，第O时钟信号为低电平；第I时钟信号为高电平时，第3时钟信号为低电平，第3时钟信号为高电平时，第I时钟信号为低电平；第1!时钟信号为高电平的时间段与第n+1时钟信号为高电平的时间段交叠，每次交叠的时长不小于第四预设时长，其中，n=0，l，2，3，当n+l>3时，第n+1时钟信号为第mod((n+1)/4)时钟信号； 在反向扫描时，若N为奇数，第一初始触发信号为高电平的时间段与第mod ((mod ((N-1) /4) +2) /4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-1)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第mod((mod((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠,交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第mod ((mod ((N-2) /4) +2) /4)时钟信号的一个周期；若N为偶数，第一初始触发信号为高电平的时间段与第m0d((m0d((N-2)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N-1个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-2)/4)+2)/4)时钟信号的一个周期，第二初始触发信号为高电平的时间段与第m0d((m0d((N-l)/4)+2)/4)时钟信号一次为高电平的时间段交叠，交叠时长不小于第N个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第m0d((m0d((N-l)/4)+2)/4)时钟信号的一个周期。
15.如权利要求13所述的栅极驱动装置，其特征在于，N=4m,m为正整数； 所述栅极驱动装置中除最后两个移位寄存单元以外的每个移位寄存单元的反向扫描信号端接收的信号，与该移位寄存单元的后一个移位寄存单元的时钟阻碍信号端接收的信号相同，倒数第二个移位寄存单元的反向扫描信号端接收第O时钟信号，倒数第一个移位寄存单元的反向扫描信号端接收第I时钟信号； 在反向扫描时，第一初始触发信号为高电平的时间段与第O时钟信号一次为高电平的时间段交叠，交叠时长不小于，倒数第二个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第O时钟信号的一个周期，第二初始触发信号为高电平的时间段与第I时钟信号一次为高电平的时间段交叠，交叠时长不小于，倒数第一个移位寄存单元中驱动栅极线的晶体管的栅极充电到该晶体管稳定开启所需电压的时长，且不大于第I时钟信号的一个周期。
16.如权利要求12~15任一所述的栅极驱动装置，其特征在于，第一初始触发信号与第二初始触发信号相同。
17.如权利要求12所述的栅极驱动装置，其特征在于，所述栅极驱动装置中的每个移位寄存单元包括第二驱动模块、第二输出模块和第二复位模块； 所述第二驱动模块的第一端为所述移位寄存单元的正向扫描信号端，所述第二驱动模块的第二端为所述移位寄存单元的正向选择信号端，所述第二驱动模块的第三端为所述移位寄存单元的反向扫描信号端，所述第二驱动模块的第四端为所述移位寄存单元的反向选择信号端，所述第二驱动模块的第五端连接所述第二输出模块的第二端，所述第二输出模块的第一端为所述移位寄存单元的时钟阻碍信号端，所述第二输出模块的第三端为所述移位寄存单元的输出端；所述第二复位模块的第一端连接所述第二输出模块的第二端，所述第二复位模块的第二端为所述移位寄存单元的复位信号端，所述第二复位模块的第三端为所述移位寄存单元的初始触发信号端，所述第二复位模块的第四端连接所述第二输出模块的第三端； 所述第二驱动模块，用于在正向选择信号端为高电平时，将正向扫描信号端接收到的信号通过自身第五端输出；并在反向选择信号端为高电平时，将反向扫描信号端接收到的信号通过自身第五端输出； 所述第二复位模块，用于在复位信号端为高电平时，将通过所述移位寄存单元的初始触发信号端接收到的信号分别通过自身的第一端和第四端输出； 所述第二输出模块，用于在通过自身第二端接收到高电平信号时，存储该高电平信号，并将时钟阻碍信号端接收到的信号从所述移位寄存单元的输出端输出；并在通过自身第二端接收到低电平信号时，存储该低电平信号，并不再将时钟阻碍信号端接收到的信号从所述移位寄存单元的输出端输出。
18.如权利要求17所述的栅极驱动装置，其特征在于，所述栅极驱动装置中的第k个移位寄存单元的时钟信号端接收第mod((mod((k-l)/4)+2)/4)时钟信号，k=l, 2...，N ;所述栅极驱动装置中的各个移位寄存单元还包括第二下拉模块； 所述第二下拉模块的第一端为所述移位寄存单元的时钟阻碍信号端，所述第二下拉模块的第二端连接所述第二输出模块的第二端，所述第二下拉模块的第三端连接所述第二输出模块的第三端，所述第二下拉模块的第四端为所述移位寄存单元的复位信号端，所述第二下拉模块的第五端为所述移位寄存单元的时钟信号端； 所述第二下拉模块，用于在并在自身的第二端为低电平，且时钟阻碍信号端为高电平时，将通过自身的第四端接收到的复位信号从自身的第三端输出；以及在时钟信号端为高电平信号时，将通过自身的第四端接收到的复位信号从自身的第三端输出。
19.如权利要求17所述的栅极驱动装置，其特征在于，所述第二驱动模块包括第十晶体管和第十一晶体管； 所述第十晶体管的第一极为所述第二驱动模块的第一端，所述第十晶体管的栅极为所述第二驱动模块的第二端，所述第十晶体管的第二极为所述第二驱动模块的第五端；所述第十一晶体管的第一极为所述第二驱动模块的第五端，所述第十一晶体管的栅极为所述第二驱动模块的第四端，所述第十一晶体管的第二极为所述第二驱动模块的第三端； 所述第十晶体管，用于在正向选择信号端为高电平时开启，将正向扫描信号端接收到的信号传输到所述第二驱动模块的第五端；并在正向选择信号端为低电平时关断，不再将正向扫描信号端接收到的信号传输到所述第二驱动模块的第五端； 所述第十一晶体管，用于在反向选择信号端为高电平时开启，将反向扫描信号端接收到的信号传输到所述第二驱动模块的第五端；并在反向选择信号端为低电平时关断，不再将反向扫描信号端接收到的信号传输到所述第二驱动模块的第五端。
20.如权利要求17所述的栅极驱动装置，其特征在于，所述第二复位模块包括第十二晶体管和第十三晶体管；所述第十二晶体管的第一极为所述第二复位模块的第一端，所述第十二晶体管的栅极为所述第二复位模块的第二端，所述第十二晶体管的第二极为所述第二复位模块的第三端，所述第十三晶体管的第一极为所述第二复位模块的第三端，所述第十三晶体管的栅极为所述第二复位模块的第二端，所述第十三晶体管的第二极为所述第二复位模块的第四端; 所述第十二晶体管，用于在复位信号端为高电平时开启，将通过所述移位寄存单元的初始触发信号端接收到的信号传输到所述第二复位模块的第一端，并在复位信号端为低电平时关断； 所述第十三晶体管，用于在复位信号端为高电平时开启，将通过所述移位寄存单元的初始触发信号端接收到的信号传输到所述第二复位模块的第四端，并在复位信号端为低电平时关断。
21.如权利要求17所述的栅极驱动装置，其特征在于，所述第二输出模块包括第十四晶体管和第三电容； 所述第十四晶体管的第一极为所述第二输出模块的第一端，所述第十四晶体管的栅极连接所述第三电容，所述第十四晶体管的栅极为所述第二输出模块的第二端，所述第十四晶体管的第二极为所述第二输出模块的第三端，所述第三电容中未与所述第十四晶体管的栅极相连的一端为所述第二输出模块的第三端； 所述第十四晶体管，用于在自身的栅极为高电平时开启，将时钟阻碍信号端接收到的信号传输至所述移位寄存单元的输出端，并在自身的栅极为高电平时关断； 所述第三电容，用于存储所述第十四晶体的栅极的信号。
22.如权利要求18所述的栅极驱动装置，其特征在于，所述第二下拉模块包括第四电容、第十五晶体管、第十六晶体管、第十七晶体管和第十八晶体管； 所述第十五晶体管的第一极为所述第二下拉模块的第二端，所述第十五晶体管的栅极连接所述第四电容，所述第十五晶体管的第二极为所述第二下拉模块的第四端，所述第四电容中未与所述第十五晶体管的栅极相连的一端为所述第二下拉模块的第一端；所述第十六晶体管的第一极连接所述第十五晶体管的栅极，所述第十六晶体管的栅极为所述第二下拉模块的第二端，所述第十六晶体管的第二极为所述第二下拉模块的第四端；所述第十七晶体管的第一极为所述第二下拉模块的第三端，所述第十七晶体管的栅极连接所述第十五晶体管的栅极，所述第十七晶体管的第二极为所述第二下拉模块的第四端；所述第十八晶体管的第一极为所述第二下拉模块的第三端，所述第十八晶体管的栅极为所述第二下拉模块的第五端，所述第十八晶体管的第二极为所述第二下拉模块的第四端； 所述第十五晶体管，用于在自身的栅极为高电平时开启，将复位信号传输至所述第二下拉模块的第二端，在自身的栅极为低电平时关断； 所述第十六晶体管，用于在所述第二下拉模块的第二端为高电平时开启，将复位信号端接收到的信号传输至所述第十五晶体管的栅极，并在所述第二下拉模块的第二端为低电平时关断； 所述第十七晶体管，用于在自身的栅极为高电平时开启，将复位信号端接收到的信号传输至所述移位寄存单元的输出端，并在自身的栅极为低电平时关断； 所述第十八晶体管，用于在时钟信号端为高电平时开启，将复位信号端接收到的信号传输至所述移位寄存单元的输出端，并在时钟信号为低电平时关断。
23.—种显示装置，其特征在于，包括权利要求1~9任一所述的栅极驱动装置。
24.一种显示装置，其特征在于，包括权利要求10或11任一所述的栅极驱动装置。
25.—种显示装置，其特征在于，包括权利要求12~22任一所述的栅极驱动装置。
【文档编号】G09G3/36GK103927960SQ201310749727
【公开日】2014年7月16日 申请日期:2013年12月30日 优先权日:2013年12月30日
【发明者】金慧俊, 夏志强 申请人:上海中航光电子有限公司, 天马微电子股份有限公司