一种有机发光二极管面板、栅极驱动电路及其单元的制作方法_2

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;以及在第二时钟信号%的控制下,下拉所述扫描信号输出端的电压以维持其为低电平。在一个优选的实施例中,扫描信号产生单元31包括输入模块311、第一上拉模块312和第一下拉模块313。第一上拉模块312包括第一控制端Q1,第一上拉模块312的第一控制端Ql获得驱动电压后,将第一时钟信号^传送至扫描信号输出端;具体地,第一上拉模块312可以由晶体管T2和电容Cl实现:电容Cl连接于晶体管T2的控制极与第二极之间;晶体管T2的控制极为上述的第一控制端Q1,晶体管T2的第一极用于输入第一时钟信号\,晶体管T2的第二极连接到扫描信号输出端,用于在晶体管T2被上述驱动电压开启后,当第一时钟信号Va的高电平到来时对扫描信号输出端充电,当第一时钟信号Va的低电平到来时对所述扫描信号输出端放电。输入模块311用于从脉冲信号输入端接收输入的脉冲信号VIN,给第一上位模块312的第一控制端Ql提供上述驱动电压;具体地,输入模块311可以由晶体管Tl实现:晶体管Tl的第一极与控制极都连接到脉冲信号输入端,用于输入脉冲信号VIN,晶体管Tl的第二极连接到第一上拉模块312的第一控制端Q1,用于在脉冲信号Vin的高平电到来时,给第一上拉模块312的第一控制端Ql充电以提供上述的驱动电压。第一下拉模块313用于在第二时钟信号%的控制下,下拉扫描信号输出端的电压以维持其为低电平;具体地,第一下拉模块313可以由晶体管T3和晶体管T4实现:晶体管T3的控制极用于输入第二时钟信号Vb,晶体管T3的第二极连接到低电平源Vss,其中低电平源Vss的电压为',晶体管T3的第一极连接到扫描信号输出端,用于当第二时钟信号%的高电平到来时,通过低电平源Vss对扫描信号输出端放电;晶体管T4的控制极用于输入第二时钟信号VB,晶体管T4的第二极连接到低电平源Vss,晶体管T4的第一极连接到第一控制端Q1,用于当第二时钟信号%的高电平到来时,通过低电平源Vss对第一控制端Ql放电。在另一些优选的实施例中,扫描信号产生单元31还可以包括低电平维持单元314,用于在发光信号Vem的控制下,将第一控制端Ql和扫描信号输出端的电压下拉并维持在低电平。具体地,扫描信号产生单元31可以由晶体管T5和晶体管T6实现:晶体管T5的控制极连接到发光信号输出端,用于输入发光信号VEM,晶体管T5的第二极连接到低电平源Vss,晶体管T5的第一极连接到扫描信号输出端,用于当发光信号Vem高电平到来时,通过低电平源Vss对扫描信号输出端放电以维持扫描信号输出端的电压为低电平;晶体管T6的控制极连接到发光信号输出端,用于输入发光信号VEM,晶体管T6的第二极连接到低电平源Vss,晶体管T6的第一极连接到上述第一控制端Q1,用于当发光信号Vem的高电平到来时,通过低电平源Vss对第一控制端Ql放电以维持第一控制端Ql的电压为低电平。
[0054]发光信号产生单元32在脉冲信号Vin的控制下,下拉发光信号输出端的电压;以及在第二时钟信号%的控制下,对发光信号输出端进行充电。在一个优选的实施例中,发光信号产生单元32包括第二控制端Q2、第二上拉模块321和第二下拉模块322。第二控制端Q2用于获得驱动电压后,驱动第二上拉模块321将发光信号输出端的电压上拉并维持。第二上拉模块321用于在第二时钟信号%的高电平到来时,对第二控制端Q2进行充电以提供上述的驱动电压;具体地,第二上拉模块321可以由晶体管T7和晶体管T8实现:晶体管T8的控制极用于输入第二时钟信号VB,晶体管T8的第一极连接到高电平源VDD,其中高电平源Vdd的电压为V H,晶体管T8的第二极连接到第二控制端Q2,用于在第二时钟信号Vb的高电平到来时,对第二控制端Q2进行充电以提供上述驱动电压;晶体管T7的控制极连接到第二控制端Q2,晶体管T7的第一极连接到高电平源VDD,晶体管T7的第二极连接到发光信号输出端,用于在晶体管T7被上述驱动电压开启后,通过高电平源Vdd对发光信号输出端充电。第二下拉模块322用于在脉冲信号Vin的高电平到来时,将发光信号输出端和第二控制端Q2的电压下拉;具体地,第二下拉模块322可以由晶体管T9和晶体管TlO实现:晶体管T9的控制极连接到脉冲信号输入端,用于输入脉冲信号VIN,晶体管T9的第二极连接到低电平源Vss,晶体管T9的第一极连接到发光信号输出端,用于在输入的脉冲信号Vin的高电平到来时,通过低电平源Vss下拉发光信号输出端的电压;晶体管TlO的控制极连接到脉冲信号输入端,用于输入脉冲信号VIN,晶体管TlO的第二极连接到低电平源Vss,晶体管TlO的第一极连接到上述第二控制端Q2,用于在输入脉冲信号Vin的高电平到来时,通过低电平源Vss下拉第二控制端Q2的电压。
[0055]请参照图4,为本实施例的栅极驱动电路单元的几种工作时序图,以分别提供图2所示的几种工作时序图。本实施例的栅极驱动电路单元的各信号可以如下配置:第一时钟信号Va和第二时钟信号Vb为周期和占空比相同、相位不同的时钟信号;第一时钟信号乂4的高电平的上升沿超前于第二时钟信号Vb的高电平的上升沿;脉冲信号V IN的高电平的上升沿超前于第一时钟信号Va的高电平的上升沿,脉冲信号Vin的高电平的下降沿超前于第二时钟信号Vb的高电平的上升沿。
[0056]本实施例的栅极驱动电路单元的工作过程分为四个阶段:预充阶段P1、上拉阶段P2、下拉阶段P3和电平维持阶段P4。
[0057]下面中妨以图4(a)所示的一种工作时序图来具体说明上述的四个阶段。在本工作时序图中,第一时钟信号V+和第二时钟信号Vb的脉冲宽度为2T,且高电平脉冲交叠宽度为T的时间;脉冲信号Vin的脉冲宽度为T。由图中可以看出,脉冲信号V IN与扫描信号V sran具有相同的脉冲宽度T且脉冲不交叠。下面具体描述。
[0058]1、预充阶段Pl
[0059]在tl时刻,脉冲信号Vin上升为高电平Vh,第二时钟信号Vb下降为低电平因此控制极与第二时钟信号输入端相连的晶体管T3、晶体管T4和晶体管T8被关断,晶体管Tl导通并对第一控制端Ql充电,第一控制端Ql的电压被充电至Vh-Vthi,其中Vthi为晶体管Tl的阈值电压。控制端Ql被充电后,获得驱动电压,使晶体管T2被开启导通,此时第一时钟信号^为低电平,因此晶体管T2将第一时钟信号Va的低电平传递至扫描信号输出端,使扫描信号入_为低电平V Lο
[0060]在tl时刻,如上所述,脉冲信号Vin上升为高电平VH,因此晶体管T9和晶体管TlO导通,将第二控制端Q2和发光信号输出端的电压下拉至低电平\。
[0061]2、上拉阶段P2
[0062]在t2时刻,第一时钟信号VA由低电平上升为高电平,通过导通的晶体管T2对扫描信号输出端进行充电,扫描信号Vs_的电压开始上升;随着扫描信号Vscan的电压上升,第一控制端Ql的电压因自举被耦合至更高的电压Vqimax,第一控制端Ql因自举而被耦合至更高的电压,又反过来增大了晶体管T2的驱动能力,使扫描信号&_可以快速的上升至高电平VH。
[0063]3、下拉阶段P3
[0064]在t3时刻,脉冲信号Vin由高电平下降为低电平,晶体管Tl、晶体管T9和晶体管TlO被关断。在t3时刻,第二时钟信号Vb的电压由低电平上升为高电平,晶体管T3和晶体管T4被开启导通,从而将第一控制端Ql和扫描信号输出端的电压下拉至低电平需要说明的是,虽然此时第一时钟信号Va仍然为高电平,但是因第一控制端Ql的电荷通过晶体管T4快速的释放时晶体管T2也被快速地关断,因此,扫描信号输出端的电压可以被晶体管T3快速地下拉。
[0065]如上所述,在t3时刻,第二时钟信号%的电压由低电平上升为高电平,因此晶体管T8导通,高电平源Vdd通过晶体管T8对第二控制端Q2进行充电,当第二控制端Q2的电压上升至大于晶体管T7的阈值电压Vth7时,晶体管T7被开启导通,高电平源Vdd开始通过晶体管T7对发光信号输出端进行充电,因此发光信号Vem的电压开始上升。需要说明的是,如前所述,由于发光信号输出端一般连接有较大的RC负载,因此发光信号Vem的上升时间一般较长。而本实施例中,当第二控制端Q2的电压被快速地充电至Vh-Vth8时,此时晶体管T8的控制极电压为VH,而第二极的电压为VH-VTH8,因此晶体管T8被判断,第二控制端Q2处于浮空状态。随着发光信号Vem的电压的上升,第二控制端Q2的电压因自举被抬升到比乂11更高的电压VQ2 mx,这又反过来增加了晶体管T7的驱动能力,从而加速了发光信号输出端的充电速度,使发光信号Vem的电压可以被加速充电,并且可以被充电至高电平V H。
[0066]4、电平维持阶段P4
[0067]经过t3时刻及t3时刻后的极短一段时间,此时进入电平维持阶段P4。在下拉阶段P3之后,扫描信号Vs_的电压需要被长期维持在低电平V μ以防止与扫描信号输出端相连的像素驱动电路中的晶体管被误开启导通,从而导致数据信号写入错误。然后,由于在晶体管T2的控制极和第一极之间存在寄生电容,随着第一时钟信号Va的高电平脉冲周期性地不断到来,这会在第一控制端Ql和扫描信号输出端产生较大的噪声电压。当第一控制端Ql的噪声电压大于晶体管T2的阈值电压时,会导致晶体管T2被误开启导通,进而导致第一时钟信号Va的高电平脉冲对扫描信号输出端误充电,使扫描信号V sc;an的低电平难以维持。
[0068]因此,本实施例引入低电平维持模块314来对第一控制端Ql以及扫描信号输出端的低电平进行维持。具体地,当发光信号Vem上升为高电平后,晶体管T5和晶体管T6被开启导通,从而通过低电平源Vss将第一控制端Ql和扫描信号输出端的电压始终维持在低电平;在脉冲信号Vin的下一个高电平到来之前,发光信号V ^始终为高电平,从而使晶体管T5和晶体管T6始终处于导通状态,从而使第一控制端Q
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