专利名称:半导体器件的晶体管及其制造方法
技术领域：
本发明涉及一种半导体器件的晶体管及其制造方法。
背景技术：
目前，由于根据半导体器件的高度集成而最小化的趋势使得晶体管的宽度持续变窄。
因此在晶体管内部会发生热载流子效应。相对于外部施加的电压而言当沟道长度变得更短时，水平电场会高度集中于漏极区从而使漏极区的电学特性退化并产生空穴，且这里，热载流子效应表明空穴朝向衬底移动。
另一方面，电子在栅极氧化物膜或间隔件下方被截留，从而影响阈值电压。
当高电场施加到半导体衬底的沟道上时，热载流子效应变得更严重，这是因为尽管沟道长度变得更短，但是对于特定的应用而言，电源电压相对恒定。
特别是，作为源极区和漏极区之间的输送路径的沟道长度越短，所发生的热载流子效应越严重。
为了克服热载流子效应，大部分晶体管制造工艺采用LDD(轻掺杂漏极)结构。该结构具有缓变结，在该处源极/漏极区内的离子注入密度在栅电极的边缘低，在栅电极的中心高，由此降低了电场突变。
然而，由于半导体器件的高度集成使得沟道长度持续变得更短，因此具有LDD结构的晶体管将导致短沟道效应。于是，LDD区内的掺杂剂将扩散到沟道，且将高电场施加在漏极之间的沟道边缘，这将导致使晶体管性能退化的热载流子效应。
此外，在晶体管的操作过程中，源极区和漏极区内的杂质横向扩散，且晶体管容易遭受击穿效应，从而使得难以进行用于防止击穿效应的离子注入工艺。而且，当沟道长度和密度控制不精确时，将难以控制阈值电压。
发明内容因此，本发明涉及一种半导体器件的晶体管及其制造方法，其基本上消除了由于现有技术的局限和缺陷而引起的一个或多个问题。
本发明的目的是提供一种半导体器件的晶体管及其制造方法，其通过制造纵向晶体管(vertical transistor)可有效地控制短沟道效应，并可以防止由于热载流子效应的产生而引起的晶体管性能的退化。
本发明的其他优点、目的和特征将部分地在以下的说明书中描述，其部分内容对于本领域的普通技术人员来说可通过下述描述而清楚或者从本发明的实践中获得。通过所撰写的说明书及其权利要求
书以及附图中具体指出的结构，可以实现和获得本发明的目的及其他优点。
为了实现这些目的及其他优点并根据本发明的目的，如在此具体实施和广泛描述的，本发明提供了一种半导体器件的晶体管，其包括源极区，其通过在半导体衬底的上侧注入杂质离子而形成；沟道区，其位于该源极区上并形成为圆柱形；漏极区，其形成于该沟道区上；栅极绝缘层，其围绕形成于该半导体衬底的上侧的源极区、该沟道区的侧面以及形成于该沟道区的上侧的该漏极区；栅极导体，其形成为围绕该沟道区的上部和一个侧面；以及导电层，其连接到该源极区、该漏极区和该栅极导体，并通过填充形成于中间绝缘膜(intercalary insulation film)上的接触孔而形成。
优选地，该沟道区由导电层组成。
优选地，该源极区通过在该沟道区上注入杂质离子而形成。
在本发明的另一个实施例中，提供了一种半导体器件的晶体管，其包括漏极区，其通过在半导体衬底的上侧注入杂质离子而形成；沟道区，其位于该漏极区上并形成为圆柱形；源极区，其形成于该沟道区上；栅极绝缘层，其围绕形成于该半导体衬底的上侧的漏极区、该沟道区的侧面以及形成于该沟道区的上侧的该源极区；栅极导体，其形成为围绕该沟道区的上部和一个侧面；以及导电层，其连接到该源极区、该漏极区和该栅极导体，并通过填充形成于中间绝缘膜上的接触孔而形成。
优选地，该沟道区由导电层组成。
优选地，该源极区通过在该沟道区上注入杂质离子而形成。
在本发明的另一个实施例中，提供了一种半导体器件的晶体管的制造方法，其包括在半导体衬底上通过第一离子注入工艺而形成第一源极/漏极区；在其上形成该第一源极/漏极区的该半导体衬底上沉积第一牺牲层，并且干蚀刻该第一牺牲层的一部分以露出该源极/漏极区；在该第一牺牲层上沉积第一导电层并对其进行平坦化，以形成填充该孔的沟道区；使用湿蚀刻方法除去该第一牺牲层；在该第一源极/漏极区和该沟道区上形成第二牺牲层；在该沟道区的形成该第二牺牲层的位置上进行第二离子注入工艺；使用湿蚀刻方法除去该第二牺牲层；依次形成该第一源极/漏极区、该沟道区上的栅极绝缘层以及该栅极导电层；干蚀刻该栅极导电层以形成围绕该沟道区的上部和一个侧面的栅极导体；在该半导体衬底上注入离子以形成该沟道区上的第二源极/漏极区；在该半导体衬底上形成中间绝缘层；蚀刻该中间绝缘层以形成露出该第一和第二源极/漏极区和该栅极导体的一部分的接触孔；以及在该中间绝缘层的形成该接触孔的位置上沉积第二导电层并对其进行图案化。
优选地，用于形成该沟道区的平坦化工艺为CMP工艺。
该第二牺牲层用作缓冲层以在注入离子时保护该半导体衬底。
在用于蚀刻该栅极导电层以形成该栅极导体的蚀刻工艺中，该栅极绝缘层用作蚀刻停止层。
该第二离子注入用于控制将要形成于该半导体衬底上的晶体管的阈值电压。
通过以30°至60°的角度对该沟道区的侧面进行注入来进行该第二离子注入工艺。
该第一牺牲层形成为其厚度与该晶体管的沟道长度相同。
应该理解，对本发明的前述概括描述和以下详细描述是示范性和解释性的，其旨在提供对所主张的本发明的进一步解释。
附图包含在本说明书中以提供对本发明的进一步理解，其并入本申请中并构成本申请的一部分，所述附图示出了本发明的实施例并且与说明书一起用于解释本发明的原理。附图中
图1至图9示出了根据本发明的一个实施例的半导体器件的晶体管的制造工艺。
具体实施方式以下将参照附图所示的实例对本发明的优选实施例进行详细地描述。在所有附图中尽可能地使用相同的附图标记表示相同或相似的部分。
图中，放大各层和各区域的厚度以清楚地将其示出。在整个说明书中，相同的部分用相同的附图标记表示。一个部分存在于层、膜、区域、表面等“之上”的表达包括在其“直接上方”或更高的位置。一个部分存在于另一个部分“直接上方”的表达是指该两个部分直接接触。
图1至图9示出了根据本发明的一个实施例的半导体器件的晶体管的制造工艺。
参照图1，杂质离子注入到半导体衬底10上以形成第一源极/漏极区30。
如图2所示，在形成第一源极/漏极区30的半导体衬底10上沉积第一牺牲层50，位于第一牺牲层50上的第一光致抗蚀剂图案100露出沟道区。并且使用第一光致抗蚀剂图案100作为掩模对该第一牺牲层50进行干蚀刻以形成用于形成沟道区的孔(图3中的附图标记“70”所示)，并除去该第一光致抗蚀剂图案100。这里，第一牺牲层50的长度与通过本发明制造的晶体管的沟道长度相同。
如图3所示，在第一牺牲层50上沉积第一导电层，并通过使用CMP(化学机械抛光)对第一导电层进行平坦化以形成填充到该孔的内部的沟道区90。这里，在沟道区90内形成根据本发明的晶体管的沟道。优选地，进行化学机械抛光直到露出第一牺牲层50。
如图4所示，使用湿蚀刻方法完全除去第一牺牲层50，并且在第一源极/漏极区30和沟道区90上形成第二牺牲层110。该第二牺牲层110通过氧化而形成。此外，进行离子注入工艺以控制待形成的晶体管的阈值电压。这里，第二牺牲层110作为缓冲层用于在离子注入中保护该衬底。另外，通过以30°至60°的角度对该沟道区的侧面进行注入来进行该离子注入工艺。
如图5所示，通过使用湿蚀刻方法除去该第二牺牲层110，并且在第一源极/漏极区30和沟道区90上形成栅极绝缘层130，且在栅极绝缘层130上形成栅极导电层150。此外，在栅极导电层150的上部和一个侧面形成第二光致抗蚀剂图案200。
如图6所示，使用第二光致抗蚀剂图案200作为掩模干蚀刻该栅极导电层150，以形成围绕该沟道区90的一个侧向的栅极导体170。该栅极绝缘层130用作蚀刻停止层。通过对栅极导电层150进行蚀刻，在沟道区90的另一侧保留该栅极导电层150的一部分。之后除去该第二光致抗蚀剂图案200。并且随后在通过上述工艺形成的衬底上进行离子注入，从而在沟道区上形成第二源极/漏极区210。
如图7所示，在该衬底上形成中间绝缘层230，并形成第三光致抗蚀剂图案300以露出形成接触孔的上部区。
如图8所示，以第三光致抗蚀剂图案300作为掩模蚀刻该中间绝缘层230和栅极绝缘层130，从而在露出该第一和第二源极/漏极区的一部分和该栅极导体的一部分之后，除去该第三光致抗蚀剂图案300。
如图9所示，在中间绝缘层230以及形成于中间绝缘层230上的接触孔上沉积第二导电层并对其进行图案化，从而形成用于连接到栅极、源极和漏极的第二导体250。
在该半导体器件的晶体管中，第一源极/漏极区30和第二源极/漏极区210的其中的一个作为源极，另一个作为漏极。此外，沟道区90为用于形成晶体管的沟道的区域，栅极导体170为栅极，且该栅极、源极和漏极通过第二导体250连接到外部。
因此，根据本发明的半导体器件的晶体管具有纵向形状，并且能够控制有效沟道的长度，使其比传统晶体管的沟道长度更长，从而减少短沟道效应。因此，通过有效地控制短沟道效应，可以形成高度集成的半导体器件的晶体管。
通过制造纵向晶体管并通过增加有效沟道的长度，可以有效地控制短沟道效应，且可以防止由于热载流子效应引起的晶体管性能退化，于是可以形成根据本发明的高度集成的半导体器件的晶体管。
对本领域技术人员来说显而易见的是，可以对本发明进行各种修改和变化。因此，本发明旨在覆盖这些修改和变化，只要其落在所附权利要求
书及其等同特征的范围内。
权利要求
1.一种半导体器件的晶体管，包括源极区，其通过在半导体衬底的上侧注入杂质离子而形成；沟道区，其位于该源极区上并形成为圆柱形；漏极区，其形成于该沟道区上；栅极绝缘层，其围绕形成于该半导体衬底的上侧的源极区、该沟道区的侧面以及形成于该沟道区的上侧的该漏极区；栅极导体，其形成为围绕该沟道区的上部和一个侧面；以及导电层，其连接到该源极区、该漏极区和该栅极导体，并通过填充形成于中间绝缘膜上的接触孔而形成。
2.一种半导体器件的晶体管，包括漏极区，其通过在半导体衬底的上侧注入杂质离子而形成；沟道区，其位于该漏极区上并形成为圆柱形；源极区，其形成于该沟道区上；栅极绝缘层，其围绕形成于该半导体衬底的上侧的漏极区、该沟道区的侧面以及形成于该沟道区的上侧的该源极区；栅极导体，其形成为围绕该沟道区的上部和一个侧面；以及导电层，其连接到该源极区、该漏极区和该栅极导体，并通过填充形成于中间绝缘膜上的接触孔而形成。
3.根据权利要求
1或2所述的半导体器件的晶体管，其中该沟道区由导电层组成。
4.根据权利要求
1或2所述的半导体器件的晶体管，其中该漏极区通过在该沟道区上注入杂质离子而形成。
5.根据权利要求
1或2所述的半导体器件的晶体管，其中该源极区通过在该沟道区上注入杂质离子而形成。
6.一种半导体器件的晶体管的制造方法，包括在半导体衬底上通过第一离子注入工艺形成第一源极/漏极区；在其上形成该第一源极/漏极区的该半导体衬底上沉积第一牺牲层，并且干蚀刻该第一牺牲层的一部分以露出该源极/漏极区；在该第一牺牲层上沉积第一导电层并对其进行平坦化，以形成填充孔的沟道区；使用湿蚀刻方法除去该第一牺牲层；在该第一源极/漏极区和该沟道区上形成第二牺牲层；在该沟道区上的形成该第二牺牲层的位置进行第二离子注入工艺；使用湿蚀刻方法除去该第二牺牲层；依次形成该第一源极/漏极区、该沟道区上的栅极绝缘层以及该栅极导电层；干蚀刻该栅极导电层以形成围绕该沟道区的上部和一个侧面的栅极导体；在该半导体衬底上注入离子以在该沟道区上形成第二源极/漏极区；在该半导体衬底上形成中间绝缘层；蚀刻该中间绝缘层以形成露出该第一和第二源极/漏极区和该栅极导体的一部分的接触孔；以及在该中间绝缘层的形成该接触孔的位置上沉积第二导电层并对其进行图案化。
7.根据权利要求
6所述的制造方法，其中用于形成该沟道区的平坦化工艺为化学机械抛光工艺。
8.根据权利要求
6所述的制造方法，其中该第二牺牲层用作缓冲层以在注入离子时保护该半导体衬底。
9.根据权利要求
6所述的制造方法，其中在用于蚀刻该栅极导电层以形成该栅极导体的蚀刻工艺中，该栅极绝缘层用作蚀刻停止层。
10.根据权利要求
6所述的制造方法，其中该第二离子注入用于控制将要形成于该半导体衬底上的晶体管的阈值电压。
11.根据权利要求
6所述的制造方法，其中该第二离子注入工艺通过以30°至60°的角度对该沟道区的侧面进行注入来进行。
12.根据权利要求
6所述的制造方法，其中该第一牺牲层形成为其厚度与该晶体管的沟道长度相同。
专利摘要
一种半导体器件的晶体管及其制造方法，该方法包括在半导体衬底上通过第一离子注入工艺形成第一源极/漏极区；在半导体衬底上沉积第一牺牲层并干蚀刻一部分以露出源极/漏极区；形成填充孔的沟道区；在第一源极/漏极区和沟道区上形成第二牺牲层；在沟道区上形成第二牺牲层处进行第二离子注入工艺；使用湿蚀刻方法除去第二牺牲层；依次形成第一源极/漏极区、沟道区上的栅极绝缘层及栅极导电层；干蚀刻栅极导电层以形成围绕沟道区上部和一个侧面的栅极导体；在半导体衬底上注入离子以在沟道区上形成第二源极/漏极区；在半导体衬底上形成中间绝缘层；蚀刻中间绝缘层以形成露出第一和第二源极/漏极区及栅极导体一部分的接触孔；形成第二导电层。
文档编号H01L29/423GK1992344SQ200610170200
公开日2007年7月4日 申请日期2006年12月25日
发明者朴正浩 申请人:东部电子股份有限公司导出引文BiBTeX, EndNote, RefMan